JP5314936B2 - 表示装置および表示装置駆動回路 - Google Patents
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Description
まず、本発明の実施の形態1に係る表示装置駆動回路で行う画像伸張処理の概要について、図1を用いて簡単に説明を行う。本実施の形態では、バックライト電力を下げるために、図1に示す操作を行う。図1(a)は、本実施の形態の表示装置駆動回路の入力階調と出力階調の関係を示す図である。図1(b)は、表示画像のヒストグラムを示す図である。図1(b)に示すように、表示画像において、t階調301以上、最大階調(255階調)以下であるピクセルの数が、全ピクセル数のp%302であるt階調301をスレッシュホールド階調t301と呼ぶ。図1(b)上で、階調0と階調tの間にある階調z302を考える。
次に、本発明の実施の形態2に係る表示装置について、図3を用いて説明する。実施の形態1では、階調z以上の各階調に対するカウンタが必要となり、回路規模が大きくなってしまう。実施の形態2では、本質的に実施の形態1と同じであるが、省回路規模化を考慮した方式について説明を行う。図3(b)は図1(b)と同じ絵であり、表示画像のヒストグラムを示す図である。
次に、本発明の実施の形態3に係る表示装置について、図4〜図7を用いて説明する。図4は本発明の実施の形態3に係る表示装置のブロック図である。実施の形態3は、実施の形態1とほとんど同じであるが、ピクセル伸張回路109で行う階調の伸張演算が異なる。
次に、本発明の実施の形態4に係る表示装置について図8および図9を用いて説明する。図8は本発明の実施の形態4に係る表示装置のブロック図である。実施の形態4は、実施の形態3と比較して、スレッシュホールド階調t301の下限値を設定するスレッシュホールド階調下限値設定レジスタ401を備え、CPU102がαを直接設定しない点が、実施の形態3と異なっているが、他は、実施の形態3と同様である。
次に、本発明の実施の形態5に係る表示装置について図10、図11を用いて説明する。図10は本発明の実施の形態5に係る表示装置のブロック図である。実施の形態5も、2つの1次関数をα402に基づいて決定して表示画像の変換(伸張)を行う点では、実施の形態3、4と同じではあるが、αの決定方法が異なる。
次に、本発明の実施の形態6に係る表示装置について図12、図13を用いて説明する。図12は本発明の実施の形態6に係る表示装置のブロック図である。実施の形態6も、2つの1次関数をα402に基づいて決定して表示画像の変換(伸張)を行う点では、実施の形態3〜5と同じではあるが、αの決定方法が異なる。
次に、発明の実施の形態7に係る表示装置について、図14および図15を用いて説明する。図14は本発明の実施の形態7に係る表示装置のブロック図である。実施の形態7は、実施の形態5と同じく、画面全体の表示画像のヒストグラムだけでなく、表示画像を分割し、分割した領域毎のヒストグラムを生成し、領域毎のスレッシュホールド階調と、画面全体の表示画像のヒストグラムから得られたスレッシュホールド階調を計算するという点では、実施の形態5と類似している。
次に、発明の実施の形態8に係る表示装置について、図15および図16を用いて説明する。図16は本発明の実施の形態8に係る表示装置のブロック図である。実施の形態8は、図15に示すように、スレッシュホールド階調値をtとおくと、座標(0,0)と(t,255)を結ぶ直線によって現される1次関数により、入力階調t以下は変換し、入力階調t以上は255階調に変換する。
次に、本発明の実施の形態9に係る表示装置駆動回路で行う画像伸張処理の概要について図17を用いて説明する。図17は本発明の実施の形態9に係る表示装置駆動回路で行う画像伸張処理を説明するためのピクセル値変換器の構成を示す構成図である。実施の形態9では、変換回路となる実施の形態1のピクセル伸張回路109を以下のように変更する。
次に、本発明の実施の形態10に係る表示装置駆動回路で行う画像伸張処理の概要について説明する。実施の形態10では、実施の形態2のピクセル伸張回路を以下のように変更する。
以下、図21より、本発明の実施の形態11に係る表示装置駆動回路における係数決定方式について、実施の形態2との違いを詳細に説明する。図21は本発明の実施の形態11に係る表示装置駆動回路の係数演算回路周辺図である。
Claims (15)
- 1または複数のフレーム分の入力表示画像データの階調ごとの画素数の累計値の分布の一部を階調方向に伸張するように入力表示画像データを変換し、変換された表示画像データを表示装置に表示する表示装置駆動回路において、
前記表示画像データの階調が特定階調より小さい階調である場合、1次関数に従って変換し、前記表示画像データの階調が前記特定階調以上の場合、前記表示画像データの特定階調以上の階調ごとの画素数の累計値に従った階調に変換し、
前記表示画像データの階調が前記特定階調以上の場合に用いられる変換方式は、ヒストグラムイコライゼーションであることを特徴とする表示装置駆動回路。 - 請求項1記載の表示装置駆動回路において、
前記表示画像データの階調ごとの画素数を計測し、最大階調からの累計値が全画素数の一定割合に達した閾値階調を算出する算出回路を備え、
前記特定階調は前記閾値階調より小さい階調であり、前記特定階調と前記閾値階調の差と前記特定階調と表示装置の表示可能な最大階調の差の比を設定するレジスタを有することを特徴とする表示装置駆動回路。 - 請求項1記載の表示装置駆動回路において、
前記表示画像データの階調ごとの画素数を計測し、最大階調からの累計値が全画素数の一定割合に達した閾値階調を算出する算出回路を備え、
前記特定階調は、前記閾値階調であることを特徴とする表示装置駆動回路。 - 請求項3記載の表示装置駆動回路において、
前記1次関数は前記閾値階調を入力した時にある第2の特定階調を出力する1次関数であり、
前記閾値階調と前記第2の特定階調の差と前記閾値階調と表示装置の表示可能な最大階調の差の比を設定するレジスタを有することを特徴とする表示装置駆動回路。 - 請求項1記載の表示装置駆動回路において、
伸張方式を切り替えるレジスタを持ち、
該レジスタが第1の状態の場合には、前記表示画像データの階調が前記特定階調より小さい階調である場合、第1の1次関数に従って変換し、前記表示画像データの階調が前記特定階調以上の場合、前記表示画像データの特定階調以上の階調ごとの画素数の累計値に従った階調に変換し、
該レジスタが第2の状態の場合には、前記表示画像データの階調が前記特定階調以下の場合、第1の1次関数に従って変換し、前記表示画像データの階調が前記特定階調以上の場合、異なる第2の1次関数に従って変換することを特徴とする表示装置駆動回路。 - 請求項1記載の表示装置駆動回路において、
表示画像データの階調ごとの画素数を計測し、最大階調からの累計値が全画素数の一定割合に達した閾値階調を算出する算出回路を備え、
前記算出回路は、前記表示画像データを複数の領域に分割し、領域毎の階調ごとの画素数を計測し、最大階調からの累計値が、各領域の全画素数の一定割合に達した領域毎閾値階調を算出し、
前記特定階調と前記閾値階調の差と前記特定階調と表示装置の表示可能な最大階調の差の比は、前記複数の領域毎閾値階調の最大値に従って決定されることを特徴とする表示装置駆動回路。 - 請求項3記載の表示装置駆動回路において、
前記算出回路は、前記表示画像データを複数の領域に分割し、領域毎の階調ごとの画素数を計測し、最大階調からの累計値が、各領域の全画素数の一定割合に達した領域毎閾値階調を算出し、
前記1次関数は前記閾値階調を入力した時にある第2の特定階調を出力する1次関数であり、
前記閾値階調と第2の特定階調の差と前記閾値階調と表示装置の表示可能な最大階調の差の比は、前記複数の領域毎閾値階調の最大値に従って決定されることを特徴とする表示装置駆動回路。 - 請求項6または7記載の表示装置駆動回路において、
領域の分割数を設定するレジスタを有することを特徴とする表示装置駆動回路。 - 請求項1記載の表示装置駆動回路において、
前記表示画像データの階調ごとの画素数を計測し、最大階調からの累計値が、全画素数の一定割合に達した第1の閾値階調を算出する第1の算出回路と、
隣接画素との差分が一定値以上である前記表示画像データの階調ごとの画素数を計測し、最大階調からの累計値が、全画素数の第2の一定割合に達した第2の閾値階調を算出する第2の算出回路とを備え、
前記特定階調と前記閾値階調の差と前記特定階調と表示装置の表示可能な最大階調の差の比は、前記第2の閾値階調に従って決定されることを特徴とする表示装置駆動回路。 - 請求項3記載の表示装置駆動回路において、
隣接画素との差分が一定値以上である前記表示画像データの階調ごとの画素数を計測し、最大階調からの累計値が、全画素数の第2の一定割合に達した第2の閾値階調を算出する第2の算出回路を備え、
第1の1次関数に閾値階調を入力した時の出力階調がある特定階調であり、該特定階調は該表示装置の表示可能な最大階調以下、前記閾値階調以上である階調であり、
該最大階調と該閾値階調の差と該特定階調と該閾値階調の差の比は、前記第2の閾値階調に従って決定されることを特徴とする表示装置駆動回路。 - 請求項1、3、5、6、7、9、または10記載の表示装置駆動回路を有することを特徴とする表示装置。
- 請求項1記載の表示装置駆動回路において、
前記表示画像データの特定階調以上の階調ごとの画素数の累計値の計数時に別な特定階調X1以上の階調については計数せず除外するよう動作し、この結果の累計値に従った階調に変換することを特徴とする表示装置駆動回路。 - 請求項1記載の表示装置駆動回路において、
前記ヒストグラムイコライゼーションの変換において特定階調X1以上の階調については除外し、全て最大階調への変換とすることを特徴とする表示装置駆動回路。 - 請求項12または13記載の表示装置駆動回路において、
前記特定階調X1を設定するレジスタを有することを特徴とする表示装置駆動回路。 - 請求項12、13、または14記載の表示装置駆動回路を有することを特徴とする表示装置。
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