JP5306081B2 - 信号処理回路 - Google Patents
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Description
ABPCORG={ORG×EV+ABPC(α1−EV)}/α2
(ただしα1、α2はそれぞれ正の整数で、かつα1≦α2)
に従って重み付け加算を行なうことを特徴する。
図1及び図2はそれぞれ本発明の第1の実施形態に係る信号処理回路、及びこの信号処理回路が用いられる固体撮像装置の構成を示している。
図1に示す信号処理回路は、プリγ補正回路31、4Hラインメモリ32、キズ補正処理ブロック33、ノイズリダクション回路34、及び逆γ補正回路35等により構成されている。
(ただし255=α1、256=α2であり、α1<α2である)
なお、エッジ調整回路43内のクリップ回路53は、調整後のエッジ信号EV´のビット数を、重み付け加算回路44内の乗算器54、55に入力される乗算係数のビット数に合わせるために設けられている。例えば、乗算器54、55の係数入力が8ビットの場合、クリップ回路53はエッジ信号EV´のビット数が8ビット以上の時はそのビット数を8ビットにクリップして重み付け加算回路44に出力する。従って、エッジ信号EV´のビット数が8ビットの場合、クリップ回路53は省略できる。
白キズ判定は以下のように行われる。
(a)補正対象の中心画素(R22)の信号レベルと正常画素である同色8画素の中の最大信号レベル(8番目)の差を求め、図7に示すように中心画素(R22)の信号レベルの方が大きかった場合、白キズと判定する。
(c)補正対象の中心画素(R22)の信号レベルと正常画素である同色8画素の中の最小信号レベル(1番目)の差を求め、図7に示すように中心画素(R22)の信号レベルの方が小さかった場合、黒キズと判定する。
図8は、第2の実施形態におけるキズ補正処理ブロック33の要部の具体的な回路構成を示している。本実施形態のキズ補正処理ブロック33が図3に示す第1の実施形態におけるキズ補正処理ブロックと異なる点は、クリップ回路53はクリップ前の値が0(EV´=0)の場合に1にクリップ(EV´=1)する点と、重み付け加算回路44において、クリップ後のエッジ信号EV´の反転信号(補数信号)に1を加算する加算器57が追加されている点である。したがって、クリップ後のエッジ信号EV´が取り得る値の範囲は1≦EV´≦255であり、乗算器55はキズ補正信号ABPCと加算器57の出力との乗算を行なう。
(ただし256=α1=α2である)
このため、重み付け加算回路44の出力である加算出力信号ABPCORGは、補正対象となる画素の元の信号とキズ補正信号の両方の出力を必ず使用する。
第1の実施形態において、EV´=255の場合、ABPCORG=ORGとなり、重み付け加算回路44の出力は補正対象となる画素の元の信号となる。すなわち、上記のようにEV´=255の場合、重み付け加算回路44の出力は補正対象となる画素の元の信号そのものとなり、キズ補正回路42の出力は重み付け加算回路44で使用されない。
Claims (4)
- 補正対象となる画素の周辺に存在する複数の画素の信号から最大信号レベル及び最小信号レベルを抽出し、かつ前記最大信号レベルと最小信号レベルの差分を生成する信号レベル比較回路と、
補正対象となる画素の信号を前記信号レベル比較回路で抽出された前記最大信号レベル及び最小信号レベルと比較して補正対象となる画素が白キズまたは黒キズであるか否かを判定し、この判定結果に従って補正対象となる画素のキズ補正を行うキズ補正回路と、
前記補正対象となる画素の元の信号と前記キズ補正回路によりキズ補正された後の画素の信号とを前記信号レベル比較回路で生成された差分に基づいて重み付けを変えて加算する重み付け加算回路と
を具備し、
前記重み付け加算回路は、前記信号レベル比較回路で生成された差分をEV、前記補正対象となる画素の元の信号をORG、前記キズ補正回路によりキズ補正された後の画素の信号をABPC、加算出力をABPCORGとした時に、
ABPCORG={ORG×EV+ABPC(α1−EV)}/α2
(ただしα1、α2はそれぞれ正の整数で、かつα1≦α2)
に従って重み付け加算を行なうことを特徴する信号処理回路。 - 前記信号レベル比較回路は、前記補正対象となる画素の周辺に存在する前記補正対象となる画素と同色の複数の画素の信号から前記最大信号レベル及び最小信号レベルを抽出することを特徴とする請求項1記載の信号処理回路。
- 前記キズ補正回路は、前記補正対象となる画素が白キズまたは黒キズであると判定した際に、前記補正対象となる画素の信号を前記最大信号レベルまたは最小信号レベルの画素の信号と置き換えることによってキズ補正を行うことを特徴とする請求項1記載の信号処理回路。
- 前記キズ補正回路は、前記信号レベル比較回路で生成された最大信号レベルと最小信号レベルの差分が一定の閾値よりも大きい場合には前記キズ補正を行わないことを特徴とする請求項1記載の信号処理回路。
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