JP5248104B2 - Cpu搭載asicを備える検出センサ - Google Patents
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Description
図1に示すように、本実施形態において、検出センサとしての光電センサ1は、所謂反射型の光電センサであって、生産ラインのコンベアによって搬送されるワーク等の被検出物4に光を照射する投光手段3と、前記被検出物4に入反射された光を受光する受光手段5と、前記投光手段3及び受光手段5の動作を制御する制御手段としてのCPU搭載ASIC2(CPU:中央演算処理装置、ASIC:特定用途向け集積回路)とを備えている。
即ち、図1に示すように、各光電センサ1において、前記駆動回路6から制御信号が出力され、前記投光手段3において、投光回路3aが作動し、投光素子3bから所定の投光量Eの光が所定の出射タイミングで、被検出物4に向けて照射される。この被検出物4に照射された光は、被検出物4によって反射され、前記受光手段5の受光素子5bによって受光される。そして、該受光素子5bにおいて電気信号に変換される。
(1)被検出物4の有無の判定に関わる判定条件等の設定情報の演算処理、並びに、表示部9に前記設定情報を表示させる表示処理及び被検出物4の有無を表示させる表示処理がCPU搭載ASIC2に搭載されたCPU2a(制御プログラム)によって実行されるとともに、被検出物4の検出処理、及び、外部通信装置101,102と通信を行うための電気信号の演算処理(以下、「通信処理」という。)がCPU搭載ASIC2のロジック回路部2bによって並列演算処理によって実行される。これにより、被検出物4の検出処理、通信処理、及び表示部9に各種情報や機能を表示させる表示処理が並行して実行できるようになり、当該表示処理や通信処理に要する時間に左右されることなく、被検出物4の検出処理を連続的に実行することができるようになる。しかも、ロジック回路部2bにおいては、特定の演算処理を実行するように設計されたロジック回路を用いてハードウェア的に高速処理が可能であるので、被検出物4の検出処理のさらなる高速化にも対応できるようになる。
・上記実施形態では、外部の制御ユニットにより一括制御され、前記階層構造をなす設定情報が前記表示部9に階層毎に1つずつ順番に表示されるように、光電センサ1を互いに通信可能な状態で他の光電センサ1と隣接配置し、このように隣接配置された複数の光電センサ1,…及び前記制御ユニットによりセンサシステムを構成した。しかし、本発明の技術的思想はこれに限られず、図2に示すように、単独で構成され、各種の演算処理を実行するCPU12aと、特定の演算処理を実行するロジック回路部12bとを一体的に搭載するCPU搭載ASIC2を備えるとともに、当該CPU12aは、制御プログラム及び該制御プログラムに必要な各種のデータを格納(記憶)するメモリ12cを有し、同CPU12aには、検出回路7によって検出された被検出物4の有無等を表示する表示部9が接続されている光電センサ10(投光手段3、受光手段5、駆動回路6、及び検出回路7は上記実施形態の光電センサ1と同様に構成されている。)にも適用可能である。
Claims (3)
- 被検出物の状態に応じたレベルの電気信号を出力する出力手段と、該電気信号に基づいて前記被検出物の状態を検出する検出手段と、少なくとも前記検出された被検出物の状態を表示する表示手段とを備えた検出センサであって、
各種の演算処理を実行するCPU(中央演算処理装置)と、特定の演算処理を実行するロジック回路部とを一体的に搭載するCPU搭載ASIC(特定用途向け集積回路)をさらに備え、
前記CPUには、前記表示手段による表示処理を実行させるとともに、
前記ロジック回路部には、前記検出手段による前記被検出物の状態の検出処理を実行させるようにしたことを特徴とする検出センサ。 - 請求項1に記載の検出センサにおいて、
前記検出センサは、該検出センサの制御に用いる各種情報の設定操作を行わせる操作手段をさらに備え、
前記CPUには、前記操作手段により設定された各種情報の演算処理を実行させるようにしたことを特徴とする検出センサ。 - 請求項1又は請求項2に記載の検出センサにおいて、
前記検出センサは、外部との通信に用いる通信手段をさらに備え、
前記ロジック回路部には、前記通信を行うための電気信号の演算処理を実行させるようにしたことを特徴とする検出センサ。
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