JP5202832B2 - Wafer circuit surface protection method and wafer thinning method - Google Patents

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Description

本発明は、ハイバンプが設けられたウエハ回路面をテープ保護する方法及びハイバンプが設けられたウエハを薄化する方法に関する。   The present invention relates to a method for tape-protecting a wafer circuit surface provided with high bumps and a method for thinning a wafer provided with high bumps.

携帯機器の薄型化、小型化、又は軽量化の開発が進むにつれ、機器に組み込まれる半導体チップの更なる薄化が求められるようになってきた。現状、この半導体チップには、厚みを125μm〜150μmにまで薄化したウエハが利用されている。また、一方で、ウエハを25μm〜50μmにまで薄化する開発も進められており、今後の利用が期待されている。   As the development of thinner, smaller, or lighter portable devices has progressed, there has been a demand for further thinner semiconductor chips incorporated in the devices. At present, a wafer having a thickness reduced to 125 μm to 150 μm is used for the semiconductor chip. On the other hand, development for thinning the wafer to 25 μm to 50 μm is also underway, and future use is expected.

ウエハの薄化は、通常、ウエハへIC回路を形成し、その後にウエハ裏面を研削するという工程で行われる。そのため、その研削の際は、予め回路面に保護用テープ(一般的には、バックグラインドテープ、略してBGテープと呼ばれる)を貼り付けておき、その状態でウエハ裏面を研削する。こうすることにより、ウエハ裏面の研削時における回路面の損傷や汚染をその保護用テープで防止することができる。   Thinning of the wafer is usually performed in a process of forming an IC circuit on the wafer and then grinding the back surface of the wafer. Therefore, at the time of grinding, a protective tape (generally called a back grind tape, abbreviated as BG tape) is pasted on the circuit surface in advance, and the wafer back surface is ground in that state. By doing so, damage and contamination of the circuit surface during grinding of the wafer back surface can be prevented with the protective tape.

ところで、近年、凹凸差が0.1〜350μmの配線パターン及び/又はバンプ(突起電極)を回路面に設けたウエハの薄化処理方法が考案されるようになってきた。
この処理方法では、配線パターン及び/又はバンプが形成された回路面に最大で200μmの厚みの粘着剤層を有するシートを貼り付けて回路面を保護する。この粘着剤層は、厚さが200μmを超えると回路面の凹凸に追従できずに隙間が生じるため、回路面の凹凸に追従できるようにその厚さを200μm以下に保ち、必要に応じて中間層を設けている。(特許文献1参照)。
特開2005−116610 号公報(段落「0036」、段落「0043」、図1(d))
Incidentally, in recent years, a wafer thinning method has been devised in which wiring patterns and / or bumps (projection electrodes) having an unevenness difference of 0.1 to 350 μm are provided on a circuit surface.
In this processing method, the circuit surface is protected by attaching a sheet having an adhesive layer having a thickness of 200 μm at the maximum to the circuit surface on which the wiring patterns and / or bumps are formed. When the thickness exceeds 200 μm, the pressure-sensitive adhesive layer cannot follow the unevenness on the circuit surface, and a gap is generated. Therefore, the thickness is maintained at 200 μm or less so that the unevenness on the circuit surface can be followed. A layer is provided. (See Patent Document 1).
Japanese Patent Laying-Open No. 2005-116610 (paragraph “0036”, paragraph “0043”, FIG. 1D)

近年、凹凸差が100μm以上のバンプ(本明細書では、これらを総称して「ハイバンプ」と呼ぶことにする)を回路面に設けたウエハの利用が検討されつつある。この凹凸差は、より高くなる傾向にある。   In recent years, use of a wafer in which bumps having unevenness differences of 100 μm or more (in the present specification, these are collectively referred to as “high bumps”) on a circuit surface is being studied. This unevenness difference tends to be higher.

図6は上記ハイバンプを回路面に設けたウエハの全体斜視図である。
同図の例では、ウエハ1の表面1−1のエッジの内方にハイバンプ100を設けた回路10が配置されている。
FIG. 6 is an overall perspective view of a wafer in which the high bumps are provided on the circuit surface.
In the example shown in the figure, a circuit 10 provided with high bumps 100 is arranged inward of the edge of the surface 1-1 of the wafer 1.

ハイバンプ100は通常のバンプに比べバンプとウエハとの凹凸差が大きい。このため、その回路面1−1を従来方式で保護しても、以下の理由によりウエハの品質を保ったままウエハ裏面1−2を薄く研削できないため、問題となっている。   The high bump 100 has a larger unevenness between the bump and the wafer than a normal bump. For this reason, even if the circuit surface 1-1 is protected by the conventional method, the wafer back surface 1-2 cannot be thinly ground while maintaining the quality of the wafer for the following reason, which is a problem.

例えばその回路面1−1に従来のBGテープ(不図示)を貼り付けた場合、そのBGテープの接着層に厚みがないため、その接着層で上記回路面1−1の凹凸を吸収できない。このため、裏面研削したときにBGテープの表面(このBGテープに構成されるテープ基材の表面)にその凹凸が現れ、その回路10を充分に保護できなくなる。   For example, when a conventional BG tape (not shown) is affixed to the circuit surface 1-1, the adhesive layer of the BG tape is not thick, so that the unevenness of the circuit surface 1-1 cannot be absorbed by the adhesive layer. For this reason, when the back surface is ground, the irregularities appear on the surface of the BG tape (the surface of the tape base material formed on the BG tape), and the circuit 10 cannot be sufficiently protected.

その他、凹凸を吸収できるように上記BGテープの接着層を厚く構成した場合は、ハイバンプ100の裾付近(特に球体のバンプの裾付近)をそのBGテープが追従できなくなる。そのため、ハイバンプ100の裾付近に隙間が生じ、この隙間が、薄化して生成されたウエハ1の表面不良の原因になっている。   In addition, when the adhesive layer of the BG tape is formed thick so as to absorb unevenness, the BG tape cannot follow the skirt of the high bump 100 (particularly, the skirt of the sphere bump). For this reason, a gap is generated near the hem of the high bump 100, and this gap causes a surface defect of the wafer 1 produced by thinning.

また、特許文献1の場合は、上述したように、ハイバンプの凹凸に追従させることが困難となっている。そのため、別途中間層を設けてそれらを多層構造にすることにより、その厚みを増す必要がある。この場合には、各層の着脱に伴う工数が多くなり、各層の材料も複数種類が必要になるので、煩雑になり問題である。   In the case of Patent Document 1, as described above, it is difficult to follow the unevenness of the high bumps. Therefore, it is necessary to increase the thickness by providing an intermediate layer separately to make them a multilayer structure. In this case, the number of steps for attaching and detaching each layer increases, and a plurality of types of materials for each layer are required, which is complicated and problematic.

そこで本発明は、上記問題に鑑みてなされた発明であり、裏面研削したウエハの品質低下を抑止することを可能にし且つ煩雑でないウエハ回路面の保護方法及びウエハ薄化方法を提供することを目的とする。   Accordingly, the present invention has been made in view of the above problems, and an object of the present invention is to provide a method for protecting a wafer circuit surface and a method for thinning a wafer, which can suppress deterioration of the quality of a wafer subjected to back grinding and are not complicated. And

本発明は上記課題を解決するために以下のように構成する。
本発明のウエハ回路面の保護方法の態様の一つは、ハイバンプ(ウエハとの凹凸差が100μm以上、特に200μm以上のバンプ)が設けられたウエハの回路面に上記ハイバンプの裾を埋めつつ樹脂層を設け、この樹脂層の上にテープ基材(例えば既存のBGテープ)を貼り合わせる。この際、樹脂層の高さは、ハイバンプの高さよりも厚いことが好ましい。
In order to solve the above problems, the present invention is configured as follows.
One aspect of the method for protecting a wafer circuit surface according to the present invention is to fill the bottom of the high bumps on the circuit surface of the wafer provided with high bumps (bumps having an unevenness difference with the wafer of 100 μm or more, particularly 200 μm or more). A layer is provided, and a tape base material (for example, an existing BG tape) is bonded onto the resin layer. At this time, the height of the resin layer is preferably thicker than the height of the high bump.

なお、上記樹脂層は、上記回路面に液状樹脂をスピンコートにより塗布し、その液状樹脂を乾燥せしめて設ける、ことが好ましい。
また、上記樹脂層は、上記回路面に液状樹脂をスキージを使用して塗布し、その液状樹脂を乾燥せしめて設ける、ことがより好ましい。
The resin layer is preferably provided by applying a liquid resin to the circuit surface by spin coating and drying the liquid resin.
More preferably, the resin layer is provided by applying a liquid resin to the circuit surface using a squeegee and drying the liquid resin.

本発明のウエハ薄化方法の態様の一つは、上記の何れか一つの方法でウエハの回路面(ウエハの表面)を保護し、その後、上記ウエハの裏面を研削する。
なお、上記のウエハの裏面を研削する際は、例えば上記テープ基材を吸着支持するなどしておくことが好ましい。
In one aspect of the wafer thinning method of the present invention, the circuit surface of the wafer (wafer surface) is protected by any one of the methods described above, and then the back surface of the wafer is ground.
In addition, when grinding the back surface of said wafer, it is preferable to adsorb and support the said tape base material, for example.

また、上記の工程後において、上記樹脂層から上記テープ基材を剥がし、その後、上記樹脂層を溶解除去する、ことが好ましい。   Moreover, it is preferable to peel the said tape base material from the said resin layer after said process, and to dissolve and remove the said resin layer after that.

本発明により、回路面にハイバンプが設けられていたとしても、裏面研削したウエハの品質低下を抑止できる。
また、樹脂を塗ったその上に中間層を介さずに保護テープを貼るだけで良いため、作業が煩雑にならない。そして更に、上記樹脂層を一層で構成できるため、材料を複数種類揃える必要がなく、煩雑にならない。
According to the present invention, even if high bumps are provided on the circuit surface, it is possible to suppress the deterioration of the quality of the wafer ground on the back surface.
Moreover, since it is only necessary to apply a protective tape on the resin-coated material without using an intermediate layer, the operation is not complicated. Furthermore, since the resin layer can be composed of a single layer, it is not necessary to prepare a plurality of types of materials, and it is not complicated.

また、樹脂層をハイバンプの高さよりも厚くできるため、接着層の薄い既存のBGテープを上記の保護テープとして転用することも可能になる。   Moreover, since the resin layer can be made thicker than the height of the high bumps, an existing BG tape with a thin adhesive layer can be used as the protective tape.

以下、本発明を実施するための最良の形態について、図面を参照しながら詳細に説明する。
ただし、以下では、回路面にハイバンプが設けられたウエハの例として、図5のウエハ(ウエハからの高さが200μm以上のバンプが形成されている)を引用する。また、以下の説明に使用する図の対応箇所には、同一の番号を付すこととする。
Hereinafter, the best mode for carrying out the present invention will be described in detail with reference to the drawings.
However, in the following, as an example of a wafer having a high bump on the circuit surface, the wafer in FIG. 5 (a bump having a height of 200 μm or more from the wafer is formed) is cited. Also, the same numbers are assigned to corresponding parts in the drawings used in the following description.

図1は、本発明に係るウエハ回路面の保護方法を工程順((a)〜(c))に示した図である。
各工程((a)、(b)、(c))には、ウエハの状態が側方断面図で示されている。
FIG. 1 is a view showing a method for protecting a wafer circuit surface according to the present invention in the order of steps ((a) to (c)).
In each step ((a), (b), (c)), the state of the wafer is shown in a side sectional view.

同図(a)は、樹脂を塗布する工程のウエハの状態断面図である。
この工程では、同図(a)に示されるようにハイバンプ100が設けられた回路面を上向きにウエハ1を配置し、その回路面に樹脂を塗布する。
FIG. 4A is a sectional view of a wafer in a process of applying a resin.
In this step, as shown in FIG. 6A, the wafer 1 is placed with the circuit surface provided with the high bumps 100 facing upward, and resin is applied to the circuit surface.

なお、破線は、樹脂を塗布する高さ(つまり樹脂層の厚み)の目安を示している。
樹脂の塗布には、例えばスキージやスピンコートなどを利用する。樹脂を塗布する際には、その樹脂をハイバンプ100の裾(100A)までその樹脂が埋め込まれるようにしつつその回路面(10)全体に塗り広げる。とくに、その樹脂により構成される樹脂層の厚みを上記ハイバンプ100の高さを超える厚みにすることが好ましい。つまり、同図(a)に一例として示した破線の高さまで樹脂を盛りつける。
Note that the broken line indicates an indication of the height at which the resin is applied (that is, the thickness of the resin layer).
For the application of the resin, for example, a squeegee or a spin coat is used. When applying the resin, the resin is spread over the entire circuit surface (10) while the resin is embedded up to the bottom (100A) of the high bump 100. In particular, it is preferable that the thickness of the resin layer made of the resin exceeds the height of the high bump 100. That is, the resin is arranged up to the height of the broken line shown as an example in FIG.

同図(b)は、上記樹脂層の表面に保護テープを貼り付ける工程のウエハの状態断面図である。
スキージやスピンコートなどにより樹脂が塗布されると、ハイバンプ100の凹凸の全て又は大部分がその樹脂層2によって吸収される。そして、その樹脂層2の表面20は平坦又は平坦に近い状態にすることが好ましい。同図(b)では、そのうちの後者(平坦に近い状態)を示している。
FIG. 2B is a sectional view of the wafer in the process of attaching a protective tape to the surface of the resin layer.
When the resin is applied by squeegee or spin coating, all or most of the unevenness of the high bump 100 is absorbed by the resin layer 2. The surface 20 of the resin layer 2 is preferably flat or nearly flat. FIG. 2B shows the latter (near flat state).

この樹脂層2の表面20全体に例えば既存のBGテープなどの保護テープ3を貼り付ける。
例えば、その保護テープ3の接着面3−2を樹脂層2の表面20に沿って貼り付ける。
A protective tape 3 such as an existing BG tape is attached to the entire surface 20 of the resin layer 2.
For example, the adhesive surface 3-2 of the protective tape 3 is attached along the surface 20 of the resin layer 2.

同図(c)は、上記の保護テープ3を貼り付けた後のウエハの状態断面図である。
同図(c)に示されるように、ハイバンプ100による凹凸の大部分が上記樹脂層2によって吸収されている。そして、その残りの凹凸差hは保護テープ3の接着層3−2で吸収されている。
FIG. 2C is a sectional view of the wafer after the protective tape 3 is applied.
As shown in FIG. 2C, most of the unevenness due to the high bump 100 is absorbed by the resin layer 2. The remaining unevenness difference h is absorbed by the adhesive layer 3-2 of the protective tape 3.

このため、保護テープ3のテープ基材3−1の表面へその凹凸の影響が現れない。
本発明の方法によれば、特に200μm以上のハイバンプ100に対しても、ハイバンプに追従させて樹脂層2を設けることができるので、凹凸差hを吸収できる。また、本発明の方法によれば、上記ハイバンプ100の高さよりも高く樹脂層2を設けることができるので、保護テープ3における接着層3−2の高さに依存せず、保護テープ3の貼り付けを容易に行うことができる。さらに、上記ハイバンプが球状である場合には、ハイバンプの裾に空間が生じる場合があるが、本発明の方法によれば、この裾にまで樹脂層2を形成することができるため、後の工程におけるウエハへのダメージを抑制することができる。
For this reason, the influence of the unevenness does not appear on the surface of the tape base 3-1 of the protective tape 3.
According to the method of the present invention, the unevenness h can be absorbed because the resin layer 2 can be provided to follow the high bumps, particularly even for the high bumps 100 of 200 μm or more. Further, according to the method of the present invention, since the resin layer 2 can be provided higher than the height of the high bump 100, the protective tape 3 can be applied without depending on the height of the adhesive layer 3-2 in the protective tape 3. Can be easily attached. Furthermore, when the high bump is spherical, a space may be formed at the skirt of the high bump. However, according to the method of the present invention, the resin layer 2 can be formed up to the skirt. Damage to the wafer can be suppressed.

(実施例1)
本実施例1では、上記の保護方法を利用してハイバンプをもつウエハを薄化する方法を説明する。
Example 1
In the first embodiment, a method for thinning a wafer having high bumps using the above-described protection method will be described.

図2は、上記のウエハを薄化する方法を工程順((a)から(h))に示した図である。
先ず、ハイバンプ100のある回路面(表面とする)1−1を上向きにウエハ1を固定して樹脂2を塗布する(図2(a))。
FIG. 2 is a diagram showing the method of thinning the wafer in the order of steps ((a) to (h)).
First, the wafer 1 is fixed with the circuit surface (surface) 1-1 on which the high bumps 100 are located facing upward, and the resin 2 is applied (FIG. 2A).

その樹脂2の塗布には、例えばスキージやスピンコートなどを使用する。本実施例では、そのうちのスキージを使用した場合について説明する。
なお、上記樹脂2には、例えばアクリル系の樹脂を溶剤(有機溶剤)に溶解したものを用いればよい。前記溶剤としては、アクリル系樹脂を溶解できるものであればよく、アルコール類、エーテル類、エステル類、ケトン類等、公知のものを用いることができる。剥離液がアルコール系または一般溶剤系(PM,HP等)極性溶剤ではない接着剤も多々ある。
For the application of the resin 2, for example, a squeegee or a spin coat is used. In this embodiment, a case where one of the squeegees is used will be described.
For example, a resin in which an acrylic resin is dissolved in a solvent (organic solvent) may be used as the resin 2. The solvent is not particularly limited as long as it can dissolve the acrylic resin, and known solvents such as alcohols, ethers, esters, and ketones can be used. There are many adhesives in which the stripping solution is not an alcohol-based or general solvent-based (PM, HP, etc.) polar solvent.

また、その樹脂2の粘度は、スキージによりハイバンプ100の裾が埋まる程度のものを使用し、必要であればその粘度調整のために有機溶剤等で調整すればよい。
図3は、回路面にスキージを使用して樹脂を塗布する工程のウエハの状態斜視図である。
The viscosity of the resin 2 is such that the skirt of the high bump 100 is filled with a squeegee, and if necessary, the viscosity may be adjusted with an organic solvent or the like.
FIG. 3 is a perspective view of the wafer in the process of applying resin to the circuit surface using a squeegee.

図3(a)は、スキージで液状の上記樹脂(液状樹脂)2を均す様子を示した図である。
上記液状樹脂2を上記回路面1−1上に盛り付け、その回路面1−1をスキージ4で走査する(同図においては矢印方向に走査している状態が示されている)。
FIG. 3A is a diagram showing how the resin (liquid resin) 2 that is liquid with a squeegee is leveled.
The liquid resin 2 is placed on the circuit surface 1-1, and the circuit surface 1-1 is scanned with the squeegee 4 (in the figure, the state of scanning in the direction of the arrow is shown).

このスキージ4の走査により、その液状樹脂2はハイバンプ100の裾まで埋め込みつつ厚い層を形成することができる。
図3(b)は、その樹脂層2の乾燥状態を示した図である。
By scanning the squeegee 4, the liquid resin 2 can form a thick layer while being embedded up to the bottom of the high bump 100.
FIG. 3B is a diagram showing a dried state of the resin layer 2.

回路面1−1全体に液状樹脂が塗り広げられてなる樹脂層2は、例えば不図示のベークユニットなどにより乾燥が行われる。このベークユニットにはホットプレートやクールプレートが備えられており、回路面1−1上の液状樹脂2を高速に乾燥せしめ、その流動を抑える。   The resin layer 2 formed by spreading the liquid resin on the entire circuit surface 1-1 is dried by, for example, a bake unit (not shown). This bake unit is equipped with a hot plate or a cool plate, and dries the liquid resin 2 on the circuit surface 1-1 at a high speed to suppress the flow.

図4は、本実施例1における回路面の保護方法を図1に対応させて工程順に示した図である。
図4(a)は、樹脂を塗布する前の回路面の状態断面図である。
FIG. 4 is a diagram showing the circuit surface protection method according to the first embodiment in the order of steps corresponding to FIG.
FIG. 4A is a state sectional view of the circuit surface before the resin is applied.

図4(b)は、樹脂を塗布した後の回路面の状態断面図である。
図4(c)は、後述のBGテープを貼り付けた後の回路面の状態断面図である。
本実施例1ではスキージを使用したため、図4(a)に破線で示されるようにその樹脂の厚みをハイバンプ100の高さよりも厚く設定できる。このため、図4(b)に示されるようにその樹脂2がハイバンプ100の凹凸をより良く吸収することができる。図4に示すように、樹脂層の表面を略均一に形成することが好ましい。
FIG. 4B is a state sectional view of the circuit surface after the resin is applied.
FIG. 4C is a state sectional view of the circuit surface after a BG tape to be described later is attached.
Since the squeegee is used in the first embodiment, the thickness of the resin can be set larger than the height of the high bump 100 as shown by the broken line in FIG. For this reason, as shown in FIG. 4B, the resin 2 can better absorb the unevenness of the high bump 100. As shown in FIG. 4, it is preferable to form the surface of the resin layer substantially uniformly.

念のため一つのデータ結果を挙げると、ハイバンプの高さが200μmであった場合に樹脂層を250μmの厚み(ウエハからの最小の高さ)で設けることができた。つまり、樹脂層は、ハイバンプの裾を埋めつつもそのハイバンプの高さよりも厚く設定できた。このとき、ハイバンプ上の樹脂層の厚みは、150μmであり、ハイバンプが形成されている部位におけるウエハから樹脂層までの厚さは350μmであった。つまり、ハイバンプによる凹凸差を100μmにまで減らすことができた。この100μmの凹凸差は、保護テープの接着層で充分に吸収できる厚みである。このため、その保護テープとして、接着層の厚みの薄い既存のBGテープの転用もできる。   As a reminder, when the height of the high bump was 200 μm, the resin layer could be provided with a thickness of 250 μm (minimum height from the wafer). That is, the resin layer could be set thicker than the height of the high bump while filling the bottom of the high bump. At this time, the thickness of the resin layer on the high bump was 150 μm, and the thickness from the wafer to the resin layer at the portion where the high bump was formed was 350 μm. That is, the unevenness difference due to the high bumps could be reduced to 100 μm. This unevenness of 100 μm is a thickness that can be sufficiently absorbed by the adhesive layer of the protective tape. For this reason, the existing BG tape with a thin adhesive layer can also be used as the protective tape.

なお、スキージの替わりにスピンコートにより樹脂2を塗布しても良い。この場合、例えば回路面1−1の中央に液状樹脂を滴下し、ウエハ1をスピンさせてその液状樹脂2を回路面1−1全体に塗り広げ、それを乾燥させる。   Note that the resin 2 may be applied by spin coating instead of the squeegee. In this case, for example, a liquid resin is dropped on the center of the circuit surface 1-1, the wafer 1 is spun, the liquid resin 2 is spread over the entire circuit surface 1-1, and it is dried.

スピンコートにより樹脂2を塗布する場合も、ハイバンプ100の裾を埋め込みつつ樹脂層2を設けるようにする。そして、ハイバンプ100の高さよりも厚く樹脂層2を設けることが好ましい。ただし、1度塗りでその厚みに到達しない場合には2度塗りするなどして対処すればよい。これにより、凹凸差(図1(b)中の凹凸差hに対応)は保護テープの接着層の厚みで充分に吸収できる高さまで減らすことができる。   Even when the resin 2 is applied by spin coating, the resin layer 2 is provided while the bottom of the high bump 100 is embedded. And it is preferable to provide the resin layer 2 thicker than the height of the high bump 100. However, if it does not reach the thickness after being painted once, it can be dealt with by painting twice. Thereby, the unevenness difference (corresponding to the unevenness difference h in FIG. 1B) can be reduced to a height that can be sufficiently absorbed by the thickness of the adhesive layer of the protective tape.

ウエハの薄化工程では、続いて、乾燥した樹脂層2の表面に保護テープ3を貼り付ける(図2(b))。この工程では、保護テープ(一般的にはBGテープ)3の接着面を樹脂層2の表面に沿って貼り付ける。   In the wafer thinning step, subsequently, a protective tape 3 is attached to the surface of the dried resin layer 2 (FIG. 2B). In this step, the adhesive surface of the protective tape (generally a BG tape) 3 is attached along the surface of the resin layer 2.

なお、研削時の安定性等を考慮すると、その保護テープ3の大きさはウエハ1の回路形成面1−1と同一又はそれよりも大きい方が好ましい。
この工程に対応するウエハの状態断面図は、図4(c)である。
In consideration of stability during grinding, the size of the protective tape 3 is preferably the same as or larger than the circuit forming surface 1-1 of the wafer 1.
FIG. 4C is a state sectional view of the wafer corresponding to this step.

続く工程では、上記ウエハ1を反転して(つまりウエハの裏面1−2が上向きになるようにして)、その裏面1−2を研削/研磨する(図2(c))。
本実施例1では、ウエハ1の裏面1−2に研削ホイール5を当てて該裏面1−2を薄く削る。
In the subsequent step, the wafer 1 is turned over (that is, with the back surface 1-2 of the wafer facing upward), and the back surface 1-2 is ground / polished (FIG. 2C).
In the first embodiment, the grinding wheel 5 is applied to the back surface 1-2 of the wafer 1 to cut the back surface 1-2 thinly.

図5は、模式的な研削/研磨装置の断面図である。
同図に示されているように、ウエハ1を裏面1−2を上向きにして台50上に置き、その裏面1−2に研削ホイール5を当てて削る。
FIG. 5 is a cross-sectional view of a schematic grinding / polishing apparatus.
As shown in the figure, the wafer 1 is placed on a table 50 with the back surface 1-2 facing upward, and is ground by applying a grinding wheel 5 to the back surface 1-2.

本実施例1では、ウエハ1を固定する台50として、一般的にチャックと呼ばれる吸着台を使用する。
この吸着台50には、真空引き用の孔(50−1〜50−4)が形成されており、その孔を介して上記ウエハのテープ基材3−1をその吸着台50の上面に真空吸着固定する。
In the first embodiment, a suction table generally called a chuck is used as the table 50 for fixing the wafer 1.
The suction table 50 has holes (50-1 to 50-4) for evacuation, and the tape base material 3-1 of the wafer is vacuumed on the upper surface of the suction table 50 through the holes. Adsorb and fix.

上記研削ホイール5は、回転軸5−1を中心軸にして回転しながらウエハ1の裏面1−2に当接され、その裏面1−2を一様に研削していく。こうして、ウエハ1の厚みを例えば125μm〜150μmのオーダー、要求に応じては25μm〜50μmのオーダーに薄くする。なお、研削時はウエハ1と研削ホイール5の間に摩擦熱が生じるため、ウエハ1の裏面1−2に水を供給するなどしてその熱を抑えるようにする。   The grinding wheel 5 is in contact with the back surface 1-2 of the wafer 1 while rotating about the rotation shaft 5-1, and uniformly grinds the back surface 1-2. In this way, the thickness of the wafer 1 is reduced to, for example, the order of 125 μm to 150 μm, and to the order of 25 μm to 50 μm as required. In addition, since frictional heat is generated between the wafer 1 and the grinding wheel 5 during grinding, water is supplied to the back surface 1-2 of the wafer 1 to suppress the heat.

ウエハの薄化工程では、続いて、研削/研磨処理により薄化したウエハ1を裏面処理する(図2(d))。
この裏面処理としては、例えば、バックメタライズ加工(図2(d−1))や回路形成処理(図2(d−2))などがあり、これらの工程が不要であれば省くこともできる。
In the wafer thinning process, subsequently, the wafer 1 thinned by the grinding / polishing process is processed on the back surface (FIG. 2D).
Examples of the back surface processing include back metallization (FIG. 2 (d-1)) and circuit formation processing (FIG. 2 (d-2)), and can be omitted if these steps are unnecessary.

次に、ウエハの裏面1−2側に粘着性を有するダイシングテープ6を貼りつける(図2e)。この貼り付け工程も、不要であれば省いて良い。
次に、ウエハから保護テープ3を剥がし取る(図2(f))。この保護テープ3は、保護テープ3の接着層3−2を介して樹脂層2に貼り付いているだけであるため、テープリムバー等を用いて接着層3−2ごと剥がし取ることもできる。
Next, a dicing tape 6 having adhesiveness is attached to the back surface 1-2 side of the wafer (FIG. 2e). This pasting step may be omitted if unnecessary.
Next, the protective tape 3 is peeled off from the wafer (FIG. 2 (f)). Since the protective tape 3 is only attached to the resin layer 2 via the adhesive layer 3-2 of the protective tape 3, the adhesive layer 3-2 can be peeled off using a tape rim bar or the like.

次に、剥き出しになった樹脂層2を溶解除去する(図2(g))。
この場合、樹脂層に溶剤7(上述した種類の溶剤)を当接させてその樹脂層を溶解し、例えばスピンするなどしてその溶解した液を取り除く。なお、ウエハ1にダイシングテープ6を貼り付けている場合は、そのダイシングテープ6からウエハ1が剥がれないように、その液がそのダイシングテープ6にかからないように注意する。
Next, the exposed resin layer 2 is dissolved and removed (FIG. 2G).
In this case, the resin 7 is brought into contact with the resin layer to dissolve the resin layer, and the dissolved liquid is removed by, for example, spinning. When the dicing tape 6 is attached to the wafer 1, care is taken so that the liquid does not cover the dicing tape 6 so that the wafer 1 is not peeled off from the dicing tape 6.

そして、溶剤により樹脂層が完全に除去された後、ダイシング装置8によってウエハ1をチップサイズに分割する(図2(h))。このように分割された各半導体チップは、ダイシングテープ6に紫外線を照射してその粘着力を低下せしめることで、個々に取り出される。   Then, after the resin layer is completely removed by the solvent, the wafer 1 is divided into chip sizes by the dicing apparatus 8 (FIG. 2 (h)). Each semiconductor chip divided in this way is taken out individually by irradiating the dicing tape 6 with ultraviolet rays to reduce its adhesive strength.

以上に述べたように、本実施形態により、回路面にハイバンプが設けられていたとしても、裏面研削したウエハの品質低下を抑止できる。
また、樹脂を塗ったその上に中間層を介さずに保護テープを貼るだけで良いため、作業が煩雑にならない。そして更に、上記樹脂層を一層で構成できるため、材料を複数種類揃える必要がなく、煩雑にならない。
As described above, according to the present embodiment, even if high bumps are provided on the circuit surface, it is possible to suppress the deterioration of the quality of the wafer ground on the back surface.
Moreover, since it is only necessary to apply a protective tape on the resin-coated material without using an intermediate layer, the operation is not complicated. Furthermore, since the resin layer can be composed of a single layer, it is not necessary to prepare a plurality of types of materials, and it is not complicated.

また、樹脂層をハイバンプの高さよりも厚くできるため、接着層の薄い既存のBGテープを上記の保護テープとして転用することも可能になる。
また、薄化されたウエハの表面にはディンプルが生じないため、そのウエハからは扁平率の高い高精度の半導体チップが数多く抽出できるようになる。
Moreover, since the resin layer can be made thicker than the height of the high bumps, an existing BG tape with a thin adhesive layer can be used as the protective tape.
Further, since dimples are not generated on the surface of the thinned wafer, many high-precision semiconductor chips with a high flatness can be extracted from the wafer.

本発明に係るウエハ回路面の保護方法を工程順に示した図である。It is the figure which showed the protection method of the wafer circuit surface which concerns on this invention in process order. ウエハを薄化する方法を工程順に示した図である。It is the figure which showed the method of thinning a wafer in order of a process. 回路面に樹脂を塗布する工程のウエハの状態斜視図である。It is a state perspective view of a wafer in the process of applying resin to a circuit surface. 実施例1における回路面の保護方法を工程順に示した図である。It is the figure which showed the protection method of the circuit surface in Example 1 in order of a process. 研削/研磨装置の断面図である。It is sectional drawing of a grinding / polishing apparatus. ハイバンプを回路面に設けた従来のウエハの全体斜視図である。It is a whole perspective view of the conventional wafer which provided the high bump on the circuit surface.

符号の説明Explanation of symbols

1 ウエハ
10 回路
100 ハイバンプ
100A ハイバンプの裾
2 樹脂層
20 樹脂層の表面
3 保護テープ
3−1 テープ基材
3−2 テープの接着層
h 凹凸差
DESCRIPTION OF SYMBOLS 1 Wafer 10 Circuit 100 High bump 100A High bump bottom 2 Resin layer 20 Resin layer surface 3 Protective tape 3-1 Tape base material 3-2 Adhesive layer of tape h Unevenness difference

Claims (4)

球状のハイバンプが設けられた回路面を有するウエハを準備する工程と、
前記ウエハの前記回路面に対して液状樹脂をスキージを使用して塗布し前記液状樹脂を単独で乾燥せしめることで、前記球状のハイバンプの裾を埋めつつ当該球状のハイバンプの高さよりも厚く樹脂層を設ける工程と、
更に、前記樹脂層の上にテープ基材および接着剤層からなる保護テープの前記接着剤層を貼り合わせる工程と、
を含むことを特徴とするウエハ回路面の保護方法。
Preparing a wafer having a circuit surface provided with spherical high bumps;
By in respect to the circuit surface of the wafer by applying a liquid resin using a squeegee allowed to dry the liquid resin alone, thicker resin layer than the height of Haibanpu of the spherical while filling the hem Haibanpu of the spherical Providing a step;
Further, the step of bonding the adhesive layer of the protective tape composed of a tape base material and an adhesive layer on the resin layer;
A method for protecting a wafer circuit surface, comprising:
球状のハイバンプが設けられた回路面を有するウエハを準備する工程と、
前記ウエハの前記回路面に対して液状樹脂をスキージを使用して塗布し前記液状樹脂を単独で乾燥せしめることで、前記球状のハイバンプの裾を埋めつつ当該球状のハイバンプの高さよりも厚く樹脂層を設ける工程と、
更に、前記樹脂層の上にテープ基材および接着剤層からなる保護テープの前記接着剤層を貼り合わせる工程と、
前記ウエハの前記回路面と反対側の裏面を研削する工程と、
を含むことを特徴とするウエハ薄化方法。
Preparing a wafer having a circuit surface provided with spherical high bumps;
By in respect to the circuit surface of the wafer by applying a liquid resin using a squeegee allowed to dry the liquid resin alone, thicker resin layer than the height of Haibanpu of the spherical while filling the hem Haibanpu of the spherical Providing a step;
Further, the step of bonding the adhesive layer of the protective tape composed of a tape base material and an adhesive layer on the resin layer;
Grinding the back surface of the wafer opposite to the circuit surface;
A wafer thinning method comprising:
前記樹脂層から前記テープ基材を剥がし、
その後、前記樹脂層を溶解除去する、
ことを特徴とする請求項に記載のウエハ薄化方法。
Peel off the tape substrate from the resin layer,
Thereafter, the resin layer is dissolved and removed.
The wafer thinning method according to claim 2 .
前記研削を、前記テープ基材を吸着支持して行う、
ことを特徴とする請求項又はに記載のウエハ薄化方法。
The grinding is performed by supporting the tape base material by suction.
Wafer thinning process according to claim 2 or 3, characterized in that.
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Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009289809A (en) * 2008-05-27 2009-12-10 Fuji Electric Device Technology Co Ltd Method of manufacturing semiconductor device
JP5501060B2 (en) * 2009-04-02 2014-05-21 日東電工株式会社 Method for laminating adhesive sheet for protecting semiconductor wafer, and adhesive sheet for protecting semiconductor wafer used in this laminating method
JP5503951B2 (en) * 2009-12-07 2014-05-28 株式会社ディスコ Sticking device
JP5553642B2 (en) * 2010-02-24 2014-07-16 株式会社テラプローブ Manufacturing method of semiconductor device and manufacturing method of thinned substrate
WO2013129561A1 (en) * 2012-03-01 2013-09-06 東京応化工業株式会社 Adhering apparatus
DE102013112245A1 (en) * 2013-11-07 2015-05-07 Siltectra Gmbh Method for fixing solid plates
GB2551732B (en) * 2016-06-28 2020-05-27 Disco Corp Method of processing wafer
CN106206383A (en) * 2016-09-05 2016-12-07 江苏纳沛斯半导体有限公司 Film forming method and semiconductor structure
JP6906843B2 (en) * 2017-04-28 2021-07-21 株式会社ディスコ Wafer processing method
JP6647267B2 (en) * 2017-11-09 2020-02-14 古河電気工業株式会社 Manufacturing method of semiconductor chip

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003188129A (en) * 2001-12-19 2003-07-04 Okamoto Machine Tool Works Ltd Device surface protection structure of device wafer
JP4565804B2 (en) * 2002-06-03 2010-10-20 スリーエム イノベイティブ プロパティズ カンパニー Laminate including ground substrate, method for producing the same, method for producing ultrathin substrate using laminate, and apparatus therefor
JP2005116610A (en) * 2003-10-03 2005-04-28 Nitto Denko Corp Processing method of semiconductor wafer, and adhesive sheet for processing semiconductor wafer
JP2006196705A (en) * 2005-01-13 2006-07-27 Tokyo Ohka Kogyo Co Ltd Method for forming circuit element and multilayer circuit element

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