JP5091024B2 - スイッチングレギュレータ及びその動作制御方法 - Google Patents
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Description
入力された制御信号に応じてスイッチングを行うスイッチ素子と、
該スイッチ素子のスイッチングによって前記電源電圧による充電が行われるインダクタと、
前記スイッチ素子がオフして該インダクタへの充電が停止すると、該インダクタの放電を行う整流素子と、
前記出力電圧に比例した第1比例電圧が、所定の第1基準電圧になるように前記スイッチ素子のスイッチング制御を行う制御回路部と、
前記電源電圧が所定値未満であるときは、該制御回路部に対して、前記スイッチ素子を強制的にオフさせて遮断状態にさせる低電圧誤動作防止回路部と、
を備え、
前記低電圧誤動作防止回路部は、前記第1基準電圧よりも小さく、前記電源電圧の立ち上がり時に前記第1基準電圧よりも立ち上がり速度が速い第2基準電圧を生成し、前記第1基準電圧が該第2基準電圧よりも小さいか、又は前記電源電圧が前記所定値未満である場合は、前記制御回路部に対して、前記スイッチ素子を強制的にオフさせて遮断状態にさせるものである。
前記第2基準電圧を生成して出力する第2基準電圧発生回路と、
前記第2比例電圧を生成して出力する第2比例電圧生成回路と、
前記第1基準電圧と該第2比例電圧との電圧比較を行い、該比較結果を示す信号を生成して出力する第1電圧比較回路と、
前記第1基準電圧と前記第2基準電圧との電圧比較を行い、該比較結果を示す信号を生成して出力する第2電圧比較回路と、
前記第1電圧比較回路及び第2電圧比較回路の各出力信号から、前記制御回路部に対する制御信号を生成して出力する制御信号生成回路と、
を備え、
前記制御信号生成回路は、前記第1電圧比較回路及び第2電圧比較回路の各出力信号から、前記第1基準電圧が前記第2基準電圧よりも小さいか、又は前記電源電圧が前記所定値未満であることを検出すると、前記制御回路部に対して、前記スイッチ素子を強制的にオフさせて遮断状態にさせるように前記制御信号を生成し出力するようにした。
該スイッチ素子のスイッチングによって電源電圧による充電が行われるインダクタと、
前記スイッチ素子がオフして該インダクタへの充電が停止すると、該インダクタの放電を行う整流素子と、
を備え、
出力電圧に比例した第1比例電圧が、所定の第1基準電圧になるように前記スイッチ素子のスイッチング制御を行い、入力された前記電源電圧を、所定の定電圧に変換して前記出力電圧として出力するスイッチングレギュレータにおける動作制御方法において、
前記第1基準電圧よりも小さく、前記電源電圧の立ち上がり時に前記第1基準電圧よりも立ち上がり速度が速い第2基準電圧を生成し、
前記第1基準電圧が該第2基準電圧よりも小さいか、又は前記電源電圧が所定値未満である場合は、前記スイッチ素子を強制的にオフさせて遮断状態にさせるようにした。
第1の実施の形態.
図1は、本発明の第1の実施の形態におけるスイッチングレギュレータの回路例を示した図である。
図1のスイッチングレギュレータ1は、入力端子INに入力された電源電圧Vddを所定の定電圧に昇圧して、出力電圧Voutとして出力端子OUTから出力する非同期整流方式の昇圧型スイッチングレギュレータである。
図2において、低電圧誤動作防止回路7は、電源電圧Vddを分圧して分圧電圧VXを生成し出力する抵抗R11,R12と、前記第1基準電圧Vr1よりも小さい所定の第2基準電圧Vr2を生成して出力する第2基準電圧発生回路12と、第1電圧比較回路12と、第2電圧比較回路13と、NAND回路14とで構成されている。なお、抵抗R11及びR12は第2比例電圧生成回路をなし、分圧電圧VXは第2比例電圧をなす。
第1基準電圧Vr1は、電圧の精度を重要とした信号であり、第2基準電圧Vr2は、電源電圧Vddの立ち上がりに伴って素早く電圧が立ち上がるようにした信号であり、第2基準電圧Vr2は、第1基準電圧Vr1よりも早く、設定された値に到達することができる。このようなことから、第1基準電圧Vr1が設定された値、すなわち第2基準電圧Vr2の電圧値以上になるまでの間は、第2電圧比較回路13の出力信号S2はローレベルであり、NAND回路14からハイレベルの制御信号Scが出力される。ハイレベルの制御信号Scが入力されたPWMコンパレータ5及び出力バッファ回路6は、スイッチングトランジスタMN1を強制的にオフさせて遮断状態にする。
また、第2基準電圧Vr2が、第1基準電圧Vr1よりも少し小さい電圧に設定され、かつ電源電圧Vddの立ち上がりに伴って素早く立ち上がるようにすることにより、スイッチングレギュレータにおける制御用ICの内部電源の立ち上がりを正確に検出することができる。
2 第1基準電圧発生回路
3 誤差増幅回路
4 発振回路
5 PWMコンパレータ
6 出力バッファ回路
7 低電圧誤動作防止回路
11 第2基準電圧発生回路
12 第1電圧比較回路
13 第2電圧比較回路
14 NAND回路
MN1 スイッチングトランジスタ
D1 ダイオード
L1 インダクタ
C1 コンデンサ
R1,R2,R11,R12 抵抗
Claims (5)
- 入力された電源電圧を、所定の定電圧に変換して出力電圧として出力するスイッチングレギュレータにおいて、
入力された制御信号に応じてスイッチングを行うスイッチ素子と、
該スイッチ素子のスイッチングによって前記電源電圧による充電が行われるインダクタと、
前記スイッチ素子がオフして該インダクタへの充電が停止すると、該インダクタの放電を行う整流素子と、
前記出力電圧に比例した第1比例電圧が、所定の第1基準電圧になるように前記スイッチ素子のスイッチング制御を行う制御回路部と、
前記電源電圧が所定値未満であるときは、該制御回路部に対して、前記スイッチ素子を強制的にオフさせて遮断状態にさせる低電圧誤動作防止回路部と、
を備え、
前記低電圧誤動作防止回路部は、前記第1基準電圧よりも小さく、前記電源電圧の立ち上がり時に前記第1基準電圧よりも立ち上がり速度が速い第2基準電圧を生成し、前記第1基準電圧が該第2基準電圧よりも小さいか、又は前記電源電圧が前記所定値未満である場合は、前記制御回路部に対して、前記スイッチ素子を強制的にオフさせて遮断状態にさせることを特徴とするスイッチングレギュレータ。 - 前記低電圧誤動作防止回路部は、前記電源電圧に比例した第2比例電圧を生成し、該第2比例電圧が前記第1基準電圧未満であるとき、前記電源電圧が前記所定値未満であると判定することを特徴とする請求項1記載のスイッチングレギュレータ。
- 前記低電圧誤動作防止回路部は、
前記第2基準電圧を生成して出力する第2基準電圧発生回路と、
前記第2比例電圧を生成して出力する第2比例電圧生成回路と、
前記第1基準電圧と該第2比例電圧との電圧比較を行い、該比較結果を示す信号を生成して出力する第1電圧比較回路と、
前記第1基準電圧と前記第2基準電圧との電圧比較を行い、該比較結果を示す信号を生成して出力する第2電圧比較回路と、
前記第1電圧比較回路及び第2電圧比較回路の各出力信号から、前記制御回路部に対する制御信号を生成して出力する制御信号生成回路と、
を備え、
前記制御信号生成回路は、前記第1電圧比較回路及び第2電圧比較回路の各出力信号から、前記第1基準電圧が前記第2基準電圧よりも小さいか、又は前記電源電圧が前記所定値未満であることを検出すると、前記制御回路部に対して、前記スイッチ素子を強制的にオフさせて遮断状態にさせるように前記制御信号を生成し出力することを特徴とする請求項2記載のスイッチングレギュレータ。 - 入力された制御信号に応じてスイッチングを行うスイッチ素子と、
該スイッチ素子のスイッチングによって電源電圧による充電が行われるインダクタと、
前記スイッチ素子がオフして該インダクタへの充電が停止すると、該インダクタの放電を行う整流素子と、
を備え、
出力電圧に比例した第1比例電圧が、所定の第1基準電圧になるように前記スイッチ素子のスイッチング制御を行い、入力された前記電源電圧を、所定の定電圧に変換して前記出力電圧として出力するスイッチングレギュレータにおける動作制御方法において、
前記第1基準電圧よりも小さく、前記電源電圧の立ち上がり時に前記第1基準電圧よりも立ち上がり速度が速い第2基準電圧を生成し、
前記第1基準電圧が該第2基準電圧よりも小さいか、又は前記電源電圧が所定値未満である場合は、前記スイッチ素子を強制的にオフさせて遮断状態にさせることを特徴とするスイッチングレギュレータの動作制御方法。 - 前記電源電圧に比例した第2比例電圧を生成し、該第2比例電圧が前記第1基準電圧未満であるとき、前記電源電圧が前記所定値未満であると判定することを特徴とする請求項4記載のスイッチングレギュレータの動作制御方法。
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