JP4927343B2 - 半導体チップおよびその製造方法 - Google Patents
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Description
図1は、本実施の形態における半導体チップの構成の一部を示す断面図である。
半導体チップ100は、半導体基板(不図示)と、半導体基板上に形成された炭素含有絶縁膜(第一の層間絶縁膜106、第二の層間絶縁膜112、第三の層間絶縁膜118、第一のエッチングストッパ膜104、第二のエッチングストッパ膜110、第三のエッチングストッパ膜116、および第四のエッチングストッパ膜122)と炭素非含有絶縁膜(下地層102、上地カバー膜124、第一の保護絶縁膜108、第二の保護絶縁膜114、および第三の保護絶縁膜120)とを含む積層膜150とを含む。ここで、炭素非含有絶縁膜の端面が、炭素含有絶縁膜の端面より外側に位置している。
半導体チップ100は、半導体基板(不図示)と、下地層102、第一のエッチングストッパ膜104、第一の層間絶縁膜106、第一の保護絶縁膜108、第二のエッチングストッパ膜110、第二の層間絶縁膜112、第二の保護絶縁膜114、第三のエッチングストッパ膜116、第三の層間絶縁膜118、第三の保護絶縁膜120、第四のエッチングストッパ膜122、および上地カバー膜124の順で形成された積層膜150とを含む。また、半導体チップ100は、第一の配線130、ビアプラグ132、および第二の配線134を含む。
本実施の形態における半導体チップ100の製造手順は、半導体基板(不図示)上に炭素含有絶縁膜(第一の層間絶縁膜106、第二の層間絶縁膜112、第三の層間絶縁膜118、第一のエッチングストッパ膜104、第二のエッチングストッパ膜110、第三のエッチングストッパ膜116、および第四のエッチングストッパ膜122)を含む積層膜150を形成する工程(図2(a))と、半導体基板を、表面からチップ外縁に沿って切断し、炭素含有絶縁膜の側面を露出させる工程(図2(b))と、側面が露出された炭素含有絶縁膜に酸化性ガスを施し、炭素含有絶縁膜の側面を酸化する工程(図2(c))と、を含む。
まず、通常の方法により、半導体基板(不図示)上に積層膜150を形成する(図2(a))。以下に、図2(a)に示した半導体装置101の製造手順の一例を示す。まず、半導体基板上に下地層102を形成する。つづいてその上に、プラズマCVD法により、第一のエッチングストッパ膜104を成膜する。次に、第一のエッチングストッパ膜104上に、トリメチルシランガスを流しながら、プラズマCVD法により第一の層間絶縁膜106を成膜する。その後、第一の層間絶縁膜106上に、プラズマCVD法により、第一の保護絶縁膜108を形成する。つづいて、既知のリソグラフィ技術およびエッチング技術により、第一の保護絶縁膜108上に所定形状にパターニングされたレジスト膜を形成し、レジスト膜をマスクとして、第一の保護絶縁膜108、第一の層間絶縁膜106、および第一のエッチングストッパ膜104に配線溝を形成する。
酸化性ガス:O2、N2O、CO、CO2のいずれを含むガス
処理温度:室温(RT)〜400℃
処理時間:30分
酸化性ガス:O3、O2、N2O、CO、CO2のいずれを含むガス
処理温度:室温(RT)〜400℃
処理時間:5分
酸化性ガス:O2、N2O、CO、CO2のいずれか含むガス
処理温度:室温(RT)〜400℃
処理時間:5分
本実施の形態においても、半導体チップは、第一の実施の形態における半導体チップ100と同様の構成を有する。本実施の形態において、半導体チップを個別化する手順が第一の実施の形態と異なる。
本実施の形態においても、第一の実施の形態において、図2(a)を参照して説明したのと同様の手順で半導体装置101が形成される(図3(a))。
本実施の形態においても、半導体チップは、第一の実施の形態における半導体チップ100と同様の構成を有する。本実施の形態において、半導体チップを個別化および酸化処理する手順が第一の実施の形態と異なる。
本実施の形態においても、第一の実施の形態において、図2(a)を参照して説明したのと同様の手順で半導体装置101が形成される(図4(a))。つづいて、ブレードダイシング、レーザダイシング、またはリソグラフィおよびドライエッチング技術により、半導体装置101を半導体基板の表面からチップ外縁に沿って切断するとともに、酸化性ガスを施し、酸化処理を行う(図4(b))。これにより、半導体装置101の積層膜150の側面が酸化される。酸化処理の条件は、第一の実施の形態と同様とすることができる。
第一の実施の形態で図2(a)を参照して説明した手順の一部と同様にして、半導体チップを製造した。まず、半導体基板上に下地絶縁膜を設け、その上にプラズマCVD法により、SiCN膜(膜厚50nm)を形成した。その後、SiCN膜上にプラズマCVD法により、SiOC膜(膜厚300nm)を形成した。つづいて、SiCN膜上にプラズマCVD法により、SiO2膜(膜厚100nm)を形成した。その後、SiO2膜上にレジスト膜を形成し、リソグラフィ技術およびエッチング技術により、配線溝を形成した。つづいて、レジスト膜を除去した。次いで、配線溝内にスパッタリング法によりTa/TaN膜を形成した。その後、バリア膜上において、配線溝を埋め込むように、電解めっき法により配線金属膜を形成した。つづいて、配線溝外部に形成された不要な配線金属膜およびバリア膜をCMPにより除去し、その上にSiO2膜を形成し、半導体装置を製造した。
例1と同様の手順で半導体装置を製造した後、半導体装置を大気中で常温で切断して半導体チップを個別化した。
炭素組成は、断面TEMのEDX(エネルギー分散型蛍光X線分析装置: Energy Dispersive X-Ray Fluorescence spectroscopy)分析により、炭素(C)とケイ素(Si)の強度比を測定することにより算出した。
102 下地層
104 第一のエッチングストッパ膜
106 第一の層間絶縁膜
108 第一の保護絶縁膜
110 第二のエッチングストッパ膜
112 第二の層間絶縁膜
114 第二の保護絶縁膜
116 第三のエッチングストッパ膜
118 第三の層間絶縁膜
120 第三の保護絶縁膜
122 第四のエッチングストッパ膜
124 上地カバー膜
130 第一の配線
132 ビアプラグ
134 第二の配線
Claims (18)
- 半導体基板と、
前記半導体基板上に形成された炭素含有絶縁膜と炭素非含有絶縁膜とを含む積層膜と、
を含み、
前記炭素非含有絶縁膜の端面が、前記炭素含有絶縁膜の端面より外側に位置しており、
前記炭素含有絶縁膜は、エッチングストッパ膜、および前記エッチングストッパ膜上に設けられた比誘電率が3.3以下の低誘電率膜を含み、
側面の一部が、前記炭素含有絶縁膜の端面および前記炭素非含有絶縁膜の端面により構成されていることを特徴とする半導体チップ。 - 請求項1に記載の半導体チップにおいて、
前記炭素含有絶縁膜は、端部における炭素の組成が、内部における炭素の組成よりも低いことを特徴とする半導体チップ。 - 請求項1または2に記載の半導体チップにおいて、
前記炭素含有絶縁膜は、端部近傍において、内部に向かうにつれ炭素の組成が高くなる領域を含むことを特徴とする半導体チップ。 - 請求項1乃至3いずれかに記載の半導体チップにおいて、
前記炭素含有絶縁膜は、端部における膜密度が、内部における膜密度よりも高いことを特徴とする半導体チップ。 - 請求項1乃至4いずれかに記載の半導体チップにおいて、
前記炭素含有絶縁膜は、端部近傍において、内部に向かうにつれ膜密度が低くなる領域を含むことを特徴とする半導体チップ。 - 請求項1乃至5いずれかに記載の半導体チップにおいて、
前記エッチングストッパ膜は、SiCN、またはSiCにより構成されることを特徴とする半導体チップ。 - 請求項1乃至6いずれかに記載の半導体チップにおいて、
前記低誘電率膜は、SiOC、メチルシルセスキオキサン、水素化メチルシルセスキオキサン、または有機ポリシロキサン、もしくはこれらの膜をポーラス化したものにより構成されることを特徴とする半導体チップ。 - 半導体基板と、
前記半導体基板上に形成された炭素含有絶縁膜を含む積層膜と、
を含み、
前記炭素含有絶縁膜は、端部における炭素の組成が、内部における炭素の組成よりも低く、
前記炭素含有絶縁膜は、エッチングストッパ膜、および前記エッチングストッパ膜上に設けられた比誘電率が3.3以下の低誘電率膜を含み、
側面の一部が、前記炭素含有絶縁膜の端面により構成されていることを特徴とする半導体チップ。 - 請求項8に記載の半導体チップにおいて、
前記炭素含有絶縁膜は、端部近傍において、内部に向かうにつれ炭素の組成が高くなる領域を含むことを特徴とする半導体チップ。 - 請求項8または9に記載の半導体チップにおいて、
前記低誘電率膜は、SiOC、メチルシルセスキオキサン、水素化メチルシルセスキオキサン、または有機ポリシロキサン、もしくはこれらの膜をポーラス化したものにより構成されることを特徴とする半導体チップ。 - 請求項8乃至10いずれかに記載の半導体チップにおいて、
前記エッチングストッパ膜は、SiCN、またはSiCにより構成されることを特徴とする半導体チップ。 - 半導体基板と、
前記半導体基板上に形成された炭素含有絶縁膜を含む積層膜と、
を含み、
前記炭素含有絶縁膜は、端部における膜密度が、内部における膜密度よりも高く、
前記炭素含有絶縁膜は、エッチングストッパ膜、および前記エッチングストッパ膜上に設けられた比誘電率が3.3以下の低誘電率膜を含み、
側面の一部が、前記炭素含有絶縁膜の端面により構成されていることを特徴とする半導体チップ。 - 請求項12に記載の半導体チップにおいて、
前記炭素含有絶縁膜は、端部近傍において、内部に向かうにつれ膜密度が低くなる領域を含むことを特徴とする半導体チップ。 - 請求項12または13に記載の半導体チップにおいて、
前記低誘電率膜は、SiOC、メチルシルセスキオキサン、水素化メチルシルセスキオキサン、または有機ポリシロキサン、もしくはこれらの膜をポーラス化したものにより構成されることを特徴とする半導体チップ。 - 請求項12乃至14いずれかに記載の半導体チップにおいて、
前記エッチングストッパ膜は、SiCN、またはSiCにより構成されることを特徴とする半導体チップ。 - 請求項1乃至15いずれかに記載の半導体チップにおいて、
前記半導体基板の側面は酸化されていない半導体チップ。 - 半導体基板上に炭素含有絶縁膜を含む積層膜を形成する工程と、
前記半導体基板の表面側からチップ外縁に沿って少なくとも前記炭素含有絶縁膜を切断し、前記炭素含有絶縁膜の側面を露出させる工程と、
側面が露出された前記炭素含有絶縁膜に酸化性ガスを施し、前記炭素含有絶縁膜の前記側面を酸化する工程と、
を含み、
前記炭素含有絶縁膜は、エッチングストッパ膜、および前記エッチングストッパ膜上に設けられた比誘電率が3.3以下の低誘電率膜を含むことを特徴とする半導体チップの製造方法。 - 請求項17に記載の半導体チップの製造方法において、
前記炭素含有絶縁膜の側面を露出させる工程において、前記半導体基板には切り込みは入れられず、
前記炭素含有絶縁膜の前記側面を酸化する工程の後に、前記半導体基板を切断する工程を備える半導体チップの製造方法。
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