JP4891335B2 - ハードウェア多標準対応ビデオデコーダ装置 - Google Patents
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Description
[031]以下に続く詳細な説明の一部は、プロシージャ、ステップ、論理ブロック、処理、及びコンピュータメモリ内のデータビットに対する操作のその他の記号的表現の観点で示される。これらの記述及び表現は、データ処理技術に精通した者によって、それらの者の業績の内容を当該技術に精通したその他の者に最も効果的に伝えるために使用される手段である。プロシージャ、コンピュータによって実行されるステップ、論理ブロック、プロセスなどは、ここで、及び概して、所望の結果をもたらす自己矛盾のない一連のステップ又は命令であると考えられる。ステップとは、物理量の物理的操作を必要とするステップである。必ずではないが通常は、これらの量は、記憶、転送、組合せ、比較、及びコンピュータシステムにおけるその他の操作を行われることができる電気的又は磁気的信号の形態を取る。これらの信号をビット、値、要素、シンボル、文字、語、数などと呼ぶことが、主に共通使用の理由で便利であることがあることが分かっている。
[033]図1は、本発明の実施形態が実施されることができる例示的なコンピュータシステム100を示す。概して、コンピュータシステム100は、情報を伝達するためのバス110と、情報及び命令を処理するための、バス110に結合された処理装置101と、処理装置101のための情報及び命令を記憶するための、バス110に結合された、ランダムアクセスメモリ(RAM)とも呼ばれる揮発性メモリ102と、処理装置101のための静的な情報及び命令を記憶するための、バス110に結合された、本明細書においては読み出し専用メモリ(ROM)とも呼ばれる不揮発性メモリ103とを含む。
[042]図3は、本発明の一実施形態によるハードウェア多標準対応ビデオデコーダ装置150の内部コンポーネントを示す図を示す。図3に示されるように、デコーダ装置150は、命令パーサ305、複数のハードウェア復号化ブロック310から318、ハードウェア後処理ブロック320、及びメモリ330を含む。デコーダ装置150は、複数のビデオ符号化標準を復号化するように動作可能である。
[061]以下の実施形態は、サポートされるビデオ標準のそれぞれに対するデコーダ装置400の動作を説明する。
[075]デコーダ装置400のパイプラインの段階3は、3つのハードウェア後処理ブロック、すなわち、ループ内デブロッキングフィルタ440、ループ外フィルタ442、及び回転エンジン450を含む。ループ内デブロッキングフィルタ440は、H.264及びWMV9/VC−1モードで使用される。一実施形態において、WMV9/VC−1モードで、ループ内デブロッキングフィルタ440は、重なり平滑化フィルタを実装するために使用される。
[079]図5は、ビデオストリームを復号化するための方法500のフローチャートを示し、方法は、本発明の実施形態によるハードウェア多標準対応ビデオデコーダ装置を使用して実行される。具体的なステップが方法500において開示されるが、そのようなステップは例示的である。すなわち、本発明の実施形態は、様々なその他のステップ、又は図5に記載のステップの変更形態を実行することによく適する。一実施形態において、方法500は、図3のデコーダ装置150によって実行される。
[084]本発明のハードウェア多標準対応ビデオデコーダ装置の実施形態は、複数のビデオストリームを同時に復号化するようにも動作可能である。マクロブロック又はフレームなどのビデオストリームの一部はインターリーブされる。デコーダ装置は、インターリーブされた部分に順次アクセスする。したがって、デコーダ装置は、インターリーブされた部分に対して復号化動作を実行する。例えば、復号化動作は、2つのビデオストリームのマクロブロックに対して実行されることができる。ビデオストリームは、ビデオストリームのマクロブロックが交互に現れるようにインターリーブされる。各クロックサイクルで、復号化動作が、交互に現れるビデオストリームに対して実行されることができる。
[095]図2Bを参照すると、一実施形態において、本発明は、マイクロコードエンジン260においてマクロブロックのバッファリング及び並べ替えを行う。本発明は、非ラスタ走査順のマクロブロックの送信及び受信をサポートするビデオ標準のためのループ内デブロッキングをサポートするために、マクロブロックをラスタ走査順に整列することを提供する。マイクロコードエンジン260は、ビデオストリームのフレームのマクロブロックを表す圧縮データを受信するように構成される。一実施形態において、少なくとも1つのマクロブロックが順番が狂って受信される。マイクロコードエンジン260は、圧縮データをバッファリングするように構成され、フレームのマクロブロックをラスタ走査順に整列するように構成される。
[0103]本発明の実施形態は、ビデオストリームがメモリに書き込まれる前に、ビデオストリームを「オンザフライで」回転するための回転エンジンを提供する。本発明の実施形態は、ビデオストリームが受信されるときにそれらのビデオストリームのマクロブロックを回転し、回転に基づいてフレーム内でマクロブロックを再配置することによってビデオストリームを回転することができる。本発明の実施形態は、復号化されたマクロブロックをメモリに書き込む前にマクロブロックに対して動作することによって、復号化されたフレームにおいてセカンドパス(second pass)を必要とせずにビデオストリームを回転することができる。
Claims (9)
- ハードウェア多標準対応ビデオデコーダ装置を使用して実行される、復号化のための方法であって、
複数のビデオストリームのうちの1つである第1のビデオストリームにアクセスするステップと、
前記第1のビデオストリームを符号化するために使用された第1のビデオ標準を特定するステップと、
前記第1のビデオストリームを復号化するために使用される前記ハードウェア多標準対応ビデオデコーダ装置の複数のハードウェア復号化ブロックのうち、ハードウェア復号化ブロックの第1のサブセットを決定するステップであり、前記複数のハードウェア復号化ブロックの異なるサブセットは、異なるビデオ符号化標準を使用して符号化されたビデオストリームを復号化するように動作可能である、前記決定するステップと、
ハードウェア復号化ブロックの前記第1のサブセットを使用して前記第1のビデオストリームを復号化するステップと
を含み、
前記複数のハードウェア復号化ブロックは、ハードウェアベースの復号化を実行するように動作可能であり、
前記複数のハードウェア復号化ブロックは、多段階マクロブロックレベルパイプライン内に実装される、方法。 - 前記多段階マクロブロックレベルパイプラインの1つの段階で前記第1のビデオストリームのデータが受信されない場合に前記段階の中のハードウェア復号化ブロックを停止するステップをさらに含む請求項1に記載の方法。
- 前記複数のビデオストリームにアクセスするステップと、
前記複数のビデオストリームのうちのビデオストリームに対して使用された第2のビデオ標準を特定するステップと、
前記複数のビデオストリームの一部をインターリーブするステップと、
前記複数のハードウェア復号化ブロックのうち、ハードウェア復号化ブロックの複数のサブセットを決定するステップと、
ハードウェア復号化ブロックの前記複数のサブセットを使用して前記複数のビデオストリームを復号化するステップと
をさらに含む請求項1または2に記載の方法。 - 前記複数のビデオストリームは、少なくとも1つのデジタル静止画像ストリーム、及びデジタルムービーストリームを含む請求項3に記載の方法。
- 前記複数のビデオストリームの前記一部は、前記デジタル静止画像ストリーム及び前記デジタルムービーストリームのフレームである請求項4に記載の方法。
- 前記複数のビデオストリームは、複数のデジタルムービーストリームを含む請求項3〜5のいずれかに記載の方法。
- 前記複数のビデオストリームの前記一部は、前記複数のデジタルムービーストリームのマクロブロックである請求項6に記載の方法。
- 前記第1のビデオストリームの復号化に関係のないハードウェア復号化ブロックが作動されないようにハードウェア復号化ブロックの前記サブセットを作動するステップをさらに含む請求項1〜7のいずれかに記載の方法。
- 前記第1のビデオストリームを復号化する前記ステップの後でメモリユニットにアクセスするステップをさらに含む請求項1〜8のいずれかに記載の方法。
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