JP4868868B2 - 基準電圧発生回路 - Google Patents
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Description
30、40、50、60、70 基準電圧発生回路
65 反転増幅回路
M1〜M14、M21〜M25、M31〜M34 トランジスタ
R1、R2、R21、R22、R31 抵抗
Claims (15)
- 同一特性の2つのMOSトランジスタにより構成されるカレントミラー回路と、
前記2つのMOSトランジスタのうち、一方のトランジスタの出力側に接続された、第1のトランジスタであるディプレッション型トランジスタと、前記2つのMOSトランジスタのうち他方のトランジスタの出力側に接続された、第2のトランジスタであるエンハンスメント型トランジスタにより構成されるペアMOSトランジスタと、
前記第1のトランジスタまたは前記第2のトランジスタの出力側に接続された第3のトランジスタと、
該第3のトランジスタの出力側に接続された該第3のトランジスタの負荷と、により構成され、
前記第3のトランジスタと前記負荷の接続点から出力される電圧が、前記第2のトランジスタのゲートに印加され、
前記第1のトランジスタのドレイン電流と、前記第2のトランジスタのドレイン電流が同一となるときの、前記第1のトランジスタのゲート電圧と、前記第2のトランジスタのゲート電圧との差を出力電圧する基準電圧発生回路において、
前記第1のトランジスタのゲートとソースが接続され、
前記第1のトランジスタと前記第2のトランジスタのソースが接地され、前記第2のトランジスタのゲート電圧を出力電圧とし、
前記第1のトランジスタと前記第2のトランジスタにおいて、それぞれのチャネルは同一の導電型で形成され、それぞれのゲートは異なる導電型不純物で形成され、前記それぞれのゲートのゲートサイズが異なることを特徴とする基準電源発生回路。 - 前記第1のトランジスタのチャネル幅Wdとチャネル長Ldの比SdをSd=Wd/Ldとし、前記第2のトランジスタのチャネル幅Weとチャネル長Leの比SeをSe=We/Leとし、前記Seと前記Sdの比をSe/Sdとしたとき、
前記Se/Sdが、0.5から0.67であることを特徴とする請求項1記載の基準電圧発生回路。 - 前記カレントミラー回路を構成する前記2つのMOSトランジスタは、低スレッショルド電圧のトランジスタであること特徴とする請求項1又は2記載の基準電圧発生回路。
- 前記第3のトランジスタは、前記カレントミラー回路を構成するMOSトランジスタと同一の特性であり、前記第3のトランジスタの負荷に流れる負荷電流が前記第1のトランジスタのドレイン電流と等しいことを特徴とする請求項1ないし3のいずれか一項に記載の基準電圧発生回路。
- 前記第1のトランジスタのドレイン電圧と、前記第2のトランジスタのドレイン電圧を略同電位とする回路を備えたことを特徴とする請求項1ないし4のいずれか一項に記載の基準電圧発生回路。
- 前記第1のトランジスタのドレイン電圧と、前記第2のトランジスタのドレイン電圧を略同電位とする回路は、前記第1のトランジスタのドレインと前記カレントミラー回路の一方の出力側との間に配設された第4のトランジスタと、
前記第2のトランジスタのドレインと前記カレントミラー回路の他方の出力側との間に配設された第5のトランジスタで構成され、
前記第4のトランジスタと前記第5のトランジスタのゲートが共通接続され、
共通接続された前記ゲートには、前記第3のトランジスタと前記負荷との接続点の電圧、または該電圧に比例した電圧が印加されることを特徴とする請求項5に記載の基準電圧発生回路。 - 前記第4のトランジスタと前記第5のトランジスタは、低スレッショルド電圧のトランジスタであることを特徴とする請求項6に記載の基準電圧発生回路。
- 前記第4のトランジスタと前記第5のトランジスタは、ディプレッション型トランジスタであることを特徴とする請求項6に記載の基準電圧発生回路。
- 前記第4のトランジスタと前記第5のトランジスタは、導電型不純物ゲートを有するトランジスタである請求項6に記載の基準電圧発生回路。
- 前記カレントミラー回路は、同一特性の2つのMOSトランジスタにより構成される代わりに、2組の、スレッショルド電圧の異なる2つのMOSトランジスタを直列接続した回路により構成され、
2組の前記回路において、前記スレッショルド電圧の高い方のMOSトランジスタは電源電圧側に配置されたことを特徴とする請求項1ないし9のいずれか一項に記載の基準電圧発生回路。 - 前記第3のトランジスタの負荷を定電流源したことを特徴とする請求項1ないし10のいずれか一項に記載の基準電圧発生回路。
- 前記第3のトランジスタのゲートは、負荷を定電流源とした第6のトランジスタを介して、前記ペアMOSトランジスタの一方の出力側に接続されることを特徴とする請求項1ないし11のいずれか一項に記載の基準電圧発生回路。
- 前記第6のトランジスタのゲートは、負荷を抵抗とする前記第3のトランジスタを介して前記ペアMOSトランジスタの一方の出力側に接続されること特徴とする請求項12に記載の基準電圧発生回路。
- 該基準電圧発生回路は、前記第3のトランジスタと前記負荷との接続点の電圧と比例した電圧、または前記第6のトランジスタと前記負荷との接続点の電圧と比例した電圧を出力電圧とする請求項12又は13に記載の基準電圧発生回路。
- 該基準電圧発生回路は、前記第3のトランジスタまたは前記第6のトランジスタと接続され、カレントミラー回路を構成する第7のトランジスタを備え、
前記第7のトランジスタのドレイン電流を出力することを特徴とする請求項12ないし14のいずれか一項に記載の基準電圧発生回路。
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