JP4837395B2 - オペアンプ装置 - Google Patents
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Description
以下、図面を参照して本発明の実施の形態について説明する。実施の形態1にかかるオペアンプ装置10及びその周辺回路のブロック図を図1に示す。図1に示すように、本実施の形態のオペアンプ装置10は、2つの入力端子(入力端子VIN+、VIN−)と1つの出力端子(出力端子VOUT)とを有し、接地端子GNDが第1の電位(例えば、接地電位)に接続されており、電源端子VCCが第2の電位(例えば、電源PWR)に接続されている。また、入力端子VIN+と入力端子VIN−との間の電圧差を調整するデジタル値の制御信号が外部装置(例えば、マイコン(マイクロコンピュータ)11)から入力される制御信号入力端子Din1、Din2とを有している。
実施の形態2にかかるオペアンプ装置20の回路図を図3に示す。実施の形態1にかかるオペアンプ装置10では、差動対に電流を供給する接点と2つのトランジスタの間に接続される抵抗の比を変更して入力オフセット電圧を制御していた。これに対し、実施の形態2にかかるオペアンプ装置20は、差動対を構成する2つのトランジスタの一方の端子(例えば、コレクタ端子)と接地端子GNDとの間に接続される抵抗の比率を変化させることで入力オフセット電圧を制御する。ここで、実施の形態1と実施の形態2とで同じ構成要素については、同一の符号を付して説明を省略する。
実施の形態3にかかるオペアンプ装置30の回路図を図4に示す。実施の形態3にかかるオペアンプ装置30は、2入力(入力端子VIN+、VIN−)2出力(出力端子VOUT+、VOUT−)のオペアンプとして動作する。なお、本実施の形態では、入力端子VIN+、VIN−、出力端子VOUT+、VOUT−には何も接続していない。
11 マイコン
12 増幅部
13 出力部
14 電流制御回路
15 データバッファ
16 基準クロックバッファ
17 データ同期回路
18 パラレル変換器
20 オペアンプ装置
21 増幅部
30 オペアンプ装置
VIN 入力端子
VOUT 出力端子
Din1、Din2 制御信号入力端子
Claims (10)
- 外部装置からデジタル値で制御信号を受信する制御信号入力端子と、
差動増幅回路の差動対を構成する第1及び第2のトランジスタと、
前記第1及び第2のトランジスタをそれぞれ制御する第1及び第2の入力信号端子と、
前記第1及び第2のトランジスタ間に直列に接続され、それぞれ異なる抵抗値を有する複数の抵抗と、
前記複数の抵抗間の接続点に接続される複数の定電流回路と、
前記制御信号入力端子で受信した前記制御信号に応じて、前記第1及び第2の入力信号端子との間の電位差が生じるように所定の電流を前記差動対に供給する定電流回路を前記複数の定電流回路から選択する制御回路と、
を有するオペアンプ装置。 - 前記第1及び第2の入力信号端子間に接続される抵抗と、
前記第1及び第2の入力信号端子間に接続される抵抗の一端と電源との間に接続される発光素子とを有する請求項1記載のオペアンプ装置。 - 前記複数の抵抗のうち、前記差動対に電流を供給する前記定電流回路と前記第1のトランジスタとの間に接続される抵抗を第1の抵抗とし、前記定電流回路と前記第2のトランジスタとの間に接続される抵抗を第2の抵抗とし、
前記第1、第2の抵抗は、前記制御信号に応じて選択された定電流回路が出力する電流値と前記第1及び第2の抵抗の抵抗値とに基づき前記第1及び第2の入力信号端子間に接続された抵抗の両端に第1、第2の電位差を生成することを特徴とする請求項2に記載のオペアンプ装置。 - 前記オペアンプ装置は、シリアルデータとして送信される前記制御信号に応じて前記第1の抵抗の抵抗値と前記第2の抵抗の抵抗値との比を変更することを特徴とする請求項3に記載のオペアンプ装置。
- 前記オペアンプ装置は、パラレルデータとして送信される前記制御信号に応じて前記第1の抵抗の抵抗値と前記第2の抵抗の抵抗値との比を変更することを特徴とする請求項3に記載のオペアンプ装置。
- 外部装置からデジタル値で制御信号を受信する制御信号入力端子と、
差動増幅回路の差動対を構成する第1及び第2のトランジスタと、
前記第1及び第2のトランジスタをそれぞれ制御する第1及び第2の入力信号端子と、
前記第1のトランジスタに流れる電流の大きさに応じて第1の電位を生成する第1の抵抗と、
前記第2のトランジスタに流れる電流の大きさに応じて第2の電位を生成する第2の抵抗と、
前記制御信号入力端子で受信した前記制御信号に応じて、前記第1の電位と第2の電位とに電位差を生じるように前記第1及び第2の抵抗の各抵抗値を変更する制御回路と、を有し、
前記電位差に基づき前記第1及び前記第2の入力信号端子間に電位差を設定するオペアンプ装置。 - 外部装置からデジタル値で制御信号を受信する制御信号入力端子と、
差動増幅回路の差動対を構成する第1及び第2のトランジスタと、
前記第1及び第2のトランジスタをそれぞれ制御する第1及び第2の入力信号端子と、
前記第1のトランジスタに流れる電流の大きさに応じて第1の電位を生成する第1の抵抗と、
前記第2のトランジスタに流れる電流の大きさに応じて第2の電位を生成する第2の抵抗と、
前記第1及び第2の入力端子間に接続される抵抗と、
前記第1及び第2の入力端子間に接続される抵抗の一端と電源とのあいだに接続される発光素子と、を有し、
前記制御信号入力端子で受信した前記制御信号に応じて、前記第1の電位と前記第2の電位とに電位差を生じさせ、当該電位差に基づき前記第1及び前記第2の入力信号端子との間の電位差を設定するオペアンプ装置。 - 前記第1の抵抗は、前記第1のトランジスタと第1の電位との間に直列に接続された複数の抵抗であり、前記第2の抵抗は、前記第2のトランジスタと前記第1の電位との間に直列に接続された複数の抵抗であることを特徴とする請求項6又は7に記載のオペアンプ装置。
- 前記第1及び第2の抵抗を任意の比率に分割する点のそれぞれに接続される複数のスイッチ回路を有し、前記制御信号に応じて前記複数のスイッチ回路を導通状態あるいは非導通状態とすることで、前記第1の抵抗の抵抗値と前記第2の抵抗の抵抗値との比率を変更することを特徴とする請求項6乃至8のいずれか1項に記載のオペアンプ装置。
- 前記制御回路は、前記選択された定電流回路と前記第1のトランジスタとの間に接続される第1の抵抗の抵抗値と、前記選択された定電流回路と前記第2のトランジスタとの間に接続される第2の抵抗の抵抗値とが異なるように、前記定電流回路を選択する請求項1記載のオペアンプ装置。
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