JP4785357B2 - プラズマディスプレイパネル用駆動回路 - Google Patents

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Description

本発明は、プラズマディスプレイパネル用駆動回路（ドライバ）に関する。本発明は、特に、ディスプレイセルの持続中に電流ループを低減できる駆動回路構造に関する。
現在、２つのボード間に分割された素子を有するプラズマディスプレイパネル（以下、PDD）駆動回路が存在しており、この場合、持続電極Ysを制御する素子が第１のボードに配置され、アドレス持続電極Yasを制御する素子が第２のボードに配置される。この場合が図１に示される。ディスプレイセルの持続電極Ysは、第１のボードB1上にアセンブルされる。2つのスイッチI1，I2は、電圧Vsを受ける電源端子T1と、グランドに接続される端子T2との間に直列に接続される。電圧Vsは、ディスプレイセルのアドレス持続電極Yas及び持続電極Ysに印加される持続パルス信号のピーク電圧を意味する。スイッチI1，I2間に位置する中間点は、ディスプレイセルの持続電極YsにアクセスするコネクタCN1に接続される。更に、電源及び減結合キャパシタC１が、端子T1，T2間に接続されている。
同様に、ディスプレイセルの持続電極Yasを制御する手段は、第２のボードB２上にアセンブルされる。2つのスイッチI３，I４は、電圧Vsを受ける電源端子T３と、グランドに接続される端子T４との間に直列に接続される。スイッチI３，I４間に位置する中間点は、ディスプレイセルの電極YasにアクセスするコネクタCN２に接続される。更に、電源及び減結合キャパシタC２が、端子T３，T４間に接続されている。
持続フェーズでは、スイッチI１，I４が、最初に閉じられ、次いで、スイッチI２，I３が閉じられる。図２Ａは、スイッチI１，I４が閉じられた時の駆動回路に存在する電流ループを示す。同様に、図２Ｂは、スイッチI２，I３が閉じられた時の駆動回路に存在する電流ループを示す。これらの図から分かるように、これらの電流ループは、比較的大きく、電磁放射の生成をもたらす。
これらの電流ループのサイズを低減するために、知られた解決策は、単一のボード上に駆動回路の２部品を再編することである。この場合が図３に示される。この第２の駆動回路では、当業者に公知のエネルギ回収回路が設けられる。かくして、図１で駆動回路の全ての素子は、図示されない電源端子Ｔ３及びグランド端子Ｔ４から離れて、単一のボードに搭載される。回収回路とディスプレイ電極Ｙｓ，Ｙａｓとの間の電流ループが、図４Ａに示される。同様に、一方ではスイッチI１，I４が、他方ではスイッチI２，I３が閉じられたときの電流ループが、図４Ｂ，図４Ｃに示される。これらの電流ループのサイズは、図１の駆動回路に比して低減されるが、回路がハイブリッド回路（ある複数の構成要素が集積された）である場合でさえも、依然として存在している。
本発明の目的は、電磁放射を低減するために駆動回路における電流ループのサイズを低減することである。
本発明は、プラズマディスプレイパネル用の駆動回路に関し、当該駆動回路は、前記ディスプレイのセルの持続電極(sustain electrodes)に第１の持続パルス信号を、前記ディスプレイのアドレス持続電極(address-sustain electrodes)に第２の持続パルス信号を送るように設計された持続回路を含み、該持続回路が、前記ディスプレイのセルの持続電極にアクセスする第１のアクセスコネクタと前記第１及び第２の持続パルス信号のピーク電圧を受ける電源端子との間に接続される第１のスイッチと、前記第１のアクセスコネクタとグランドとの間に接続される第２のスイッチと、前記ディスプレイのセルのアドレス持続電極にアクセスする第２のアクセスコネクタと前記電源端子との間に接続される第３のスイッチと、前記第２のアクセスコネクタとグランドとの間に接続される第４のスイッチとを含み、
当該駆動回路は、単一のボードに搭載され、前記第１及び第４のスイッチ、及び同様に前記第２及び第３のスイッチは、前記ディスプレイのセルの持続期間中における電流ループのサイズを低減するため、互いに隣り合って配置されることを特徴とする。
効果的には、前記第１及び第２のアクセスコネクタは、電流ループのサイズをさらに低減するため、前記ボードの周辺部にて同一の縁部上で互いに隣り合って配置される。
好ましい実施例によると、前記アクセスコネクタの一方は、前記ボードの前面上に配置され、他方は背面上に配置される。
その他の実施例によると、前記第１及び第２のアクセスコネクタは、単一のコネクタに一体化される。
本発明は、添付図面を参照して、非限定的な例として示される後続の説明を読むことでより良く理解されるだろう。
本発明によると、ＰＤＰの駆動回路における各素子の位置は、３次元全てでループのサイズを低減するために最適化される。図５Ａは、一平面（ｘ、ｙ）における本発明の駆動回路を示し、図５Ｂは、平面（ｙ、ｚ）における同回路を示す。
これらの図では、スイッチI１，I４は、閉じた時にそれらに流れる電流のループを低減するため、ｘ軸上の同一高さで、互いに隣り合って配置されている。同じことがスイッチI２，I３に対しても提供され、閉じた時にそれらに流れる電流のループを低減する。
更に、アクセスコネクタＣＮ１，ＣＮ２が、ボードの周辺部にて、ボードの同一縁部上で互いに隣同士にて配置されており、ここでは、ボードの左側縁部上に配置されている。全ての電流ループがこれら２つのアクセスコネクタを通るとすると、これは、これらのループのサイズを更に低減することを可能とする。この好ましい実施例では、コネクタＣＮ１は、ボードの前面上に配置され、コネクタＣＮ２は、平面（ｘ、ｙ）内の同一位置で、背面上に配置される。スイッチI２，I３間に位置する中間点を、コネクタＣＮ２に接続するトラックは、それ故に、中間点をエネルギ回収回路に接続するトラックと共に、ボードの背面上に形成される。全ての他の回路要素及びトラックは、ボードの前面上に搭載され、スクリュウが、例えば、前面上の要素に背面上のトラックをリンクするために設けられる。
従って、図６Ａ及び図６Ｆから分かるように、電流ループが大幅に低減される。図６Ａ及び図６Ｂは、回収回路とディスプレイ電極Ｙｓ及びＹａｓとの間の電流ループを示す。図６Ｃ及び図６Ｄは、スイッチI１，I４が閉じられた時にこれらを通って流れる電流のループを示す。図６Ｅ及び図６Ｆは、スイッチI２，I３が閉じられた時にこれらを通って流れる電流のループを示す。
ｚ方向における電流ループのサイズは、大幅に低減され、ボードの厚さによって実質的に決定される。平面（ｘ、ｙ）では、電流ループのサイズは、スイッチI１，I４及びまたスイッチI２，I３が互いに非常に近い場合、及び、それらがアクセスコネクタＣＮ１及びＣＮ２の近くに配置された場合、低減される。尚、この図では、２つの電源端子Ｔ１，Ｔ４及び２つのグランド端子Ｔ２，Ｔ３が、回路図を明瞭化するために示される。明らかながら、唯一の電源端子及び唯一のグランド端子の設置も可能であり、この場合、無くなった端子を接続された要素をこられの２つの端子にリンクするために追加のトラックを用いる。
この解決策は、集積回路設計やディスクリート（離散的）の部品でなるものに対しても有効である。近距離場測定結果は、電磁放射が従来的な回路に比して低減されたことを実証した。
変形例として、コネクタＣＮ１，ＣＮ２に代えて単一のコネクタを使用することも考えられ得る。この場合、このコネクタのピンの幾つかは、電極Ysに割り当てられ、他は、電極Yasに割り当てられるだろう。
先行技術による２ボード分割のPDP駆動回路を示す図である。 図１に示す回路における電流ループを示す図である。 図１に示す回路における電流ループを示す図である。 先行技術による単一ボード駆動回路を示す図である。 図３に示す回路における電流ループを示す図である。 図３に示す回路における電流ループを示す図である。 図３に示す回路における電流ループを示す図である。 本発明による駆動回路を示す平面図である。 本発明による駆動回路を示す断面図である。 図５に示す回路における電流ループを示す図である。 図５に示す回路における電流ループを示す図である。 図５に示す回路における電流ループを示す図である。 図５に示す回路における電流ループを示す図である。 図５に示す回路における電流ループを示す図である。 図５に示す回路における電流ループを示す図である。
符号の説明
I１，I４ スイッチ
I２，I３ スイッチ
ＣＮ１，ＣＮ２ アクセスコネクタ

Claims (4)

  1. プラズマディスプレイパネル用の駆動回路であって、該ディスプレイのセルの持続電極に第１の持続パルス信号を、前記ディスプレイのアドレス持続電極に第２の持続パルス信号を送るように設計された持続回路を含み、該持続回路が、前記ディスプレイのセルの持続電極にアクセスする第１のアクセスコネクタと前記第１及び第２の持続パルス信号のピーク電圧を受ける電源端子との間に接続される第１のスイッチと、前記第１のアクセスコネクタとグランドとの間に接続される第２のスイッチと、前記ディスプレイのセルのアドレス持続電極にアクセスする第２のアクセスコネクタと前記電源端子との間に接続される第３のスイッチと、前記第２のアクセスコネクタとグランドとの間に接続される第４のスイッチと、前記グランド側の前記第４のスイッチと前記電源端子側の前記第１のスイッチの間に接続される第１減結合キャパシタと、前記グランド側の前記第２のスイッチと前記電源端子側の前記第３のスイッチの間に接続される第２減結合キャパシタとを含む、駆動回路において、
    当該駆動回路は、単一のボードに搭載され、前記第１及び第４のスイッチ、及び同様に前記第２及び第３のスイッチは、前記ディスプレイのセルの持続期間中における電流が流れた際に形成される電流ループのサイズが低減されるように、互いに隣り合って配置されることを特徴とする駆動回路。
  2. 前記第１及び第２のアクセスコネクタは、前記ボードの周辺部で同一の縁部上に互いに隣り合って配置される、請求項１に記載の駆動回路。
  3. 前記アクセスコネクタの一方は、前記ボードの前面上に配置され、他方は背面上に配置される、請求項１又は２に記載の駆動回路。
  4. 前記第１及び第２のアクセスコネクタは、単一のコネクタに一体化される、請求項１又は２に記載の駆動回路。
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