JP4766050B2 - 電子回路装置の製造方法 - Google Patents

電子回路装置の製造方法 Download PDF

Info

Publication number
JP4766050B2
JP4766050B2 JP2007542333A JP2007542333A JP4766050B2 JP 4766050 B2 JP4766050 B2 JP 4766050B2 JP 2007542333 A JP2007542333 A JP 2007542333A JP 2007542333 A JP2007542333 A JP 2007542333A JP 4766050 B2 JP4766050 B2 JP 4766050B2
Authority
JP
Japan
Prior art keywords
semiconductor element
electronic circuit
circuit device
external connection
terminal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2007542333A
Other languages
English (en)
Other versions
JPWO2007052476A1 (ja
Inventor
謙太郎 熊澤
繁 近藤
英信 西川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Corp
Panasonic Holdings Corp
Original Assignee
Panasonic Corp
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Panasonic Corp, Matsushita Electric Industrial Co Ltd filed Critical Panasonic Corp
Priority to JP2007542333A priority Critical patent/JP4766050B2/ja
Publication of JPWO2007052476A1 publication Critical patent/JPWO2007052476A1/ja
Application granted granted Critical
Publication of JP4766050B2 publication Critical patent/JP4766050B2/ja
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/50Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • H01L21/565Moulds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • H01L21/568Temporary substrate used as encapsulation process aid
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49517Additional leads
    • H01L23/49524Additional leads the additional leads being a tape carrier or flat leads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49575Assemblies of semiconductor devices on lead frames
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L24/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L24/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/86Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using tape automated bonding [TAB]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32135Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/32145Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L2224/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • H01L2224/37001Core members of the connector
    • H01L2224/37099Material
    • H01L2224/371Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/37138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/37147Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L2224/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • H01L2224/3754Coating
    • H01L2224/37599Material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L2224/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • H01L2224/401Disposition
    • H01L2224/40135Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/40137Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45117Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/45124Aluminium (Al) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45144Gold (Au) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45147Copper (Cu) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/4813Connecting within a semiconductor or solid-state body, i.e. fly wire, bridge wire
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48135Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/48137Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48135Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/48145Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • H01L2224/48463Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
    • H01L2224/48465Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4912Layout
    • H01L2224/49171Fan-out arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4912Layout
    • H01L2224/49175Parallel arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838Bonding techniques
    • H01L2224/8385Bonding techniques using a polymer adhesive, e.g. an adhesive based on silicone, epoxy, polyimide, polyester
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/85Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H01L2224/85001Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector involving a temporary auxiliary member not forming part of the bonding apparatus, e.g. removable or sacrificial coating, film or substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/85Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H01L2224/852Applying energy for connecting
    • H01L2224/85201Compression bonding
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/065Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L25/0652Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00 the devices being arranged next and on each other, i.e. mixed assemblies
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/16Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different main groups of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. forming hybrid circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01013Aluminum [Al]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01015Phosphorus [P]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01028Nickel [Ni]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01029Copper [Cu]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01033Arsenic [As]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01047Silver [Ag]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/0105Tin [Sn]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01074Tungsten [W]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01082Lead [Pb]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/06Polymers
    • H01L2924/078Adhesive characteristics other than chemical
    • H01L2924/07802Adhesive characteristics other than chemical not being an ohmic electrical conductor
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/12Passive devices, e.g. 2 terminal devices
    • H01L2924/1204Optical Diode
    • H01L2924/12041LED
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/14Integrated circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • H01L2924/1815Shape
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/1901Structure
    • H01L2924/1904Component type
    • H01L2924/19041Component type being a capacitor
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/1901Structure
    • H01L2924/1904Component type
    • H01L2924/19042Component type being an inductor
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/1901Structure
    • H01L2924/1904Component type
    • H01L2924/19043Component type being a resistor
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19105Disposition of discrete passive components in a side-by-side arrangement on a common die mounting substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/301Electrical effects
    • H01L2924/30105Capacitance
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/35Mechanical effects
    • H01L2924/351Thermal stress

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Description

本発明は、半導体素子または半導体素子と受動部品の複合部品からなる電子回路装置に関し、特に配線基板を用いずに構成する電子回路装置およびその製造方法に関する。
近年、ICカード、携帯電話や携帯用端末機器などにおいては、半導体素子や半導体素子と電子部品を複合化して構成する電子回路装置の薄型化、小型化、軽量化が求められている。このような小型、薄型化を実現するために、特にダイパッドや配線基板を用いない電子回路装置が提案されている。
図10は、日本特開2001−217338号公報(以下、「特許文献1」と記す)に開示されている配線基板などの支持基板を用いない構成からなる従来の電子回路装置の断面図を示している。この電子回路装置は、絶縁性樹脂56中に、導電路50、半導体素子51およびチップ型電子部品54が埋め込まれている。半導体素子51は、銀ペーストなどの導電性ペースト52によって導電路50のうちの導電路50Bに固着されている。また、半導体素子51の電極パッド(図示せず)は、金属細線53により導電路50のうちの導電路50A、50Cに接続されている。さらに、チップ型電子部品54の電極は、ロウ材55を用いて導電路50のうちの導電路50C、50Dに接続されている。なお、導電路50は、厚さ方向の一部が絶縁性樹脂56中に埋め込まれており、その他の面は絶縁性樹脂56から露出している。
絶縁性樹脂56としては、エポキシ樹脂などの熱硬化性樹脂やポリイミド樹脂などの熱可塑性樹脂が用いられ、金型を用いたモールド成型により図示するような形状に加工される。また、導電路50としては、銅主材またはアルミニウム主材の導電箔あるいは鉄−ニッケルなどの合金箔が主として用いられる。
この電子回路装置は、以下のようにして作製される。最初に、導電箔の厚さ方向に、最終的にそれぞれの導電路50A、50B、50C、50Dとなる形状の厚みより深い分離溝を形成する。つぎに、導電路50Bとなる領域に半導体素子51をダイボンドし、金属細線53により導電路50A、50Cとなる領域と電極パッドを接続する。さらに、チップ型電子部品54を導電路50C、50Dとなる領域にはんだなどにより実装する。この後、絶縁性樹脂56によりモールドする。さらに、導電箔を研磨して分離溝を露出させると、それぞれが分離した導電路50A、50B、50C、50Dを有する電子回路装置を得ることができる。
また、薄いパッケージ形状とするだけでなく、はんだリフロー時にパッケージのクラックを生じないようにすることを目的とした電子回路装置が、日本特開平7−321139号公報(以下、「特許文献2」と記す)に開示されている。
図11は、この電子回路装置の断面図である。この電子回路装置は、半導体素子61の電極パッド(図示せず)とリード62とが金属細線であるボンディングワイヤ63で接続された後、リード62の一部を除き絶縁性樹脂64でモールドされた構造である。リード62および半導体素子61を絶縁性樹脂64で支持しているため、支持基板が不要であり、従来のリードフレームを用いる電子回路装置に比べて、より薄型とすることができるだけでなく、はんだリフロー時に加熱を受けてもクラックが生じ難い。
この電子回路装置は、以下のようにして作製される。最初に、半導体素子61を固定する凹部を有する支持台を準備する。つぎに、支持台の凹部に半導体素子61およびリードフレームを配置する。リードフレームには、ダイパッドが設けられておらず、リード62のみが設けられている。半導体素子61は真空吸着によって支持台に仮固定される。つぎに、半導体素子61の電極パッド(図示せず)とリード62間をボンディングワイヤ63で接続する。この状態で、リードフレームおよびボンディングワイヤ63で保持されている半導体素子61を支持台から取り外し、モールド金型内に設置してから樹脂モールドする。この後、モールドされた構造体からリードフレームを切断し、リード62の先端部を外方に折り曲げ加工すると、図11に示す電子回路装置が得られる。
上記特許文献1で説明した電子回路装置は、導電路を絶縁性樹脂で支持しているので、最終状態では支持基板は不要となる。したがって、従来のリードフレームを用いた電子回路装置に比べると、より薄型の電子回路装置を実現できる。しかし、半導体素子は導電路の面上にはんだなどにより固着されるので、熱膨張係数差による歪が作用し、剥離やクラックなどが発生する場合がある。また、電子回路装置とするためには、導電箔を分離溝が露出するまで研磨することが必要であるが、このステップは比較的複雑であり、低コスト化に対する課題を有している。
また、特許文献2で説明した電子回路装置の場合には、半導体素子はダイパッド固着せず、絶縁性樹脂中に埋設された構成を有している。これにより、回路基板への実装時に電子回路装置が加熱されても、クラックなどの不良発生を防止できる。
しかし、この電子回路装置はリードがモールド樹脂である絶縁性樹脂の側面から露出し、折り曲げられた構成の外部接続端子を有しており、回路基板の実装面積を小さくすることができない。また、この方法においては、複数の半導体素子、あるいは半導体素子と受動部品などの複合部品に対する実装構成については、何ら開示していない。
本発明の電子回路装置は、少なくとも1個の半導体素子と、複数個の外部接続端子と、この半導体素子と外部接続端子とを電気的に接続する接続導体と、半導体素子を被覆し、かつ接続導体を一体に支持する絶縁性樹脂とを備え、半導体素子は絶縁性樹脂中に埋設され、外部接続端子の端子面は絶縁性樹脂から露出している構成からなる。
このような構成とすることにより、半導体素子は接続導体のみにより保持されて絶縁性樹脂のほぼ中央領域に埋設されるので、反りを大幅に小さくすることができる。
また、本発明の電子回路装置の製造方法は、半導体素子を収容するための素子収容領域と、素子収容領域より深い段差を有して形成され、複数個の外部接続端子を収容するための端子収容領域とを有する位置決めプレートをセットするプレート準備ステップと、半導体素子の電極パッドが露出する方向に、半導体素子を素子収容領域に配置するとともに、外部接続端子を端子収容領域に配置する配置ステップと、半導体素子と外部接続端子とを接続導体によって電気的に接続する接続ステップと、接続導体、半導体素子および外部接続端子の露出面を絶縁性樹脂で覆いモールドする第1の樹脂モールドステップと、端子収容領域に接触していた外部接続端子のうちの端子面を除く領域および素子収容領域に接触していた半導体素子面を除く領域を、絶縁性樹脂で覆いモールドして、半導体素子を絶縁性樹脂中に埋設するとともに半導体素子と外部接続端子とを一体化し、かつ端子面を露出させる第2の樹脂モールドステップを備えた方法からなる。
このような方法とすることにより、半導体素子を絶縁性樹脂のほぼ中央領域に埋設しながら、外部接続端子の端子面を露出する構成とすることができる。この結果、反りを大幅に抑制することができる。
以下、本発明の実施の形態について、図面を参照しながら説明する。なお、同じ要素については同じ符号を付しており、説明を省略する場合がある。
(第1の実施の形態)
図1Aは本発明の第1の実施の形態にかかる電子回路装置5の構成を示す図1Bの1A−1A線断面図で、図1Bは本発明の第1の実施の形態にかかる電子回路装置5の構成を上面からみた平面図である。なお、図1Bは、理解をしやすくするために絶縁性樹脂を透過してみた状態の平面図である。
図1Aと図1Bに示す電子回路装置5は、少なくとも1個の半導体素子1と、複数個の外部接続端子2と、この半導体素子1と外部接続端子2とを電気的に接続する接続導体3と、半導体素子1を被覆し、かつ接続導体3を一体に支持する絶縁性樹脂4とを備え、半導体素子1は絶縁性樹脂4中に埋設され、外部接続端子2の端子面2Aは絶縁性樹脂4から露出している構成からなる。
すなわち、本実施の形態の電子回路装置5は、半導体素子1が絶縁性樹脂4中に埋設されており、外部接続端子2は半導体素子1より深い位置に設けられ、その端子面2Aが絶縁性樹脂4から露出している以外は、半導体素子1、外部接続端子2および接続導体3を含めて、すべてが絶縁性樹脂4中に埋設された構成からなる。
絶縁性樹脂4としては、エポキシ樹脂などの熱硬化性樹脂、あるいはポリイミド樹脂やポリフェニレンサルファイドなどの熱可塑性樹脂を用いることができる。さらに、絶縁性樹脂4は、加熱したときに型に注入できるような低い粘度を有し、半導体素子1の熱膨脹係数に近い値を有する樹脂材料であれば、上記の材料に限定されず使用することができる。なお、型に注入して形成するだけでなく、ディップ方式や塗布コーティング方式で形成してもよい。
接続導体3としては、金を主材料とする金属細線、アルミニウムを主材料とする金属細線あるいは銅を主材料とする金属細線などを用いて、ワイヤボンディング方式により接続することが望ましい。ワイヤボンディング方式としては、熱圧着接続方式、超音波接続方式または超音波と熱圧着とを併用する接続方式のいずれであってもよい。
半導体素子1としては、ベアチップの半導体素子を用いる。この半導体素子としては、メモリ、ロジックIC、CPUなどを用いることができる。さらに、絶縁性樹脂4として透光性材料を用いれば、発光ダイオードや半導体レーザ、受光部品などの光デバイスを用いることもできる。
このような構成とすることにより、薄型の電子回路装置5を実現することができる。さらに、外部接続端子2の端子面2Aは、絶縁性樹脂4と同一面となっているので、回路基板に対しても最小の厚みで実装することができる。また、半導体素子1の周囲は絶縁性樹脂4のみであるので、はんだリフローなどの熱衝撃を受けてもクラックなどが発生することがなく信頼性を大幅に改善できる。
なお、図1Aと図1Bに示すように本実施の形態の電子回路装置5では、半導体素子1を絶縁性樹脂4の厚み方向のほぼ中央部に配置している。これにより、絶縁性樹脂4により半導体素子1に加わる熱応力は、電極パッド1Aが形成された表面部と、これに対向する裏面部とに均等に加わるので、電子回路装置の反りを大幅に抑制できる。ただし、本発明は上記に限定されることはなく、半導体素子1が絶縁性樹脂4により覆われ、埋設されておればよい。
また、図1Bにおいては、半導体素子1の電極パッド1Aが長手方向の両端部に配置された構成について示したが、電極パッド1Aが半導体素子1の4辺に配置される構成であってもよい。この場合には、外部接続端子2も、半導体素子1の電極パッド1Aに対応する位置に配置すればよい。
以下に、図2Aから図2Cおよび図3Aから図3Cを用いて、本実施の形態の電子回路装置5の製造方法について説明する。
図2Aから図2Cは、本実施の形態の電子回路装置5の製造方法における前半のステップを説明するための断面図である。また、図3Aから図3Cは、この電子回路装置5の製造方法における後半のステップを説明するための断面図である。
まず、図2Aに示すように、位置決めプレート6を用意する。この位置決めプレート6は、耐熱性を有し、熱変形が生じ難く、樹脂に対する離型性のよい材料、例えばタングステン系合金などの金属材料やアルミナなどのセラミック、エンジニアリングプラスチックあるいはこれらのコンポジット材料などを使用することができる。
位置決めプレート6には、半導体素子1を収容する素子収容領域6Aおよび外部接続端子2を収容する端子収容領域6Bが形成されている。端子収容領域6Bは、素子収容領域6Aの長手方向の両端部に一定の間隔を設けて形成されている。また、素子収容領域6Aの深さに対して、端子収容領域6Bの深さの方が大きくなるように、すなわち深い段差を有して形成されている。この深さについては、絶縁性樹脂4を形成したときに、半導体素子1が絶縁性樹脂4のほぼ中央部に配置されるような位置関係としている。素子収容領域6Aと端子収容領域6Bの加工は、位置決めプレート6として金属材料を用いる場合には、例えば切削や放電加工などにより形成すれば精度よく加工することができる。
つぎに、図2Bに示すように、素子収容領域6Aには半導体素子1を、端子収容領域6Bには外部接続端子2を、それぞれ配置する。このとき、半導体素子1の電極パッド(図示せず)が露出する方向にむけて配置する。なお、半導体素子1および外部接続端子2を素子収容領域6Aおよび端子収容領域6Bに、それぞれ固定することが望ましい。このために、例えば粘着剤を塗布しておいてもよい。この粘着剤として、一定の温度に加熱したときに粘着性を喪失する特性を有するものを用いれば、絶縁性樹脂4を注入するときの加熱時に粘着性を喪失するようにできる。これにより、半導体素子1および外部接続端子2を、絶縁性樹脂の冷却後に位置決めプレート6から容易に剥離することができる。なお、位置決めプレート6の素子収容領域6Aおよび端子収容領域6Bが設けられた領域の一部に貫通孔を設けて、この貫通孔を介して真空吸着させてもよい。
この後、半導体素子1と外部接続端子2とを、例えばワイヤボンディング方式により接続導体3である金属細線で接続する。
つぎに、図2Cに示すように、樹脂成型用の成型金型7と位置決めプレート6とを嵌合する。すなわち、本実施の形態の製造方法では、位置決めプレート6が樹脂成型用の金型の一方を兼用している。このように、位置決めプレート6を樹脂成型用の金型の一方として兼用することにより、半導体素子1と外部接続端子2とを固定した状態で、そのまま樹脂成型をすることができる。
成型金型7と位置決めプレート6とを嵌合させた後、低粘度の絶縁性樹脂材料を樹脂流入口8から注入する。注入後、絶縁性樹脂材料を硬化させる。
つぎに、図3Aに示すように、片面が樹脂モールドされた構造体を取り出す。この状態では、半導体素子1と外部接続端子2の一部および接続導体3のすべてが絶縁性樹脂4中に埋設されており、絶縁性樹脂4により固定されている。したがって、取り出しても、その位置関係や接続部の剥がれなどは生じない。
つぎに、図3Bに示すように、片面が樹脂モールドされた構造体を、樹脂モールド側が下になるように下金型9に配置する。その上に、上金型10を嵌合する。これにより、空間部12が形成される。この後、低粘度の絶縁性樹脂材料を樹脂流入口11から空間部12に注入する。注入後、絶縁性樹脂材料を硬化させる。なお、この時注入する絶縁性樹脂材料は、図2Cのステップにおいて使用した絶縁性樹脂材料と同じものを用いることが望ましい。これにより、冷却後には、半導体素子1、接続導体3および外部接続端子2の一部が1種類の絶縁性樹脂材料により封止された構造体となるので、下金型9と上金型10を除去すれば、図1Aに示す電子回路装置5が得られる。
なお、本実施の形態の電子回路装置5の製造方法では、絶縁性樹脂4の注入をトランスファーモールドにより行う方法として説明したが、本発明はこれに限定されない。例えば、インジェクションモールドまたはディッピングを用いても、同様に樹脂モールドすることができる。また、樹脂材料としては、エポキシ樹脂などの熱硬化性樹脂を用いる場合はトランスファーモールド方式が好ましく、ポリイミド樹脂やポリフェニレンサルファイドなどの熱可塑性樹脂を用いる場合はインジェクションモールド方式が好ましい。これについては、後述する他の実施の形態についても同様である。
また、本実施の形態では、1個の半導体素子1を用いた電子回路装置の製造方法について説明したが、本発明はこれに限定されない。例えば、複数の半導体素子、あるいは半導体素子と受動部品とを同様な方法により実装した電子回路装置を作製してもよい。
図4Aは本発明の第1の実施の形態にかかる電子回路装置の構成の第2の例を示す図4Bの4A−4A線断面図で、図4Bは本発明の第1の実施の形態にかかる電子回路装置の構成の第2の例の上面からみた平面図である。なお、図4Bは、理解をしやすくするために絶縁性樹脂を透過してみた状態の平面図である。
この第2の例の電子回路装置15が、本実施の形態の電子回路装置5と異なる点は、第2の例の電子回路装置15の場合には複数個の半導体素子16、17、18をほぼ同一平面上に配置して、外部接続端子2を含めてそれぞれの電極パッド16A、17A、18Aの相互間を金属細線3により接続して構成していることである。
この構成により、薄型で、かつ高機能の電子回路装置を実現できる。この第2の例の電子回路装置15は、本実施の形態の電子回路装置5の製造方法と同様なステップで作製することができるので説明を省略する。
なお、図4Aと図4Bでは、それぞれの半導体素子16、17、18はほぼ同一の厚みで、かつ同一面内に1列に配置した例を示しているが、厚さが異なっていてもよく、また1列に配置しなくてもよい。また、この第2の例の電子回路装置15では、3個の半導体素子16、17、18を用いたが、本発明はこれに限定されない。例えば、半導体素子と受動部品との組み合わせとしてもよい。受動部品としては、例えばチップ抵抗、コンデンサやインダクタあるいはセンサなどを用いることができる。
また、図4Aと図4Bに示す電子回路装置15では、半導体素子16、17、18の電極パッド16A、17A、18Aには1本の金属細線3を接続しているが、複数の金属細線3を接続してもよい。同様に、1個の外部接続端子2に複数の金属細線3を接続してもよい。
図5Aは本発明の第1の実施の形態にかかる電子回路装置の構成の第3の例を示す図5Bの5A−5A線断面図で、図5Bは本発明の第1の実施の形態にかかる電子回路装置の構成の第3の例の上面からみた平面図である。なお、図5Bは、理解をしやすくするために絶縁性樹脂を透過してみた状態の平面図である。
この第3の例の電子回路装置20の場合には、半導体素子21、22と受動部品23とを用いて電子回路を構成している。さらに、この第3の例の電子回路装置20においては、中継端子板24を半導体素子21の両側に配置している。中継端子板24は、半導体素子21、22とほぼ同じ厚みとすることが望ましい。なお、半導体素子21、22、受動部品23中および中継端子板24には、電極パッド21A、22A、23A、24Aがそれぞれ必要な個数設けられている。中継端子板24を用いることにより、半導体素子22の電極パッド22Aと外部接続端子2との間のように比較的長距離の接続であっても、接続導体3である金属細線によりショートなどの不良を防止して安定な接続をすることができる。
また、図5Bに示すように、半導体素子21、22の電極パッド21A、22A、中継端子板24の電極パッド24Aおよび外部接続端子2については、複数の金属細線3を接続することもできるので、配線基板を用いなくても高機能の電子回路装置を実現できる。例えば、図5Aと図5Bに示す電子回路装置20において、半導体素子21を制御用IC、半導体素子22を大容量メモリおよび受動部品23をチップコンデンサとすれば、薄型のメモリカード、例えばSDメモリカードを容易に作製できる。このようにして作製したメモリカードは、半導体素子が絶縁性樹脂のほぼ中央部に配置されているので、絶縁性樹脂でモールドしても、反りを非常に小さくすることができる。この結果、メモリカードを種々の電子機器に搭載する場合であっても、メモリカードの挿入動作でトラブルを生じることがなくなる。
なお、中継端子板24を用いずに金属細線3で接続が可能な場合には、特に中継端子板24は不要である。また、この第3の例の電子回路装置20では、半導体素子21、22と同じ平面上に中継端子板24を配置したが、半導体素子21、22の面上にも配置してもよい。このように配置することにより、さらに金属細線3による接続の自由度を大きくすることができる。
このような構成からなる第3の例の電子回路装置20についても、図5Cに示すように、少なくとも端子収容領域6Bよりも浅い部品収容領域6Cをさらに設けた位置決めプレート6を用いる以外は、本実施の形態と同様に作製できるので、その説明を省略する。つまり、図5Cに示す位置決めプレート6の端子収容領域6Bに外部接続端子2、素子収容領域6Aに半導体素子21、22および部品収容領域6Cに受動部品23を、それぞれ配置する。それ以降は、電子回路装置5と同様の製造方法により電子回路装置20が作製される。なお、上記位置決めプレートは、高さ(厚み)の異なる半導体素子や受動部品を有する電子回路装置の作製に用いることができる。
(第2の実施の形態)
図6Aは本発明の第2の実施の形態にかかる電子回路装置25の構成を示す図6Bの6A−6A線断面図で、図6Bは本発明の第2の実施の形態にかかる電子回路装置25の構成を上面からみた平面図である。なお、図6Bは、理解をしやすくするために絶縁性樹脂を透過してみた状態の平面図である。
本実施の形態の電子回路装置25は、第1の半導体素子26の表面上に第2の半導体素子27、28を積層して配置している。なお、第1の半導体素子は大形状を有する半導体素子であり、第2の半導体素子は第1の半導体素子に比べて小さい小形状を有する半導体素子である。図6Aと図6Bからわかるように、第2の半導体素子27、28は、第1の半導体素子26の面上で、かつ電極パッドを除く領域に、絶縁性接着剤29により接着固定されている。そして、第1の半導体素子26、第2の半導体素子27、28および外部接続端子2との相互間については、接続導体3である金属細線により行っている。また、それぞれの電極パッド26A、27A、28Aと外部接続端子2については、必要に応じて複数の金属細線3を接続している。これにより、配線基板を用いなくても比較的複雑な機能を有する電子回路装置25を実現することができる。
以下に、本発明の第2の実施の形態にかかる電子回路装置25の製造方法を、図7Aから図7Dを用いて説明する。
図7Aから図7Dは、本実施の形態にかかる電子回路装置25の製造方法を説明する主要ステップの断面図である。
まず、図7Aに示すように、位置決めプレート30を用意する。この位置決めプレート30は、第1の実施の形態の製造方法と同様な材料を用いることが好ましい。位置決めプレート30には、第1の半導体素子26を収容する素子収容領域30Aおよび外部接続端子2を収容する端子収容領域30Bが形成されている。端子収容領域30Bは、素子収容領域30Aの長手方向の両端部に一定の間隔を設けて形成されている。また、素子収容領域30Aの深さに対して、端子収容領域30Bの深さの方が大きくなるように、すなわち深い段差を有して形成されている。この深さについては、絶縁性樹脂4を形成したときに、第1の半導体素子26が絶縁性樹脂4のほぼ中央部に配置されるような位置関係としている。素子収容領域30Aと端子収容領域30Bの加工は、位置決めプレート30として金属材料を用いる場合には、例えば切削や放電加工などにより形成すれば精度よく加工することができる。
つぎに、図7Bに示すように、素子収容領域30Aには第1の半導体素子26を、端子収容領域30Bには外部接続端子2を、それぞれ配置する。このとき、第1の半導体素子26の電極パッド(図示せず)が露出する方向にむけて配置する。なお、第1の半導体素子26および外部接続端子2を素子収容領域30Aおよび端子収容領域30Bに、それぞれ固定することが望ましい。このために、例えば粘着剤を塗布しておいてもよい。この粘着剤として、一定の温度に加熱したときに粘着性を喪失する特性を有するものを用いれば、絶縁性樹脂4を注入するときの加熱時に粘着性を喪失するようにできる。これにより、第1の半導体素子26および外部接続端子2を、絶縁性樹脂4の冷却後に位置決めプレート30から容易に剥離することができる。なお、位置決めプレート30の素子収容領域30Aおよび端子収容領域30Bが設けられた領域の一部に貫通孔を設けて、この貫通孔を介して真空吸着させてもよい。
そして、第1の半導体素子26の電極パッド26Aを除く領域に、第2の半導体素子27、28を接着固定する。この接着は、第2の半導体素子27、28の裏面に絶縁性接着剤29を塗布した後に、第1の半導体素子26の電極パッド26Aを除く領域に接着すれば容易に固定できる。
さらに、第1の半導体素子26および第2の半導体素子27、28の電極パッド26A、27A、28Aと外部接続端子2との相互間を、例えばワイヤボンディング方式により接続導体3である金属細線で接続する。
つぎに、図7Cに示すように、樹脂成型用の成型金型31と位置決めプレート30とを嵌合する。すなわち、本実施の形態の製造方法においても、位置決めプレート30が樹脂成型用の金型の一方を兼用している。このように、位置決めプレート30を樹脂成型用の金型の一方として兼用することにより、第1の半導体素子26、第2の半導体素子27、28および外部接続端子2を固定した状態で、そのまま樹脂成型をすることができる。
成型金型31と位置決めプレート30とを嵌合させた後、低粘度の絶縁性樹脂材料を樹脂流入口32から注入する。注入後、絶縁性樹脂材料を硬化させる。
つぎに、図7Dに示すように、片面が樹脂モールドされた構造体を取り出す。この状態では、第1の半導体素子26、第2の半導体素子27、28および外部接続端子2の一部と接続導体3のすべてが絶縁性樹脂4中に埋設されており、絶縁性樹脂4により固定されている。したがって、構造体を取り出しても、その位置関係や接続部の剥がれなどは生じない。ここまでのステップにより、第1の実施の形態の製造方法において説明した図3Aと同様な構造体を作製することができる。
これ以降のステップについては、図3Bと図3Cに示すステップと同様であるので、同図を用いて説明する。
まず、図3Bに示すように、片面が樹脂モールドされた構造体を、樹脂モールド側が下になるように下金型9に配置する。その上に、上金型10を嵌合する。これにより、空間部12が形成される。この後、加熱して低粘度とした絶縁性樹脂材料を樹脂流入口11から空間部12に注入する。注入後、絶縁性樹脂材料を冷却する。なお、この時に注入する絶縁性樹脂材料は、図7Cのステップにおいて使用した絶縁性樹脂材料と同じものを用いることが望ましい。これにより、冷却後には、第1の半導体素子26、第2の半導体素子27、28、接続導体3および外部接続端子2の一部が1種類の絶縁性樹脂材料により封止された構造体となる。この後、下金型9と上金型10を除去すれば、図6Aに示す電子回路装置25が得られる。
なお、図6Aと図6Bでは、第1の半導体素子26の上に2個の第2の半導体素子27、28を積層する構成の例について説明したが、第1の半導体素子の面上に第2の半導体素子と受動部品とを積層してもよい。また、第1の半導体素子を2つ以上配置し、これらの上に第2の半導体素子または第2の半導体素子と受動部品とを積層してもよい。さらには、第1の実施の形態の第3の例で説明したような中継端子板を積層してもよい。さらに、半導体素子にダミーパッドを形成してもよい。
(第3の実施の形態)
図8Aは本発明の第3の実施の形態にかかる電子回路装置35の構成を示す図8Bの8A−8A線断面図で、図8Bは本発明の第3の実施の形態にかかる電子回路装置35の構成を上面からみた平面図である。なお、図8Bは、理解をしやすくするために絶縁性樹脂を透過してみた状態の平面図である。
本実施の形態の電子回路装置35は、接続導体として、その一部が絶縁性シートで支持されている配線導体を用いたことが特徴である。このような接続導体として、本実施の形態ではフィルムキャリア38を用いている。このフィルムキャリア38は、絶縁性シート40で支持された金属箔からなる配線導体39により構成されている。通常、絶縁性シート40としてはポリイミドフィルムを用い、金属箔としては18μmあるいは35μm厚みの銅箔を用いることが多い。このフィルムキャリア38を用いることにより、配線の接続構成をより簡単で、かつ高信頼性にすることができる。
なお、本実施の形態の電子回路装置35では、2個の半導体素子36、37を用いた例について説明する。この電子回路装置35は、例えば半導体素子36を制御用ICとし、半導体素子37をメモリとすれば、半導体メモリカード、例えばSDメモリカードやマイクロSDメモリカードとすることができる。
半導体素子36、37の電極パッド36A、37Aにはバンプ36B、37Bがそれぞれ形成されている。このバンプ36B、37Bとフィルムキャリア38の配線導体39とをそれぞれ接続する。この接続は、一般的に熱圧着により行われる。例えば、フィルムキャリア38の配線導体39の表面にスズめっきをしておき、バンプ36B、37Bの少なくとも表面を金としておけば、熱圧着は容易にできる。フィルムキャリア38の配線導体39の端部は、外部接続端子2に接続されている。この接続についても、同様に熱圧着で容易に行うことができる。
以上のような構成からなる本実施の形態の電子回路装置35は、複数の半導体素子を絶縁性樹脂4中に埋設できるだけでなく、さらに受動部品なども接続して複合化することもできる。
以下に、本発明の第3の実施の形態にかかる電子回路装置35の製造方法を、図9Aから図9Dを用いて説明する。
図9Aから図9Dは、本実施の形態にかかる電子回路装置35の製造方法を説明する主要ステップの断面図である。
まず、図9Aに示すように、フィルムキャリア38として半導体素子36、37に対応し、かつ外部接続端子2に接続するパターン形状の配線導体39を形成する。さらに、絶縁性シート40は、これらの配線導体39を保持する領域のみに設けられている。このような形状は、ロール状において連続的に加工して形成することができる。半導体素子36、37は、フィルムキャリア38の配線導体39にそれぞれ接続する。この接続は、バンプ36B、37Bと配線導体39の材料の組み合わせを上記のようにすれば、熱圧着方式により容易に接続できる。
なお、半導体素子36、37のフィルムキャリア38への接続は、ロール状のまま連続的に接続した後に、図9Aに示す形状に切断すれば接続ステップを生産性よく行うことができる。さらに、配線導体39は銅箔をエッチング加工して形成するので、自由な形状を形成できる。したがって、図8Bに示すように分岐する形状なども容易に作製できる。
つぎに、図9Bに示すように、外部接続端子2に接続するフィルムキャリア38の配線導体39の一部をフォーミングして折り曲げた形状を作り、その先端部を外部接続端子2との接続領域39Aとする。
つぎに、図9Cに示すように、位置決めプレート41の端子収容領域41Bに外部接続端子2を固定する。そして、フィルムキャリア38に接続されている半導体素子36、37を素子収容領域41Aに入れ込むとともに、フィルムキャリア38の接続領域39Aを外部接続端子2に接続する。この接続は、熱圧着により容易に行うことができる。なお、外部接続端子2の位置決めプレート41への固定は、第1の実施の形態や第2の実施の形態と同様に粘着剤を塗布して粘着させればよい。
また、半導体素子36、37はすでにフィルムキャリア38の配線導体39に接続されているので、必ずしも位置決めプレート41に固定する必要はない。ただし、後のステップの絶縁性樹脂材料を注入するときに、半導体素子36、37が浮き上がるような場合には粘着剤により固定しておいてもよい。なお、第1の実施の形態や第2の実施の形態と同様に真空吸着してもよい。また、半導体素子36、37はすでにフィルムキャリア38に接続され,それぞれの位置が固定されているので、これらを嵌合する素子収容領域41Aを必ずしも設ける必要はない。
つぎに、図9Dに示すように、樹脂成型用の成型金型42と位置決めプレート41とを嵌合する。すなわち、本実施の形態の製造方法においても、位置決めプレート41が樹脂成型用の金型の一方を兼用している。このように、位置決めプレート41を樹脂成型用の金型の一方として兼用することにより、半導体素子36、37と外部接続端子2とを固定した状態で、そのまま樹脂成型をすることができる。
成型金型42と位置決めプレート41とを嵌合させた後、低粘度の絶縁性樹脂材料を樹脂流入口43から注入する。注入後、絶縁性樹脂材料を硬化させる。これにより、片面が樹脂モールドされた構造体が得られる。この状態では、半導体素子36、37と外部接続端子2の一部およびフィルムキャリア38のすべてが絶縁性樹脂4中に埋設されており、絶縁性樹脂4により固定されている。したがって、構造体を取り出しても、その位置関係や接続部の剥がれなどは生じない。
これ以降のステップについては、第1の実施の形態の製造方法を説明した図3Bと図3Cに示す後半のステップと同様なステップにより作製することができるので、同図を用いて説明する。
まず、図3Bに示すように、片面が樹脂モールドされた構造体を、樹脂モールド側が下になるように下金型9に配置する。その上に、上金型10を嵌合する。これにより、空間部12が形成される。この後、加熱して低粘度とした絶縁性樹脂材料を樹脂流入口11から空間部12に注入する。注入後、絶縁性樹脂材料を冷却する。なお、この時注入する絶縁性樹脂材料は、図9Dのステップにおいて使用した絶縁性樹脂材料と同じ材料を用いることが望ましい。これにより、冷却後には、半導体素子36、37、フィルムキャリア38および外部接続端子2の一部が1種類の絶縁性樹脂材料により封止された構造体となる。この後、下金型9と上金型10を除去すれば、図8Aと図8Bに示した電子回路装置35が得られる。
本実施の形態の電子回路装置35では、接続導体である配線導体39が絶縁性シート40により支持されているので、パターン形状を一定に保持できる。なお、必要に応じて絶縁性シート40間の支持のためにダミーの接続導体を設けてもよい。さらに、図8Bの配線導体39のパターンで示すように、途中で分岐するパターン形状も容易に加工できるので、より複雑なパターン形状を有する配線導体39を形成することができ、半導体素子や受動部品などを多数配置しても相互の接続を容易に行うことができる。したがって、薄型にしても反りを非常に小さくでき、かつ高機能の電子回路装置、例えばSDメモリカードなどのメモリカードを作製することができる。
なお、本実施の形態では、接続導体としてフィルムキャリアを用いたが、その一部が絶縁性シートで支持されている配線導体であればよく、例えばポリエチレンテレフタレート(PET)フィルムを絶縁性シートとして用い、この面上に蒸着やめっき、あるいは銅箔などを用いて配線導体を形成した構成であってもよい。
さらに、第1の実施の形態から第3の実施の形態までにおいては、第1の樹脂モールドステップと第2の樹脂モールドステップとで同じ絶縁性樹脂材料を用いたが、本発明はこれに限定されない。それぞれ異なる材料を用いてもよい。
本発明の電子回路装置は、半導体素子または半導体素子と受動部品とを接続導体のみにより接続し、これらを絶縁性樹脂中に埋設することにより、薄型にしても反りを非常に小さくできるので、特にカード型の電子回路装置、例えばメモリカード分野に有用である。
本発明の第1の実施の形態にかかる電子回路装置の構成を示す図1Bの1A−1A線断面図 本発明の第1の実施の形態にかかる電子回路装置の構成を上面からみた平面図 本発明の第1の実施の形態の電子回路装置の製造方法における前半のステップを説明するための断面図 本発明の第1の実施の形態の電子回路装置の製造方法における前半のステップを説明するための断面図 本発明の第1の実施の形態の電子回路装置の製造方法における前半のステップを説明するための断面図 本発明の第1の実施の形態の電子回路装置の製造方法における後半のステップを説明するための断面図 本発明の第1の実施の形態の電子回路装置の製造方法における後半のステップを説明するための断面図 本発明の第1の実施の形態の電子回路装置の製造方法における後半のステップを説明するための断面図 本発明の第1の実施の形態にかかる電子回路装置の第2の例の構成を示す図4Bの4A−4A線断面図 本発明の第1の実施の形態にかかる電子回路装置の第2の例の構成を上面からみた平面図 本発明の第1の実施の形態にかかる電子回路装置の第3の例の構成を示す図5Bの5A−5A線断面図 本発明の第1の実施の形態にかかる電子回路装置の第3の例の構成を上面からみた平面図 本発明の第1の実施の形態にかかる電子回路装置の第3の例の作製時に用いられる位置決めプレートを示す断面図 本発明の第2の実施の形態にかかる電子回路装置の構成を示す図6Bの6A−6A線断面図 本発明の第2の実施の形態にかかる電子回路装置の構成を上面からみた平面図 本発明の第2の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第2の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第2の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第2の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第3の実施の形態にかかる電子回路装置の構成を示す図8Bの8A−8A線断面図 本発明の第3の実施の形態にかかる電子回路装置の構成を上面からみた平面図 本発明の第3の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第3の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第3の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 本発明の第3の実施の形態にかかる電子回路装置の製造方法を説明するための主要ステップの断面図 従来の配線基板などの支持基板を用いない構成からなる電子回路装置の断面図 従来の他の構成の電子回路装置の断面図
符号の説明
1,16,17,18,21,22,36,37,51,61 半導体素子
1A,16A,17A,18A,21A,22A,23A,24A,26A,27A,28A,36A,37A 電極パッド
2 外部接続端子
2A 端子面
3 接続導体(金属細線)
4,56,64 絶縁性樹脂
5,15,20,25,35 電子回路装置
6,30,41 位置決めプレート
6A,30A,41A 素子収容領域
6B,30B,41B 端子収容領域
6C 部品収容領域
7,31,42 成型金型
8,11,32,43 樹脂流入口
9 下金型
10 上金型
12 空間部
23 受動部品
24 中継端子板
26 第1の半導体素子
27,28 第2の半導体素子
29 絶縁性接着剤
36B,37B バンプ
38 フィルムキャリア
39 配線導体
39A 接続領域
40 絶縁性シート
50,50A,50B,50C,50D 導電路
52 導電性ペースト
53 金属細線
54 チップ型電子部品
55 ロウ材
62 リード
63 ボンディングワイヤ

Claims (6)

  1. 半導体素子を収容するための素子収容領域と、前記素子収容領域より深い段差を有して形成され、複数個の外部接続端子を収容するための端子収容領域とを有する位置決めプレートを準備するプレート準備ステップと、
    前記半導体素子の電極パッドが露出する方向に、前記半導体素子を前記素子収容領域に配置するとともに、前記外部接続端子を前記端子収容領域に配置する配置ステップと、
    前記半導体素子と前記外部接続端子とを接続導体によって電気的に接続する接続ステップと、
    前記接続導体、前記半導体素子および前記外部接続端子と、をモールドする樹脂モールドステップとを含み、
    前記樹脂モールドステップは、
    前記接続導体、前記半導体素子および前記外部接続端子の露出面を第1絶縁性樹脂で覆いモールドし片面が樹脂モールドされた構造体を作製する第1の樹脂モールドステップと、
    前記位置決めプレートから、前記構造体を取り除き、前記構造体の片面を金型に設置し、前記構造体の別の片面の前記外部接続端子の端子面を除く領域を、第2絶縁性樹脂で覆いモールドする第2の樹脂モールドステップとからなることを特徴とする電子回路装置の製造方法。
  2. 前記プレート準備ステップにおいて、前記位置決めプレートに前記端子収容領域より浅い部品収容領域をさらに設け、前記配置ステップにおいて、さらに受動部品を前記部品収容領域に配置し、
    前記接続ステップにおいて、前記受動部品を、前記半導体素子および前記外部接続端子の少なくとも一方と前記接続導体により接続し、
    前記第1の樹脂モールドステップと前記第2の樹脂モールドステップとにおいて、前記受動部品も前記半導体素子と同様に前記絶縁性樹脂中に埋設することを特徴とする請求項に記載の電子回路装置の製造方法。
  3. 前記第1の樹脂モールドステップにおいて、前記位置決めプレートを下金型として用いることを特徴とする請求項に記載の電子回路装置の製造方法。
  4. 前記配位ステップにおいて、さらに、中継端子板の電極パッドが露出する方向に、前記中継端子板を前記素子収容領域に配置し、
    前記接続ステップにおいて、さらに、前記中継端子板と前記外部接続端子とを接続導体によって電気的に接続する接続し、
    前記第1の樹脂モールドステップにおいて、さらに、前記中継端子板の露出面を絶縁性樹脂で覆いモールドし、
    前記中継端子板を前記絶縁性樹脂中に埋設するとともに前記半導体素子と前記中継端子板と前記外部接続端子とを一体化することを特徴とする請求項1からのいずれか1項に記載の電子回路装置の製造方法。
  5. 前記接続導体として、前記半導体素子と接続するための配線パターンおよび前記外部接続端子と接続する接続領域とからなる配線導体が絶縁性シートにより支持された構成を用いることを特徴とする請求項1からのいずれか1項に記載の電子回路装置の製造方法。
  6. 前記配置ステップにおいて、前記素子収容領域に第1の半導体素子と、前記第1の半導体素子の電極パッドで囲まれた領域内に1つ以上の第2の半導体素子を積層して配置することを特徴とする請求項1からのいずれか1項に記載の電子回路装置の製造方法。
JP2007542333A 2005-11-02 2006-10-19 電子回路装置の製造方法 Expired - Fee Related JP4766050B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2007542333A JP4766050B2 (ja) 2005-11-02 2006-10-19 電子回路装置の製造方法

Applications Claiming Priority (4)

Application Number Priority Date Filing Date Title
JP2005319043 2005-11-02
JP2005319043 2005-11-02
JP2007542333A JP4766050B2 (ja) 2005-11-02 2006-10-19 電子回路装置の製造方法
PCT/JP2006/320823 WO2007052476A1 (ja) 2005-11-02 2006-10-19 電子回路装置およびその製造方法

Publications (2)

Publication Number Publication Date
JPWO2007052476A1 JPWO2007052476A1 (ja) 2009-04-30
JP4766050B2 true JP4766050B2 (ja) 2011-09-07

Family

ID=38005628

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2007542333A Expired - Fee Related JP4766050B2 (ja) 2005-11-02 2006-10-19 電子回路装置の製造方法

Country Status (4)

Country Link
US (1) US7910406B2 (ja)
JP (1) JP4766050B2 (ja)
CN (1) CN101278383B (ja)
WO (1) WO2007052476A1 (ja)

Families Citing this family (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7449369B2 (en) * 2006-01-23 2008-11-11 Stats Chippac Ltd. Integrated circuit package system with multiple molding
US8829685B2 (en) * 2009-03-31 2014-09-09 Semiconductor Components Industries, Llc Circuit device having funnel shaped lead and method for manufacturing the same
DE102010030528A1 (de) * 2010-06-25 2011-12-29 Robert Bosch Gmbh Eingekapseltes Steuerungsmodul für ein Kraftfahrzeug
JP5747737B2 (ja) * 2011-08-26 2015-07-15 三菱電機株式会社 半導体装置とその製造方法
CN102983424B (zh) * 2012-11-20 2015-08-26 芜湖致通汽车电子有限公司 一种电路板与壳体插件连接结构及连接方法
WO2015182284A1 (ja) * 2014-05-30 2015-12-03 富士電機株式会社 半導体装置
JP6750416B2 (ja) * 2016-09-14 2020-09-02 富士電機株式会社 半導体モジュールおよび半導体モジュールの製造方法
CN106686920B (zh) * 2016-12-23 2018-05-22 华中科技大学 一种提升电路稳定性的方法
US9978613B1 (en) * 2017-03-07 2018-05-22 Texas Instruments Incorporated Method for making lead frames for integrated circuit packages
JP2021025785A (ja) * 2019-07-31 2021-02-22 旭化成エレクトロニクス株式会社 電流センサおよび電流センサの製造方法
KR20210146038A (ko) * 2020-05-26 2021-12-03 엘지이노텍 주식회사 패키지기판 및 이의 제조 방법

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09162348A (ja) * 1995-12-12 1997-06-20 Fujitsu Ltd 半導体装置及びその製造方法及びリードフレーム及びその製造方法
JP2005244211A (ja) * 2004-01-30 2005-09-08 Matsushita Electric Ind Co Ltd 部品内蔵モジュールおよび部品内蔵モジュールを備えた電子機器

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05114693A (ja) * 1991-10-23 1993-05-07 Toshiba Corp 半導体装置
US5474958A (en) 1993-05-04 1995-12-12 Motorola, Inc. Method for making semiconductor device having no die supporting surface
EP0977251B1 (en) * 1997-02-10 2011-11-16 Panasonic Corporation Resin sealed semiconductor device and method for manufacturing the same
JP2001077268A (ja) * 1999-06-28 2001-03-23 Matsushita Electronics Industry Corp 樹脂封止型半導体装置およびその製造方法
JP3574025B2 (ja) 2000-01-31 2004-10-06 三洋電機株式会社 回路装置およびその製造方法
JP4619486B2 (ja) * 2000-06-01 2011-01-26 日東電工株式会社 リードフレーム積層物および半導体部品の製造方法
US6861288B2 (en) * 2003-01-23 2005-03-01 St Assembly Test Services, Ltd. Stacked semiconductor packages and method for the fabrication thereof
CN100413070C (zh) 2004-01-30 2008-08-20 松下电器产业株式会社 部件内置模块、配备部件内置模块的电子设备以及部件内置模块的制造方法
JP2005294443A (ja) 2004-03-31 2005-10-20 Sony Corp 半導体装置及びその製造方法
US7521297B2 (en) * 2006-03-17 2009-04-21 Stats Chippac Ltd. Multichip package system

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09162348A (ja) * 1995-12-12 1997-06-20 Fujitsu Ltd 半導体装置及びその製造方法及びリードフレーム及びその製造方法
JP2005244211A (ja) * 2004-01-30 2005-09-08 Matsushita Electric Ind Co Ltd 部品内蔵モジュールおよび部品内蔵モジュールを備えた電子機器

Also Published As

Publication number Publication date
WO2007052476A1 (ja) 2007-05-10
JPWO2007052476A1 (ja) 2009-04-30
US7910406B2 (en) 2011-03-22
CN101278383A (zh) 2008-10-01
US20090267214A1 (en) 2009-10-29
CN101278383B (zh) 2011-04-13

Similar Documents

Publication Publication Date Title
JP4766050B2 (ja) 電子回路装置の製造方法
KR100523495B1 (ko) 반도체 장치 및 그 제조 방법
US6548328B1 (en) Circuit device and manufacturing method of circuit device
US8344492B2 (en) Semiconductor device and method of manufacturing the same, and electronic apparatus
JP5823043B2 (ja) 電子素子搭載用基板、電子装置および撮像モジュール
JP3526788B2 (ja) 半導体装置の製造方法
JP5215244B2 (ja) 半導体装置
KR20150012285A (ko) 와이어 본드 상호연결을 이용하여 기판 없이 적층가능한 패키지
TWI236759B (en) Semiconductor device, and laminated semiconductor device
JP2002026233A (ja) 半導体装置およびその製造方法
KR20060101385A (ko) 반도체 장치 및 그 제조 방법
US11862600B2 (en) Method of forming a chip package and chip package
US20120056319A1 (en) Embedded package and method for manufacturing the same
JP2005294443A (ja) 半導体装置及びその製造方法
JPWO2007057954A1 (ja) 半導体装置及びその製造方法
KR20020070107A (ko) 표면에 장착 가능한 칩형 반도체 장치 및 그 제조 방법
US20120086133A1 (en) Semiconductor Device And Semiconductor Device Manufacturing Method
JP2001257291A (ja) 回路装置
JP3759572B2 (ja) 半導体装置
JP2001332580A (ja) 半導体装置及びその製造方法
JP3634709B2 (ja) 半導体モジュール
CN109768023B (zh) 具有表面安装结构的扁平无引线封装体
JP3668090B2 (ja) 実装基板およびそれを用いた回路モジュール
KR100769204B1 (ko) 반도체 패키지 및 그 제조방법
TW201036113A (en) Substrateless chip package and fabricating method

Legal Events

Date Code Title Description
RD01 Notification of change of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7421

Effective date: 20091127

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20101124

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20110124

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20110215

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20110415

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20110517

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20110530

R151 Written notification of patent or utility model registration

Ref document number: 4766050

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20140624

Year of fee payment: 3

LAPS Cancellation because of no payment of annual fees