JP4682968B2 - エンコーダの位置情報補間回路 - Google Patents
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Description
ッチするデータラッチ部2と、データラッチ部1でラッチされた位置データとデータラッチ部2でラッチされた1サンプリング周期前の位置データとの差分を演算する差分演算部と、差分演算部で演算された差分データをシフト演算により2のN(自然数)乗段階のデータに分割することで分割データを生成するシフト演算部と、1サンプリング周期をK:L(K、Lは正の整数かつK<L)の比率でM(自然数かつN≧M)回と、1:1の比率でN−M回分割した2のN乗個の領域を生成し、各領域で前記分割データを段階的に加算してサンプリング周期間の補間データを生成する加算処理部とで構成する。
1回目シフト:P1=P>>1=20
2回目シフト:P2=P1>>1=10
3回目シフト:P3=P2>>1=5
4回目シフト:P4=P3>>1=2
また、サンプリング周期の時間分割回数もシフト演算の回数と同じく3回となるため、2^4=16の領域に分割される。
領域1 :0(1周期前のラッチデータを出力)
領域2 :P4=2
領域3 :P3=5
領域4 :P3+P4=7
領域5 :P2=10
領域6 :P2+P4=12
領域7 :P2+P3=15
領域8 :P2+P3+P4=17
領域9 :P1=20
領域10:P1+P4=22
領域11:P1+P3=25
領域12:P1+P3+P4=27
領域13:P1+P2=30
領域14:P1+P2+P4=32
領域15:P1+P2+P3=35
領域16:P1+P2+P3+P4=37
上記に従い、各領域で割当てられた値を1周期前のラッチデータ15aに加算すること
で、サンプリング周期間の補間データ18aを生成する。
10a アナログ信号
11 パルス検出部
11a 二相パルスデータ
12 アナログ検出部
12a ADCデータ
12b AD変換完了パルス(AD変換完了信号)
13 位置データ演算部
13a 位置データ
14 データラッチ部1
14a ラッチデータ
15 データラッチ部2
15a 1周期前のラッチデータ
16 差分演算部
16a 差分データ
17 シフト演算部
17a 分割データ
18 加算処理部
18a 補間データ
19 補間処理部
20 パラレルシリアル変換部
21 通信手段
22 モータ駆動装置
Claims (1)
- 回転位置に応じてアナログ信号を生成する原信号生成部と、アナログ信号からパルス信号を生成するパルス検出部と、アナログ信号をサンプリング周期毎にアナログ/ディジタル変換してADCデータとAD変換完了信号を出力するアナログ検出部と、ADCデータから前記パルス信号間の内挿データを生成してパルス信号と合成することにより位置データを生成する位置データ演算部と、前記位置データとAD変換完了信号を入力する補間処理部とを備え、前記補間処理部は、前記位置データをサンプリング周期毎にラッチするデータラッチ部1と、データラッチ部1と同期して1サンプリング周期前の位置データをラッチするデータラッチ部2と、データラッチ部1でラッチされた位置データとデータラッチ部2でラッチされた1サンプリング周期前の位置データとの差分を演算する差分演算部と、差分演算部で演算された差分データをシフト演算により2のN(自然数)乗段階のデータに分割することで分割データを生成するシフト演算部と、1サンプリング周期をK:L(K、Lは正の整数かつK<L)の比率でM(自然数かつN≧M)回と、1:1の比率でN−M回分割した2のN乗個の領域を生成し、各領域で前記分割データを段階的に加算してサンプリング周期間の補間データを生成する加算処理部とで構成したことを特徴とするエンコーダの位置情報補間回路。
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