JP4638097B2 - 画像センサ - Google Patents
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Description
【発明の属する技術分野】
本発明は、画像検知デバイスに関し、より詳細には、より小さいピクセルサイズまたは増大したピクセルフィル(pixel fill)ファクタのための手段を提供する画像検知デバイスに関する。
【0002】
【従来の技術】
アクティブピクセルセンサ(APS)は、一般的には、個々のベース上のピクセルに割り当てられた関連する能動回路構成要素を備えた感光手段を含む。これらの能動回路構成要素は、一般的には、ピクセルリセット機能を実行するための手段、または電荷を移動するための何らかの手段、電圧変換を実行するための手段、または増幅に使用される回路構成要素である。APSデバイスは、画像の各行が選択され、それから列選択信号を使用して読み出される方式で操作されてきた(メモリデバイスのワードとビットの行にそれぞれ類似する)。開示されてきた従来の技術のデバイスでは、これらの構成要素のすべてが完全に単一のピクセルの境界内に置かれている。
【0003】
これらの能動回路構成要素を各ピクセルに含めることは、そうでなければ光検出器に使用できた区域を取ることから、ピクセルのためのフィルファクタ(ピクセルが占める割合)を減少させる。フィルファクタの減少は、センサの感度と飽和信号を減少させ、これによって、良好な画質を得るための重要な性能パラメータであるセンサの写真速度とダイナミックレンジに順に悪影響が及ぶ。さらに、これらの能動回路構成要素をピクセル内に含めることによって、ピクセルの最小サイズに制限が置かれ、これは画像センサのサイズと費用に悪影響を及ぼす。
【0004】
高解像度で小さなピクセルのAPSデバイスを構築するためには、ピクセル内の行選択トランジスタと増幅器の他の部分に割り当てられたピクセルの区域を最小限にするためにサブミクロンレベルのCMOSプロセスを使用することが必要である。本質的に、標準的な電荷結合素子(CCD)センサと比較して同一の解像度と感度のAPSデバイスを実現するには、技術的により進んだ、よりコストのかかるプロセスが取られる。しかし、APSデバイスは、CCDセンサと比較して、単一の電源操作、低消費電力、x−yアドレス指定能力、画像ウインドー処理、および信号処理回路を効率よくオンチップ集積できる機能の利点を有する。
【0005】
CCDの感度とAPSデバイスの利点を備える画像センサを提供する一つの取り組み方法は、元のピクセル設計の望ましい特徴と機能性を維持しながら、完全に単一のピクセル内に必要とされる構成要素と相互接続の数を減らすことによって、APSデバイスのフィルファクタと感度を改善することである。Guidashによる米国特許出願番号第08/808,444号は、この必要性を満たす手段を開示する。この事例では、浮動拡散、共通ドレイン増幅器、行選択トランジスタ、リセットトランジスタが二つの行の隣接する光検出器とトランスファゲートとの間で共有されていた。この事例は、改善したフィルファクタを備えたピクセルを提供するが、外部の機械シャッタを使用せずにグローバル電子シャッタを実行する可能性を消滅させた。
【0006】
【発明が解決しようとする課題】
前述の議論を考察すると、ピクセルフィルファクタを増大させ、および/またはピクセルサイズを減少させ、同時にグローバルシャッタを実現させる方法および装置については、先行技術には不足するものがあることは容易に明らかである。
【0007】
【課題を解決するための手段】
画像センサは、(a)行列状に配列された複数のピクセルと、(b)光検出器をそれぞれ有し、同一の行内でに隣接する少なくとも二つのピクセルと、(c)隣接するピクセルを独立に選択できる行選択機構と、(d)二つの隣接するピクセルのための共通の出力信号ノードとを備える。そして、前記行選択機構は、ピクセルの行ごとに第1の選択信号線と第2の選択信号線とを備え、前記第1の選択信号線は対応する行における奇数列のすべての画素に接続され、前記第2の選択信号線は対応する行における偶数列のすべての画素に接続され、前記共通の出力信号ノードに接続される前記2つの隣接するピクセルの各々についてそれぞれ少なくとも1つの列回路が設けられている。
【0008】
【発明の実施の形態】
本発明を認識するためには、先行技術を理解することが有益である。これに関して、いくつかの典型的な先行技術のアクティブピクセルセンサ(APS)およびパッシブピクセルセンサ(PPS)のピクセルが図1、図2および図3に示される。図1のAPSピクセルは、フォトダイオードまたはフォトゲートのいずれかでありうる光検出器(PD)、トランスファゲート(TG)、浮動拡散(FD:フローティング・ディフュージョン)、リセットゲート(RG)を備えたリセットトランジスタ、行選択ゲート(RSEL)を備えた行選択トランジスタ、および信号トランジスタ(SIG)を含む。図2のAPSピクセルは、通常はフォトダイオード(P)である光検出器(PD)、リセットゲート(RG)を備えたリセットトランジスタ、行選択ゲート(RSEL)を備えた行選択トランジスタ、および信号トランジスタ(SIG)を含む。図3のPPSピクセルは、通常はフォトダイオード(P)である光検出器(PD)、および行選択ゲート(RSEL)を備えた行選択トランジスタを含む。上述のAPSおよびPPSのピクセルの操作は当該技術分野では周知であり、本願明細書では詳述しない。各事例において、これらの構成要素のすべてを単一のピクセル内に含めることによって、ピクセルのフィルファクタ、感度、および最小サイズは減少する。
【0009】
フィルファクタの改善を実現する一つの手段は、行順次(row at a time)読み出し動作を利用し、各ピクセルの代わりに2つの隣接する行ピクセルに浮動拡散及び増幅器を提供することである。この手段は、Guidashによる米国特許出願番号第08/808,444号に開示された。一時に1つの行だけが読み出されるので、単一の浮動拡散、リセットトランジスタ、行選択トランジスタ、および共通ドレイン増幅器が、離れた行にある2つの隣接するピクセルに使用できる。しかし、米国特許出願番号第08/808,444号の開示内容は、機械シャッタを使用せずにグローバル電子シャッタを実行して、センサの読み出し中の入射照明を妨ぐことはできない。
【0010】
本発明に立ち返って、本発明に係る実施例の概略図が図4、図5および図6に示される。一般的に、本実施例は、ピクセル出力ノードと出力信号線を少なくとも2つの行が隣接するピクセル5間で共有する。1つの行内での画像信号分離は、行ごとに2つの分離行選択信号線、すなわち行内の1つおきのピクセルに対する分離行選択信号線を1つずつと、2列1組ごとに対して1:2の列出力信号線デマルチプレクススキームを設けることによって達成される。
【0011】
操作の好適な方式は以下に記載する。当業者は、他の方式も可能であり、以下に記載する方式は例示目的のために選択されていることを理解されたい。当業者は、2つのピクセル5のみが示されているが、各行は複数のピクセル5を含み、隣接するピクセル5の操作はその下に記載されることも理解されたい。図4に示される4つのトランジスタ(4T)ピクセルについては、読み出し操作が図8に示されるような次の方式でなされる。図4および図8の両方を参照して、まず、RGをパルスにすることによって、浮動拡散(FD)10aおよび10bがリセットされる。次に、SR1をパルスにすることによって、行選択(RSEL)1(15)が作動され、浮動拡散(FD)1(10a)のリセットレベルが列回路20aにより標本化され、保持される。行選択1(15)が接続しているピクセルすなわち本実施例では1つおきのピクセルのすべての電気的活動を行選択1(15)が命じることは、当業者には明らかである。その後、行選択1(15)が停止され、行選択2(25)が作動される。SR2をパルスすることによって、浮動拡散2(10b)のリセットレベルは、列回路20bにより標本化され、保持される。次に、TGをパルスすることによって、集積された信号電荷が、光検出器30から浮動拡散へ転送される。SS1をパルスすることによって、行選択2(25)が停止され、行選択1(15)が作動され、浮動拡散1(10a)の信号レベルが列回路20aにより標本化され、保持される。SS2をパルスすることによって、行選択1(15)が停止され、行選択2(25)が作動され、浮動拡散2(10b)の信号レベルが列回路20bによって標本化され、保持される。その後、列回路20a、20bの標本化され、保持された信号の読み出しは、同一のピクセル読み出し方式が次の行で始まる前に行われる。
【0012】
図8のタイミングは、ピクセルの回転シャッタオペレーションを示す。図4の例は、グローバルシャッタオペレーションも行うことができる。これが図9に示される。これに関して、読み出しは、センサの各ピクセルにおいて、集積された信号電荷を光検出器30a、30bから浮動拡散10a、10bへ転送することによって、同時に始まる。次に、SS1をパルスすることによって、行選択1(15)が作動され、浮動拡散1(10a)の信号レベルが列回路20aにより標本化(サンプリング)され、保持される。その後、SS2をパルスすることによって、行選択1(15)が停止され、行選択2(25)が作動され、浮動拡散2(10b)の信号レベルが列回路20bにより標本化され、保持される。その後、RGをパルスすることによって、読み出されている行の浮動拡散10a、10bがリセットされる。次に、SR1をパルスすることによって、行選択2(25)が停止され、行選択1(15)が作動され、浮動拡散1(10a)のリセットレベルが列回路20aにより標本化され、保持される。その後、SR2をパルスすることによって、行選択1(15)が停止され、行選択2(25)が作動され、浮動拡散2(10b)のリセットレベルが標本化され、保持される。列回路20a、20bの標本化され、保持された信号の読み出しは、同一のピクセル読み出し方式が画像センサの次の行で始まる前に行われる。
【0013】
図5でのAPSピクセルの読み出し操作は、図10のタイミング図に示される。所望の集積時間の終わりには、SS1をパルスすることによって、行選択1(15)が作動され、光検出器1(30a)の信号レベルが列回路20aにより標本化され、保持される。次に、SS2をパルスすることによって、行選択1(15)が停止され、行選択2(25)が作動され、光検出器2(30b)の信号レベルが列回路20bにより標本化され、保持される。次に、RGをパルスにすることによって、読み出されている行のすべての光検出器30a、30bは、リセットされる。行選択2(25)を停止し、行選択1(15)を作動させ、SR1をパルスにすることによって、光検出器1(30a)のリセットレベルは、列回路20aにより標本化され、保持される。次に、行選択1(15)を停止し、行選択2(25)を作動させ、SR2をパルスすることによって、光検出器2(30b)のリセットレベルは、列回路20aにより標本化され、保持される。列回路20a、20bにより標本化され、保持された信号の読み出しは、同一のピクセル読み出し方式が画像センサの次の行で始まる前に行われる。
【0014】
図6でのPPSピクセルの読み出し操作は、図11のタイミング図に示される。所望の集積時間の終わりには、SS1(図示せず)をパルスにすることによって、行選択1(15)が作動され、光検出器1(30a)の信号レベルが列回路(図示せず)により標本化され、保持される。次に、SS2(図示せず)をパルスにすることによって、行選択1(15)が停止され、行選択2(25)が作動され、光検出器2(30b)の信号レベルが列回路(図示せず)により標本化され、保持される。標本化され、保持された信号の読み出しは、同一のピクセル読み出し方式が画像センサの次の行で始まる前に行われる。
【0015】
行ごとの2つの分離選択信号線と共有の出力ノードと出力信号線のこの同一の概念は、読み出しのための特定の行を能動的に選択することによって列出力信号線に一時読み出しがなされる特定のピクセル設計であればどれにでも適用できる。この操作は、概念的には、行ごとの列インタレース・サンプルホールド・オペレーションとして説明できる。この概念を使用した他の例が図7に提供される。この事例では、ピクセル選択機構は、Guidashによる1999年9月7日付で発行された米国特許番号第5,949,061号に記載されているような切替可能(スイッチ付き)電源行選択(switched supply row select)である。この事例では、2つの切替可能電源信号線が各行について提供されている。1つの選択信号線が行のすべての奇数のピクセルに適用され、1つの選択信号線が行のすべての偶数のピクセルに適用される。
【0016】
本発明の構成は、出力ノードと列出力信号線が少なくとも2つの隣接するピクセル間で共有されるので、高いフィルファクタ、または従来の技術に比較してより小さいピクセルを提供する。このことの利点は、図12及び13を検討することによって判明できる。図12は、従来の技術の2つの行が隣接するピクセル間の領域を示す。図13は、本実施例のピクセル構成を使用して、同一の領域を示す。出力ノードと列信号線を共有することによって省かれる一次元での区域は、次の式(1)によって与えられ、ここで、Wcは最小のコンタクトサイズ、ENC1は活性領域によるコンタクトの最小のエンクロージャ(囲み範囲)、およびISOは最小の活性領域スペースである。
【0017】
【数1】
省かれる区域=(2Wc+2ENC1+ISO)-(Wc)=Wc+2ENC1+ISO (1)
【0018】
この区域は重要となりうる。例えば0.5μmCMOSプロセスでは、この区域は約1.8μmであり、0.35μmCMOSプロセスについては、この区域は約1.4μmである。さらに、この新アーキテクチャは、アレイ内の隣接する金属線間の距離が増大しているので、より少ない列出力信号線を提供し、それゆえにピクセルのより大きな有効開口を作り出す。行ごとの1つの余分の金属線が、行ごとの第2の行選択信号線を提供するために必要であるが、2つの選択信号線が異なった金属レベルの互いの上部に渡って通ることができるので、別々の出力ノード領域と出力信号線によって占められる区域よりもずっと少ない区域を取る。1つの余分のタイミングと制御信号が必要であり、列ごとの2つの追加のトランジスタが必要である。しかし、これらは画像アレイの外にあるCMOSロジックに組み込まれているので、ピクセルまたは画像アレイ区域には強い影響を与えない。このアーキテクチャでは、行内の奇数および偶数のピクセルの画像キャプチャの一時的置換(転位)も行う。しかし、その時間は非常に短く、(特に行から行への一時的な置換に比較して)、およそ数百ナノセカンドのレベルであり、いかなる画像捕獲アーティファクトも作り出さない。余分の一連のサンプル・ホールド(SHRおよびSHSストローブ)があるので、最小ライン時間は、この新しいアーキテクチャにとってはわずかにより長く、それによって、ビデオアプリケーションのための最大フレームレートは、斬進的に減少する。
【図面の簡単な説明】
【図1】 従来の技術の画像センサのピクセルを示す図である。
【図2】 従来の技術の画像センサのピクセルを示す図である。
【図3】 従来の技術の画像センサのピクセルを示す図である。
【図4】 本発明に係る画像センサの実施例のピクセルを示す図である。
【図5】 本発明に係る画像センサの実施例のピクセルを示す図である。
【図6】 本発明に係る画像センサの実施例のピクセルを示す図である。
【図7】 本発明に係る画像センサの実施例のピクセルを示す図である。
【図8】 図4のタイミング図である。
【図9】 図4のタイミング図である。
【図10】 図5のタイミング図である。
【図11】 図6のタイミング図である。
【図12】 従来の技術のピクセルの位置関係を示す図である。
【図13】 本発明に係るピクセルの位置関係を示す図である。
【符号の説明】
5 ピクセル、10a 浮動拡散1、10b 浮動拡散2、15 行選択1、20a 列回路、20b 列回路、25 行選択2、30a 光検出器1、30b 光検出器2、APS アクティブピクセルセンサ、PPS パッシブピクセルセンサ、PD 光検出器、TG トランスファゲート、FD 浮動拡散、RGリセットゲート、SIG 信号トランジスタ、P フォトダイオード、RSEL 行選択ゲート。
Claims (4)
- 画像センサであって、
(a)行列状に配列した複数のピクセルと、
(b)光検出器をそれぞれ有し、同じ行内で隣接する少なくとも2つのピクセルと、
(c)前記隣接するピクセルを独立に選択できる行選択機構と、
(d)行内の隣接する2つのピクセルのペアごとに設けられた共通の出力信号ノードと、
(e)前記共通の出力信号ノードに接続される前記隣接する2つのピクセルの各々について1つずつ設けられた列回路と、
(f)前記複数のピクセルの各行を順に読み出す手段と、
を備え、
前記行選択機構は、ピクセルの行ごとに、第1の選択信号線と第2の選択信号線という唯2本の選択信号線を備え、前記第1の選択信号線は対応する行における奇数列のすべての画素に接続され、前記第2の選択信号線は対応する行における偶数列のすべての画素に接続され、
前記各列回路は、前記各ペアにおける当該列回路に対応するピクセルからの信号を蓄積し、
前記読み出す手段は、前記ピクセルの行ごとに、当該行についての前記2本の選択信号線のうちの一方を起動することで、当該行内の奇数列及び偶数列のうち起動された前記一方の選択信号線に対応する列のすべての画素についての信号を標本化してそれぞれ対応する列回路に蓄積するとともに、当該行についての前記2本の選択信号線のうちの他方を起動することで、当該行内の奇数列及び偶数列のうち起動された前記他方の選択信号線に対応する列のすべての画素についての信号を標本化してそれぞれ対応する列回路に蓄積することにより、前記各行を順に読み出す、
ことを特徴とする画像センサ。 - 請求項1に記載の画像センサであって、
前記行選択機構が、MOSトランジスタを含むことを特徴とする画像センサ。 - 請求項1に記載の画像センサであって、
前記行選択機構が、切替可能電源を含むことを特徴とする画像センサ。 - 請求項1〜3のいずれか1項に記載の画像センサであって、
前記各ピクセルが、前記光検出器に対し電気的に接続された浮動拡散であって前記光検出器から転送される電荷を蓄積する浮動拡散、をそれぞれ備えることを特徴とする、画像センサ。
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