JP4598024B2 - 帯域阻止フィルタ - Google Patents
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Description
本発明の帯域阻止フィルタは、阻止帯域幅の狭い帯域阻止フィルタを、コンパクトかつ簡素な構造で実現することができる一方で、厚い誘電体基板で構成された平面回路形帯域阻止フィルタにおいては、挿入損失と減衰量の双方に優れた特性を実現するものである。
図1は、本発明の実施の形態1における帯域阻止フィルタの展開構造図である。図2は、本発明の実施の形態1における帯域阻止フィルタの図1のA−A'断面図である。また、図3は、本発明の実施の形態1における帯域阻止フィルタの図1のB−B’断面図である。
本実施の形態1における3段フィルタは、中心周波数で略1/4波長の共振器のストリップ導体11、21、31のそれぞれの一端を主線路のストリップ導体3へと直接接続し、それぞれの他端を開放端11z、21z、31zとしている。さらに、それに加えて、前述のように、共振器のストリップ導体11、21、31のそれぞれと主線路のストリップ導体3との間で結合線路を構成している。従って、この3段フィルタの等価回路は、図4のようになる。
図13は、本発明の実施の形態2における帯域阻止フィルタの展開構造図である。図14は、本発明の実施の形態2における帯域阻止フィルタの図13のA−A'断面図である。また、図15は、本発明の実施の形態2における帯域阻止フィルタの図13のB−B’断面図である。
図16は、本発明の実施の形態3における帯域阻止フィルタの展開構造図である。図17は、本発明の実施の形態3における帯域阻止フィルタの図16のA−A'断面図である。また、図18は、本発明の実施の形態3における帯域阻止フィルタの図16のB−B’断面図である。
図19は、本発明の実施の形態4における帯域阻止フィルタの展開構造図である。図20は、本発明の実施の形態4における帯域阻止フィルタの図19のA−A'断面図である。また、図21は、本発明の実施の形態4における帯域阻止フィルタの図19のB−B’断面図である。
図22は、本発明の実施の形態5における帯域阻止フィルタの展開構造図である。また、図23は、本発明の実施の形態5における帯域阻止フィルタの図22のA−A'断面図である。さらに、図24は、本発明の実施の形態5における帯域阻止フィルタの図22のB−B’断面図である。
図28は、本発明の実施の形態6における帯域阻止フィルタの展開構造図である。また、図29は、本発明の実施の形態6における帯域阻止フィルタの図28のA−A'断面図である。また、図30は、本発明の実施の形態6における帯域阻止フィルタの図28のB−B’断面図である。さらに、図31は、本発明の実施の形態6における帯域阻止フィルタの図28のC−C’断面図である。
図32は、本発明の実施の形態7における帯域阻止フィルタの展開構造図である。また、図33は、本発明の実施の形態7における帯域阻止フィルタの図32のA−A'断面図である。また、図34は、本発明の実施の形態7における帯域阻止フィルタの図32のB−B’断面図である。さらに、図35は、本発明の実施の形態7における帯域阻止フィルタにおいて共振器ストリップ導体上を流れる電流の主たる経路を説明する図である。
Claims (7)
- 複数の誘電体層を積層した積層誘電体の少なくとも一方の主面に地導体が設けられ、前記複数の誘電体層の間、もしくは前記複数の誘電体層の間および前記地導体が設けられていない主面上にストリップ状の信号導体を設けた多層構造を有する帯域阻止フィルタであって、
前記ストリップ状の信号導体は、
入力端子および出力端子を備え、前記複数の誘電体層の少なくとも1つの誘電体層上に設けられた主線路の信号導体と、
略1/4波長の長さを有し、少なくとも1つの誘電体層を介して前記主線路の信号導体と幅広面を対向させ、かつ、略平行に配列され、それぞれが前記主線路の信号導体と電磁界結合された複数の共振器用の信号導体と
を含み、
前記複数の共振器用の信号導体のそれぞれは、一端が開放端であり、他端が第1の接続導体を介して前記主線路の信号導体と電気的に接続されて結合線路形共振回路を構成し、前記結合線路形共振回路のそれぞれが縦続接続された構成を有する
ことを特徴とする帯域阻止フィルタ。 - 請求項1に記載の帯域阻止フィルタにおいて、
前記複数の共振器用の信号導体の少なくとも1つは、前記主線路の信号導体が設けられた誘電体層に対して上側の誘電体層上および下側の誘電体層上に設けられた1組の信号導体で構成されることを特徴とする帯域阻止フィルタ。 - 請求項1に記載の帯域阻止フィルタにおいて、
前記地導体は、前記積層誘電体の両方の主面に設けられ、
前記複数の共振器用の信号導体は、前記主線路の信号導体に関して誘電体層の積層方向に対称な1組の信号導体で構成される
ことを特徴とする帯域阻止フィルタ。 - 請求項2または3に記載の帯域阻止フィルタにおいて、
前記1組の信号導体で構成された共振器用の信号導体の少なくとも1つは、前記1組の信号導体の開放端の近傍同士が第2の接続導体を介して接続されて結合線路形共振回路を構成することを特徴とする帯域阻止フィルタ。 - 複数の誘電体層を積層した積層誘電体の少なくとも一方の主面に地導体が設けられ、前記複数の誘電体層の間、もしくは前記複数の誘電体層の間および前記地導体が設けられていない主面上にストリップ状の信号導体を設けた多層構造を有する帯域阻止フィルタであって、
前記ストリップ状の信号導体は、
入力端子および出力端子を備え、前記複数の誘電体層の少なくとも1つの誘電体層上に設けられた主線路の信号導体と、
前記主線路の信号導体と同一の誘電体層上で、前記主線路の信号導体の長手方向の一部分に設けられ、一端が前記主線路の信号導体の一部分と接続され、前記一端以外の周囲が前記主線路の信号導体との間で第1間隙を有するように、前記主線路の信号導体の長手方向に延在する第1導体と、少なくとも1つの誘電体層を介して前記主線路の信号導体と幅広面を対向させ、かつ、略平行に配置されて前記主線路の信号導体と電磁界結合され、前記第1導体の他端と第1共振器内接続導体を介して一端が接続された第2導体と、前記主線路の信号導体と同一の誘電体層上で、前記主線路の信号導体の長手方向の他の一部分に設けられ、前記主線路の信号導体との間で周囲が第2間隙を有して直流的に絶縁された状態で配置され、前記第2導体における他端と第2共振器内接続導体を介して一端が接続され、かつ、前記第1導体における一端から他端へと前記第1導体が延在する長手方向と同一方向に、前記第2共振器内接続導体が接続された一端から他端へと延在する第3導体との3つの導体から一組が構成され、前記主線路の信号導体の長手方向に対する前記第1導体、前記第2導体、および前記第3導体のそれぞれの長手方向の長さの和が略1/4波長となる複数組の共振器用の信号導体と、
を含み、
前記複数組の共振器用の信号導体のそれぞれは、前記第3導体の他端が開放端であり、前記第3導体の一端が前記第2共振器内接続導体、前記第2導体、前記第1共振器内接続導体、および前記第1導体を介して前記主線路の信号導体と電気的に接続されて結合線路形共振回路を構成し、前記結合線路形共振回路のそれぞれが縦続接続された構成を有する
ことを特徴とする帯域阻止フィルタ。 - 請求項5に記載の帯域阻止フィルタにおいて、
前記複数組の共振器用の信号導体の少なくとも1つは、前記主線路の信号導体が設けられた誘電体層に対して上側の誘電体層上および下側の誘電体層上に設けられた1組の信号導体で構成された第2導体を有することを特徴とする帯域阻止フィルタ。 - 請求項5に記載の帯域阻止フィルタにおいて、
前記地導体は、前記積層誘電体の両方の主面に設けられ、
前記複数組の共振器用の信号導体を構成する前記第2導体は、前記主線路の信号導体が設けられた誘電体層に対して上側の誘電体層上および下側の誘電体層上に設けられ、前記主線路の信号導体に関して誘電体層の積層方向に対称な1組の信号導体で構成される
ことを特徴とする帯域阻止フィルタ。
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