JP4555791B2 - データ読出方法及びデータ読出装置 - Google Patents
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Description
この読出要求を受けたMCH2はその内容にしたがってメモり2からデータを読み出し、DMAコントローラ3に対し返信する(図2中、ステップS13,S15,S16)。ここで返信されるデータは上記コンプレションパケットである。このコンプレションパケットのヘッダは、例えば図6に示すフォーマットを有する。
なお上記の説明では本発明の実施の形態として、図2乃至4とともに上述のファイル制御システムにおける動作の流れの中で、ハードディスク装置D1に対しデータを要求する側のセントラルモジュール10−0において、DMAコントローラ3がMCH2を介し、メモリ4から当該ハードディスク装置D1に対する読出要求のコマンドのデータを読み出す場面(ステップS12乃至S17)を例にとって説明した。
(付記1)
所定の格納データの読み出しのために読出要求を発行する読出要求発行段階と、
発行した読出要求に対する読出データの到来が所定時間内に到来しない場合に再度読出要求を発行する読出要求再発行段階と、
前記読出要求再発行段階では、前記再度の読出要求にフラグを付加することにより最初に発行した読出要求と異なったものとすることを特徴とするデータ読出方法。
(付記2)
前記読出要求の発行は、発行された読出要求に対する読出データの順番が保証されない構成のデータ読出システムに対してなされてなる付記1に記載のデータ読出方法。
(付記3)
読出データはパケット形式とされてなり、
前記読出要求に付加したフラグは、当該読出要求に対して得られるパケットの未使用領域に埋め込まれた状態で当該パケットとともに提供される構成とされてなる付記1に記載のデータ読出方法。
(付記4)
同時に複数のデータ読出要求を受け付ける構成の複数のキューを設け、
各キューごとに前記読出要求に付加するフラグを決定するフラグカウンタを設け、
前記フラグカウンタは該当するキューについてデータ読出要求が発行されるたびに更新される構成とされてなる付記1に記載のデータ読出方法。
(付記5)
前記読出データはDMA転送により要求元に対し提供される構成とされてなる付記1に記載のデータ読出方法。
(付記6)
前記読出データはPCI−Express方式によるインタフェースを介して得られる構成とされてなる付記1に記載のデータ読出方法。
(付記7)
所定の格納データの読み出しのために読出要求を発行する読出要求発行手段と、
発行した読出要求に対する読出データの到来が所定時間内に到来しない場合に再度読出要求を発行する読出要求再発行手段と、
前記読出要求再発行段階では、前記再度の読出要求にフラグを付加することにより最初に発行した読出要求と異なったものとすることを特徴とするデータ読出装置。
(付記8)
前記読出要求の発行は、発行された読出要求に対する読出データの順番が保証されない構成のデータ読出システムに対してなされてなる付記7に記載のデータ読出装置。
(付記9)
読出データはパケット形式とされてなり、
前記読出要求に付加したフラグは、当該読出要求に対し得られるパケットの未使用領域に埋め込まれた状態で当該パケットとともに提供される構成とされてなる付記7に記載のデータ読出装置。
(付記10)
同時に複数のデータ読出要求を受け付ける複数のキューを設け、
各キューごとに前記読出要求に付加するフラグを決定するフラグカウンタを設け、
前記フラグカウンタは該当するキューについてデータ読出要求が発行されるたびに更される構成とされてなる付記7に記載のデータ読出装置。
(付記11)
前記読出データはDMA転送により要求元に対し提供される構成とされてなる付記7に記載のデータ読出装置。
(付記12)
前記読出データはPCI−Express方式によるインタフェースを介して得られる構成とされてなる付記7に記載のデータ読出装置。
2 メモリコントロールハブ
3 DMAコントローラ
3a DMA要求アービタ
3b 要求制御部
3c キュー管理部
4 メモリ
10−1,10−2,10−n、10−m セントラルモジュール
20 ルータ
H0,H1 ホスト
D0,D1 ハードディスク装置
DC0,DC1 デバイスコントローラ
DE0,DE1,DE2,DE3 DMAエンジン
Q0,Q1,Q2,Q3 キュー
C0,C1,C2,C3 フラグカウンタ
Claims (7)
- 所定の格納データの読み出しのために読出要求を発行する読出要求発行段階と、
発行した読出要求に対する読出データが所定時間内に到来しない場合に再度読出要求を発行する読出要求再発行段階とを有するデータ読出方法であって、
前記読出要求再発行段階では、前記再度の発行に係る読出要求にフラグを付加することにより当該再度の発行に係る読出要求を最初に発行した読出要求と異なったものとし、
前記再度の発行に係る読出要求に付加した前記フラグと同一のフラグが付加された、前記再度の発行に係る読出要求に対する読出データにつき、当該読出データに付加されたフラグと、前記再度の発行に係る読出要求に付加したフラグとを照合することにより、当該読出データが、前記最初に発行した読出要求に対する読出データか、前記再度の発行に係る読出要求に対する読出データかを判定する判定段階を有することを特徴とするデータ読出方法。 - 前記読出要求再発行段階では、前記再度の発行に係る読出要求に係るメモリ上のアドレスであるローアドレスおよび読み出すデータ長を示すバイトカウントを格納し、
前記判定段階では、前記再度の発行に係る読出要求に付加した前記フラグと同一のフラグ、並びに前記再度の発行に係る読出要求に係るローアドレスおよびバイトカウントが付加された、前記再度の発行に係る読出要求に対する読出データにつき、当該読出データに付加されたフラグ、並びにローアドレスおよびバイトカウントと、前記再度の発行に係る読出要求に付加したフラグ、並びに前記再度の発行に係る読出要求に係るローアドレスおよびバイトカウントとを照合することにより、当該読出データが、前記最初に発行した読出要求に対する読出データか、前記再度の発行に係る読出要求に対する読出データかを判定する、請求項1に記載のデータ読出方法。 - 前記読出要求の発行は、発行された読出要求に対する読出データの順番が保証されない構成のデータ読出システムに対してなされる、請求項1または2に記載のデータ読出方法。
- 読出データはパケット形式とされてなり、
前記読出要求に付加するフラグは、当該読出要求に対して提供されるパケットの未使用領域に埋め込まれた状態で当該パケットとともに提供される、請求項1乃至3のうちの何れか一項に記載のデータ読出方法。 - 所定の格納データの読み出しのために読出要求を発行する読出要求発行手段と、
発行した読出要求に対する読出データが所定時間内に到来しない場合に再度読出要求を発行する読出要求再発行手段とを有するデータ読出装置であって、
前記読出要求再発行手段は、前記再度の発行に係る読出要求にフラグを付加することにより当該再度の発行に係る読出要求を最初に発行した読出要求と異なったものとし、
前記再度の発行に係る読出要求に付加した前記フラグと同一のフラグが付加された、前記再度の発行に係る読出要求に対する読出データにつき、当該読出データに付加されたフラグと、前記再度の発行に係る読出要求に付加したフラグとを照合することにより、当該読出データが、前記最初に発行した読出要求に対する読出データか、前記再度の発行に係る読出要求に対する読出データかを判定する判定手段を有することを特徴とするデータ読出装置。 - 前記読出要求再発行手段は、前記再度の発行に係る読出要求に係るメモリ上のアドレスであるローアドレスおよび読み出すデータ長を示すバイトカウントを格納し、
前記判定手段は、前記再度の発行に係る読出要求に付加した前記フラグと同一のフラグ、並びに前記再度の発行に係る読出要求に係るローアドレスおよびバイトカウントが付加された、前記再度の発行に係る読出要求に対する読出データにつき、当該読出データに付加されたフラグ、並びにローアドレスおよびバイトカウントと、前記再度の発行に係る読出要求に付加したフラグ、並びに前記再度の発行に係る読出要求に係るローアドレスおよびバイトカウントとを照合することにより、当該読出データが、前記最初に発行した読出要求に対する読出データか、前記再度の発行に係る読出要求に対する読出データかを判定する、請求項5に記載のデータ読出装置。
出装置。 - 前記読出要求の発行は、発行された読出要求に対する読出データの到来の順番が保証されない構成のデータ読出システムに対してなされる、請求項5または6に記載のデータ読出装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006072738A JP4555791B2 (ja) | 2006-03-16 | 2006-03-16 | データ読出方法及びデータ読出装置 |
US11/457,483 US7769911B2 (en) | 2006-03-16 | 2006-07-14 | Data reading method and data reading apparatus |
US11/723,151 US20070220179A1 (en) | 2006-03-16 | 2007-03-16 | Data reading method and data reading apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006072738A JP4555791B2 (ja) | 2006-03-16 | 2006-03-16 | データ読出方法及びデータ読出装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2007249646A JP2007249646A (ja) | 2007-09-27 |
JP4555791B2 true JP4555791B2 (ja) | 2010-10-06 |
Family
ID=38519291
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006072738A Expired - Fee Related JP4555791B2 (ja) | 2006-03-16 | 2006-03-16 | データ読出方法及びデータ読出装置 |
Country Status (2)
Country | Link |
---|---|
US (2) | US7769911B2 (ja) |
JP (1) | JP4555791B2 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
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-
2006
- 2006-03-16 JP JP2006072738A patent/JP4555791B2/ja not_active Expired - Fee Related
- 2006-07-14 US US11/457,483 patent/US7769911B2/en not_active Expired - Fee Related
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2007
- 2007-03-16 US US11/723,151 patent/US20070220179A1/en not_active Abandoned
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
Publication number | Publication date |
---|---|
US7769911B2 (en) | 2010-08-03 |
JP2007249646A (ja) | 2007-09-27 |
US20070220178A1 (en) | 2007-09-20 |
US20070220179A1 (en) | 2007-09-20 |
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Legal Events
Date | Code | Title | Description |
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A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20090529 |
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A131 | Notification of reasons for refusal |
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A521 | Request for written amendment filed |
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A131 | Notification of reasons for refusal |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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R150 | Certificate of patent or registration of utility model |
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