JP4416775B2 - 撮像装置 - Google Patents
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Description
/D変換器6aは、第1のアナログ信号処理回路5aから出力される第1の画像信号Ya(t)を第1のCCD固体撮像素子1aの出力タイミングに同期して規格化し、デジタル信
号の第1の画像データYa(n)を出力する。
の被写体画像を受けて発生する情報電荷が各受光画素に蓄積される。また、撮像部では、複数の垂直シフトレジスタの一部の列が遮光されて所謂OPB(Optical Black)領域と称される領域に設定されている。撮像部の各受光画素に蓄積された情報電荷は、フレーム転送クロックφa(f)及び垂直転送クロックφa(v)によって蓄積部に高速で転送される。蓄積部に出力された情報電荷は、蓄積部で一時的に蓄積され、垂直転送クロックφa(v)によって水平シフトレジスタ1hに1ライン単位で転送され、水平転送クロックφhによって水平シフトレジスタ1hから出力部1d側へ1画素単位で転送される。出力部1dへ出力
された情報電荷は、1画素毎に容量に蓄積されることで、電荷量に応じた電圧値に変換され、画像信号Ya(t)として出力される。このとき、出力部1dでは、水平転送クロックφhに同期するリセットクロックφrに応答して容量に蓄積された情報電荷がドレインへ排出される。また、第1のCCD固体撮像素子1aは、撮像部に発生する過剰な電荷を基板側へ吸収させる所謂縦型オーバーフロードレイン構造を有しており、撮像部に蓄積される情報電荷を基板クロックφa(b)によって基板側へ排出することが可能になっている。第2のCCD固体撮像素子31bは、第1のCCD固体撮像素子31aと同様に複数の受光画素が行列配置され、第2の被写体映像に応答して発生する情報電荷を各受光画素に蓄積し、この蓄積した情報電荷に応じた第2の画像信号Yb(t)を出力する。この第2のCCD固体撮像素子1bにおいても、縦型オーバーフロードレイン構造を有しており、基板側への情報電荷の排出が可能になっている。
グが指定された表示モードに合わせて変更される。
ら得られる2つの撮像画像のコントラストのばらつきを抑制し、2つの撮像画像で画質が相違するのを防止することができる。
では、図4に示すように、第1及び第2の垂直転送クロックφa(v)、φb(v)が交互に立ち上がるように設定され、この結果、第1及び第2のCCD固体撮像素子31a、31bからは第1及び第2の画像信号Ya(t)、Yb(t)が1ライン単位で交互に出力される。このとき、第2の画像信号Yb(t)は、表示領域が垂直方向の1/2の領域に設定されているため、12ラインで構成される1画面分が1ラインおきに間引かれて6ラインで出力される。また、タイミングt5〜t7においては、第1及び第2の画像信号Ya(t)、Yb(t)の出力タイミングに応答して、選択回路36でそれぞれの画像信号が選択的に取り出され、画像
信号Y(t)として出力される。このように、第1及び第2の画像信号Y(t)の出力タイミングを制御し、その出力タイミングに合わせて選択回路36を動作させることで、指定された表示モードに合わせた順序で画像信号を取り出すことができる。
示すように第1の撮影画像A、或いは、第2の撮影画像Bの何れか一方のみを表示する場合には、表示を所望する画像に合わせて第1のCCD固体撮像素子31a、または、第2のCCD固体撮像素子31bの何れか一方を駆動させるようにすれば良い。
し、第2の積分回路43から出力される積分データに基づいて第2のCCD固体撮像素子31bの蓄積時間を伸縮制御する。例えば、第1のCCD固体撮像素子31aの露光状態を制御する場合、第1の画像信号Ya(t)から生成された画像データの積分値が適正範囲より大きくなると、第1のCCD固体撮像素子31aの蓄積時間を短くするようにタイミング制御回路33へ指示を与える。逆に、積分値が適正範囲より小さくなると、蓄積時間を長くするように指示を与え、常に第1のCCD固体撮像素子31aの露光状態が適当となるようにフィードバック制御する。
像データとを合成する。
50bでは、デコーダの設定値を変更することで様々なタイミング信号を複数生成することができる。
トクロックφa(r)が生成される。そして、第1のCCD固体撮像素子31aが駆動し、第1の画像信号Y(t)が第1のクランプ回路5aに取り込まれる。このとき、第2のタイミング制御回路50bは、タイミング信号の出力を停止しており、これにより、第2のCCDドライバ回路32b及び第2のCCD固体撮像素子31bの駆動が停止されている。
1b、31b:第2のCCD固体撮像素子
2a、32a:第1の昇圧回路
2b、33b:第2の昇圧回路
3a、33a:第1のCCDドライバ回路
3b、33b:第2のCCDドライバ回路
4a:第1のタイミング制御回路
4b:第2のタイミング制御回路
5a:第1のアナログ信号処理回路
5b:第2のアナログ信号処理回路
6a:第1のA/D変換器
6b:第2のA/D変換器
7a:第1のデジタル信号処理回路
7b:第2のデジタル信号処理回路
8a:第1のメモリ
8b:第2のメモリ
9:メモリコントローラ
34:タイミング制御回路
35a:第1のクランプ回路
35b:第2のクランプ回路
36:選択回路
37:アナログ信号処理回路
38:A/D変換回路
39:デジタル信号処理回路
41:ラインメモリ
42:第1の積分回路
43:第2の積分回路
44:露光制御回路
45:RGBプロセス回路
46:第3の積分回路
47:第4の積分回路
48:ホワイトバランス制御回路
50a:第1のタイミング制御回路
50b:第2のタイミング制御回路
61:昇圧回路
61a:昇圧部
61b:出力選択部
Claims (7)
- 複数の受光画素が行列配置され、第1の被写体映像に応答して発生する情報電荷を各受光画素に蓄積する第1の固体撮像素子と、
複数の受光画素が行列配置され、第2の被写体映像に応答して発生する情報電荷を各受光画素に蓄積する第2の固体撮像素子と、
前記第1の固体撮像素子の各受光画素に蓄積された情報電荷を転送出力して第1の画像信号を得る第1の駆動回路と、
前記第2の固体撮像素子の各受光画素に蓄積された情報電荷を転送出力して第2の画像信号を得る第2の駆動回路と、
一定周期の基準クロックに基づいて前記第1の固体撮像素子の垂直走査及び水平走査のタイミングを決定する第1のタイミング制御回路と、
前記基準クロックに基づいて前記第2の固体撮像素子の垂直走査及び水平走査のタイミングを決定する第2のタイミング制御回路と、
前記第1の画像信号及び前記第2の画像信号を取り込んで、前記第1のタイミング制御回路が前記第1の固体撮像素子を駆動させる場合は前記第1の画像信号を選択的に出力し、前記第2のタイミング制御回路が前記第2の固体撮像素子を駆動させる場合は前記第2の画像信号を選択的に出力する選択回路と、
前記選択回路の出力をクランプして出力するクランプ回路と、
前記クランプ回路からの出力を受けて所定の画像信号を生成する信号処理回路と、
を備えることを特徴とする撮像装置。 - 請求項1に記載の撮像装置において、
入力される電圧を昇圧して昇圧電圧を生成する昇圧回路を更に備え、
前記昇圧回路は、前記昇圧電圧を生成する昇圧部と、前記昇圧電圧を前記第1及び第2の固体撮像素子の動作タイミングに同期して前記第1及び第2の駆動回路の何れか一方に選択的に出力する出力選択部と、を含むことを特徴とする撮像装置。 - 請求項1に記載の撮像装置において、
前記信号処理回路は、前記第1及び第2の画像信号をそれぞれ取り込み、所定の期間単位で積分する第1及び第2の積分回路と、
前記第1及び第2の積分回路の各出力に基づいて、前記第1及び第2の固体撮像素子の露光状態をそれぞれ独立して制御する露光制御回路と、を含むことを特徴とする撮像装置。 - 請求項3に記載の撮像装置において、
前記信号処理回路は、前記第1及び第2の画像信号をそれぞれ取り込み、所定の期間単位で積分する第3及び第4の積分回路と、
前記第3及び第4の積分回路の各出力に基づいて、前記第1及び第2の画像信号のホワイトバランスをそれぞれ独立して補正するホワイトバランス制御回路と、を更に含むことを特徴とする撮像装置。 - 請求項1に記載の撮像装置において、
前記第1及び第2の固体撮像素子は、互いに駆動条件が異なることを特徴とする撮像装
置。 - 請求項5に記載の撮像装置において、
前記第2の固体撮像素子は、前記第1の固体撮像素子よりも赤外感度が高く設定されることを特徴とする撮像装置。 - 請求項5に記載の撮像装置において、
前記第1及び第2の固体撮像素子は、受光画素数が互いに異なることを特徴とする撮像装置。
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2006
- 2006-10-05 JP JP2006274209A patent/JP4416775B2/ja not_active Expired - Fee Related
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