JP4111235B2 - 電気光学装置の駆動回路及び電気光学装置並びに電子機器 - Google Patents
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Description
まず、本発明に係る電気光学装置として、液晶装置を一例にとって説明する。液晶装置の構成は、後述するように、TFTアレイ基板と対向基板とが互いに電極形成面を対向させて、かつ、一定の間隙を保って貼付されて、この間隙に液晶が挟持された構成となっている。このうち、TFTアレイ基板の画像表示領域にあっては、図1に示されるような等価回路となっている。
この図に示されるように、m本の走査線3aが、X方向に沿って平行に配列して形成される一方、n本のデータ線6aが、Y方向に沿って平行に配列して形成されている。そして、これらの走査線3aとデータ線6aとの各交点においては、TFT30のゲートが走査線3aに接続される一方、TFT30のソースがデータ線6aに接続されるとともに、TFT30のドレインが画素電極9aに接続されている。そして、各画素は、画素電極9aと、対向基板に形成される対向電極(後述する)と、これら両電極間に挟持された液晶とによって構成される結果、走査線3aとデータ線6aとの各交点に対応して、マトリクス状に配列することとなる。
次に、データ線駆動回路101の詳細について説明する。図3は、データ線駆動回路101の構成を示すブロック図である。図3に示されるように、データ線駆動回路101は、転送信号を順次出力するシフトレジスタ回路400と、順次出力された転送信号を波形整形するバッファ回路500とを備えている。このうち、シフトレジスタ回路400は、直列接続された複数段のラッチ回路401から構成されており、各ラッチ回路401は、実際には、クロック信号CLXおよびその反転クロック信号CLX'にしたがって入力信号の取込・保持を行う遅延型フリップフロップ回路などが用いられる。
ここで、データ線駆動回路101の回路レイアウトについて説明する。図5は、データ線駆動回路101の要部回路についてのレイアウトを示す平面図である。この図においては、配線404を介して供給される位相調整回路402の出力信号が、第1に、バッファ回路500によって波形整形等されて、サンプリング制御信号線114を介しサンプリング制御信号として出力され、第2に、このサンプリング制御信号にしたがって、12個のサンプリングスイッチ302を駆動制御する構成とともに、12本の画像信号線115に供給される画像信号VID1〜VID12が、当該12個のサンプリングスイッチによりサンプリングされて、対応する12本のデータ線6aに供給される構成が示されている。
また、図5に示されるように、バッファ回路500は、ラッチ回路401や位相調整回路402が形成される領域と、シリアル−パラレル変換された12系統の画像信号VID1〜VID12が供給される12本の画像信号線115が形成される領域との間に形成されている。
次に、バッファ回路500の詳細について図6〜図8を参照して説明する。ここで、図6は、バッファ回路500のレイアウトを示す平面図であり、図7は、図6のレイアウトを簡略化した回路図であり、図8は、バッファ回路500の構成を示す等価回路図である。これらの図に示されるように、バッファ回路500では、インバータ501〜503がデータ線6aの延在方向(Y方向)に3段直列接続して構成されており、さらに、各段のインバータ501〜503では、それぞれ7個のインバータが走査線3aの延在方向(X方向)に並列接続して構成されている。すなわち、第1段目のインバータ501はインバータ511〜517が、第2段目のインバータ502はインバータ521〜527が、第3段目のインバータ503はインバータ531〜537が、それぞれ並列接続されたものである。
次に、上述した実施形態に係る液晶装置の全体構成について図11および図12を参照して説明する。ここで、図11は、液晶装置100の構成を示す斜視図であり、図12は、図11におけるA−A'線の断面図である。
また、実施形態においては、液晶装置を構成するTFTアレイ基板10として、ガラス等の透明な絶縁性基板を用いて、当該基板上にシリコン薄膜を形成するとともに、当該薄膜上にソース、ドレイン、チャネルが形成されたTFTによって、画素のスイッチング素子(TFT30)や駆動回路200を構成するTFTを形成するものとして説明したが、本発明はこれに限られるものではない。
次に、上述した液晶装置を各種の電子機器に適用される場合について説明する。この場合、電子機器は、図13に示されるように、主に、表示情報出力源1000、表示情報処理回路1002、駆動回路1004、液晶装置100、クロック発生回路1008並びに電源回路1010を備えて構成されている。このうち、表示情報出力源1000は、ROM(Read Only Memory)、RAM(Random Access Memory)などのメモリや、光ディスク装置などのストレージユニット、画像信号を同調して出力する同調回路等を含み、クロック発生回路1008からのクロック信号に基づいて、所定フォーマットの画像信号などの表示情報を表示情報処理回路1002に出力するものである。また、表示情報処理回路1002は、上述したシリアル−パラレル変換回路や、増幅・極性反転回路、ローテーション回路、ガンマ補正回路、クランプ回路等の周知の各種処理回路を含んで構成されており、クロック信号に基づいて入力された表示情報からデジタル信号を順次生成し、クロック信号CLKとともに駆動回路1004に出力するものである。駆動回路1004は、液晶装置100を駆動するものであり、上述した駆動回路200のほか、製造後の検査に用いる検査回路などを含んだものである。電源回路1010は、上述の各回路に所定の電源を供給するものである。
まず、この液晶装置100をライトバルブとして用いたプロジェクタについて説明する。図14は、このプロジェクタの構成を示す平面図である。この図に示されるように、プロジェクタ1100内部には、ハロゲンランプ等の白色光源からなるランプユニット1102が設けられている。このランプユニット1102から射出された投射光は、内部に配置された3枚のミラー1106および2枚のダイクロイックミラー1108によってRGBの3原色に分離されて、各原色に対応するライトバルブ100R、100Gおよび100Bにそれぞれ導かれる。
次に、この液晶装置を、モバイル型のパーソナルコンピュータに適用した例について説明する。図15は、このパーソナルコンピュータの構成を示す斜視図である。図において、コンピュータ1200は、キーボード1202を備えた本体部1204と、液晶表示ユニット1206とから構成されている。この液晶表示ユニット1206は、先に述べた液晶装置100の背面にバックライトを付加することにより構成されている。
Claims (3)
- 複数の走査線と、複数のデータ線と、前記複数の走査線と前記複数のデータ線との各交点に対応して設けられた複数の画素とを備えた電気光学装置を駆動するための電気光学装置の駆動回路であって、
前記駆動回路は、
転送信号を出力するシフトレジスタ回路と、
前記転送信号をサンプリング制御信号として出力するバッファ回路と、
を有し、
前記バッファ回路は、
並列接続された複数の論理回路によって構成される段が、複数直列接続して構成されたものであり、
前記論理回路を構成するトランジスタのチャネル幅は、前記論理回路を含む段の前段に含まれる論理回路を構成するトランジスタのチャネル幅よりも広いことを特徴とする電気光学装置の駆動回路。 - 請求項1に記載の電気光学装置の駆動回路を備えたことを特徴とする電気光学装置。
- 請求項2に記載の電気光学装置を備えたことを特徴とする電子機器。
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