JP3964900B2 - 電圧供給回路 - Google Patents
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Description
充電すると、μsecオーダーの時間がかかってしまう。これは、動作速度が高速化した負荷回路では、所望の動作が実現できないという問題がある。
図1は、本発明の第1の実施形態に係る半導体装置1の構成を示す回路ブロック図である。半導体装置1は、電圧供給回路2と、負荷回路3と、DC/DCコンバータ4とを備えている。DC/DCコンバータ4は、例えば外部から入力される入力電圧Vinを降圧して出力電圧Voutを生成する。この出力電圧Voutは、電圧供給回路2を介して負荷回路3に供給される。
よって、電圧供給回路2に蓄えられる電荷Qは、以下のように表される。
次に、負荷回路3がアクティブ状態の場合について説明する。図4は、この場合の半導体装置1の電流経路を示す回路ブロック図である。なお、電流経路は、図中の太線で示している。
第2の実施形態は、各々がスイッチドキャパシタを備えた2つの電圧供給回路をDC/DCコンバータ4と負荷回路3との間に設けるようにしたものである。
容量比C2/C1=Aとすると、(1)式は、次式のように表される。
(2)式を整理すると、次式のようになる。
(3式)より、容量比Aは次式で表される。
V1=Vin/3、V2=Vin/2であるため、入力電圧Vin=3.3V、出力電圧Vout=1.2Vの場合、容量比Aは次式のようになる。
仮に、C1=900pFとすると、C2=300pFとなる。
第3の実施形態は、第2の実施形態で示した2つの電圧供給部が有するキャパシタ数を変えて電圧供給回路を構成したものである。
Claims (5)
- 第1電圧を降圧して第2電圧を生成するDC/DCコンバータと前記第2電圧が供給される負荷回路との間に設けられた電圧供給回路であって、
前記第1電圧が供給される第1端子と、
前記負荷回路に接続された第2端子と、
複数のキャパシタと、
前記負荷回路が待機状態の時、前記複数のキャパシタを前記第1端子と接地電位との間に直列に接続し、一方前記負荷回路が動作状態の時、前記複数のキャパシタを前記第2端子と前記接地電位との間に並列に接続するスイッチ回路と
を具備することを特徴とする電圧供給回路。 - 前記負荷回路が待機状態の時、前記DC/DCコンバータと前記負荷回路とを電気的に切断し、一方前記負荷回路が動作状態の時、前記DC/DCコンバータと前記負荷回路とを電気的に接続する第1スイッチ素子をさらに具備することを特徴とする請求項1記載の電圧供給回路。
- 前記負荷回路が待機状態の時、前記キャパシタに前記第1電圧を供給し、一方前記負荷回路が動作状態の時、前記キャパシタに前記第1電圧を供給するのを停止する第2スイッチ素子をさらに具備することを特徴とする請求項1又は2記載の電圧供給回路。
- 前記複数のキャパシタは、略同じ容量値を有し、
前記複数のキャパシタの数は、前記複数のキャパシタが前記第2端子と前記接地電位との間に並列に接続された場合に、前記第2端子から出力される出力電圧が前記第2電圧と略同じになるように設定されることを特徴とする請求項1乃至3のいずれかに記載の電圧供給回路。 - 第1電圧を降圧して第2電圧を生成するDC/DCコンバータと前記第2電圧が供給される負荷回路との間に設けられた電圧供給回路であって、
前記第1電圧が供給される第1端子と、
前記負荷回路に接続された第2端子と、
複数のキャパシタを含む第1キャパシタ群と、
前記負荷回路が待機状態の時、前記第1キャパシタ群のキャパシタを前記第1端子と接地電位との間に直列に接続し、一方前記負荷回路が動作状態の時、前記第1キャパシタ群のキャパシタを前記第2端子と前記接地電位との間に並列に接続する第1スイッチ回路と、
複数のキャパシタを含む第2キャパシタ群と、
前記負荷回路が待機状態の時、前記第2キャパシタ群のキャパシタを前記第1端子と接地電位との間に直列に接続し、一方前記負荷回路が動作状態の時、前記第2キャパシタ群のキャパシタを前記第2端子と前記接地電位との間に並列に接続する第2スイッチ回路と
を具備することを特徴とする電圧供給回路。
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