JP3761558B2 - スイッチング電源回路及び該スイッチング電源回路に用いられる制御方法 - Google Patents
スイッチング電源回路及び該スイッチング電源回路に用いられる制御方法 Download PDFInfo
- Publication number
- JP3761558B2 JP3761558B2 JP2004132146A JP2004132146A JP3761558B2 JP 3761558 B2 JP3761558 B2 JP 3761558B2 JP 2004132146 A JP2004132146 A JP 2004132146A JP 2004132146 A JP2004132146 A JP 2004132146A JP 3761558 B2 JP3761558 B2 JP 3761558B2
- Authority
- JP
- Japan
- Prior art keywords
- switching element
- auxiliary
- state
- power supply
- switching
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Landscapes
- Rectifiers (AREA)
- Dc-Dc Converters (AREA)
Description
すなわち、スイッチング素子3のターンオン及びターンオフの際、損失が発生する。たとえば、スイッチング素子3のターンオン時、ターンオンの直前において、コンデンサ5は、スイッチング素子3の寄生容量であり、出力電圧Nにほぼ等しい電圧で充電されている。そして、コンデンサ5の充電電荷は、ターンオン時にスイッチング素子3を通して放電される。このとき、コンデンサ5に蓄積されていた電磁エネルギーはスイッチング素子3で消費され、電力の損失が発生する。また、スイッチング素子3がターンオンする直前では、整流用ダイオード6に順方向に負荷電流が流れているが、この状態でスイッチング素子がターンオンすると、整流用ダイオード6に平滑コンデンサ7から逆電圧が印加される。このため、整流用ダイオード6にリカバリ電流が流れ、しかも電流制限するものがないため、多大な損失及び雑音が発生するという問題点がある。また、整流用ダイオード6をファースト・リカバリ・ダイオードで構成した場合、リカバリ電流は減少するが、完全になくなるわけではない。
特許文献1に記載された昇圧チョッパ型スイッチング電源は、図7に示すように、バッテリ1と、チョークコイル2と、主スイッチング素子3と、ダイオード4と、コンデンサ5と、整流用ダイオード6と、平滑コンデンサ7と、制御部8Aと、チョークコイル9と、ダイオード10,11と、補助スイッチング素子12と、ダイオード13とから構成され、同平滑コンデンサ7に負荷Zが並列接続されている。
すなわち、時刻t2において補助スイッチ電流ISW2がゼロに達した後、時刻t3において補助スイッチング素子22がオン状態となる。このため、補助スイッチング素子22に並列接続されているダイオード23がオフ状態のときに同補助スイッチング素子22がオン状態となり、ゼロ電圧スイッチングにならないため、スイッチング損失が発生するという問題点がある。また、上記特許文献2では、図9中のダイオード4の働きが明確に記載されていない。
この例のスイッチング電源回路は、同図に示すように、バッテリ31と、チョークコイル32と、nMOSで構成されたスイッチング素子33と、ダイオード34と、コンデンサ35と、整流用ダイオード36と、平滑コンデンサ37と、トランス38と、nMOSで構成された補助スイッチング素子39と、補助ダイオード40と、補助コンデンサ41と、蓄積用コンデンサ42と、制御部43とから構成され、同平滑コンデンサ37に負荷Zが並列接続されている。ダイオード34は、スイッチング素子33の寄生ダイオードで構成され、同スイッチング素子33に流れる電流の方向に対する逆の方向が順方向となる態様で同スイッチング素子33の両端に並列接続されている。コンデンサ35は、スイッチング素子33の寄生容量で構成され、同スイッチング素子33の両端に並列接続されている。
この図を参照して、この例のスイッチング電源回路に用いられる制御方法について説明する。
このスイッチング電源回路では、スイッチング素子33がオン状態のときにバッテリ31から供給される電磁エネルギーがチョークコイル32に貯蔵され、同スイッチング素子33がオフ状態になったときに同チョークコイル32に生ずる逆起電圧が同バッテリ31の出力電圧Eに重畳されて整流用ダイオード36を介して平滑コンデンサ37に印加され、出力電圧Eが昇圧されて出力電圧Nが生成される。
この例のスイッチング電源回路では、図1中のバッテリ31及び制御部43に代えて、商用交流電源51、整流回路52及び力率改善制御部43Aが設けられている。また、スイッチング素子33のソース電極と整流回路52との間に電流検出抵抗44が並列接続されている。整流回路52は、商用交流電源51から得られる入力電圧Wを整流して脈動電圧Mを生成する。電流検出抵抗44は、整流回路52から出力される脈動電流iを検出することにより、商用交流電源51から得られる入力電流を間接的に検出する。力率改善制御部43Aは、たとえば集積回路などで構成され、脈動電圧M、出力電圧N及び脈動電流iに基づいて前記入力電流が入力電圧Wとほぼ同一位相のサイン波形になるように、スイッチング素子33及び補助スイッチング素子39のオン時間を制御する。他は、図1と同様の構成である。
この例のスイッチング電源回路では、同図4に示すように、図1中のトランス38の二次巻線n2の一端が整流ダイオード36のアノード側に接続され、また、補助スイッチング素子39、補助ダイオード40、補助コンデンサ41、及び蓄積用コンデンサ42が平滑コンデンサ37の一端に接続されていない。他は、図1と同様の構成である。
この例のスイッチング電源回路では、同図5に示すように、図3中のトランス38の二次巻線n2の一端が整流ダイオード36のアノード側に接続され、また、補助スイッチング素子39、補助ダイオード40、補助コンデンサ41、及び蓄積用コンデンサ42が平滑コンデンサ37の一端に接続されていない。他は、図3と同様の構成である。
たとえば、各実施例では、スイッチング素子33及び補助スイッチング素子39はnMOSで構成されているが、たとえば、バイポーラトランジスタやIGBT(Insulated Gate Bipolar Transistor )などでも良い。この場合、各トランジスタのエミッタとコレクタとの間にダイオード及びコンデンサを接続することになる。また、脈動電流iを検出する電流検出抵抗44の他、同脈動電流iが流れる線材の周囲に発生する磁界を検出することにより、同脈動電流iを間接的に検出する電流センサを用いても良い。
32 チョークコイル(インダクタンス素子)
33 スイッチング素子
34 ダイオード(整流素子)
35 コンデンサ(静電容量素子)
36 整流用ダイオード(整流手段)
37 平滑コンデンサ(平滑手段)
38 トランス(制御回路の一部)
39 補助スイッチング素子(制御回路の一部)
40 補助ダイオード(制御回路の一部)
41 補助コンデンサ(制御回路の一部)
42 蓄積用コンデンサ(制御回路の一部)
43 制御部(制御回路の一部)
43A 力率改善制御部(力率改善制御手段)
44 電流検出抵抗(電流検出手段)
51 商用交流電源
52 整流回路
Claims (5)
- スイッチング素子がオン状態のときに直流電源部から供給される電磁エネルギーをインダクタンス素子に貯蔵し、前記スイッチング素子がオフ状態になったときに前記インダクタンス素子に生ずる逆起電圧を前記直流電源部の出力電圧に重畳して整流手段を介して平滑手段に印加することにより、前記直流電源部の出力電圧を昇圧させるスイッチング電源回路であって、
前記スイッチング素子に流れる電流の方向に対する逆の方向が順方向となる態様で該スイッチング素子の両端に介挿された整流素子と、
前記スイッチング素子の両端に介挿された静電容量素子と、
前記スイッチング素子がオフ状態からオン状態に遷移する前に前記整流素子に順方向電流を流して該整流素子をオン状態とすると共に前記静電容量素子を放電し、前記スイッチング素子がオン状態からオフ状態に遷移するときに前記静電容量素子を充電すると共に前記整流素子をオフ状態とし、かつ前記スイッチング素子がオフ状態からオン状態に遷移したときに前記平滑手段から前記整流手段を介して該スイッチング素子に流れ込むリカバリ電流を制限する制御回路とが設けられていると共に、
前記制御回路は、
前記スイッチング素子に流れる電流を一次巻線に流し、該一次巻線に蓄えられた電磁エネルギーを二次巻線に転送する一方、該二次巻線に電流を流し、該二次巻線に蓄えられた電磁エネルギーを前記一次巻線に転送するトランスと、
該トランスの前記二次巻線との間で共振電流が流れ、該二次巻線から供給される電磁エネルギーを蓄積する蓄積手段と、
オン状態になったときに前記蓄積手段から前記トランスの二次巻線に電流を流す補助スイッチング素子と、
前記補助スイッチング素子に流れる電流の方向に対する逆の方向が順方向となる態様で該補助スイッチング素子の両端に介挿された補助整流素子と、
前記補助スイッチング素子に介挿された補助静電容量素子と、
前記スイッチング素子と前記補助スイッチング素子とを交互にオン/オフ制御し、かつ同時にオフ状態となるデッドタイム期間を設定する制御部とから構成されていて、かつ、
前記スイッチング素子がオン状態からオフ状態に遷移するときの前記デッドタイム期間では、前記スイッチング素子に流れる電流の立下りに比べて電圧の立ち上がりが緩やかになるように設定する一方、
前記補助スイッチング素子がオン状態からオフ状態に遷移するときの前記デッドタイム期間では、前記補助スイッチング素子に流れる電流の立下りに比べて電圧の立ち上がりが緩やかになるように設定されていることを特徴とするスイッチング電源回路。 - 前記スイッチング素子は、MOSトランジスタで構成され、
前記整流素子は、該MOSトランジスタの寄生ダイオードで構成され、
前記静電容量素子は、該MOSトランジスタの寄生容量で構成されていることを特徴とする請求項1記載のスイッチング電源回路。 - 前記補助スイッチング素子は、MOSトランジスタで構成され、
前記補助整流素子は、該MOSトランジスタの寄生ダイオードで構成され、
前記補助静電容量素子は、該MOSトランジスタの寄生容量で構成されていることを特徴とする請求項1記載のスイッチング電源回路。 - 請求項1記載のスイッチング電源回路において、
前記直流電源部は、
商用交流電源から得られる入力電圧を整流して脈動電圧を生成する整流回路で構成され、
かつ、前記商用交流電源から得られる入力電流を検出する電流検出手段が設けられ、
前記制御部は、
前記脈動電圧、出力電圧及び入力電流に基づいて該入力電流を前記入力電圧とほぼ同一位相のサイン波形になるように前記スイッチング素子及び補助スイッチング素子のオン時間を制御する力率改善制御手段で構成されていることを特徴とするスイッチング電源回路。 - スイッチング素子がオン状態のときに直流電源部から供給される電磁エネルギーをインダクタンス素子に貯蔵し、前記スイッチング素子がオフ状態になったときに前記インダクタンス素子に生ずる逆起電圧を前記直流電源部の出力電圧に重畳して整流手段を介して平滑手段に印加することにより、前記直流電源部の出力電圧を昇圧させるスイッチング電源回路に用いられ、
前記スイッチング素子に流れる電流の方向に対する逆の方向が順方向となる態様で該スイッチング素子の両端に介挿された整流素子と、前記スイッチング素子の両端に介挿された静電容量素子とを設けておき、
前記スイッチング素子がオフ状態からオン状態に遷移する前に前記整流素子に順方向電流を流して該整流素子をオン状態とすると共に前記静電容量素子を放電し、前記スイッチング素子がオン状態からオフ状態に遷移するときに前記静電容量素子を充電すると共に前記整流素子をオフ状態とし、かつ前記スイッチング素子がオフ状態からオン状態に遷移したときに前記平滑手段から前記整流手段を介して該スイッチング素子に流れ込むリカバリ電流を制限することを特徴とする制御方法であって、
前記スイッチング素子に流れる電流を一次巻線に流し、該一次巻線に蓄えられた電磁エネルギーを二次巻線に転送する一方、該二次巻線に電流を流し、該二次巻線に蓄えられた電磁エネルギーを前記一次巻線に転送するトランスと、
該トランスの二次巻線との間で共振電流が流れ、該二次巻線から供給される電磁エネルギーを蓄積する蓄積手段と、
オン状態になったときに前記蓄積手段から前記トランスの二次巻線に電流を流す補助スイッチング素子と、
前記補助スイッチング素子に流れる電流の方向に対する逆の方向が順方向となる態様で該補助スイッチング素子の両端に介挿された補助整流素子と、
前記補助スイッチング素子に介挿された補助静電容量素子と、
前記スイッチング素子と前記補助スイッチング素子とを交互にオン/オフ制御し、かつ同時にオフ状態となるデッドタイム期間を設定する制御部とを設けておき、
前記補助スイッチング素子がオフ状態からオン状態に遷移する前に前記補助整流素子をオン状態とすると共に前記補助静電容量素子を放電し、前記補助スイッチング素子がオン状態からオフ状態に遷移するときに前記補助静電容量素子を充電すると共に前記補助整流素子をオフ状態とし、かつ、
前記スイッチング素子がオン状態からオフ状態に遷移するときの前記デッドタイム期間では、前記スイッチング素子に流れる電流の立下りに比べて電圧の立ち上がりが緩やかになるように設定する一方、
前記補助スイッチング素子がオン状態からオフ状態に遷移するときの前記デッドタイム期間では、前記補助スイッチング素子に流れる電流の立下りに比べて電圧の立ち上がりが緩やかになるように設定することを特徴とする制御方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004132146A JP3761558B2 (ja) | 2003-05-07 | 2004-04-27 | スイッチング電源回路及び該スイッチング電源回路に用いられる制御方法 |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003129511 | 2003-05-07 | ||
JP2004132146A JP3761558B2 (ja) | 2003-05-07 | 2004-04-27 | スイッチング電源回路及び該スイッチング電源回路に用いられる制御方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2004357495A JP2004357495A (ja) | 2004-12-16 |
JP3761558B2 true JP3761558B2 (ja) | 2006-03-29 |
Family
ID=34067019
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004132146A Expired - Fee Related JP3761558B2 (ja) | 2003-05-07 | 2004-04-27 | スイッチング電源回路及び該スイッチング電源回路に用いられる制御方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3761558B2 (ja) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5275186B2 (ja) * | 2009-09-17 | 2013-08-28 | 富士通テレコムネットワークス株式会社 | 照明用led駆動回路 |
WO2011083503A1 (ja) * | 2010-01-05 | 2011-07-14 | 株式会社日立製作所 | Ac-dcコンバータおよびその制御方法 |
JP5648570B2 (ja) * | 2011-04-25 | 2015-01-07 | 株式会社デンソー | Dc/dcコンバータ |
KR102349045B1 (ko) * | 2019-11-04 | 2022-01-07 | 엘지전자 주식회사 | 디커플링 동작을 수행하는 벅-부스트 컨버터 |
-
2004
- 2004-04-27 JP JP2004132146A patent/JP3761558B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2004357495A (ja) | 2004-12-16 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US9287792B2 (en) | Control method to reduce switching loss on MOSFET | |
JP4320787B2 (ja) | スイッチング電源装置 | |
CN101689807B (zh) | 多输出开关电源装置 | |
US20080037293A1 (en) | Forward power converter controllers | |
US20060119281A1 (en) | Power conversion device | |
JP5585408B2 (ja) | スイッチング電源装置 | |
JP2008109775A (ja) | Dc−dcコンバータおよびその制御方法 | |
JP2013201829A (ja) | スイッチング電源装置 | |
US7002323B2 (en) | Switching power supply circuit capable of reducing switching loss and control method used therein | |
JP2004201373A (ja) | スイッチング電源回路 | |
JP2014075943A (ja) | コンバータ及び双方向コンバータ | |
JP4830408B2 (ja) | 電力変換装置 | |
JP2012239341A (ja) | スイッチング電源装置 | |
JP6262835B1 (ja) | 誘導負荷駆動回路 | |
JP3761558B2 (ja) | スイッチング電源回路及び該スイッチング電源回路に用いられる制御方法 | |
JP4123231B2 (ja) | 直流変換装置 | |
EP2892135B1 (en) | Power Supply and energy efficient Gate Driver | |
US6930895B2 (en) | Computer power supply | |
JP7185676B2 (ja) | 半導体リレー装置 | |
JPWO2006080112A1 (ja) | 絶縁型dc−dcコンバータ | |
JP6829220B2 (ja) | スイッチング電源装置及びその制御方法 | |
JP2001286130A (ja) | 力率改善回路 | |
JP2012143071A (ja) | 電源装置および電子機器 | |
JP2005295649A (ja) | スイッチング電源装置 | |
JP2002199726A (ja) | スイッチング電源装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20050705 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20050719 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050920 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20051227 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20060110 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100120 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110120 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110120 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120120 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130120 Year of fee payment: 7 |
|
LAPS | Cancellation because of no payment of annual fees |