JP3638135B2 - 交流面放電型プラズマディスプレイパネル及びその駆動方法 - Google Patents
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Description
【０００１】
【発明の属する技術分野】
本発明は、走査期間の短縮を図った交流面放電型プラズマディスプレイパネル及びその駆動方法に関する。
【０００２】
【従来の技術】
プラズマディスプレイパネルには、電極を放電ガスが充填された放電空間に露出させ、前記電極間に直流放電を発生させることにより動作させる直流放電型と、電極を誘電体層により被覆して放電ガスには直接露出させず、交流放電の状態で動作させる交流放電型がある。交流放電型プラズマディスプレイパネルには、１セル内の電極数が２であるものと３であるものとがある。以下、従来の３電極面放電交流型プラズマディスプレイパネル（以下、ＰＤＰという）の構造及び駆動方法について説明する。
【０００３】
図６は、３電極面放電交流型プラズマディスプレイパネル（ＰＤＰ）における１つの表示セルの構成を示す斜視図である。図６に示すように、この表示セルにおいては、ガラス等の透明材料よりなる背面基板である絶縁基板１及び前面基板である絶縁基板２が相互に平行に設けられている。絶縁基板２における絶縁基板１に対向する表面には、複数本の透明な走査電極３及び共通電極４が所定の間隔を隔てて交互に配置されている。走査電極上３及び共通電極４上には、電極の電極抵抗値を小さくするために、夫々トレース電極５及び６が形成されている。また、走査電極３、共通電極４、トレース電極５及び６を覆うように、誘電膜１２が形成され、誘電膜１２上にはこの誘電膜１２を放電から保護する酸化マグネシウム等からなる保護層１３が形成されている。
【０００４】
また、絶縁基板１における絶縁基板２に対向する表面には、走査電極３及び共通電極４に直交する方向に延びる複数本のデータ電極７が設けられている。データ電極７上には、このデータ電極７を覆うように誘電膜１４が形成されている。
【０００５】
絶縁基板１及び２の間には、放電ガス空間８を確保すると共に表示セル（画素）を区画する隔壁９が設けられている。放電ガス空間８にはヘリウム、ネオン及びキセノン等の希ガス並びにこれらの希ガスの混合ガスからなる放電ガスが充填されている。また、誘電膜１４の表面及び隔壁９の側面には前記放電ガスの放電により発生する紫外線を吸収し可視光１０を発光する蛍光体１１が形成されている。
【０００６】
図７は図６に示すＰＤＰの電極配置を示す模式的平面図である。図７に示す符号Ｓ１〜Ｓｎはｎ本（ｎは自然数）の走査電極３（図６参照）を示し、符号Ｃ１〜Ｃｎはｎ本の共通電極４（図６参照）を示し、符号Ｄ１〜Ｄｍはｍ本（ｍは自然数）のデータ電極７（図６参照）を示す。図７に示すように、このＰＤＰにおいては、相互に平行に延びるｎ本の走査電極Ｓ及びｎ本の共通電極Ｃと、それらと直交する方向に延びるｍ本のデータ電極Ｄとが設けられており、データ電極Ｄにおける走査電極Ｓ及び共通電極Ｃとの最近接点を各１ヶ所含むように、発光するセル１５が形成されている。即ち、１つのセル１５には各１本の走査電極Ｓ、共通電極Ｃ及びデータ電極Ｄが貫通しており、セル１５はマトリクス状に配列されている。従って、ＰＤＰの画面全体のセル数は、（ｎ×ｍ）個となる。
【０００７】
次に、従来のＰＤＰの駆動方法について説明する。図８は従来のＰＤＰの駆動方法における１フィールドの構成を示すタイミングチャートである。図８に示す駆動方法はサブフィールド法と呼ばれる方法である。例えば、１／６０秒に１枚の割合で切り替わる画像を１フィールド２０で表示し、この１フィールド２０を８のサブフィールドＳＦ１乃至ＳＦ８により構成し、各サブフィールドにおける維持放電の回数を２のべき乗に比例する数として相互に異ならせる。例えば、ｋを一定の係数とするとき、サブフィールドＳＦ１乃至ＳＦ８における維持放電回数を夫々、２７ｋ＝１２８ｋ回、２６ｋ＝６４ｋ回、２５ｋ＝３２ｋ回、２４ｋ＝１６ｋ回、２３ｋ＝８ｋ回、２２ｋ＝４ｋ回、２１ｋ＝２ｋ回及び２０ｋ＝１ｋ回とする。そして、これらのサブフィールドＳＦ１乃至ＳＦ８の中から維持放電を発生させるサブフィールドを任意に選択して組み合わせることにより、各セルに２５６階調を表示させる。
【０００８】
図９は従来の各サブフィールドの駆動方法を示す駆動波形図であり、図１０（ａ）乃至（ｃ）並びに図１１（ａ）及び（ｂ）は図９に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、図１０（ａ）及び（ｂ）はリセット期間における壁電荷配置を示し、図１０（ｃ）は走査期間における壁電荷配置を示し、図１１（ａ）及び（ｂ）は維持期間における壁電荷配置を示す。図９に示すように、この駆動方法において各サブフィールドはリセット期間２１、走査期間２２、維持期間２３に分かれている。以下、サブフィールドを構成する各期間の動作について、図９、図１０（ａ）乃至（ｃ）並びに図１１（ａ）及び（ｂ）を参照して説明する。なお、図１０（ａ）乃至（ｃ）並びに図１１（ａ）及び（ｂ）において、正の壁電荷を「＋」を円で囲んだ記号で示し、負の壁電荷を「−」を円で囲んだ記号で示す。
【０００９】
リセット期間２１は前サブフィールド（図示せず）で生成された壁電荷を消去し、表示データをリセットする期間である。リセット期間２１においては、先ず、走査電極Ｓに正極性プライミングパルスＶｐ＋を印加すると共に、共通電極Ｃに負極性プライミングパルスＶｐ−を印加する。データ電極Ｄの電位は接地電位（ＧＮＤ）とする。正極性プライミングパルスＶｐ＋及び負極性プライミングパルスＶｐ−の合計電圧は、このＰＤＰの面放電開始電圧以上の電圧とする。これにより、図１０（ａ）の状態Ａ１に示すように、誘電体１２（図６参照）の表面上における走査電極Ｓ上に相当する領域（以下、走査電極Ｓ上という）と、誘電体１２の表面上における共通電極Ｃ上に相当する領域（以下、共通電極Ｃ上という）との間（以下、面間ともいう）にプライミング放電（予備放電）が発生する。プライミング放電後は、図１０（ａ）の状態Ａ２に示すように、走査電極Ｓ上に負の壁電荷が形成され、共通電極Ｃ上に正の壁電荷が形成される。プライミング放電後においては、セル内に形成される壁電荷は、各電極に印加されている電位を打ち消すように形成され、セル内の電界は一様になる。従って、各セルにおいてプライミング放電後に形成される壁電荷の状態は、前サブフィールドで生成された壁電荷の状態によらず、同一になる。
【００１０】
次に、データ電極Ｄの電位を接地電位に維持したまま、走査電極Ｓに鋸歯状波の負極性のプライミング消去パルスＶｐｅを印加すると共に、共通電極Ｃの電位を接地電位とする。プライミング消去パルスＶｐｅは、電位が接地電位から連続的に低下するパルスであり。これにより、面間の電位差が連続的に増大し、図１０（ｂ）の状態Ａ３に示すように、面間で弱放電（プライミング消去放電）が発生する。なお、弱放電とは、放電ギャップ間の電圧をほぼ放電開始電圧に保ちながら持続する弱い放電をいう。これにより、状態Ａ４に示すように、前述のプライミング放電により形成された壁電荷（図１０（ａ）参照）が消去される。これにより、各セル内の壁電荷の状態がリセットされる。
【００１１】
走査期間２２においては、共通電極Ｃの電位を接地電位に保ったまま、各走査電極Ｓ１〜Ｓｎに負極性の走査パルスＶｗを順次印加する。また、走査期間２２における走査電極Ｓに走査パルスＶｗを印加しない期間は、走査電極Ｓに負極性の一定電圧である走査ベースパルスＶｂｗを印加する。走査電極Ｓに走査ベースパルスＶｂｗを印加することにより、走査パルスＶｗの振幅を低減し、走査パルスＶｗを印加する駆動ＩＣの使用電圧を引き下げることができる。これにより、ＰＤＰの低コスト化を図ることができる。
【００１２】
そして、この走査パルスＶｗに同期して、表示データに基づいてデータ電極Ｄに正極性のデータパルスＶｄを選択的に印加する。このとき、走査パルスＶｗ及びデータパルスＶｄの電圧は、単独では対向放電開始電圧未満であり、走査パルスＶｗがデータパルスＶｄに重畳されると対向放電開始電圧以上となるような電圧に設定する。また、走査ベースパルスＶｂｗは、データパルスＶｄに重畳されても、対向放電開始電圧未満の電圧になるような電圧に設定する。
【００１３】
これにより、図１０（ｃ）の状態Ａ５に示すように、表示データに基づいて選択されたセル内、即ち、走査パルスＶｗに同期してデータパルスＶｄが印加されたセル内のみで、書込放電を発生させることができる。この書込放電は、先ず走査電極上と誘電体１４（図６参照）の表面上におけるデータ電極Ｄ上に相当する領域（以下、データ電極Ｄ上という）との間（以下、対向間ともいう）において対向放電が発生する。続いて、この対向放電をトリガとして走査電極Ｓ上と共通電極Ｃ上との間（面間）で面放電が発生する。この面放電が発生するのは、前記対向放電に伴ってセル内に生成された電子、原子、準安定原子等の活性粒子が、面放電のしきい値電圧を引き下げるためである。この対向放電及び面放電を合わせて書込放電という。なお、書込放電が発生したセルを選択セルといい、書込放電が発生しなかったセルを非選択セルという。
【００１４】
また、前記書込放電における対向放電において、走査電極Ｓ上を負極性とすることにより、ＭｇＯからなる保護層１３（図６参照）に放電ガス中のプラスイオンが衝突して２次電子を放出する。この２次電子がセルに印加される電界により正極側へ移動し、放電ガスの分子に衝突することにより、この放電ガス分子をプラスイオンと電子とに電離する。これにより、セル内に更にプラスイオン及び電子を供給し、放電を持続させることができる。なお、蛍光体１１は、放電に伴って発生する紫外線が照射されることにより可視光１０を発光するが、ＭｇＯは紫外線を透過させないため、保護層１１は絶縁基板２の表面上、即ち、走査電極３及び共通電極４上に形成することが好ましい。
【００１５】
図１０（ｃ）の状態Ａ６に示すように、書込放電により、走査電極Ｓ上には正の壁電荷が形成され、共通電極Ｃ上及びデータ電極Ｄ上には負の壁電荷が形成される。この書込放電を発生させたセル（選択セル）が、後述する維持期間２３において点灯するセルとなる。なお、書込放電が発生していないセルにおいては、壁電荷配置は図１０（ｂ）の状態Ａ４に示す配置のままである。全ての走査電極Ｓに対して走査パルスＶｗの印加が終了すると、走査期間２２が終了し、次いで維持期間２３に移行する。
【００１６】
維持期間２３は、走査期間２２で選択されたセルのみを発光させて実際の映像表示を行う期間である。維持期間２３においては、データ電極Ｄの電位は常に接地電位とする。そして先ず、走査電極Ｓの電位を接地電位とし、共通電極Ｃに負極性の維持パルスＶｓを印加する。この維持パルスＶｓは、接地電位との電位差が面放電開始電圧よりも小さく、且つ、面放電開始電圧から前述の書込放電により生じた壁電荷（図１０（ｃ）の状態Ａ６参照）による電圧（壁電圧）を減じた電圧以上であるような電圧とする。
【００１７】
これにより、走査期間２２において書込放電が発生したセルでは、図１０（ｃ）の状態Ａ６に示すように、走査電極Ｓ上に正の壁電荷が形成され、共通電極Ｃ上に負の壁電荷が形成されているため、この壁電荷による壁電圧が維持電圧Ｖｓに重畳されて、面放電のしきい値（面放電開始電圧）を超える。この結果、図１１（ａ）の状態Ａ７に示すように、面間で１回目の維持放電が生じる。１回目の維持放電が生じると、図１１（ａ）の状態Ａ８に示すように、走査電極Ｓ上には負の壁電荷が形成され、共通電極Ｃ上には正の壁電荷が形成される。続いて、図１１（ｂ）の状態Ａ９に示すように、走査電極Ｓに負極性の維持パルスＶｓを印加し、共通電極Ｃに接地電位を印加する。これにより、前述の１回目の維持放電が発生したセルにおいては、１回目の維持放電により形成された壁電荷に走査電極に印加した維持パルスＶｓが重畳されて面放電開始電圧を超え、２回目の維持放電が発生する。この結果、図１１（９）の状態Ａ１０に示すように、走査電極Ｓ上には正の壁電荷が形成され、共通電極Ｃ上には負の壁電荷が形成される。以後同様に、ｘ回目の維持放電により形成された壁電荷が（ｘ＋１）回目の維持パルスＶｓに重畳され、（ｘ＋１）回目の維持放電が発生する。
【００１８】
一方、走査期間２２において書込放電が生じていないセルでは、図１０（ｂ）の状態Ａ４に示すように壁電荷が形成されていないため、維持パルスＶｓに壁電圧が重畳されず、１回目の維持放電が発生しない。従って、２回目以降の維持放電も発生しない。
【００１９】
このように、維持パルスを繰り返し印加することによって、走査期間２２において選択されたセルのみを発光させることができる。各セルにおいて、発光させるサブフィールドを選択して組み合わせることにより、所望の表示を実現することができる。
【００２０】
しかしながら、上述の従来の技術には以下に示すような問題点がある。上述の駆動方法では、１つのサブフィールドの走査期間は走査電極Ｓの数（ライン数）と書込時間（走査時間）との積だけ必要となり、例えば、走査電極のライン数が４８０本であり、１行当たりの走査時間が３μｓ（μ秒）である場合、１フィールドを８サブフィールドにより構成すると、総走査時間は１１．５ｍｓ（ｍ秒）を要する。これは、１フレームが１／６０秒である場合、総駆動時間の約７割に相当する。即ち、１フレームにおいて、実際に映像を表示する維持期間は３割以下しかないことになる。
【００２１】
近時、ＰＤＰにおいては、より一層の高精細化及び階調数の増加が望まれている。しかし、ＰＤＰを高精細化すると走査ライン数が増加し、階調数を増加させると１フィールドを構成するサブフィールド数が増加し、いずれの場合も総走査時間を増加させる。１フィールド中における走査期間が占める割合が増加すると、その分維持期間が占める割合が減少し、画像の輝度が低下してしまう。従って、ＰＤＰの高精細化及び階調数の増加を図るためには、１ライン当たりの走査時間を短縮して、１フィールド中における走査期間が占める割合の増加を抑え、維持期間を確保する必要がある。
【００２２】
しかしながら、１ライン当たりの走査時間を短縮すると、正常な映像表示が可能になる維持パルスＶｓの電圧（以下、維持電圧ともいう）の設定範囲が狭くなってしまい、顕著な場合には画面がチラつくという問題点がある。以下、この問題点について説明する。
【００２３】
図１２は、横軸に走査周期、即ち、１ライン当たりの走査時間をとり、縦軸に維持電圧をとって、維持放電を安定して発生させるために必要な最小の維持電圧（Ｖｓｍｉｎ）及び非選択セルが誤点灯しない最大の維持電圧（Ｖｓｍａｘ）の走査周期依存性を示すグラフ図である。図１２において、最小維持電圧Ｖｓｍｉｎと最大維持電圧Ｖｓｍａｘとで囲まれた電圧範囲が、正常な映像表示が可能となる維持電圧の正常動作範囲３３である。なお、測定に使用したＰＤＰはパネルサイズが５０インチのＰＤＰである。ＰＤＰの駆動は、図９に示す従来の駆動方法により行った。図１２に示すように、走査周期の短縮に伴って最小維持電圧Ｖｓｍｉｎが上昇し、走査周期が１μｓでは、最小維持電圧Ｖｓｍｉｎが最大維持電圧Ｖｓｍａｘより大きくなっている。即ち、走査周期を１μｓとすると、ＰＤＰを正常に駆動することが不可能になる。
【００２４】
以下、この理由について説明する。図１３（ａ）及び（ｂ）は走査パルス印加後に壁電荷が形成される挙動を示す模式図であり、（ａ）は走査周期が十分に長い場合を示し、（ｂ）は走査周期が短い場合を示す。図１３（ａ）に示すように、走査電極Ｓに走査パルスＶｗを印加してから、発光Ｆが起こるまでには、一定期間３１を必要とする。そして、発光Ｆが起こると、セル内の放電ガスが電離し、セル内に電子及びイオンが発生する。走査電極Ｓに走査パルスＶｗを印加している期間における発光Ｆが起こった後の期間が壁電荷引寄期間３２である。この壁電荷引寄期間３２において、セル内に印加されている電界によって、発光Ｆにより生じたイオンが走査電極Ｓ上に引き寄せられ、発光Ｆにより生じた電子が共通電極Ｃ上及びデータ電極Ｄ上に引き寄せられ、走査電極Ｓ上に正の壁電荷を形成し、共通電極Ｃ上及びデータ電極Ｄ上に負の壁電荷を形成する。
【００２５】
しかしながら、図１３（ｂ）に示すように、走査周期、即ち、走査電極Ｓに走査パルスＶｗを印加する期間が短いと、壁電荷引寄期間３２が短くなってしまう。このため、セル内に生じたイオン及び電子が十分に各電極上に引き付けられなくなり、壁電荷の形成が不十分となる。なお、書込放電後に走査電極Ｓに印加される走査ベースパルスＶｂｗによる電界も、電子及びイオンを各電極上に移動させ、壁電荷を形成する働きをする。このため、走査期間２２の初期に書込放電が起こるセルにおいては、走査パルスＶｗによる壁電荷形成が不十分であっても、その後の走査期間において走査ベースパルスＶｂｗによりある程度壁電荷が形成される。しかし、走査期間の末期に書込放電が起こるセル、即ち、最終行付近のセルにおいては、走査パルスＶｗによる壁電荷形成が不十分であると、その後の走査期間において走査ベースパルスＶｂｗが印加される時間が短いため、走査ベースパルスＶｂｗによる壁電荷の形成がほとんど起こらず、前述の問題点がより顕著に発生する。
【００２６】
この問題点を解決するために、特開２０００−２０６９３３号公報には、高い電圧で書込放電を発生させる技術が開示されている。この技術においては、サブフィールドを予備放電期間、走査期間、変換期間及び維持期間により構成する。そして、予備放電期間の終わりに対向間に壁電荷を形成する。次に、走査期間において非点灯画素のデータ電極にデータパルスを印加し、点灯画素のデータ電極にはデータパルスを印加しない。これにより、非点灯画素には相対的に大きな壁電荷が形成され、点灯画素には相対的に小さな壁電荷が形成される。その後、変換期間において非点灯画素のみにおいて放電を発生させ、壁電荷を消滅させる。この結果、維持期間において、非点灯画素では維持放電が発生せず、点灯画素のみで維持放電が発生する。この技術によれば、高い電圧により書込放電を発生させることができるため、書込放電後に壁電荷を効率的に形成することができ、走査時間を短縮することができる。
【００２７】
【発明が解決しようとする課題】
しかしながら、特開２０００−２０６９３３号公報に開示された技術には以下に示す問題点がある。この駆動方法においては、走査期間及び変換期間において、非点灯画素で放電を発生させている。このため、この放電により非放電画素が発光してしまい、黒表示時の輝度（黒輝度）が増加してしまうという問題点がある。
【００２８】
本発明はかかる問題点に鑑みてなされたものであって、維持放電の設定範囲を広く確保してチラつきを発生させず、且つ黒輝度を増加させることなく走査期間を短縮することができる交流面放電型プラズマディスプレイパネル及びその駆動方法を提供することを目的とする。
【００２９】
【課題を解決するための手段】
本発明に係る交流面放電型プラズマディスプレイパネルの駆動方法は、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に、その時間幅が３乃至５０μｓであり３電極間における電位の相対的な関係により決まる電界の向きが前記走査期間における前記書込放電時の電界の向きと同じである壁電荷形成パルスを、全ての前記画素において放電を発生させないように印加することにより前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有することを特徴とする。
【００３０】
本発明においては、走査期間と維持期間との間に壁電荷形成期間を設け、この壁電荷形成期間において、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に壁電荷形成パルスを印加することにより、画素内に３電極間における電位の相対的な関係により決まる電界を発生させる。この電界の向きは走査期間における書込放電時の電界の向きと同じである。なお、電界の向きとは、画素内の電界が例えば走査電極側がデータ電極側に対して正極性であり、データ電極側が走査電極側に対して負極性であることをいい、電界の方向を指すものではない。走査期間においては、書込放電により前記画素内において放電ガスが電離し、画素内にイオン及び電子が発生する。書込放電後に前記電界を印加することにより、前記イオン及び電子を各電極上に引き寄せ、セル内に壁電荷を形成することができる。これにより、走査パルスの時間幅が短く、走査パルスの印加時間内に十分な壁電荷を形成できない場合においても、壁電荷形成期間中に壁電荷を形成することができ、維持期間において維持放電を発生させやすくなる。このため、画面にチラつきを発生させることなく、走査パルスを短縮することができる。この結果、黒輝度を上昇させることなく走査期間を短縮化して維持期間を確保することができ、輝度の向上、走査ライン増加及び表示階調数の増加を図ることができる。
【００３１】
また、壁電荷形成パルスの時間幅を３μｓ以上とすることにより、維持パルスの電圧設定範囲が広くなり、ＰＤＰの安定駆動がより一層容易になる。一方、壁電荷形成パルスの時間幅を５０μｓ以下とすることにより、壁電荷形成パルスの効果が飽和することを防ぎ、壁電荷形成期間において、効率良く壁電荷を形成することができる。
【００３２】
更に、前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極又は前記共通電極に負極性の壁電荷形成パルスを印加してもよい。これにより、前記壁電荷形成期間において、書込放電時とほぼ同じ方向の電界を画素内に印加することができ、走査電極領域に正の壁電荷を形成し、共通電極領域及びデータ電極領域に負の壁電荷を形成することができる。
【００３３】
更にまた、前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極に負極性の壁電荷形成パルスを印加すると共に前記データ電極に正極性の壁電荷形成パルスを印加してもよい。これにより、走査電極領域に正の壁電荷を形成し、共通電極領域に負の壁電荷を形成すると共に、データ電極領域にも大きな負の壁電荷を形成することができる。これにより、維持放電において面放電の他に対向放電も発生させることができ、維持放電の発生をより安定化することができる。
【００３４】
更にまた、前記データ電極に印加する正極性の壁電荷形成パルスの電位を、前記走査期間におけるデータパルスの電位と等しくしてもよい。これにより、駆動波形を簡略化することができる。
【００３５】
更にまた、前記走査期間における前記走査電極に前記走査パルスが印加されていない期間において、大きさが対向放電開始電圧から前記データパルスを減じた値未満である負極性の走査ベースパルスを前記走査電極に印加することが好ましい。これにより、走査パルスの振幅を低減することができ、ＰＤＰの低コスト化を図ることができる。
【００３６】
更にまた、前記壁電荷形成パルスは、前記走査ベースパルスを時間的に延長したものであってもよい。これにより、駆動波形の簡略化を図ることができる。
本発明に係る他の交流面放電型プラズマディスプレイパネルの駆動方法は、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査パルスと同電位の壁電荷形成パルスを印加すると共に、前記共通電極及び前記データ電極に接地電位を印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有することを特徴とする。
本発明に係る更に他の交流面放電型プラズマディスプレイパネルの駆動方法は、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、全ての前記走査電極に走査ベースパルスを印加しつつ前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査ベースパルスと同電位の壁電荷形成パルスを印加し、前記共通電極に接地電位を印加すると共に、前記データ電極に前記データパルスと同電位の壁電荷形成パルスを印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有し、走査ベースパルスの大きさが対向放電開始電圧から前記データパルスを減じた値未満であることを特徴とする。
本発明に係る交流面放電型プラズマディスプレイパネルは、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に、その時間幅が３乃至５０μｓであり３電極間における電位の相対的な関係により決まる電界の向きが前記走査期間における前記書込放電時の電界の向きと同じである壁電荷形成パルスを、全ての前記画素において放電を発生させないように印加することにより前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前 記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されていることを特徴とする。
本発明に係る他の交流面放電型プラズマディスプレイパネルは、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査パルスと同電位の壁電荷形成パルスを印加すると共に、前記共通電極及び前記データ電極に接地電位を印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されていることを特徴とする交流面放電型プラズマディスプレイパネル。
本発明に係る更に他の交流面放電型プラズマディスプレイパネルは、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、全ての前記走査電極に走査ベースパルスを印加しつつ前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査ベースパルスと同電位の壁電荷形成パルスを印加し、前記共通電極に接地電位を印加すると共に、前記データ電極に前記データパルスと同電位の壁電荷形成パルスを印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されており、走査ベースパルスの大きさが対向放電開始電圧から前記データパルスを減じた値未満であることを特徴とする交流面放電型プラズマディスプレイパネル。
【００３７】
【発明の実施の形態】
以下、本発明の実施例について添付の図面を参照して具体的に説明する。先ず、本発明の第１の実施例について説明する。本実施例において駆動させるＰＤＰの構成は図６に示す従来のＰＤＰの構成と同じである。図１は本実施例に係るＰＤＰの駆動方法を示す１サブフィールドの駆動波形図であり、図２は図１に示す駆動方法により壁電荷形成期間においてセル内に形成される壁電荷配置を示す模式図である。なお、図２においては、正の壁電荷を「＋」を円で囲んだ記号で示し、負の壁電荷を「−」を円で囲んだ記号で示す。後述する図４（ａ）及び（ｂ）においても同様である。
【００３８】
図１に示すように、本実施例に係るＰＤＰの駆動方法は、表示セルの選択を行う走査期間２２と実際に映像表示を行う維持期間２３とを具備する交流型の駆動方式である。そして、走査期間２２の直後に壁電荷形成期間２４が設けられている。即ち、サブフィールドにおいて、リセット期間２１、走査期間２２、壁電荷形成期間２４及び維持期間２３がこの順に設けられている。
【００３９】
本実施例のＰＤＰの駆動方法におけるリセット期間２１及び走査期間２２の駆動方法は前述の図９、図１０（ａ）乃至（ｃ）、図１１（ａ）及び（ｂ）に示す従来の駆動方法と同様である。即ち、リセット期間２１において、走査電極Ｓに正極性プライミングパルスＶｐ＋を印加すると共に、共通電極Ｃに負極性プライミングパルスＶｐ−を印加して、面間にプライミング放電（予備放電）を発生させる。これにより、走査電極Ｓ上に負の壁電荷を形成し、共通電極Ｃ上に正の壁電荷を形成する。次いで、共通電極Ｃの電位を接地電位として、走査電極Ｓに接地電位から連続的に低下する鋸歯状波の負極性のプライミング消去パルスＶｐｅを印加する。これにより、面間に弱放電（プライミング消去放電）を発生させ、プライミング放電により形成された壁電荷を消去する。これにより、各セル内の壁電荷の状態をリセットする。
【００４０】
次に、走査期間２２において、各走査電極Ｓ１〜Ｓｎに負極性の走査パルスＶｗを順次印加し、この走査パルスＶｗに同期して、表示データに基づいてデータ電極Ｄに正極性のデータパルスＶｄを選択的に印加する。これにより、表示データに基づいて選択されたセル内において、書込放電を発生させる。このとき、走査周期、即ち、各走査電極Ｓに走査パルスＶｗを印加する時間幅は従来よりも短くする。このため、この書込放電が発生したセル内にはイオン及び電子が発生するが、このイオン及び電子は十分に走査電極Ｓ上並びに共通電極Ｃ上及びデータ電極Ｄ上には引き付けられていない。従って、セル内には十分な壁電荷が形成されていない。
【００４１】
次に、壁電荷形成期間２４において、共通電極Ｃ及びデータ電極Ｄの電位を接地電位とし、全ての走査電極Ｓに走査パルスＶｗと同電位の壁電荷形成パルスＶｗｍを印加する。壁電荷形成パルスＶｗｍの時間幅は、例えば３乃至５０μｓとする。これにより、各セル内において、走査期間２２においてデータパルスＶｄが印加されたセル内に発生した電界とほぼ同じ方向の電界が発生する。このとき、選択セル及び非選択セルの双方において放電は発生しない。しかしながら、前記電界が印加された結果、走査期間２２において書込放電が発生したセル内、特に、走査の最終行付近のセル内には、イオン及び電子が多く残留しているため、図２の状態Ａ１１に示すように、走査電極Ｓ上に正電荷を持つイオンが引き寄せられ、共通電極Ｃ上及びデータ電極Ｄ上に負電荷を持つ電子が引き寄せられる。この結果、図２の状態Ａ１２に示すように、走査電極Ｓ上に負の壁電荷が形成され、共通電極Ｃ上及びデータ電極Ｄ上に正の壁電荷が形成される。即ち、壁電荷形成パルスＶｗｍはこれらの空間電荷を各電極上の誘電体表面に引き寄せる役割を果たす。これにより、走査周期を短縮し、走査期間２２における壁電荷の形成が不十分である場合においても、壁電荷形成期間２４において壁電荷の形成を補うことができる。
【００４２】
次に、維持期間２３に移行する。維持期間２３における駆動方法は、図９に示す従来の駆動方法と同一である。即ち、先ず、走査電極Ｓの電位を接地電位とし、共通電極Ｃに負極性の維持パルスＶｓを印加する。これにより、走査期間２２において書込放電が発生したセルにおいては、壁電荷による壁電圧に維持電圧Ｖｓを重畳させて、面間で１回目の維持放電が生じる。走査期間２２において書込放電が発生していないセルにおいては、維持放電は発生しない。次に、走査電極Ｓに負極性の維持パルスＶｓを印加し、共通電極Ｃに接地電位を印加することにより、１回目の維持放電が発生したセルにおいて、２回目の維持放電が発生する。このように、維持パルスを繰り返し印加することによって、走査期間２２において選択されたセルのみを発光させる。各セルにおいて、発光させるサブフィールドを選択して組み合わせることにより、所望の表示を実現する。
【００４３】
本実施例においては、走査期間２２と維持期間２３との間に壁電荷形成期間２４を設け、この壁電荷形成期間２４において、走査電極Ｓに壁電荷形成パルスＶｗｍを印加することにより、走査期間２２の直後に走査パルスＶｗ及びデータパルスＶｄにより印加される電界とほぼ同方向の電界を印加することができる。これにより、書込放電に伴って生成したセル内の電子及びイオンを各電極上に引き寄せ、壁電荷の生成量を増やすことができる。
【００４４】
この結果、走査時間を短縮しても壁電荷が十分に形成されるようになり、維持放電の設定範囲を広く確保することができる。このため、選択セルにおいて維持放電が安定して発生すると共に非選択セルにおいて誤放電が起こらず、チラつきが無い良好な表示画像を実現することができる。また、走査期間２２、壁電荷形成期間２４及び維持期間２３において、非選択セルが発光することがないため、黒輝度を低く抑えることができる。そして、走査時間を短縮することにより、維持期間を十分に確保することができ、画面の輝度を向上させることができる。また、画面の輝度を維持したまま、ＰＤＰの高精細化及び多階調化を図ることができる。
【００４５】
なお、本実施例においては、壁電荷形成パルスＶｗｍを走査電極Ｓに印加したが、発生する電界の方向が書込放電時の電界とほぼ同じ方向であれば、共通電極Ｃに壁電荷形成パルスを印加してもよい。また、壁電荷形成パルスＶｗｍの電圧は高いほど大きな壁電荷形成効果が得られるが、誤放電によってＶｓｍａｘが著しく低下しない程度であればいかなる電圧でもよく、例えば、最終行の走査電極Ｓに走査パルスＶｗを印加した後に印加する走査ベースパルスＶｂｗの印加時間を伸ばして、壁電荷形成パルスとしてもよい。
【００４６】
また、壁電荷形成パルスＶｗｍの時間幅は３μｓ以上であれば、最小維持電圧Ｖｓｍｉｎが最大維持電圧Ｖｓｍａｘよりも低くなり、ＰＤＰの安定駆動が容易になる。一方、壁電荷形成パルスＶｗｍの時間幅を５０μｓよりも大きくしても、その効果が飽和する。この維持電圧の壁電荷形成パルスの時間幅依存性は、セル構造並びに放電ガスの種類及び圧力等によって異なるが、駆動時間との関係からみても、壁電荷形成パルスＶｗｍの時間幅は３乃至５０μｓであることが好ましい。
【００４７】
次に、本発明の第２の実施例について説明する。図３は本第２実施例に係るＰＤＰの駆動方法を示す駆動波形図である。図４（ａ）及び（ｂ）は図３に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、（ａ）は壁電荷形成期間における壁電荷配置を示し、（ｂ）は維持期間における壁電荷配置を示す。本実施例においては、前述の第１の実施例において使用したＰＤＰと同じＰＤＰを使用する。また、本実施例に係るＰＤＰの駆動方法において、リセット期間２１及び走査期間２２における駆動方法は、前述の第１の実施例に係るＰＤＰの駆動方法におけるリセット期間２１及び走査期間２２の駆動方法と同じである。
【００４８】
本実施例の駆動方法では、図３に示すように、壁電荷形成期間２４において、共通電極Ｃの電位を接地電位とし、走査電極Ｓに負極性の壁電荷形成パルスＶｗｍ１を印加し、データ電極Ｄに正極性の壁電荷形成パルスＶｗｍ２を印加する。走査電極Ｓに印加する壁電荷形成パルスＶｗｍ１は、走査期間２２において走査電極Ｓに印加する走査ベースパルスＶｂｗを壁電荷形成期間２４の終了時点まで延長することにより構成する。壁電荷形成パルスＶｗｍ１の電位は走査ベースパルスＶｂｗの電位と等しく、壁電荷形成パルスＶｗｍ２の電位はデータパルスＶｄの電位と等しい。従って、壁電荷形成パルスＶｗｍ１及びＶｗｍ２を重畳しても対向放電開始電圧には達しない。壁電荷形成パルスＶｗｍ１及びＶｗｍ２の時間幅は、例えば、３乃至５０μｓとする。
【００４９】
これにより、図４（ａ）の状態Ａ１３に示すように、走査期間２２における書込放電によってセル内に発生したイオンが壁電荷形成パルスＶｗｍ１により走査電極Ｓに引き寄せられると共に、セル内に発生した電子が壁電荷形成パルスＶｗｍ２によりデータ電極Ｄに引き寄せられる。この結果、状態Ａ１４に示すように、走査電極Ｓ上に正の壁電荷が形成され、データ電極Ｄ上及び共通電極Ｃ上に負の壁電荷が形成される。このとき、本実施例においては、前述の第１の実施例における壁電荷形成期間の終了時点（図２の状態Ａ１２参照）と比較して、データ電極Ｄ上に負の壁電荷が多く形成されるようになる。
【００５０】
次に、維持期間２３において、先ず、データ電極Ｄ及び共通電極Ｃの電位を接地電位とし、走査電極Ｓに正極性の維持パルスＶｓを印加する。このように、本実施例においては、維持パルスＶｓの極性を走査パルスＶｗに対して逆の極性としている。走査期間２２において書込放電が発生したセルにおいては、図４（ｂ）の状態Ａ１５に示すように、走査電極Ｓ上の正壁電荷及び共通電極Ｃ上の負壁電荷に起因する壁電圧に、走査電極Ｓに印加された正極性の維持パルスＶｓが重畳され、面放電が発生する。このとき、データ電極Ｄ上にも負の壁電荷が多く形成されているため、走査電極Ｓ上の正壁電荷及びデータ電極Ｄ上の負壁電荷に起因する壁電圧に、走査電極Ｓに印加された正極性の維持パルスＶｓが重畳され、対向放電も発生する。この面放電及び対向放電が第１回目の維持放電になる。この結果、図４（ｂ）の状態Ａ１６に示すように、走査電極Ｓ上には負の壁電荷が形成され、共通電極Ｃ上及びデータ電極Ｄ上には正の壁電荷が形成される。
【００５１】
次に、走査電極Ｓの電位を接地電位とし、共通電極Ｃに正の維持パルスＶｓを印加する。これにより、第１回目の維持放電が発生したセルにおいては、図４（ｂ）の状態Ａ１６に示す壁電荷に維持パルスＶｓが重畳され、第２回目の維持放電が発生する。以後同様に、走査電極Ｓ及び共通電極Ｃに正の維持パルスＶｓを交互に印加することにより、走査期間２２において書込放電を発生させたセルにおいて、維持放電が持続する。
【００５２】
本第２実施例においては、壁電荷形成期間２４において、データ電極Ｄに正極性の壁電荷形成パルスＶｗｍ２を印加することにより、維持期間２３の第１回目の維持放電において走査電極Ｓに正極性の維持パルスＶｓが印加されると、面放電の他に対向放電が発生し易くなり、維持放電の放電確率が上昇する。その結果、よりチラつきが少ない良好な画像表示が得られる。
【００５３】
前述の第１及び第２実施例においては、ＰＤＰの駆動波形を正極性のパルス及び負極性のパルスを組み合わせて構成したが、本発明においては、ＰＤＰの駆動波形を正極性のパルスのみ又は負極性のパルスのみによって構成してもよい。また、その場合は壁電荷形成パルスＶｗｍのＧＮＤに対する極性も併せて変化する。
【００５４】
【実施例】
以下、本発明の実施例の効果について、その特許請求の範囲から外れる比較例と比較して具体的に説明する。大きさが５０インチのＰＤＰを使用し、このＰＤＰを図１に示す駆動波形により駆動した。このとき、走査周期を１μｓとし、壁電荷形成パルスＶｗｍの時間幅を変化させ、選択セルに安定した維持放電を発生させるために必要な最小の維持電圧（Ｖｓｍｉｎ）と、非選択セルが誤点灯しない最大の維持電圧（Ｖｓｍａｘ）を測定した。図５は横軸に壁電荷形成パルスＶｗｍの時間幅をとり、縦軸に維持パルスＶｓの電圧をとって、維持電圧の設定範囲に及ぼす壁電荷形成パルスＶｗｍの時間幅の影響を示すグラフ図である。
【００５５】
図５に示すように、壁電荷形成パルスＶｗｍの時間幅が０の場合、即ち、従来の駆動方法と同様に、走査電極Ｓに壁電荷形成パルスＶｗｍが印加されない場合においては、最小維持電圧Ｖｓｍｉｎが著しく上昇し、最大維持電圧Ｖｓｍａｘよりも高くなった。これは、走査周期が１μｓであるため、図１３（ｂ）に示すように、書込放電（発光Ｆ）が走査パルスＶｗの終了間際で発生し、十分に壁電荷が形成されなかったためである。
【００５６】
これに対して、壁電荷形成パルスＶｗｍの時間幅を長くしていくと、最小維持電圧Ｖｓｍｉｎが低下し、正常動作範囲３０が広がった。これは、壁電荷形成パルスＶｗｍによって走査の最終行付近のセルで発生するチラつきが改善された結果である。特に、壁電荷形成パルスＶｗｍの時間幅を３μｓ以上とすると、最小維持電圧Ｖｓｍｉｎが確実に最大維持電圧Ｖｓｍａｘよりも低くなり、ＰＤＰの安定駆動が容易になった。一方、壁電荷形成パルスの時間幅を長くする程、最小維持電圧Ｖｓｍｉｎは低下したが、壁電荷形成パルスの時間幅が約５０μｓになるとその効果が飽和した。これは、壁電荷形成パルスの幅が５０μｓになると、放電空間内の空間電荷の大部分が各電極上に引き寄せられてしまい、空間電荷が減少することによるものと考えられる。この維持電圧の壁電荷形成パルスの時間幅依存性は、セル構造及び放電ガス等によって異なるが、駆動時間の関係からみても、壁電荷形成パルスの時間幅は３乃至５０μｓの範囲で設定することが望ましい。
【００５７】
【発明の効果】
以上詳述したように、本発明によれば、書込放電後の壁電荷量を増加させることができ、書込期間から維持期間へ安定して遷移させることが可能となる。これにより、従来の駆動において、走査周期を短く設定した場合に発生する書込時の壁電荷形成不足による最終行付近のチラつきを改善し、良好な画像を得ることができる。この結果、黒輝度を増加させることなく走査周期を短縮することができ、この短縮による空き時間を維持パルス数、サブフィールド数及び走査ラインの増加に当てることができるようになる。これにより、ＰＤＰの輝度の向上、階調数の向上及び画質の向上を図ることが可能となる。
【図面の簡単な説明】
【図１】本発明の第１の実施例に係るＰＤＰの駆動方法を示す１サブフィールドの駆動波形図である。
【図２】図１に示す駆動方法により壁電荷形成期間においてセル内に形成される壁電荷配置を示す模式図である。
【図３】本発明の第２の実施例に係るＰＤＰの駆動方法を示す駆動波形図である。
【図４】（ａ）及び（ｂ）は図３に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、（ａ）は壁電荷形成期間における壁電荷配置を示し、（ｂ）は維持期間における壁電荷配置を示す。
【図５】横軸に壁電荷形成パルスＶｗｍの時間幅をとり、縦軸に維持パルスＶｓの電圧をとって、維持電圧の設定範囲に及ぼす壁電荷形成パルスＶｗｍの時間幅の影響を示すグラフ図である。
【図６】３電極面放電交流型プラズマディスプレイパネル（ＰＤＰ）における１つの表示セルの構成を示す斜視図である。
【図７】図６に示すＰＤＰの電極配置を示す模式的平面図である。
【図８】従来のＰＤＰの駆動方法における１フィールドの構成を示すタイミングチャートである。
【図９】従来の各サブフィールドの駆動方法を示す駆動波形図である。
【図１０】（ａ）乃至（ｃ）は図９に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、（ａ）及び（ｂ）はリセット期間における壁電荷配置を示し、（ｃ）は走査期間における壁電荷配置を示す。
【図１１】（ａ）及び（ｂ）は図９に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、維持期間における壁電荷配置を示す。
【図１２】横軸に走査周期をとり、縦軸に維持電圧をとって、維持放電を安定して発生させるために必要な最小の維持電圧（Ｖｓｍｉｎ）及び非選択セルが誤点灯しない最大の維持電圧（Ｖｓｍａｘ）の走査周期依存性を示すグラフ図である。
【図１３】（ａ）及び（ｂ）は走査パルス印加後に壁電荷が形成される挙動を示す模式図であり、（ａ）は走査周期が十分に長い場合を示し、（ｂ）は走査周期が短い場合を示す。
【符号の説明】
１，２；絶縁基板
３；走査電極
４；共通電極
５、６；トレース電極
７；データ電極
８；放電ガス空間
９；隔壁
１０；可視光
１１；蛍光体
１２、１４；誘電体
１３；保護層
１５；セル
２０；フィールド
２１；リセット期間
２２；走査期間
２３；維持期間
２４；壁電荷形成期間
３０、３３；正常動作範囲
３１；走査パルスＶｗを印加してから発光Ｆが起こるまでの期間
３２；壁電荷引寄期間
Ａ１〜Ａ１６；状態
Ｓ、Ｓ１〜Ｓｎ；走査電極
Ｃ、Ｃ１〜Ｃｎ；共通電極
Ｄ、Ｄ１〜Ｄｍ；データ電極
Ｆ；発光
Ｖｐ＋；正極性プライミングパルス
Ｖｐ−；負極性プライミングパルス
Ｖｐｅ；プライミング消去パルス
Ｖｂｗ；走査ベースパルス
Ｖｗ；走査パルス
Ｖｄ；データパルス
Ｖｗｍ、Ｖｗｍ１、Ｖｗｍ２；壁電荷形成パルス
Ｖｓ；維持パルス
Ｖｓｍｉｎ；最小維持電圧
Ｖｓｍａｘ；最大維持電圧
【発明の属する技術分野】
本発明は、走査期間の短縮を図った交流面放電型プラズマディスプレイパネル及びその駆動方法に関する。
【０００２】
【従来の技術】
プラズマディスプレイパネルには、電極を放電ガスが充填された放電空間に露出させ、前記電極間に直流放電を発生させることにより動作させる直流放電型と、電極を誘電体層により被覆して放電ガスには直接露出させず、交流放電の状態で動作させる交流放電型がある。交流放電型プラズマディスプレイパネルには、１セル内の電極数が２であるものと３であるものとがある。以下、従来の３電極面放電交流型プラズマディスプレイパネル（以下、ＰＤＰという）の構造及び駆動方法について説明する。
【０００３】
図６は、３電極面放電交流型プラズマディスプレイパネル（ＰＤＰ）における１つの表示セルの構成を示す斜視図である。図６に示すように、この表示セルにおいては、ガラス等の透明材料よりなる背面基板である絶縁基板１及び前面基板である絶縁基板２が相互に平行に設けられている。絶縁基板２における絶縁基板１に対向する表面には、複数本の透明な走査電極３及び共通電極４が所定の間隔を隔てて交互に配置されている。走査電極上３及び共通電極４上には、電極の電極抵抗値を小さくするために、夫々トレース電極５及び６が形成されている。また、走査電極３、共通電極４、トレース電極５及び６を覆うように、誘電膜１２が形成され、誘電膜１２上にはこの誘電膜１２を放電から保護する酸化マグネシウム等からなる保護層１３が形成されている。
【０００４】
また、絶縁基板１における絶縁基板２に対向する表面には、走査電極３及び共通電極４に直交する方向に延びる複数本のデータ電極７が設けられている。データ電極７上には、このデータ電極７を覆うように誘電膜１４が形成されている。
【０００５】
絶縁基板１及び２の間には、放電ガス空間８を確保すると共に表示セル（画素）を区画する隔壁９が設けられている。放電ガス空間８にはヘリウム、ネオン及びキセノン等の希ガス並びにこれらの希ガスの混合ガスからなる放電ガスが充填されている。また、誘電膜１４の表面及び隔壁９の側面には前記放電ガスの放電により発生する紫外線を吸収し可視光１０を発光する蛍光体１１が形成されている。
【０００６】
図７は図６に示すＰＤＰの電極配置を示す模式的平面図である。図７に示す符号Ｓ１〜Ｓｎはｎ本（ｎは自然数）の走査電極３（図６参照）を示し、符号Ｃ１〜Ｃｎはｎ本の共通電極４（図６参照）を示し、符号Ｄ１〜Ｄｍはｍ本（ｍは自然数）のデータ電極７（図６参照）を示す。図７に示すように、このＰＤＰにおいては、相互に平行に延びるｎ本の走査電極Ｓ及びｎ本の共通電極Ｃと、それらと直交する方向に延びるｍ本のデータ電極Ｄとが設けられており、データ電極Ｄにおける走査電極Ｓ及び共通電極Ｃとの最近接点を各１ヶ所含むように、発光するセル１５が形成されている。即ち、１つのセル１５には各１本の走査電極Ｓ、共通電極Ｃ及びデータ電極Ｄが貫通しており、セル１５はマトリクス状に配列されている。従って、ＰＤＰの画面全体のセル数は、（ｎ×ｍ）個となる。
【０００７】
次に、従来のＰＤＰの駆動方法について説明する。図８は従来のＰＤＰの駆動方法における１フィールドの構成を示すタイミングチャートである。図８に示す駆動方法はサブフィールド法と呼ばれる方法である。例えば、１／６０秒に１枚の割合で切り替わる画像を１フィールド２０で表示し、この１フィールド２０を８のサブフィールドＳＦ１乃至ＳＦ８により構成し、各サブフィールドにおける維持放電の回数を２のべき乗に比例する数として相互に異ならせる。例えば、ｋを一定の係数とするとき、サブフィールドＳＦ１乃至ＳＦ８における維持放電回数を夫々、２７ｋ＝１２８ｋ回、２６ｋ＝６４ｋ回、２５ｋ＝３２ｋ回、２４ｋ＝１６ｋ回、２３ｋ＝８ｋ回、２２ｋ＝４ｋ回、２１ｋ＝２ｋ回及び２０ｋ＝１ｋ回とする。そして、これらのサブフィールドＳＦ１乃至ＳＦ８の中から維持放電を発生させるサブフィールドを任意に選択して組み合わせることにより、各セルに２５６階調を表示させる。
【０００８】
図９は従来の各サブフィールドの駆動方法を示す駆動波形図であり、図１０（ａ）乃至（ｃ）並びに図１１（ａ）及び（ｂ）は図９に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、図１０（ａ）及び（ｂ）はリセット期間における壁電荷配置を示し、図１０（ｃ）は走査期間における壁電荷配置を示し、図１１（ａ）及び（ｂ）は維持期間における壁電荷配置を示す。図９に示すように、この駆動方法において各サブフィールドはリセット期間２１、走査期間２２、維持期間２３に分かれている。以下、サブフィールドを構成する各期間の動作について、図９、図１０（ａ）乃至（ｃ）並びに図１１（ａ）及び（ｂ）を参照して説明する。なお、図１０（ａ）乃至（ｃ）並びに図１１（ａ）及び（ｂ）において、正の壁電荷を「＋」を円で囲んだ記号で示し、負の壁電荷を「−」を円で囲んだ記号で示す。
【０００９】
リセット期間２１は前サブフィールド（図示せず）で生成された壁電荷を消去し、表示データをリセットする期間である。リセット期間２１においては、先ず、走査電極Ｓに正極性プライミングパルスＶｐ＋を印加すると共に、共通電極Ｃに負極性プライミングパルスＶｐ−を印加する。データ電極Ｄの電位は接地電位（ＧＮＤ）とする。正極性プライミングパルスＶｐ＋及び負極性プライミングパルスＶｐ−の合計電圧は、このＰＤＰの面放電開始電圧以上の電圧とする。これにより、図１０（ａ）の状態Ａ１に示すように、誘電体１２（図６参照）の表面上における走査電極Ｓ上に相当する領域（以下、走査電極Ｓ上という）と、誘電体１２の表面上における共通電極Ｃ上に相当する領域（以下、共通電極Ｃ上という）との間（以下、面間ともいう）にプライミング放電（予備放電）が発生する。プライミング放電後は、図１０（ａ）の状態Ａ２に示すように、走査電極Ｓ上に負の壁電荷が形成され、共通電極Ｃ上に正の壁電荷が形成される。プライミング放電後においては、セル内に形成される壁電荷は、各電極に印加されている電位を打ち消すように形成され、セル内の電界は一様になる。従って、各セルにおいてプライミング放電後に形成される壁電荷の状態は、前サブフィールドで生成された壁電荷の状態によらず、同一になる。
【００１０】
次に、データ電極Ｄの電位を接地電位に維持したまま、走査電極Ｓに鋸歯状波の負極性のプライミング消去パルスＶｐｅを印加すると共に、共通電極Ｃの電位を接地電位とする。プライミング消去パルスＶｐｅは、電位が接地電位から連続的に低下するパルスであり。これにより、面間の電位差が連続的に増大し、図１０（ｂ）の状態Ａ３に示すように、面間で弱放電（プライミング消去放電）が発生する。なお、弱放電とは、放電ギャップ間の電圧をほぼ放電開始電圧に保ちながら持続する弱い放電をいう。これにより、状態Ａ４に示すように、前述のプライミング放電により形成された壁電荷（図１０（ａ）参照）が消去される。これにより、各セル内の壁電荷の状態がリセットされる。
【００１１】
走査期間２２においては、共通電極Ｃの電位を接地電位に保ったまま、各走査電極Ｓ１〜Ｓｎに負極性の走査パルスＶｗを順次印加する。また、走査期間２２における走査電極Ｓに走査パルスＶｗを印加しない期間は、走査電極Ｓに負極性の一定電圧である走査ベースパルスＶｂｗを印加する。走査電極Ｓに走査ベースパルスＶｂｗを印加することにより、走査パルスＶｗの振幅を低減し、走査パルスＶｗを印加する駆動ＩＣの使用電圧を引き下げることができる。これにより、ＰＤＰの低コスト化を図ることができる。
【００１２】
そして、この走査パルスＶｗに同期して、表示データに基づいてデータ電極Ｄに正極性のデータパルスＶｄを選択的に印加する。このとき、走査パルスＶｗ及びデータパルスＶｄの電圧は、単独では対向放電開始電圧未満であり、走査パルスＶｗがデータパルスＶｄに重畳されると対向放電開始電圧以上となるような電圧に設定する。また、走査ベースパルスＶｂｗは、データパルスＶｄに重畳されても、対向放電開始電圧未満の電圧になるような電圧に設定する。
【００１３】
これにより、図１０（ｃ）の状態Ａ５に示すように、表示データに基づいて選択されたセル内、即ち、走査パルスＶｗに同期してデータパルスＶｄが印加されたセル内のみで、書込放電を発生させることができる。この書込放電は、先ず走査電極上と誘電体１４（図６参照）の表面上におけるデータ電極Ｄ上に相当する領域（以下、データ電極Ｄ上という）との間（以下、対向間ともいう）において対向放電が発生する。続いて、この対向放電をトリガとして走査電極Ｓ上と共通電極Ｃ上との間（面間）で面放電が発生する。この面放電が発生するのは、前記対向放電に伴ってセル内に生成された電子、原子、準安定原子等の活性粒子が、面放電のしきい値電圧を引き下げるためである。この対向放電及び面放電を合わせて書込放電という。なお、書込放電が発生したセルを選択セルといい、書込放電が発生しなかったセルを非選択セルという。
【００１４】
また、前記書込放電における対向放電において、走査電極Ｓ上を負極性とすることにより、ＭｇＯからなる保護層１３（図６参照）に放電ガス中のプラスイオンが衝突して２次電子を放出する。この２次電子がセルに印加される電界により正極側へ移動し、放電ガスの分子に衝突することにより、この放電ガス分子をプラスイオンと電子とに電離する。これにより、セル内に更にプラスイオン及び電子を供給し、放電を持続させることができる。なお、蛍光体１１は、放電に伴って発生する紫外線が照射されることにより可視光１０を発光するが、ＭｇＯは紫外線を透過させないため、保護層１１は絶縁基板２の表面上、即ち、走査電極３及び共通電極４上に形成することが好ましい。
【００１５】
図１０（ｃ）の状態Ａ６に示すように、書込放電により、走査電極Ｓ上には正の壁電荷が形成され、共通電極Ｃ上及びデータ電極Ｄ上には負の壁電荷が形成される。この書込放電を発生させたセル（選択セル）が、後述する維持期間２３において点灯するセルとなる。なお、書込放電が発生していないセルにおいては、壁電荷配置は図１０（ｂ）の状態Ａ４に示す配置のままである。全ての走査電極Ｓに対して走査パルスＶｗの印加が終了すると、走査期間２２が終了し、次いで維持期間２３に移行する。
【００１６】
維持期間２３は、走査期間２２で選択されたセルのみを発光させて実際の映像表示を行う期間である。維持期間２３においては、データ電極Ｄの電位は常に接地電位とする。そして先ず、走査電極Ｓの電位を接地電位とし、共通電極Ｃに負極性の維持パルスＶｓを印加する。この維持パルスＶｓは、接地電位との電位差が面放電開始電圧よりも小さく、且つ、面放電開始電圧から前述の書込放電により生じた壁電荷（図１０（ｃ）の状態Ａ６参照）による電圧（壁電圧）を減じた電圧以上であるような電圧とする。
【００１７】
これにより、走査期間２２において書込放電が発生したセルでは、図１０（ｃ）の状態Ａ６に示すように、走査電極Ｓ上に正の壁電荷が形成され、共通電極Ｃ上に負の壁電荷が形成されているため、この壁電荷による壁電圧が維持電圧Ｖｓに重畳されて、面放電のしきい値（面放電開始電圧）を超える。この結果、図１１（ａ）の状態Ａ７に示すように、面間で１回目の維持放電が生じる。１回目の維持放電が生じると、図１１（ａ）の状態Ａ８に示すように、走査電極Ｓ上には負の壁電荷が形成され、共通電極Ｃ上には正の壁電荷が形成される。続いて、図１１（ｂ）の状態Ａ９に示すように、走査電極Ｓに負極性の維持パルスＶｓを印加し、共通電極Ｃに接地電位を印加する。これにより、前述の１回目の維持放電が発生したセルにおいては、１回目の維持放電により形成された壁電荷に走査電極に印加した維持パルスＶｓが重畳されて面放電開始電圧を超え、２回目の維持放電が発生する。この結果、図１１（９）の状態Ａ１０に示すように、走査電極Ｓ上には正の壁電荷が形成され、共通電極Ｃ上には負の壁電荷が形成される。以後同様に、ｘ回目の維持放電により形成された壁電荷が（ｘ＋１）回目の維持パルスＶｓに重畳され、（ｘ＋１）回目の維持放電が発生する。
【００１８】
一方、走査期間２２において書込放電が生じていないセルでは、図１０（ｂ）の状態Ａ４に示すように壁電荷が形成されていないため、維持パルスＶｓに壁電圧が重畳されず、１回目の維持放電が発生しない。従って、２回目以降の維持放電も発生しない。
【００１９】
このように、維持パルスを繰り返し印加することによって、走査期間２２において選択されたセルのみを発光させることができる。各セルにおいて、発光させるサブフィールドを選択して組み合わせることにより、所望の表示を実現することができる。
【００２０】
しかしながら、上述の従来の技術には以下に示すような問題点がある。上述の駆動方法では、１つのサブフィールドの走査期間は走査電極Ｓの数（ライン数）と書込時間（走査時間）との積だけ必要となり、例えば、走査電極のライン数が４８０本であり、１行当たりの走査時間が３μｓ（μ秒）である場合、１フィールドを８サブフィールドにより構成すると、総走査時間は１１．５ｍｓ（ｍ秒）を要する。これは、１フレームが１／６０秒である場合、総駆動時間の約７割に相当する。即ち、１フレームにおいて、実際に映像を表示する維持期間は３割以下しかないことになる。
【００２１】
近時、ＰＤＰにおいては、より一層の高精細化及び階調数の増加が望まれている。しかし、ＰＤＰを高精細化すると走査ライン数が増加し、階調数を増加させると１フィールドを構成するサブフィールド数が増加し、いずれの場合も総走査時間を増加させる。１フィールド中における走査期間が占める割合が増加すると、その分維持期間が占める割合が減少し、画像の輝度が低下してしまう。従って、ＰＤＰの高精細化及び階調数の増加を図るためには、１ライン当たりの走査時間を短縮して、１フィールド中における走査期間が占める割合の増加を抑え、維持期間を確保する必要がある。
【００２２】
しかしながら、１ライン当たりの走査時間を短縮すると、正常な映像表示が可能になる維持パルスＶｓの電圧（以下、維持電圧ともいう）の設定範囲が狭くなってしまい、顕著な場合には画面がチラつくという問題点がある。以下、この問題点について説明する。
【００２３】
図１２は、横軸に走査周期、即ち、１ライン当たりの走査時間をとり、縦軸に維持電圧をとって、維持放電を安定して発生させるために必要な最小の維持電圧（Ｖｓｍｉｎ）及び非選択セルが誤点灯しない最大の維持電圧（Ｖｓｍａｘ）の走査周期依存性を示すグラフ図である。図１２において、最小維持電圧Ｖｓｍｉｎと最大維持電圧Ｖｓｍａｘとで囲まれた電圧範囲が、正常な映像表示が可能となる維持電圧の正常動作範囲３３である。なお、測定に使用したＰＤＰはパネルサイズが５０インチのＰＤＰである。ＰＤＰの駆動は、図９に示す従来の駆動方法により行った。図１２に示すように、走査周期の短縮に伴って最小維持電圧Ｖｓｍｉｎが上昇し、走査周期が１μｓでは、最小維持電圧Ｖｓｍｉｎが最大維持電圧Ｖｓｍａｘより大きくなっている。即ち、走査周期を１μｓとすると、ＰＤＰを正常に駆動することが不可能になる。
【００２４】
以下、この理由について説明する。図１３（ａ）及び（ｂ）は走査パルス印加後に壁電荷が形成される挙動を示す模式図であり、（ａ）は走査周期が十分に長い場合を示し、（ｂ）は走査周期が短い場合を示す。図１３（ａ）に示すように、走査電極Ｓに走査パルスＶｗを印加してから、発光Ｆが起こるまでには、一定期間３１を必要とする。そして、発光Ｆが起こると、セル内の放電ガスが電離し、セル内に電子及びイオンが発生する。走査電極Ｓに走査パルスＶｗを印加している期間における発光Ｆが起こった後の期間が壁電荷引寄期間３２である。この壁電荷引寄期間３２において、セル内に印加されている電界によって、発光Ｆにより生じたイオンが走査電極Ｓ上に引き寄せられ、発光Ｆにより生じた電子が共通電極Ｃ上及びデータ電極Ｄ上に引き寄せられ、走査電極Ｓ上に正の壁電荷を形成し、共通電極Ｃ上及びデータ電極Ｄ上に負の壁電荷を形成する。
【００２５】
しかしながら、図１３（ｂ）に示すように、走査周期、即ち、走査電極Ｓに走査パルスＶｗを印加する期間が短いと、壁電荷引寄期間３２が短くなってしまう。このため、セル内に生じたイオン及び電子が十分に各電極上に引き付けられなくなり、壁電荷の形成が不十分となる。なお、書込放電後に走査電極Ｓに印加される走査ベースパルスＶｂｗによる電界も、電子及びイオンを各電極上に移動させ、壁電荷を形成する働きをする。このため、走査期間２２の初期に書込放電が起こるセルにおいては、走査パルスＶｗによる壁電荷形成が不十分であっても、その後の走査期間において走査ベースパルスＶｂｗによりある程度壁電荷が形成される。しかし、走査期間の末期に書込放電が起こるセル、即ち、最終行付近のセルにおいては、走査パルスＶｗによる壁電荷形成が不十分であると、その後の走査期間において走査ベースパルスＶｂｗが印加される時間が短いため、走査ベースパルスＶｂｗによる壁電荷の形成がほとんど起こらず、前述の問題点がより顕著に発生する。
【００２６】
この問題点を解決するために、特開２０００−２０６９３３号公報には、高い電圧で書込放電を発生させる技術が開示されている。この技術においては、サブフィールドを予備放電期間、走査期間、変換期間及び維持期間により構成する。そして、予備放電期間の終わりに対向間に壁電荷を形成する。次に、走査期間において非点灯画素のデータ電極にデータパルスを印加し、点灯画素のデータ電極にはデータパルスを印加しない。これにより、非点灯画素には相対的に大きな壁電荷が形成され、点灯画素には相対的に小さな壁電荷が形成される。その後、変換期間において非点灯画素のみにおいて放電を発生させ、壁電荷を消滅させる。この結果、維持期間において、非点灯画素では維持放電が発生せず、点灯画素のみで維持放電が発生する。この技術によれば、高い電圧により書込放電を発生させることができるため、書込放電後に壁電荷を効率的に形成することができ、走査時間を短縮することができる。
【００２７】
【発明が解決しようとする課題】
しかしながら、特開２０００−２０６９３３号公報に開示された技術には以下に示す問題点がある。この駆動方法においては、走査期間及び変換期間において、非点灯画素で放電を発生させている。このため、この放電により非放電画素が発光してしまい、黒表示時の輝度（黒輝度）が増加してしまうという問題点がある。
【００２８】
本発明はかかる問題点に鑑みてなされたものであって、維持放電の設定範囲を広く確保してチラつきを発生させず、且つ黒輝度を増加させることなく走査期間を短縮することができる交流面放電型プラズマディスプレイパネル及びその駆動方法を提供することを目的とする。
【００２９】
【課題を解決するための手段】
本発明に係る交流面放電型プラズマディスプレイパネルの駆動方法は、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に、その時間幅が３乃至５０μｓであり３電極間における電位の相対的な関係により決まる電界の向きが前記走査期間における前記書込放電時の電界の向きと同じである壁電荷形成パルスを、全ての前記画素において放電を発生させないように印加することにより前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有することを特徴とする。
【００３０】
本発明においては、走査期間と維持期間との間に壁電荷形成期間を設け、この壁電荷形成期間において、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に壁電荷形成パルスを印加することにより、画素内に３電極間における電位の相対的な関係により決まる電界を発生させる。この電界の向きは走査期間における書込放電時の電界の向きと同じである。なお、電界の向きとは、画素内の電界が例えば走査電極側がデータ電極側に対して正極性であり、データ電極側が走査電極側に対して負極性であることをいい、電界の方向を指すものではない。走査期間においては、書込放電により前記画素内において放電ガスが電離し、画素内にイオン及び電子が発生する。書込放電後に前記電界を印加することにより、前記イオン及び電子を各電極上に引き寄せ、セル内に壁電荷を形成することができる。これにより、走査パルスの時間幅が短く、走査パルスの印加時間内に十分な壁電荷を形成できない場合においても、壁電荷形成期間中に壁電荷を形成することができ、維持期間において維持放電を発生させやすくなる。このため、画面にチラつきを発生させることなく、走査パルスを短縮することができる。この結果、黒輝度を上昇させることなく走査期間を短縮化して維持期間を確保することができ、輝度の向上、走査ライン増加及び表示階調数の増加を図ることができる。
【００３１】
また、壁電荷形成パルスの時間幅を３μｓ以上とすることにより、維持パルスの電圧設定範囲が広くなり、ＰＤＰの安定駆動がより一層容易になる。一方、壁電荷形成パルスの時間幅を５０μｓ以下とすることにより、壁電荷形成パルスの効果が飽和することを防ぎ、壁電荷形成期間において、効率良く壁電荷を形成することができる。
【００３２】
更に、前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極又は前記共通電極に負極性の壁電荷形成パルスを印加してもよい。これにより、前記壁電荷形成期間において、書込放電時とほぼ同じ方向の電界を画素内に印加することができ、走査電極領域に正の壁電荷を形成し、共通電極領域及びデータ電極領域に負の壁電荷を形成することができる。
【００３３】
更にまた、前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極に負極性の壁電荷形成パルスを印加すると共に前記データ電極に正極性の壁電荷形成パルスを印加してもよい。これにより、走査電極領域に正の壁電荷を形成し、共通電極領域に負の壁電荷を形成すると共に、データ電極領域にも大きな負の壁電荷を形成することができる。これにより、維持放電において面放電の他に対向放電も発生させることができ、維持放電の発生をより安定化することができる。
【００３４】
更にまた、前記データ電極に印加する正極性の壁電荷形成パルスの電位を、前記走査期間におけるデータパルスの電位と等しくしてもよい。これにより、駆動波形を簡略化することができる。
【００３５】
更にまた、前記走査期間における前記走査電極に前記走査パルスが印加されていない期間において、大きさが対向放電開始電圧から前記データパルスを減じた値未満である負極性の走査ベースパルスを前記走査電極に印加することが好ましい。これにより、走査パルスの振幅を低減することができ、ＰＤＰの低コスト化を図ることができる。
【００３６】
更にまた、前記壁電荷形成パルスは、前記走査ベースパルスを時間的に延長したものであってもよい。これにより、駆動波形の簡略化を図ることができる。
本発明に係る他の交流面放電型プラズマディスプレイパネルの駆動方法は、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査パルスと同電位の壁電荷形成パルスを印加すると共に、前記共通電極及び前記データ電極に接地電位を印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有することを特徴とする。
本発明に係る更に他の交流面放電型プラズマディスプレイパネルの駆動方法は、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、全ての前記走査電極に走査ベースパルスを印加しつつ前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査ベースパルスと同電位の壁電荷形成パルスを印加し、前記共通電極に接地電位を印加すると共に、前記データ電極に前記データパルスと同電位の壁電荷形成パルスを印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有し、走査ベースパルスの大きさが対向放電開始電圧から前記データパルスを減じた値未満であることを特徴とする。
本発明に係る交流面放電型プラズマディスプレイパネルは、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に、その時間幅が３乃至５０μｓであり３電極間における電位の相対的な関係により決まる電界の向きが前記走査期間における前記書込放電時の電界の向きと同じである壁電荷形成パルスを、全ての前記画素において放電を発生させないように印加することにより前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前 記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されていることを特徴とする。
本発明に係る他の交流面放電型プラズマディスプレイパネルは、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査パルスと同電位の壁電荷形成パルスを印加すると共に、前記共通電極及び前記データ電極に接地電位を印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されていることを特徴とする交流面放電型プラズマディスプレイパネル。
本発明に係る更に他の交流面放電型プラズマディスプレイパネルは、対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、全ての前記走査電極に走査ベースパルスを印加しつつ前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査ベースパルスと同電位の壁電荷形成パルスを印加し、前記共通電極に接地電位を印加すると共に、前記データ電極に前記データパルスと同電位の壁電荷形成パルスを印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されており、走査ベースパルスの大きさが対向放電開始電圧から前記データパルスを減じた値未満であることを特徴とする交流面放電型プラズマディスプレイパネル。
【００３７】
【発明の実施の形態】
以下、本発明の実施例について添付の図面を参照して具体的に説明する。先ず、本発明の第１の実施例について説明する。本実施例において駆動させるＰＤＰの構成は図６に示す従来のＰＤＰの構成と同じである。図１は本実施例に係るＰＤＰの駆動方法を示す１サブフィールドの駆動波形図であり、図２は図１に示す駆動方法により壁電荷形成期間においてセル内に形成される壁電荷配置を示す模式図である。なお、図２においては、正の壁電荷を「＋」を円で囲んだ記号で示し、負の壁電荷を「−」を円で囲んだ記号で示す。後述する図４（ａ）及び（ｂ）においても同様である。
【００３８】
図１に示すように、本実施例に係るＰＤＰの駆動方法は、表示セルの選択を行う走査期間２２と実際に映像表示を行う維持期間２３とを具備する交流型の駆動方式である。そして、走査期間２２の直後に壁電荷形成期間２４が設けられている。即ち、サブフィールドにおいて、リセット期間２１、走査期間２２、壁電荷形成期間２４及び維持期間２３がこの順に設けられている。
【００３９】
本実施例のＰＤＰの駆動方法におけるリセット期間２１及び走査期間２２の駆動方法は前述の図９、図１０（ａ）乃至（ｃ）、図１１（ａ）及び（ｂ）に示す従来の駆動方法と同様である。即ち、リセット期間２１において、走査電極Ｓに正極性プライミングパルスＶｐ＋を印加すると共に、共通電極Ｃに負極性プライミングパルスＶｐ−を印加して、面間にプライミング放電（予備放電）を発生させる。これにより、走査電極Ｓ上に負の壁電荷を形成し、共通電極Ｃ上に正の壁電荷を形成する。次いで、共通電極Ｃの電位を接地電位として、走査電極Ｓに接地電位から連続的に低下する鋸歯状波の負極性のプライミング消去パルスＶｐｅを印加する。これにより、面間に弱放電（プライミング消去放電）を発生させ、プライミング放電により形成された壁電荷を消去する。これにより、各セル内の壁電荷の状態をリセットする。
【００４０】
次に、走査期間２２において、各走査電極Ｓ１〜Ｓｎに負極性の走査パルスＶｗを順次印加し、この走査パルスＶｗに同期して、表示データに基づいてデータ電極Ｄに正極性のデータパルスＶｄを選択的に印加する。これにより、表示データに基づいて選択されたセル内において、書込放電を発生させる。このとき、走査周期、即ち、各走査電極Ｓに走査パルスＶｗを印加する時間幅は従来よりも短くする。このため、この書込放電が発生したセル内にはイオン及び電子が発生するが、このイオン及び電子は十分に走査電極Ｓ上並びに共通電極Ｃ上及びデータ電極Ｄ上には引き付けられていない。従って、セル内には十分な壁電荷が形成されていない。
【００４１】
次に、壁電荷形成期間２４において、共通電極Ｃ及びデータ電極Ｄの電位を接地電位とし、全ての走査電極Ｓに走査パルスＶｗと同電位の壁電荷形成パルスＶｗｍを印加する。壁電荷形成パルスＶｗｍの時間幅は、例えば３乃至５０μｓとする。これにより、各セル内において、走査期間２２においてデータパルスＶｄが印加されたセル内に発生した電界とほぼ同じ方向の電界が発生する。このとき、選択セル及び非選択セルの双方において放電は発生しない。しかしながら、前記電界が印加された結果、走査期間２２において書込放電が発生したセル内、特に、走査の最終行付近のセル内には、イオン及び電子が多く残留しているため、図２の状態Ａ１１に示すように、走査電極Ｓ上に正電荷を持つイオンが引き寄せられ、共通電極Ｃ上及びデータ電極Ｄ上に負電荷を持つ電子が引き寄せられる。この結果、図２の状態Ａ１２に示すように、走査電極Ｓ上に負の壁電荷が形成され、共通電極Ｃ上及びデータ電極Ｄ上に正の壁電荷が形成される。即ち、壁電荷形成パルスＶｗｍはこれらの空間電荷を各電極上の誘電体表面に引き寄せる役割を果たす。これにより、走査周期を短縮し、走査期間２２における壁電荷の形成が不十分である場合においても、壁電荷形成期間２４において壁電荷の形成を補うことができる。
【００４２】
次に、維持期間２３に移行する。維持期間２３における駆動方法は、図９に示す従来の駆動方法と同一である。即ち、先ず、走査電極Ｓの電位を接地電位とし、共通電極Ｃに負極性の維持パルスＶｓを印加する。これにより、走査期間２２において書込放電が発生したセルにおいては、壁電荷による壁電圧に維持電圧Ｖｓを重畳させて、面間で１回目の維持放電が生じる。走査期間２２において書込放電が発生していないセルにおいては、維持放電は発生しない。次に、走査電極Ｓに負極性の維持パルスＶｓを印加し、共通電極Ｃに接地電位を印加することにより、１回目の維持放電が発生したセルにおいて、２回目の維持放電が発生する。このように、維持パルスを繰り返し印加することによって、走査期間２２において選択されたセルのみを発光させる。各セルにおいて、発光させるサブフィールドを選択して組み合わせることにより、所望の表示を実現する。
【００４３】
本実施例においては、走査期間２２と維持期間２３との間に壁電荷形成期間２４を設け、この壁電荷形成期間２４において、走査電極Ｓに壁電荷形成パルスＶｗｍを印加することにより、走査期間２２の直後に走査パルスＶｗ及びデータパルスＶｄにより印加される電界とほぼ同方向の電界を印加することができる。これにより、書込放電に伴って生成したセル内の電子及びイオンを各電極上に引き寄せ、壁電荷の生成量を増やすことができる。
【００４４】
この結果、走査時間を短縮しても壁電荷が十分に形成されるようになり、維持放電の設定範囲を広く確保することができる。このため、選択セルにおいて維持放電が安定して発生すると共に非選択セルにおいて誤放電が起こらず、チラつきが無い良好な表示画像を実現することができる。また、走査期間２２、壁電荷形成期間２４及び維持期間２３において、非選択セルが発光することがないため、黒輝度を低く抑えることができる。そして、走査時間を短縮することにより、維持期間を十分に確保することができ、画面の輝度を向上させることができる。また、画面の輝度を維持したまま、ＰＤＰの高精細化及び多階調化を図ることができる。
【００４５】
なお、本実施例においては、壁電荷形成パルスＶｗｍを走査電極Ｓに印加したが、発生する電界の方向が書込放電時の電界とほぼ同じ方向であれば、共通電極Ｃに壁電荷形成パルスを印加してもよい。また、壁電荷形成パルスＶｗｍの電圧は高いほど大きな壁電荷形成効果が得られるが、誤放電によってＶｓｍａｘが著しく低下しない程度であればいかなる電圧でもよく、例えば、最終行の走査電極Ｓに走査パルスＶｗを印加した後に印加する走査ベースパルスＶｂｗの印加時間を伸ばして、壁電荷形成パルスとしてもよい。
【００４６】
また、壁電荷形成パルスＶｗｍの時間幅は３μｓ以上であれば、最小維持電圧Ｖｓｍｉｎが最大維持電圧Ｖｓｍａｘよりも低くなり、ＰＤＰの安定駆動が容易になる。一方、壁電荷形成パルスＶｗｍの時間幅を５０μｓよりも大きくしても、その効果が飽和する。この維持電圧の壁電荷形成パルスの時間幅依存性は、セル構造並びに放電ガスの種類及び圧力等によって異なるが、駆動時間との関係からみても、壁電荷形成パルスＶｗｍの時間幅は３乃至５０μｓであることが好ましい。
【００４７】
次に、本発明の第２の実施例について説明する。図３は本第２実施例に係るＰＤＰの駆動方法を示す駆動波形図である。図４（ａ）及び（ｂ）は図３に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、（ａ）は壁電荷形成期間における壁電荷配置を示し、（ｂ）は維持期間における壁電荷配置を示す。本実施例においては、前述の第１の実施例において使用したＰＤＰと同じＰＤＰを使用する。また、本実施例に係るＰＤＰの駆動方法において、リセット期間２１及び走査期間２２における駆動方法は、前述の第１の実施例に係るＰＤＰの駆動方法におけるリセット期間２１及び走査期間２２の駆動方法と同じである。
【００４８】
本実施例の駆動方法では、図３に示すように、壁電荷形成期間２４において、共通電極Ｃの電位を接地電位とし、走査電極Ｓに負極性の壁電荷形成パルスＶｗｍ１を印加し、データ電極Ｄに正極性の壁電荷形成パルスＶｗｍ２を印加する。走査電極Ｓに印加する壁電荷形成パルスＶｗｍ１は、走査期間２２において走査電極Ｓに印加する走査ベースパルスＶｂｗを壁電荷形成期間２４の終了時点まで延長することにより構成する。壁電荷形成パルスＶｗｍ１の電位は走査ベースパルスＶｂｗの電位と等しく、壁電荷形成パルスＶｗｍ２の電位はデータパルスＶｄの電位と等しい。従って、壁電荷形成パルスＶｗｍ１及びＶｗｍ２を重畳しても対向放電開始電圧には達しない。壁電荷形成パルスＶｗｍ１及びＶｗｍ２の時間幅は、例えば、３乃至５０μｓとする。
【００４９】
これにより、図４（ａ）の状態Ａ１３に示すように、走査期間２２における書込放電によってセル内に発生したイオンが壁電荷形成パルスＶｗｍ１により走査電極Ｓに引き寄せられると共に、セル内に発生した電子が壁電荷形成パルスＶｗｍ２によりデータ電極Ｄに引き寄せられる。この結果、状態Ａ１４に示すように、走査電極Ｓ上に正の壁電荷が形成され、データ電極Ｄ上及び共通電極Ｃ上に負の壁電荷が形成される。このとき、本実施例においては、前述の第１の実施例における壁電荷形成期間の終了時点（図２の状態Ａ１２参照）と比較して、データ電極Ｄ上に負の壁電荷が多く形成されるようになる。
【００５０】
次に、維持期間２３において、先ず、データ電極Ｄ及び共通電極Ｃの電位を接地電位とし、走査電極Ｓに正極性の維持パルスＶｓを印加する。このように、本実施例においては、維持パルスＶｓの極性を走査パルスＶｗに対して逆の極性としている。走査期間２２において書込放電が発生したセルにおいては、図４（ｂ）の状態Ａ１５に示すように、走査電極Ｓ上の正壁電荷及び共通電極Ｃ上の負壁電荷に起因する壁電圧に、走査電極Ｓに印加された正極性の維持パルスＶｓが重畳され、面放電が発生する。このとき、データ電極Ｄ上にも負の壁電荷が多く形成されているため、走査電極Ｓ上の正壁電荷及びデータ電極Ｄ上の負壁電荷に起因する壁電圧に、走査電極Ｓに印加された正極性の維持パルスＶｓが重畳され、対向放電も発生する。この面放電及び対向放電が第１回目の維持放電になる。この結果、図４（ｂ）の状態Ａ１６に示すように、走査電極Ｓ上には負の壁電荷が形成され、共通電極Ｃ上及びデータ電極Ｄ上には正の壁電荷が形成される。
【００５１】
次に、走査電極Ｓの電位を接地電位とし、共通電極Ｃに正の維持パルスＶｓを印加する。これにより、第１回目の維持放電が発生したセルにおいては、図４（ｂ）の状態Ａ１６に示す壁電荷に維持パルスＶｓが重畳され、第２回目の維持放電が発生する。以後同様に、走査電極Ｓ及び共通電極Ｃに正の維持パルスＶｓを交互に印加することにより、走査期間２２において書込放電を発生させたセルにおいて、維持放電が持続する。
【００５２】
本第２実施例においては、壁電荷形成期間２４において、データ電極Ｄに正極性の壁電荷形成パルスＶｗｍ２を印加することにより、維持期間２３の第１回目の維持放電において走査電極Ｓに正極性の維持パルスＶｓが印加されると、面放電の他に対向放電が発生し易くなり、維持放電の放電確率が上昇する。その結果、よりチラつきが少ない良好な画像表示が得られる。
【００５３】
前述の第１及び第２実施例においては、ＰＤＰの駆動波形を正極性のパルス及び負極性のパルスを組み合わせて構成したが、本発明においては、ＰＤＰの駆動波形を正極性のパルスのみ又は負極性のパルスのみによって構成してもよい。また、その場合は壁電荷形成パルスＶｗｍのＧＮＤに対する極性も併せて変化する。
【００５４】
【実施例】
以下、本発明の実施例の効果について、その特許請求の範囲から外れる比較例と比較して具体的に説明する。大きさが５０インチのＰＤＰを使用し、このＰＤＰを図１に示す駆動波形により駆動した。このとき、走査周期を１μｓとし、壁電荷形成パルスＶｗｍの時間幅を変化させ、選択セルに安定した維持放電を発生させるために必要な最小の維持電圧（Ｖｓｍｉｎ）と、非選択セルが誤点灯しない最大の維持電圧（Ｖｓｍａｘ）を測定した。図５は横軸に壁電荷形成パルスＶｗｍの時間幅をとり、縦軸に維持パルスＶｓの電圧をとって、維持電圧の設定範囲に及ぼす壁電荷形成パルスＶｗｍの時間幅の影響を示すグラフ図である。
【００５５】
図５に示すように、壁電荷形成パルスＶｗｍの時間幅が０の場合、即ち、従来の駆動方法と同様に、走査電極Ｓに壁電荷形成パルスＶｗｍが印加されない場合においては、最小維持電圧Ｖｓｍｉｎが著しく上昇し、最大維持電圧Ｖｓｍａｘよりも高くなった。これは、走査周期が１μｓであるため、図１３（ｂ）に示すように、書込放電（発光Ｆ）が走査パルスＶｗの終了間際で発生し、十分に壁電荷が形成されなかったためである。
【００５６】
これに対して、壁電荷形成パルスＶｗｍの時間幅を長くしていくと、最小維持電圧Ｖｓｍｉｎが低下し、正常動作範囲３０が広がった。これは、壁電荷形成パルスＶｗｍによって走査の最終行付近のセルで発生するチラつきが改善された結果である。特に、壁電荷形成パルスＶｗｍの時間幅を３μｓ以上とすると、最小維持電圧Ｖｓｍｉｎが確実に最大維持電圧Ｖｓｍａｘよりも低くなり、ＰＤＰの安定駆動が容易になった。一方、壁電荷形成パルスの時間幅を長くする程、最小維持電圧Ｖｓｍｉｎは低下したが、壁電荷形成パルスの時間幅が約５０μｓになるとその効果が飽和した。これは、壁電荷形成パルスの幅が５０μｓになると、放電空間内の空間電荷の大部分が各電極上に引き寄せられてしまい、空間電荷が減少することによるものと考えられる。この維持電圧の壁電荷形成パルスの時間幅依存性は、セル構造及び放電ガス等によって異なるが、駆動時間の関係からみても、壁電荷形成パルスの時間幅は３乃至５０μｓの範囲で設定することが望ましい。
【００５７】
【発明の効果】
以上詳述したように、本発明によれば、書込放電後の壁電荷量を増加させることができ、書込期間から維持期間へ安定して遷移させることが可能となる。これにより、従来の駆動において、走査周期を短く設定した場合に発生する書込時の壁電荷形成不足による最終行付近のチラつきを改善し、良好な画像を得ることができる。この結果、黒輝度を増加させることなく走査周期を短縮することができ、この短縮による空き時間を維持パルス数、サブフィールド数及び走査ラインの増加に当てることができるようになる。これにより、ＰＤＰの輝度の向上、階調数の向上及び画質の向上を図ることが可能となる。
【図面の簡単な説明】
【図１】本発明の第１の実施例に係るＰＤＰの駆動方法を示す１サブフィールドの駆動波形図である。
【図２】図１に示す駆動方法により壁電荷形成期間においてセル内に形成される壁電荷配置を示す模式図である。
【図３】本発明の第２の実施例に係るＰＤＰの駆動方法を示す駆動波形図である。
【図４】（ａ）及び（ｂ）は図３に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、（ａ）は壁電荷形成期間における壁電荷配置を示し、（ｂ）は維持期間における壁電荷配置を示す。
【図５】横軸に壁電荷形成パルスＶｗｍの時間幅をとり、縦軸に維持パルスＶｓの電圧をとって、維持電圧の設定範囲に及ぼす壁電荷形成パルスＶｗｍの時間幅の影響を示すグラフ図である。
【図６】３電極面放電交流型プラズマディスプレイパネル（ＰＤＰ）における１つの表示セルの構成を示す斜視図である。
【図７】図６に示すＰＤＰの電極配置を示す模式的平面図である。
【図８】従来のＰＤＰの駆動方法における１フィールドの構成を示すタイミングチャートである。
【図９】従来の各サブフィールドの駆動方法を示す駆動波形図である。
【図１０】（ａ）乃至（ｃ）は図９に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、（ａ）及び（ｂ）はリセット期間における壁電荷配置を示し、（ｃ）は走査期間における壁電荷配置を示す。
【図１１】（ａ）及び（ｂ）は図９に示す駆動方法によりセル内に形成される壁電荷配置を示す模式図であり、維持期間における壁電荷配置を示す。
【図１２】横軸に走査周期をとり、縦軸に維持電圧をとって、維持放電を安定して発生させるために必要な最小の維持電圧（Ｖｓｍｉｎ）及び非選択セルが誤点灯しない最大の維持電圧（Ｖｓｍａｘ）の走査周期依存性を示すグラフ図である。
【図１３】（ａ）及び（ｂ）は走査パルス印加後に壁電荷が形成される挙動を示す模式図であり、（ａ）は走査周期が十分に長い場合を示し、（ｂ）は走査周期が短い場合を示す。
【符号の説明】
１，２；絶縁基板
３；走査電極
４；共通電極
５、６；トレース電極
７；データ電極
８；放電ガス空間
９；隔壁
１０；可視光
１１；蛍光体
１２、１４；誘電体
１３；保護層
１５；セル
２０；フィールド
２１；リセット期間
２２；走査期間
２３；維持期間
２４；壁電荷形成期間
３０、３３；正常動作範囲
３１；走査パルスＶｗを印加してから発光Ｆが起こるまでの期間
３２；壁電荷引寄期間
Ａ１〜Ａ１６；状態
Ｓ、Ｓ１〜Ｓｎ；走査電極
Ｃ、Ｃ１〜Ｃｎ；共通電極
Ｄ、Ｄ１〜Ｄｍ；データ電極
Ｆ；発光
Ｖｐ＋；正極性プライミングパルス
Ｖｐ−；負極性プライミングパルス
Ｖｐｅ；プライミング消去パルス
Ｖｂｗ；走査ベースパルス
Ｖｗ；走査パルス
Ｖｄ；データパルス
Ｖｗｍ、Ｖｗｍ１、Ｖｗｍ２；壁電荷形成パルス
Ｖｓ；維持パルス
Ｖｓｍｉｎ；最小維持電圧
Ｖｓｍａｘ；最大維持電圧
Claims (18)
- 対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に、その時間幅が３乃至５０μｓであり３電極間における電位の相対的な関係により決まる電界の向きが前記走査期間における前記書込放電時の電界の向きと同じである壁電荷形成パルスを、全ての前記画素において放電を発生させないように印加することにより前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有することを特徴とする交流面放電型プラズマディスプレイパネルの駆動方法。
- 前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極に負極性の壁電荷形成パルスを印加することを特徴とする請求項１に記載の交流面放電型プラズマディスプレイパネルの駆動方法。
- 前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記共通電極に正極性の壁電荷形成パルスを印加することを特徴とする請求項１に記載の交流面放電型プラズマディスプレイパネルの駆動方法。
- 前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極に負極性の壁電荷形成パルスを印加すると共に前記データ電極に正極性の壁電荷形成パルスを印加することを特徴とする請求項１に記載の交流面放電型プラズマディスプレイパネルの駆動方法。
- 前記データ電極に印加する正極性の壁電荷形成パルスの電位を、前記走査期間におけるデータパルスの電位と等しくすることを特徴とする請求項４に記載の交流面放電型プラズマディスプレイパネルの駆動方法。
- 前記走査期間における前記走査電極に前記走査パルスが印加されていない期間において、大きさが対向放電開始電圧から前記データパルスを減じた値未満である負極性の走査ベースパルスを前記走査電極に印加することを特徴とする請求項１乃至５のいずれか１項に記載の交流面放電型プラズマディスプレイパネルの駆動方法。
- 前記壁電荷形成パルスは、前記走査ベースパルスを時間的に延長したものであることを特徴とする請求項６に記載の交流面放電型プラズマディスプレイパネルの駆動方法。
- 対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記 画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査パルスと同電位の壁電荷形成パルスを印加すると共に、前記共通電極及び前記データ電極に接地電位を印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有することを特徴とする交流面放電型プラズマディスプレイパネルの駆動方法。
- 対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列された面放電交流型プラズマディスプレイパネルの駆動方法において、１の画像を表示する１フィールドを１又は複数のサブフィールドから構成し、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、全ての前記走査電極に走査ベースパルスを印加しつつ前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査ベースパルスと同電位の壁電荷形成パルスを印加し、前記共通電極に接地電位を印加すると共に、前記データ電極に前記データパルスと同電位の壁電荷形成パルスを印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、を有し、走査ベースパルスの大きさが対向放電開始電圧から前記データパルスを減じた値未満であることを特徴とする交流面放電型プラズマディスプレイパネルの駆動方法。
- 対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極、前記共通電極及び前記データ電極からなる群より選択された１又は２以上の電極に、その時間幅が３乃至５０μｓであり３電極間における電位の相対的な関係により決まる電界の向きが前記走査期間における前記書込放電時の電界の向きと同じである壁電荷形成パルスを、全ての前記画素において放電を発生させないように印加することにより前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されていることを特徴とする交流面放電型プラズマディスプレイパネル。
- 前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記走査電極に負極性の壁電荷形成パルスを印加することを特徴とする請求項１０に記載の交流面放電型プラズマディスプレイパネル。
- 前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期間において、前記共通電極に正極性の壁電荷形成パルスを印加することを特徴とする請求項１０に記載の交流面放電型プラズマディスプレイパネル。
- 前記走査期間において、前記走査電極に負極性の走査パルスを印加すると共に前記データ電極に選択的に正極性のデータパルスを印加し、前記壁電荷形成期 間において、前記走査電極に負極性の壁電荷形成パルスを印加すると共に前記データ電極に正極性の壁電荷形成パルスを印加することを特徴とする請求項１０に記載の交流面放電型プラズマディスプレイパネル。
- 前記データ電極に印加する正極性の壁電荷形成パルスの電位を、前記走査期間におけるデータパルスの電位と等しくすることを特徴とする請求項１３に記載の交流面放電型プラズマディスプレイパネル。
- 前記走査期間における前記走査電極に前記走査パルスが印加されていない期間において、大きさが対向放電開始電圧から前記データパルスを減じた値未満である負極性の走査ベースパルスを前記走査電極に印加することを特徴とする請求項１０乃至１４のいずれか１項に記載の交流面放電型プラズマディスプレイパネル。
- 前記壁電荷形成パルスは、前記走査ベースパルスを時間的に延長したものであることを特徴とする請求項１５に記載の交流面放電型プラズマディスプレイパネル。
- 対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査パルスと同電位の壁電荷形成パルスを印加すると共に、前記共通電極及び前記データ電極に接地電位を印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されていることを特徴とする交流面放電型プラズマディスプレイパネル。
- 対向して配置された第１及び第２の絶縁基板と、前記第１の絶縁基板における前記第２の絶縁基板との対向面側に設けられ第１の方向に延びると共に交互に配置された複数本の走査電極及び共通電極と、前記第２の絶縁基板における前記第１の絶縁基板との対向面側に設けられ前記第１の方向に直交する第２の方向に延びる複数本のデータ電極と、を有し、複数の画素がマトリクス状に配列されており、１の画像を表示する１フィールドが１又は複数のサブフィールドから構成され、このサブフィールドが、前記各画素内の電荷状態を初期化するリセット期間と、全ての前記走査電極に走査ベースパルスを印加しつつ前記走査電極に順次走査パルスを印加すると共に表示データに基づいて前記走査パルスと同一タイミングで前記データ電極に選択的にデータパルスを印加して前記画素内に選択的に書込放電を発生させる走査期間と、前記走査電極に前記走査ベースパルスと同電位の壁電荷形成パルスを印加し、前記共通電極に接地電位を印加すると共に、前記データ電極に前記データパルスと同電位の壁電荷形成パルスを印加することにより、前記書込放電が発生した画素内に壁電荷を形成する壁電荷形成期間と、前記走査電極及び前記共通電極に交互に維持パルスを印加して前記壁電荷が形成された画素において維持放電を発生させる維持期間と、から構成されており、走査ベースパルスの大きさが対向放電開始電圧から前記データパルスを減じた値未満であることを特徴とする交流面放電型プラズマディスプレイパネル。
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