JP3432552B2 - 窒化アルミニウム多層基板 - Google Patents

窒化アルミニウム多層基板

Info

Publication number
JP3432552B2
JP3432552B2 JP27579593A JP27579593A JP3432552B2 JP 3432552 B2 JP3432552 B2 JP 3432552B2 JP 27579593 A JP27579593 A JP 27579593A JP 27579593 A JP27579593 A JP 27579593A JP 3432552 B2 JP3432552 B2 JP 3432552B2
Authority
JP
Japan
Prior art keywords
aluminum nitride
multilayer substrate
nitride multilayer
package
pin
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP27579593A
Other languages
English (en)
Other versions
JPH07130909A (ja
Inventor
晋 秋山
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ibiden Co Ltd
Original Assignee
Ibiden Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ibiden Co Ltd filed Critical Ibiden Co Ltd
Priority to JP27579593A priority Critical patent/JP3432552B2/ja
Publication of JPH07130909A publication Critical patent/JPH07130909A/ja
Application granted granted Critical
Publication of JP3432552B2 publication Critical patent/JP3432552B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1517Multilayer substrate
    • H01L2924/15172Fan-out arrangement of the internal vias
    • H01L2924/15174Fan-out arrangement of the internal vias in different layers of the multilayer substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/303Surface mounted components, e.g. affixing before soldering, aligning means, spacing means
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3421Leaded components

Landscapes

  • Production Of Multi-Layered Print Wiring Board (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、窒化アルミニウム多層
基板に関するものである。
【0002】
【従来の技術】近年において小型化・高密度化等の著し
い電子機器には、同じく小型化・高密度化したICチッ
プやLSIチップ等が使用される状況にある。ところ
が、チップの高密度化等が進むと発熱量も増加するとい
うことから、セラミックス多層基板にチップを搭載して
なるパッケージには高い放熱性が要求されることとな
る。このため、従来から良く知られているアルミナパッ
ケージよりも更に放熱性に優れたセラミックパッケージ
を実現することが近年強く望まれている。
【0003】非酸化物系セラミックスに属する窒化アル
ミニウムは、熱伝導率がアルミナよりも高くしかも熱膨
張係数がシリコンに近似しているという優れた物理的特
性を備えている。よって、現時点においては、窒化アル
ミニウム製の多層基板を使用したパッケージが好適であ
ろうと考えられている。
【0004】
【発明が解決しようとする課題】この種のパッケージと
しては、例えば窒化アルミニウム多層基板の下面側に接
続用端子としての多数のピンを備えた、いわゆるPGA
(ピングリッドアレイ)タイプのものなどが良く知られ
ている。そして、PGAタイプのパッケージは、マザー
ボードであるプリント配線板上のパッドにピンを介して
表面実装されるようになっている。
【0005】ところが、窒化アルミニウム多層基板を使
用したセラミックパッケージには、以下に述べるような
問題点があった。つまり、窒化アルミニウムの熱膨張係
数は4.5(×10-6/℃)前後であるため、熱膨張係
数が3.6(×10-6/℃)前後であるシリコンとの差
は比較的小さい。このため、窒化アルミニウム多層基板
とシリコンチップとの組合わせに関しては、両者間に特
に熱的不整合が生じるということはない。従って、窒化
アルミニウム多層基板−シリコンチップ間で抵抗増大が
みられたり、接続不良が起こるということもない。
【0006】一方、プリント配線板の形成材料であるガ
ラスエポキシ等の樹脂は、一般的にセラミックスや金属
に比して熱膨張係数が数倍大きいという特徴を有する。
ゆえに、窒化アルミニウム多層基板とプリント配線板と
の組合せに関しては、両者間に熱的不整合が生じ易い。
このため、窒化アルミニウム多層基板−プリント配線板
間で抵抗増大がみられたり、接続不良が起こる確率が高
くなる。また、前記のような不具合は、例えばパッケー
ジが急激な温度変化に遭遇したときなどに顕著になるも
のと予測される。
【0007】本願発明者は上記のような予測のもと、窒
化アルミニウム基板を使用したパッケージを実際に作製
しかつそのパッケージをプリント配線板に表面実装させ
た状態で、次のような実装信頼性試験を行った。
【0008】被験用のパッケージのサイズは、20mm
角、25mm角、30mm角、35mm角の4種類とした。ま
た、これらのパッケージを表面実装するためのプリント
配線板として、一般的に良く使用されているFR−4製
のプリント配線板を選択した。接続用端子としてのピン
には、コバール製のショートピン(長さ2mm,0.2mm
φ)を用いた。また、前記ピンの接合には共晶はんだ
(Pb:Sn=63:37)を用いた。そして、サー
マルサイクル試験(気相,−65℃〜150℃)とサ
ーマルショック試験(液相,−55℃〜125℃)とを
それぞれ1000サイクルずつ行い、所定のサイクル毎
に抵抗値を測定した。そして、抵抗変化率(%)を求
め、当初の抵抗値の10%増になった時点を「NG」と
判定した。なお、抵抗値の測定は、(a) パッケージの最
外周部に存在しているピン及び(b) そうでないピンの二
群に分けて行った。以下、説明の便宜上前者(a) を「外
周部のピン」、後者(b) を「中央部のピン」と呼ぶこと
にする。
【0009】図9,図10は上記した試験の結果を示し
たグラフである。これらのグラフから明らかなように、
外周部のピンに関しては、いずれの試験においても10
00サイクルを経過するまでにNGに到るという結果が
得られた。逆に中央部のピンに関しては、1000サイ
クルを経過した後でもNGに到らないという結果が得ら
れた。また、NGに到った外周部のピンの接続部分を観
察したところ、ピンとはんだとの界面付近にクラックが
発生したものが多くみられた。
【0010】そこで、本願発明者は、上記のような現象
を引き起こすメカニズムについて次のように推論した。
図8には、パッケージを窒化アルミニウム多層基板Sの
底面側から見た図が示されている。窒化アルミニウム多
層基板Sに突設されているピンのうち、ピンP1 ,P1a
がいわゆる外周部のピンであり、ピンP2 ,P2aがいわ
ゆる中央部のピンである。ここでピンP2aについて注目
すると、同ピンP2aの周囲には8本のピンが存在してい
ることがわかる。それに比べて、ピンP1 の周囲には5
本のピンのみが、ピンP1aの周囲には3本のピンのみが
存在しているに過ぎないことがわかる。従って、ピンに
熱応力が加わった場合、周囲に存在するピンの本数が少
ないものほど熱応力の分散度合いも小さくなることがわ
かる。
【0011】つまり、一本当たりの熱応力の負担分が大
きい外周部のピンP1 ,P1a、特にコーナー部Cに位置
するピンP1aにクラックが多発するのであろう、という
結論に到ることになる。
【0012】そこで、本願発明者は、外周部のピンP1
,ピンP1aのような特定のピンに対して大きな熱応力
が加わらないように、何らかの対策を講じれば良いもの
と考えた。そして、本願発明者は、これまでに得た知見
を更に発展させることによって、以下に詳述する本発明
を完成させた。
【0013】本発明の目的は、マザーボードであるプリ
ント配線板に対する実装信頼性に極めて優れた窒化アル
ミニウム多層基板を提供することにある。
【0014】
【課題を解決するための手段】上記の課題を解決するた
めに、請求項1に記載の発明では、ガラスエポキシ樹脂
からなるプリント配線板上に複数の接続用端子を介し
て表面実装される窒化アルミニウム多層基板において、
前記接続用端子は、窒化アルミニウム多層基板の最下層
に設けられたスルーホールに接合されてなり、前記窒化
アルミニウム多層基板のうち、接続用端子形成領域の外
側のコーナー部にコバール製のダミー接続用端子を設
け、該ダミー接続用端子は前記スルーホールに接合され
てなることを特徴とする窒化アルミニウム多層基板をそ
の要旨としている。
【0015】請求項2に記載の発明では、請求項1に記
載の発明において、前記窒化アルミニウム多層基板に
は、LSIチップが搭載されてなる窒化アルミニウム多
層基板をその要旨としている。
【0016】
【0017】
【作用】本発明の構成によると、窒化アルミニウム多層
基板が表面実装されたガラスエポキシ樹脂からなるプリ
ント配線板が高温に晒され熱応力が発生した時、接続用
端子形成領域の外側のコーナー部のダミー接続用コバー
ル端子側に熱応力を集中させることによって、電気的接
続に関与する接続用端子の破壊が回避される。
【0018】
【0019】
【0020】
【実施例】〔実施例1〕以下、本発明を窒化アルミニウ
ム多層基板を用いたセラミックパッケージに具体化した
一実施例を図1〜図3に基づき詳細に説明する。
【0021】図1に示されるように、本実施例のパッケ
ージ1はPGAタイプのパッケージであり、主に窒化ア
ルミニウム多層基板2、封止用のリング3及びキャップ
4、並びにLSIチップ5等によって構成されている。
【0022】本実施例において使用される窒化アルミニ
ウム多層基板2は、グリーンシートを積層したものをホ
ットプレス焼成してなる5層板である。窒化アルミニウ
ム多層基板2の内部には、タングステンペースト等の印
刷によって、表裏を貫通するスルーホール7a,7bや
配線パターン6が形成されている。窒化アルミニウム多
層基板2の上面には、5層の薄膜多層回路(L/S=2
0μm/20μm)8を備えるビルドアップ層9が形成
されている。ビルドアップ層9の上面中央部には、LS
Iチップ5が搭載されている。LSIチップ5とビルド
アップ層9の薄膜多層回路8とは、ボンディングワイヤ
11を介して電気的に接続されている。
【0023】窒化アルミニウム多層基板2の最下層のス
ルーホール7aの径(0.8mmφ)は、それ以外の層の
スルーホール7bの径(0.2mmφ)よりも大きくなっ
ている。そして、この窒化アルミニウム多層基板2の場
合、このスルーホール7aの表面が接続用端子を取り付
けるためのパッドとして使用されている。なお、スルー
ホール7aの表面には予めNi−Auめっきが施されて
いる。
【0024】図1,図2に示されるように、最下層のス
ルーホール7aの表面には、接続用端子としてのコバー
ル製のショートピン(長さ2mm,0.2mmφ)12,1
2aが接合されている。また、本実施例ではショートピ
ン12と最下層のスルーホール7aとの接合に、Au−
Cuろう材が用いられている。従って、これらのショー
トピン12,12aは、スルーホール7a,7b、薄膜
多層回路8及びボンディングワイヤ11を介してLSI
チップ5に電気的に接続された状態にある。なお、本実
施例では、ショートピン12,12aのピッチは1.2
7mmに設定されている。
【0025】図2に示されるように、ショートピン1
2,12aが突設された領域の更に外周には、同ショー
トピン12,12aを包囲するようにダミーのショート
ピン13が突設されている。ここでいうダミーのショー
トピン13は、前記ショートピン12,12aとは異な
り、電気的な接続には特に関与していない。また、本実
施例では、ダミーのショートピン13として、電気的接
続に関与しているショートピン12と同一形状かつ同一
材質のものが使用されている。
【0026】図1に示されるように、LSIチップ5が
搭載された窒化アルミニウム多層基板2の上面には、L
SIチップ5を湿気等から保護するためにコバール製の
封止用のリング3及びキャップ4が接合されている。そ
の結果、いわゆるフェースアップ型かつ略正方形状のパ
ッケージ1(本実施例では35mm角)が構成されてい
る。
【0027】図3に示されるように、このパッケージ1
はマザーボードであるプリント配線板(FR−4製)1
4上に実装される。プリント配線板14上の所定位置に
は、パッケージ1側のショートピン12,12a及びダ
ミーのショートピン13の突設位置に対応して接続用パ
ッド15が形成されている。そして、共晶はんだ(P
b:Sn=63:37)10によって、ショートピン1
2,12a及びダミーのショートピン13と接続用パッ
ド15とが接合されている。
【0028】さて、本実施例のパッケージ1によると、
熱応力の集中し易いショートピン、即ち外周部(特にコ
ーナー部C)に位置しているショートピン12aの周囲
をダミーのショートピン13が包囲したような構成とな
っている。従って、急激な温度変化に遭遇したときで
も、ダミーのショートピン13に熱応力を分散させるこ
とができる。よって、外周部に位置しているショートピ
ン12aの破壊を未然に回避することができる。また、
仮にダミーのショートピン13の一部に破壊が生じたと
しても、それ自身が電気的接続に何ら関与していないも
のであることから、重大な問題が生じるというようなこ
とはない。ゆえに、本発明の窒化アルミニウム多層基板
2を使用したパッケージ1は、プリント配線板14に対
する実装信頼性に極めて優れたものとなる。
【0029】ちなみに、本実施例においても上述の実装
信頼性試験を行ったところ、1000サイクルを経過し
た後でも外周部に位置しているショートピン12aがN
Gに到ることがない、という極めて好ましい結果が得ら
れた。
【0030】以上の試験結果からも明らかなように、本
実施例によると、窒化アルミニウム多層基板2−プリン
ト配線板間14での抵抗増大や接続不良等といった不具
合は発生しないということがわかる。
【0031】なお、本発明は上記実施例のみに限定され
ることはなく、以下のように変更することが可能であ
る。例えば、 (a)図4に示される別例1の窒化アルミニウム多層基
板20を使用したパッケージ21のように、ダミーのシ
ョートピン13をコーナー部Cのみに配設するという構
成にしても良い。このような構成であっても、少なくと
も熱応力が最も集中し易いコーナー部Cのショートピン
12aが保護されることになるという利点がある。ま
た、この構成を採用した場合、使用されるダミーのショ
ートピン13の本数が少なくて済むため、コスト的にも
安くなる。
【0032】(b)実施例に示したダミーのショートピ
ン13を、例えばショートピン12,12aが突設され
ている領域Rの内側に設けることとしても良い。即ち、
図4において二点鎖線で示されるような領域Rにダミー
のショートピンを設ければ、その近傍のショートピン1
2bに加わる熱応力を分散させることができるからであ
る。
【0033】(c)図5に示される別例2の窒化アルミ
ニウム多層基板22に使用するパッケージ23のよう
に、電気的接続に関与する接続用端子をバンプ24と
し、かつその周囲に電気的接続に関与しないダミーのバ
ンプ25としても良い。この場合、バンプの形成材料と
して、例えば高融点はんだ、銀ろう、タングステン等を
使用することが好適である。
【0034】別例2のような構成であっても前記実施例
と同様の作用効果が得られ、前記パッケージ23のプリ
ント配線板に対する実装信頼性を向上させることができ
る。 (d)図6に示される別例3の窒化アルミニウム多層基
板26に使用するパッケージ27のような構成としても
良い。
【0035】この窒化アルミニウム多層基板26の場
合、電気的接続に関与する接続用ピン28,28aのう
ち、最外周の接続用ピン28aがそれ以外の接続用ピン
28に比べて小径(0.15mmφ)なものとなってい
る。この構成であると、温度変化に遭遇したときでも、
熱応力の集中し易い最外周の接続用ピン28a自体が、
ある程度の熱応力を吸収してしまう。よって、接続用ピ
ン28aの破壊が未然に回避される。
【0036】また、接続用ピン28,28aのうち少な
くとも熱応力の集中し易い最外周の接続用ピン28a
を、熱応力の集中し難い接続用ピン28よりも軟質なも
のとしても良い。つまり、熱応力の集中し難い接続用ピ
ン28をコバール製としたときには、最外周の接続用ピ
ン28a用の材料として、例えば銅や金等のコバールよ
りも軟質な金属を選択すれば良い。また、これらの金属
ばかりでなく、例えば軟質の合金を選択することも可能
である。
【0037】更に、熱応力の集中し難い接続用ピン28
用の金属としてコバール以外のものを選択した場合であ
っても、最外周の接続用ピン28aとして同金属よりも
軟質な別の金属を選択すれば良いということになる。
【0038】(e)図7に示される別例4の窒化アルミ
ニウム多層基板29を使用したパッケージ30のよう
に、接続用ピン31の全てを熱応力を吸収し得る形状に
することも好ましい。即ち、別例4のパッケージ30の
場合、接続用ピン31を熱応力を吸収し得る形状にする
ために、同接続用ピン31を小径(0.15mmφ)にし
ている。また、前記接続用ピン31の形状を変更するば
かりでなく、例えば接続用ピン31等の材料として軟質
な金属である銅等を用いることとしても良い。
【0039】(f)窒化アルミニウム多層基板2の上面
のビルドアップ層9は特に必須というわけではなく、不
要な場合には構成から省略することも可能である。ま
た、窒化アルミニウム多層基板2の積層数は任意に変更
することが可能である。
【0040】(g)接続用ピンを平坦なパッドにはんだ
付けするという接合方法に代え、例えば窒化アルミニウ
ム多層基板2側の凹部に接続用ピンを挿入するという接
続方法を採用しても良い。
【0041】
【発明の効果】以上詳述したように、本発明によれば、
窒化アルミニウム多層基板が表面実装されたガラスエポ
キシ樹脂からなるプリント配線板が高温に晒され熱応力
が発生した時、接続用端子形成領域の外側のコーナー部
のダミー接続用コバール端子側に熱応力を集中させるこ
とによって、電気的接続に関与する接続用端子の破壊が
回避されるため、マザーボードであるプリント配線板に
対する実装信頼性に極めて優れたものとなるという効果
を奏する。
【図面の簡単な説明】
【図1】窒化アルミニウム多層基板を使用した実施例の
パッケージを示す概略縦断面図である。
【図2】実施例の窒化アルミニウム多層基板を示す底面
図である。
【図3】実施例のパッケージをマザーボードであるプリ
ント配線板に実装した状態を示す要部拡大断面図であ
る。
【図4】別例1の窒化アルミニウム多層基板(パッケー
ジ)を示す底面図である。
【図5】別例2の窒化アルミニウム多層基板(パッケー
ジ)を示す概略縦断面図である。
【図6】別例3の窒化アルミニウム多層基板(パッケー
ジ)を示す概略縦断面図である。
【図7】別例4の窒化アルミニウム多層基板(パッケー
ジ)を示す概略縦断面図である。
【図8】パッケージを構成する従来の窒化アルミニウム
多層基板を示す一部破断底面図である。
【図9】従来のパッケージに対するサーマルサイクル試
験の結果を表したグラフである。
【図10】従来のパッケージに対するサーマルショック
試験の結果を表したグラフである。
【符号の説明】5…LSIチップ、7a…スルーホール、21 …パッケ
ージ、20…窒化アルミニウム多層基板、12,12a
…接続用端子としてのショートピン、13…ダミーの接
続用端子としてのダミーのショートピン、14…プリン
ト配線板
フロントページの続き (56)参考文献 特開 昭62−150837(JP,A) 特開 昭58−53837(JP,A) 特開 昭49−92548(JP,A) 特開 平3−71649(JP,A) 特開 平1−313969(JP,A) 特開 平2−165661(JP,A) 特開 平6−216193(JP,A) (58)調査した分野(Int.Cl.7,DB名) H01L 23/12

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】ガラスエポキシ樹脂からなるプリント配線
    板上に複数の接続用端子を介して表面実装される窒化
    アルミニウム多層基板において、 前記接続用端子は、窒化アルミニウム多層基板の最下層
    に設けられたスルーホールに接合されてなり、前記窒化
    アルミニウム多層基板のうち、接続用端子形成領域の外
    側のコーナー部にコバール製のダミー接続用端子を設
    け、該ダミー接続用端子は前記スルーホールに接合され
    てなることを特徴とする窒化アルミニウム多層基板。
  2. 【請求項2】前記窒化アルミニウム多層基板には、LS
    Iチップが搭載されてなる請求項1に記載の窒化アルミ
    ニウム多層基板。
JP27579593A 1993-11-04 1993-11-04 窒化アルミニウム多層基板 Expired - Fee Related JP3432552B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP27579593A JP3432552B2 (ja) 1993-11-04 1993-11-04 窒化アルミニウム多層基板

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP27579593A JP3432552B2 (ja) 1993-11-04 1993-11-04 窒化アルミニウム多層基板

Related Child Applications (2)

Application Number Title Priority Date Filing Date
JP2003103314A Division JP3662910B2 (ja) 2003-04-07 2003-04-07 窒化アルミニウム多層基板
JP2003103313A Division JP2003264351A (ja) 2003-04-07 2003-04-07 窒化アルミニウム多層基板

Publications (2)

Publication Number Publication Date
JPH07130909A JPH07130909A (ja) 1995-05-19
JP3432552B2 true JP3432552B2 (ja) 2003-08-04

Family

ID=17560527

Family Applications (1)

Application Number Title Priority Date Filing Date
JP27579593A Expired - Fee Related JP3432552B2 (ja) 1993-11-04 1993-11-04 窒化アルミニウム多層基板

Country Status (1)

Country Link
JP (1) JP3432552B2 (ja)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2699932B2 (ja) * 1995-06-21 1998-01-19 日本電気株式会社 半導体装置
JP2803603B2 (ja) * 1995-09-18 1998-09-24 日本電気株式会社 マルチチップパッケージ構造
DE19757612C1 (de) * 1997-12-23 1999-07-08 Siemens Ag Hybridschaltung mit einem System zur Wärmeableitung
KR100331986B1 (ko) * 1999-06-03 2002-04-10 김덕중 하면 핀 어레이된 저온 동시 소성 세라믹 모듈 패키지

Also Published As

Publication number Publication date
JPH07130909A (ja) 1995-05-19

Similar Documents

Publication Publication Date Title
US4724472A (en) Semiconductor device
US6232147B1 (en) Method for manufacturing semiconductor device with pad structure
US6303992B1 (en) Interposer for mounting semiconductor dice on substrates
US5288944A (en) Pinned ceramic chip carrier
JP2658672B2 (ja) I/oピンの修理構造および修理方法
JPH10256429A (ja) 半導体パッケージ
US6351389B1 (en) Device and method for packaging an electronic device
JP2001210749A (ja) バンプ電極付き配線基板およびその製造方法
JP3432552B2 (ja) 窒化アルミニウム多層基板
JP2002026073A (ja) 半導体装置およびその製造方法
JPH10275522A (ja) 導電性樹脂ペースト、それを用いたパッケージ用基体および半導体パッケージ
JP3662910B2 (ja) 窒化アルミニウム多層基板
JPH10256428A (ja) 半導体パッケージ
JPH1084011A (ja) 半導体装置及びこの製造方法並びにその実装方法
JP2003264351A (ja) 窒化アルミニウム多層基板
JPH10256413A (ja) 半導体パッケージ
JPH08255851A (ja) 半導体用パッケージ
JP2572092Y2 (ja) 半導体素子パッケージ
JPH10275878A (ja) 半導体パッケージ
JPS6020597A (ja) 電子装置およびその製造方法
JP2001185642A (ja) 半導体実装用パッケージ基板
JP2741611B2 (ja) フリップチップボンディング用基板
JP2001102492A (ja) 配線基板およびその実装構造
JPH0536275Y2 (ja)
KR20020028018A (ko) 멀티 칩 패키지

Legal Events

Date Code Title Description
R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080523

Year of fee payment: 5

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080523

Year of fee payment: 5

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090523

Year of fee payment: 6

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100523

Year of fee payment: 7

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110523

Year of fee payment: 8

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110523

Year of fee payment: 8

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120523

Year of fee payment: 9

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120523

Year of fee payment: 9

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130523

Year of fee payment: 10

LAPS Cancellation because of no payment of annual fees