JP3425648B2 - 多相交流発電機の相間の電圧を検出する検出回路 - Google Patents

多相交流発電機の相間の電圧を検出する検出回路

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    • H02J7/14—Circuit arrangements for charging or depolarising batteries or for supplying loads from batteries for charging batteries from dynamo-electric generators driven at varying speed, e.g. on vehicle
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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、交流発電機により、車
両用バッテリーに充電するための多相発電機のフェーズ
信号を検出する検出回路に関する。
【０００２】
【従来の技術】このような回路の例は、本特許出願人が
出願したフランス国特許出願第2,649,797号明細書に記
載されている。本願の明細書は、前記フランス国特許出
願の明細書を参照することにより、よりよく理解しうる
と思う。前記フランス国特許出願明細書には、この種の
検出方法の利点や、互換性のある配線方法が記載されて
いる。
【０００３】この検出方法は、発電機が回転する時に、
交流発電機の２相端子間に電位差が発生するという原理
に基づいている。上記フランス国特許出願の実施例で
は、上記２相間の電圧と、閾値電圧、たとえば＋０．６
ボルトとを対比している。その閾値を越えると、回路の
論理出力が調節回路に働きかけ、交流発電機の励磁コイ
ルに適当な調節電流を流す。
【０００４】
【発明が解決しようとする課題】本発明の目的は、極め
て簡単かつ安価で、信頼性の高いフェーズ間(インター
フェーズ)の電圧検出回路を提供することにある。上述
の公知の回路には、いくつかの欠点がある。特に、高周
波数の干渉信号に妨害されないように改善する余地があ
る。更に同回路は、交流発電機とフェーズ信号入力端子
との間の不通などの故障を確実に検出する手段も必要で
ある。
【０００５】従来、交流発電機が回転していない(エン
ジンが止まっている)時に、レギュレータが作動し、そ
の結果、車両のバッテリーが放電するようなことがあっ
た。本発明の目的は、回路の複雑さやコストの上昇を招
くことなしに、これらの欠点を減らすことにある。
【０００６】
【課題を解決するための手段】本発明は、多相の交流発
電機が発生した一対のフェーズ信号間の電圧の大きさを
比較する比較手段を有する回路を備える、前記交流発電
機による自動車用バッテリーの充電を調節するレギュレ
ータを制御する電圧の検出回路において、比較手段は、
一対のバイポーラ型のトランジスタを備え、比較手段の
第１の入力端子は、第１のトランジスタのベースと第２
のトランジスタのエミッタとに接続され、比較手段の第
２の入力端子は、第２のトランジスタのベースと第１の
トランジスタのエミッタに接続され、トランジスタのコ
レクタは、ＯＲ論理回路の入力端子に接続され、各トラ
ンジスタは、相間の電圧とエミッタ/ベース接合電圧に
よる各閾値電圧とを比較する比較手段をなし、前記閾値
電圧は、小電圧であり、反対極性を有し、前記ＯＲ論理
回路は、フェーズ信号間の電圧差の絶対値が前記閾値電
圧よりも高いことを示す信号を出力するようになってい
ることを特徴とする検出回路を提供している。
【０００７】
【実施例】図１を参照して、本発明の第１の実施例を説
明する。本検出回路は、交流発電機の第１の相の信号及
び第２の相の信号がそれぞれ入力される２つの入力端子
(φ１)(φ２)を有している。これら２つの入力端子(φ
１)(φ２)は，抵抗（Ｒ１３）に接続されている。入力
端子（φ１）は、抵抗（Ｒ１０）を介し、ＮＰＮ型のト
ランジスタ（Ｔ１）のエミッタ及びＮＰＮ型のトランジ
スタ（Ｔ２）のベースに接続されている。入力端子（φ
２）は、抵抗（Ｒ１１）を介し、（Ｔ１）のベース及び
（Ｔ２）のエミッタに接続されている。
【０００８】トランジスタ（Ｔ１）（Ｔ２）のコレクタ
は、それぞれ抵抗（Ｒ７）と（Ｒ８）の一端に接続さ
れ、抵抗（Ｒ７）と（Ｒ８）の他端は、車両のバッテリ
ー電源（ＵB+）が接続されている。また、トランジスタ
（Ｔ１）（Ｔ２）のコレクタには、ＰＮＰ型のトランジ
スタ（Ｔ３）（Ｔ４）が夫々接続されている。トランジ
スタ（Ｔ３）（Ｔ４）のエミッタはバッテリー電源（Ｕ
B+）に、コレクタは抵抗（Ｒ９）（Ｒ１２）を介してそ
れぞれ接地されている。
【０００９】トランジスタ（Ｔ３）（Ｔ４）のコレクタ
は、それぞれ２つの抵抗（Ｒ３０）（Ｒ４０）及びＯＲ
ゲートを構成する２つのダイオード（Ｄ３０）（Ｄ４
０）を介し、処理回路に接続されている。処理回路は、
カスケード接続されたトランジスタ（Ｔ５）（Ｔ６）
（Ｔ７）を備え、フランス国特許出願番号第2,649,797
号の図４ｂに示したようなミラー積分回路網型のデュー
ティ比弁別回路を構成している。
【００１０】出力端子（Ｓ１）は、抵抗を介して、トラ
ンジスタ（Ｔ７）のコレクタに接続されている。この出
力端子（Ｓ１）から高論理レベルの信号が出力される
と、レギュレータ(図示せず)が作動する。
【００１１】トランジスタ（Ｔ８）のベースは、抵抗を
介して（Ｔ６）のコレクタに接続され、そのエミッタは
バッテリー電源ＵB+に、そのコレクタは電源
（ＵB+COM）に接続されている。入力端子（φ１）は、
抵抗（Ｒ１４）を介しＰＮＰ型のトランジスタ（Ｔ９）
のベースに接続されている。トランジスタ（Ｔ９）のコ
レクタは、抵抗（Ｒ１６）を介して入力端子（φ２）に
接続されている。
【００１２】トランジスタ（Ｔ９）のエミッタは、まず
抵抗（Ｒ１５）を介して電源（ＵB+COM）、ダイオード
（Ｄ４）の陰極、及びツェナーダイオード（Ｚ３）の陰
極に接続されている。ダイオード（Ｄ４）の陽極は、ト
ランジスタ（Ｔ９）のベースに接続されている。ツェナ
ーダイオード（Ｚ３）の陽極は接地されている。トラン
ジスタ（Ｔ９）のコレクタは、ＮＰＮ型のトランジスタ
（Ｔ１０）のベースと、ダイオード（Ｄ１）の陰極に接
続されている。ダイオード（Ｄ１）の陽極は接地されて
いる。
【００１３】抵抗（Ｒ１７）は、エミッタが接地された
トランジスタ（Ｔ１０）のコレクタと電源（ＵB+COM）
の間に接続されている。トランジスタ（Ｔ１０）のコレ
クタは、回路の論理出力端子（Ｓ２）に接続されている
とともに、並列接続されて、かつ一端が接地されたコン
デンサ（Ｃ３）とツェナーダイオード（Ｚ４）の他端に
接続されている。
【００１４】入力端子（φ１）は、抵抗（Ｒ１８）を介
してＰＮＰ型のトランジスタ（Ｔ１１）のベースに接続
されている。このベースは、ダイオード（Ｄ２）の陽極
に、その陰極は電源（ＵB+COM）に接続されている。ト
ランジスタ（Ｔ１１）のエミッタは電源（ＵB+COM）
に、そのコレクタは抵抗（Ｒ２０）の一端に接続されて
いる。抵抗（Ｒ２０）の他端は、抵抗（Ｒ１９）の一
端、ダイオード（Ｄ３）の陰極、及びＮＰＮ型のトラン
ジスタ（Ｔ１２）のベースに接続されている。
【００１５】抵抗（Ｒ１９）の他端は、入力端子（φ
２）に接続されている。ダイオード（Ｄ３）の陽極は接
地されている。トランジスタ（Ｔ１２）のエミッタも接
地されている。そのコレクタは、抵抗（Ｒ２１）を介し
て電源（ＵB+COM）に、また論理出力端子（Ｓ３）に接
続されている。コンデンサ（Ｃ４）とツェナーダイオー
ド（Ｚ５）は，トランジスタ（Ｔ１２）のコレクタとア
ースの間に並列接続されている。
【００１６】次に、図１の検出回路の動作を説明する。
トランジスタ（Ｔ１）と（Ｔ２）により、Ｖφ２（入力
端子（φ２）からの電圧）−Ｖφ１（入力端子（φ１）
からの電圧）のフェーズ間の電圧と、トランジスタ（Ｔ
１）と（Ｔ２）のエミッタ/ベース接合電圧により設定
される２つの所定閾値とが比較される。その閾値は、ト
ランジスタ（Ｔ１）と（Ｔ２）のエミッタとベースとの
接合部の電圧で決められる。これらの２つの閾値は、た
とえばトランジスタ（Ｔ１）に関しては＋０．６ボル
ト、トランジスタ（Ｔ２）に関しては−０．６ボルトに
設定されている。
【００１７】トランジスタ（Ｔ３）（Ｔ４）により、上
記の閾値をフェーズ間の電圧が越えた時、トランジスタ
（Ｔ１）（Ｔ２）が発生した信号が整形される。（Ｖφ
２）−（Ｖφ１）の電圧が、＋０．６ボルトより大きい
場合には、トランジスタ（Ｔ１）（Ｔ３）がオンし、ト
ランジスタ（Ｔ２）（Ｔ４）がオフする。
【００１８】逆に、（Ｖφ２）−（Ｖφ１）の電圧が、
−０．６ボルトより小さい場合には、トランジスタ（Ｔ
２）（Ｔ４）がオンし、トランジスタ（Ｔ１）（Ｔ３）
がオフする。（Ｖφ２）−（Ｖφ１）の電圧が、−０．
６ボルトと＋０．６ボルトとの間にある時は、トランジ
スタ（Ｔ１）（Ｔ２）（Ｔ３）（Ｔ４）がオフする。ミ
ラー積分回路網は、トランジスタ（Ｔ３）（Ｔ４）から
論理信号を受け取る。
【００１９】オフしている時間と比較して、デューティ
比が小さい時に、トランジスタ（Ｔ３）または（Ｔ４）
に対応する閾値交差信号を無視すると、出力端子（Ｓ
１）からの出力は、交流発電機と関連するレギュレータ
を作動状態に切り換えることができなくなる。
【００２０】その理由は、単に、短い干渉信号がフェー
ズ間の電圧に発生したり、切り換え中に高周波パルスが
発生したりするためである。逆に、フェーズ間の電圧
が、１つまたは２つの閾値電圧を、大きなデューティ比
で超えた時に、交流発電機が回転し、レギュレータが作
動しなければならない。これは、ミラー積分回路網を介
して高レベルに切り換わった出力端子（Ｓ１）からの論
理信号によりなされる。
【００２１】本発明によると、フェーズ間の電圧を、正
閾値電圧及び負閾値電圧と比較することができ、極めて
簡単で安い２つのトランジスタ（Ｔ１）（Ｔ２）を有す
る回路を用いるので、集積が容易であり、シリコン部分
も非常に少ない。トランジスタ（Ｔ１）（Ｔ２）（Ｔ
３）（Ｔ４）を、バッテリー電源（ＵB+）に直接接続す
ることもできる。交流発電機が停止中は、殆どの時間、
これら全てのトランジスタはオフで、干渉波や過渡電流
は事実上全く存在しないので、消費電流は無視できる程
僅かである。
【００２２】トランジスタ（Ｔ９）（Ｔ１０）を備える
回路は、交流発電機が回転中、交番フェーズの入力端子
（φ２）の電圧ピークが２つの所定閾値電圧、たとえば
＋０．６ボルトと＋７ボルトを確実に越えるようにす
る。この状態は、このフェーズ出力に接続されている車
両用電子回転計が、特にディーゼルエンジンと共に確実
に作動するようにするため、通常必要である。
【００２３】より詳しく言うと、入力端子（φ１）の電
圧が、ツェナーダイオード（Ｚ３）の電圧からトランジ
スタ（Ｔ９）のエミッタ/ベース接合電圧を引いたもの
(たとえば上記例のごとく＋７ボルト)より大きいと，ト
ランジスタ（Ｔ９）はオフに切り換わる。もしこの間、
入力端子（φ２）の電圧がトランジスタ（Ｔ１０）のエ
ミッタ/ベース接合電圧より小さいと、トランジスタ
（Ｔ１０）はオフする。出力端子（Ｓ２）の論理信号は
高論理レベルになる。このことは、そのピークが閾値を
越えており、回転計は正常に作動し得ることを示してい
る。
【００２４】逆に、上述した２つの状態の一方が満足さ
れないと、トランジスタ（Ｔ１０）は、出力端子（Ｓ
２）の論理信号レベルを低くする。図示していないが、
それにより、交流発電機の励磁コイルに流れる電流が増
加し、フェーズ信号のピーク値が、再び直ちに上記の閾
値を越す。
【００２５】ツェナーダイオードＺ４により、出力端子
（Ｓ２）の信号が高論理レベルになるのに必要な電圧が
供給される。コンデンサ（Ｃ３）により、出力端子（Ｓ
２）における寄生発振が防止される。トランジスタ（Ｔ
１１）（Ｔ１２）を備える回路により、（Ｖφ１）と
（Ｖφ２）との電圧差が、交流発電機の出力電圧に近い
電圧（ＵB+COM）と同じ値を有するか否かが検出され
る。
【００２６】トランジスタ（Ｔ１２）と（Ｔ１１）のエ
ミッタ/ベース接合電圧は、電圧（Ｖφ１）と（Ｖφ
２）が、＋０．６ボルトのレベルと電源（ＵB+COM）−
０．６ボルトを越えるか否かを決定するための、約＋
０．６ボルトと電源（Ｕ B+COM ）−０．６ボルトの閾値
電圧となっている。
【００２７】より詳しく言うと、もし入力端子（φ１）
の電圧が、電源（ＵB+COM）からトランジスタ（Ｔ１
１）のエミッタ/ベース接合電圧を差し引いたものより
大きい場合は、トランジスタ（Ｔ１１）はオフする。も
し、入力端子（φ２）の電圧がトランジスタ（Ｔ１２）
のエミッタ/ベース接合電圧より小さい場合は、トラン
ジスタ（Ｔ１２）はオフし、出力端子（Ｓ３）は高論理
レベルとなり、異常がないこととなる。もし、上記の２
つの状態のどちらかが満足されなくなると、トランジス
タ（Ｔ１２）は直ちにオンし、出力端子（Ｓ３）の信号
は低論理レベルとなる。
【００２８】（Ｖφ１）と（Ｖφ２）との電圧差が十分
な時は、上記の回路は出力端子（Ｓ３）に、論理レベル
を切り換える信号を送る。逆に、その電圧差が不十分な
時は、出力端子（Ｓ３）の信号は、常に高レベルとな
り、異常であることを示す。ツェナーダイオード（Ｚ
５）とコンデンサ（Ｃ４）は、前述のツェナーダイオー
ド（Ｚ４）とコンデンサ（Ｃ３）と同じ働きをする。
【００２９】交流発電機が回転して、レギュレータを作
動させることを検出回路が検出した時のみに、トランジ
スタ（Ｔ８）は、トランジスタ（Ｔ９）（Ｔ１０）（Ｔ
１１）（Ｔ１２）を備える２つの回路に給電する電源
（ＵB+COM）を、バッテリー電源（ＵB+）に切り換え
る。
【００３０】次に、図２を参照して、本発明の第２の実
施例を説明する。トランジスタ（Ｔ１）〜（Ｔ４）を備
える回路、及び、トランジスタ（Ｔ９）（Ｔ１０）（Ｔ
１１）（Ｔ１２）を備える回路は、図１と同じであるの
で再述しない。第２の実施例では、ミラー積分回路網の
代わりに、異なるタイプのフィルタ回路が設けられ、干
渉を防止している。
【００３１】より詳しく言うと、トランジスタ（Ｔ３）
のコレクタは、抵抗（Ｒ１）の一端に接続され、その他
端は、抵抗（Ｒ２）の一端、ツェナーダイオード（Ｚ
１）の陰極、及びＭＯＳＦＥＴ（Ｔ４０）のゲートに接
続されている。
【００３２】抵抗（Ｒ２）の他端は、別のＭＯＳＦＥＴ
（Ｔ３０）のドレーンと抵抗（Ｒ３）の一端とに接続さ
れている。抵抗（Ｒ３）の他端は、１対のカウンタをな
す第１遅延回路（ＣＴ１）のゼロ・リセット入力端子
（ＲＳ）とコンデンサ（Ｃ１）の一端とに接続されてい
る。
【００３３】コンデンサ（Ｃ１）の他端、ツェナーダイ
オード（Ｚ１）の陽極、及びＭＯＳＦＥＴ（Ｔ３０）の
ソースは接地されている。トランジスタ（Ｔ４）のコレ
クタは、抵抗（Ｒ４）の一端とに接続されている。その
他端は、抵抗（Ｒ５）の一端、ツェナーダイオード（Ｚ
２）の陰極、及びＭＯＳＦＥＴ（Ｔ３０）のゲートに接
続されている。抵抗（Ｒ５）の他端は、ＭＯＳＦＥＴ
（Ｔ４０）のドレーンと、抵抗（Ｒ６）の一端に接続さ
れている。
【００３４】抵抗（Ｒ６）の他端は、１対のカウンタを
なす第２遅延回路（ＣＴ２）のゼロ・リセット入力端子
（ＲＳ）とコンデンサ（Ｃ２）の一端とに接続されてい
る。コンデンサ（Ｃ２）の他端、ツェナーダイオード
（Ｚ２）の陽極、及びＭＯＳＦＥＴ（Ｔ４０）のソース
は接地されている。クロック信号(たとえば好適な周波
数の矩形波信号)の入力端子（ＣＫ）は、遅延回路（Ｃ
Ｔ１）（ＣＴ２）の各クロック入力端子（ＣＫ）に接続
されている。
【００３５】各遅延回路の出力端子（Ｓ）は、適切に重
み付けされたカウンタの並列の１対の出力線に接続され
ている。また、各出力端子（Ｓ）は、遅延回路のＥｎに
接続され、遅延回路（ＣＴ１）と（ＣＴ２）をタイマー
にする。ＮＯＲゲート（Ｐ１）の入力は、各遅延回路の
出力端子（Ｓ）に接続され、その出力は、本回路の論理
出力端子（Ｓ１）に接続されている。
【００３６】次に、図２の回路の作用について説明す
る。トランジスタ（Ｔ１）〜（Ｔ４）により形成された
比較回路のトランジスタ（Ｔ３）または（Ｔ４）は、フ
ェーズ間の電圧の絶対値が０．６ボルトを越える時にオ
ンする。抵抗（Ｒ１）（Ｒ２）（Ｒ３）、コンデンサ
（Ｃ１）、ＭＯＳＦＥＴ（Ｔ３０）のアセンブリと、抵
抗（Ｒ４）（Ｒ５）（Ｒ６）、コンデンサ（Ｃ２）、Ｍ
ＯＳＦＥＴ（Ｔ４０）のアセンブリは、非対称のローパ
スフィルタを構成し、コンデンサ（Ｃ１）が抵抗（Ｒ
１）（Ｒ２）（Ｒ３）を介して、コンデンサ（Ｃ２）が
抵抗（Ｒ４）（Ｒ５）（Ｒ６）を介して、それぞれ徐々
に充電する。また、ＭＯＳＦＥＴ（Ｔ３０）（Ｔ４０）
が通電している間、コンデンサ（Ｃ１）（Ｃ２）は、抵
抗（Ｒ３）（Ｒ６）により、それぞれ迅速に放電され
る。
【００３７】より詳しく言うと、交流発電機が停止して
いて、干渉などがない場合には、（Ｖφ２）−（Ｖφ
１）の電圧はゼロでありトランジスタ（Ｔ１）〜（Ｔ
４）はオフしている。従って、コンデンサ（Ｃ１）（Ｃ
２）は、抵抗（Ｒ３）（Ｒ２）（Ｒ１）（Ｒ９）及び抵
抗（Ｒ６）（Ｒ５）（Ｒ４）（Ｒ１２）を介してそれぞ
れ徐々に放電する。そのため、２つの遅延回路のゼロ・
リセット入力端子（ＲＳ）に印加される電圧は、常に低
論理レベルとなる。
【００３８】遅延回路（ＣＴ１）と（ＣＴ２）の出力端
子（Ｓ）からは、(計測による遅延の後に)、高論理レベ
ルの信号が出力され、出力端子（Ｓ１）からは低レベル
の信号が出力される。それにより、交流発電機のレギュ
レータが作動しない。交流発電機が回転しているか、高
周波干渉がある時、（Ｖφ２）−（Ｖφ１）の電圧は、
トランジスタ（Ｔ１）と（Ｔ２）により設定された閾値
電圧と順に交差する。
【００３９】例えば、（Ｖφ２）−（Ｖφ１）が＋０．
６ボルトより大きくなると、トランジスタ（Ｔ１）（Ｔ
３）が通電する。コンデンサ（Ｃ１）は、抵抗（Ｒ１）
（Ｒ２）（Ｒ３）を介して徐々に充電される。次に、ト
ランジスタＴ１とＴ３は再びオフになり、トランジスタ
Ｔ２とＴ４はオンする。
【００４０】ツェナーダイオード（Ｚ２）の電子なだれ
電圧、たとえば＋５ボルトがゲートに印加されると、Ｍ
ＯＳＥＦＴ（Ｔ３０）はオンする。それにより、コンデ
ンサ（Ｃ１）は、抵抗（Ｒ３）のみを介して速やかに放
電される。コンデンサ（Ｃ１）の電圧は、トランジスタ
（Ｔ３）のオン／オフ周期の周波数及びデューティ比の
関数として変化する。同様に、コンデンサＣ２の電圧
は、トランジスタＴ４の関数として変化する。
【００４１】その結果、高周波干渉信号(通常は数百キ
ロヘルツ)だけがフェーズ入力端子に発生した時、トラ
ンジスタ（Ｔ３）と（Ｔ４）とのオン時間が余りにも短
いので、関連する遅延回路（ＣＴ１）または（ＣＴ２）
が高論理レベルとみなすレベルまで、コンデンサ（Ｃ
１）または（Ｃ２）の電圧を高めることはできない。
【００４２】同様に、干渉信号が、時間的に間隔を置い
た短い電圧パルスからなる時、デューティ比は低いの
で、コンデンサ（Ｃ１）または（Ｃ２）の電圧レベルは
十分に上昇しない。そのため、遅延回路（ＣＴ１）と
（ＣＴ２）は、前述のようにはゼロにリセットされず、
ＮＯＲゲート（Ｐ１）の出力は、出力端子（Ｓ１）に低
論理レベルの信号を出力する。そのため、レギュレータ
は作動しない状態のままになる。
【００４３】逆に、交流発電機が回転している時、（Ｖ
φ２）−（Ｖφ１）の電圧の周波数は十分に低いので、
コンデンサ（Ｃ１）（Ｃ２）の電圧は、遅延回路（ＣＴ
１）（ＣＴ２）が高論理レベルとみなすレベルに達し、
遅延回路はゼロにリセットされる。
【００４４】交流発電機がかなりの低速で回転している
時、フェーズ信号の半サイクル以上の遅延があるので、
出力端子（Ｓ）の出力はゼロのままとなる。すなわち、
これら２つの遅延回路（ＣＴ１）（ＣＴ２）の出力端子
（Ｓ）の出力は、恒久的にゼロとなる。そのため、出力
端子（Ｓ１）の出力は高レベルとなり、交流発電機のレ
ギュレータが作動する。
【００４５】更に交流発電機が回転していないで、交流
発電機と入力端子（φ１）（φ２）の一方が分断された
時には、交流発電機のステーターによる電位は、それら
の入力端子に入力されなくなるので、（Ｖφ１）−（Ｖ
φ２）の電圧は０．６ボルトより大きくなる。
【００４６】トランジスタ（Ｔ１）（Ｔ３）（Ｔ２）
（Ｔ４）とは、非対称に動作する。例えば、トランジス
タ（Ｔ１）（Ｔ３）がオンすると、トランジスタ（Ｔ
２）（Ｔ４）は常にオフする。この場合には、遅延回路
（ＣＴ１）はゼロにリセットされるが、遅延回路（ＣＴ
２）はリセットされない。従って、２つの遅延回路（Ｃ
Ｔ１）（ＣＴ２）は、低論理レベルの信号と、高論理レ
ベルの信号とをそれぞれ出力する。
【００４７】このため、出力端子（Ｓ１）は低論理レベ
ルの信号を出力し、レギュレータは作動しない。エンジ
ンが停止し、入力端子への接続が分断された時には、本
発明の回路は、レギュレータが作動するのを確実に防止
でき、バッテリーの放電を防ぐ。本発明は、上述の実施
例や図面に限定されるものではなく、また、当業者が実
施しうるような変形例を含むものである。
【００４８】
【発明の効果】極めて簡単で安価に、信頼性の高いフェ
ーズ間の電圧検波の整流回路を提供できる。特に高周波
数の干渉信号を防止することができる。この回路は、交
流発電機とフェーズ信号の入力端子との間が分断された
場合にも適用できる。交流発電機が回転していない(エ
ンジンが止まっている)時に、レギュレータの作動を確
実に防止するので、車両バッテリーの放電が防止され
る。
【００４９】レギュレータは、交流発電機が回転してい
る時のみに、レギュレータを作動させることができ、
（Ｖφ１）と（Ｖφ２）の電圧差が、高周波干渉信号ま
たは交流発電機のステータ巻線の分断により妨害されて
いる時にも同様である。コンデンサ（Ｃ１）（Ｃ２）の
フィルタリング及び遅延回路（ＣＴ１）（ＣＴ２）によ
る遅延で、入力端子（φ１）（φ２）に発生する短期間
の高周波干渉信号を防止できる。
【００５０】図１の回路と同様に、図２の回路を、極め
て容易に１つのシリコンチップに集積でき、場所をとら
ず、またコストも安い。ＮＯＲゲート（Ｐ１）は、２つ
の遅延回路からの出力信号を取り纏め、２つの遅延回路
のうちの少なくとも１つがゼロにリセットされない時
は、常に、出力端子（Ｓ１）の出力信号は低レベルにな
り、レギュレータは作動しない。
【図面の簡単な説明】
【図１】本発明の第１の実施例を示す電気回路図であ
る。
【図２】本発明の第２の実施例を示す電気回路図であ
る。
【符号の説明】
Ｔ１〜Ｔ１２ トランジスタ φ１、φ２ フェーズ入力端子；フェーズ信号 Ｃ１〜Ｃ４ コンデンサ Ｔ３０，Ｔ４０ ＭＯＳＦＥＴ（制御スイッチ手段） ＣＴ１，ＣＴ２ 遅延回路 Ｐ１ ＮＯＲゲート（論理ゲート） Ｓ１〜Ｓ３ 論理出力端子 Ｒ１〜Ｒ４０ 抵抗 Ｚ１〜Ｚ６ ツェナーダイオード Ｄ１〜Ｄ４０ ダイオード ＵB+ バッテリー電源 ＵB+com 電源 ＲＳ ゼロ・リセット入力 ＣＫ 入力端子 Ｔ１〜Ｔ４ 比較器手段 Ｔ５〜Ｔ７ 処理回路(ミラー積分回路網型弁別回
路)
フロントページの続き (73)特許権者 592028743 エス ジー エス トムソン マイクロ エレクトロニクス エッセ エルレ エ ッレ ＳＧＳ−ＴＨＯＭＳＯＮ ＭＩＣＲＯＥ ＬＥＣＴＲＯＮＩＣＳ ＳＯＣＩＥＴＡ Ａ ＲＥＳＰＯＮＳＡＢＩＬＩＴＡ ＬＩＭＩＴＡＴＡ イタリア国 20041 アグラーテ ブリ アンザ ヴィア チ オリヴェッティ ２ (72)発明者 アレッシオ ペンニーシ イタリア国 20149 ミラノ ヴィア アルクイノ ５ (72)発明者 ファビオ マルキーオ イタリア国 21013 ガララーテ ヴィ ア ヂュスチ 10 (72)発明者 ジャン・マリ ピエレ フランス国 75012 パリ リュ スィ ビュ 24 (72)発明者 ディディエ カニトロ フランス国 94100 サン・モール デ フォス リュ ルイ ブライユ 54 (56)参考文献 特開 昭59−188399（ＪＰ，Ａ) 特開 昭61−8677（ＪＰ，Ａ) 欧州特許出願公開408436（ＥＰ，Ａ １) (58)調査した分野(Int.Cl.7，ＤＢ名) H02J 7/24 G01R 19/22 H03G 3/20

Claims (10)

    (57)【特許請求の範囲】
  1. 【請求項１】 多相の交流発電機が発生した一対のフェ
    ーズ信号(φ１）（φ２)間の電圧の大きさを比較する比
    較手段を有する回路を備える、前記交流発電機による自
    動車用バッテリーの充電を調節するレギュレータを制御
    する電圧の検出回路において、 比較手段は、一対のバイポーラ型のトランジスタ(Ｔ
    １）（Ｔ２)を備え、比較手段の第１の入力端子は、第
    １のトランジスタ（Ｔ１）のベースと第２のトランジス
    タ（Ｔ２）のエミッタとに接続され、比較手段の第２の
    入力端子は、第２のトランジスタ（Ｔ２）のベースと第
    １のトランジスタ（Ｔ１）のエミッタに接続され、トラ
    ンジスタ（Ｔ１）（Ｔ２）のコレクタは、ＯＲ論理回路
    の入力端子に接続され、各トランジスタ（Ｔ１）（Ｔ
    ２）は、相間の電圧とエミッタ/ベース接合電圧による
    各閾値電圧とを比較する比較手段をなし、前記閾値電圧
    は、小電圧であり、反対極性を有し、前記ＯＲ論理回路
    は、フェーズ信号間の電圧差の絶対値が前記閾値電圧よ
    りも高いことを示す信号を出力するようになっているこ
    とを特徴とする検出回路。
  2. 【請求項２】 比較手段を構成するトランジスタ(Ｔ
    １）（Ｔ２)の各出力信号は、信号整形のためのトラン
    ジスタ(Ｔ３）（Ｔ４)のベースに出力されることを特徴
    とする請求項１記載の検出回路。
  3. 【請求項３】 各トランジスタ（Ｔ３）（Ｔ４）のコレ
    クタは、抵抗（Ｒ１）（Ｒ２）（Ｒ３）、コンデンサ
    （Ｃ１）及びＭＯＳＦＥＴ（Ｔ３０）からなるフィルタ
    回路のアセンブリと、抵抗（Ｒ４）（Ｒ５）（Ｒ６）、
    コンデンサ（Ｃ２）及びＭＯＳＦＥＴ（Ｔ４０）からな
    るフィルタ回路のアセンブリにそれぞれ接続されている
    ことを特徴とする請求項２記載の検出回路。
  4. 【請求項４】 一方のフィルタ回路はコンデンサ（Ｃ
    １）を備え、トランジスタ（Ｔ１）がオンすると第１定
    格で充電され、トランジスタ（Ｔ２）がオンすると、第
    １定格よりも大きい第２定格でＭＯＳＦＥＴ（Ｔ３０）
    を介して放電され、他方のフィルタ回路はコンデンサ
    （Ｃ２）を備え、トランジスタ（Ｔ２）がオンすると第
    １定格で充電され、トランジスタ（Ｔ１）がオンする
    と、第１定格よりも大きい第２定格でＭＯＳＦＥＴ（Ｔ
    ４０）を介して放電されることを特徴とする請求項３記
    載の検出回路。
  5. 【請求項５】 一方のフィルタ回路は、カウンタをなす
    遅延回路(ＣＴ１）と接続され、他方のフィルタ回路
    は、カウンタをなす遅延回路（ＣＴ２)と接続され、関
    連するフィルタ回路のコンデンサ(Ｃ１）（Ｃ２)の端子
    上の電圧が、定格より大きい率で所定の電圧を越えると
    きのみ、各遅延回路の出力端子が論理状態の長さを変更
    することを特徴とする請求項４記載の検出回路。
  6. 【請求項６】 各遅延回路（ＣＴ１）（ＣＴ２）は、関
    連するフィルタ回路のコンデンサ(Ｃ１）（Ｃ２)の端子
    上の電圧を受け取るゼロ・リセット入力を有し、かつそ
    の出力は、ハイランクビットの出力からなることを特徴
    とする請求項５記載の検出回路。
  7. 【請求項７】 ２つの遅延回路(ＣＴ１）（ＣＴ２)の出
    力端子は、論理ゲートであるＮＯＲゲート（Ｐ１）の入
    力端子に接続され、ＮＯＲゲート（Ｐ１）からの出力信
    号は、レギュレータを作動させるか否かを決定すること
    を特徴とする請求項６記載の検出回路。
  8. 【請求項８】 一方のフェーズ信号の電圧が、エミッタ
    /ベース接合電圧である第３閾値電圧より低く、かつ、
    他方のフェーズ信号の電圧が、バッテリー電圧の半分近
    辺の第４閾値電圧より大きい状態であるか否かを検出す
    る、トランジスタ(Ｔ９）及びトランジスタ（Ｔ１０)か
    らなる第１の追加的な比較手段を備え、前記状態でない
    場合には、交流発電機の励磁電流が増加することを特徴
    とする請求項１〜７のいずれかに記載の検出回路。
  9. 【請求項９】 一方のフェーズ信号の電圧が、エミッタ
    /ベース接合電圧である第５閾値電圧より低く、他方の
    フェーズ信号の電圧が、バッテリー電圧近辺の第６閾値
    電圧より大きい状態であるか否かを検出する、トランジ
    スタ(Ｔ１１）及びトランジスタ（Ｔ１２)からなる第２
    の追加的な比較手段を備え、前記状態でない場合には、
    故障を示す信号を出力することを特徴とする請求項８記
    載の検出回路。
  10. 【請求項１０】 交流発電機が回転して、検出回路がレ
    ギュレータを作動させることを検出した時のみ、前記第
    １及び第２の追加的な比較手段が作動するようになって
    いることを特徴とする請求項９記載の検出回路。
JP18461492A 1991-06-18 1992-06-18 多相交流発電機の相間の電圧を検出する検出回路 Expired - Lifetime JP3425648B2 (ja)

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