JP3254159B2 - 充放電制御回路 - Google Patents
充放電制御回路Info
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Description
電を制御することができる充放電制御回路とその回路を
利用した充電式電源装置に関する。
としては、図2の回路ブロック図に示すような電源装置
が知られていた。図2において、外部端子−V0 または
+V0にスイッチ回路203、電流センス用抵抗204
を介して二次電池201が接続されている。さらに二次
電池201に並列に接続してスイッチ制御回路202、
及び過電流検出回路205が設けられている。
1の電圧を検出する機能を備え、201の電圧が過充電
状態、または過放電状態のいずれかの場合は、スイッチ
回路203をOFFするようにスイッチ制御回路202
から信号がでる。また負荷に異常が起こり、過電流状態
となった時、電流センス用抵抗204の電圧をコンパレ
ータ212がモニターし、基準電圧回路206の基準電
圧と比較する。
を、VREF [V]、電流センス用抵抗204の抵抗値をR
[Ω](この時、スイッチ回路203のON抵抗は、R
より十分小さいものとする)、そこに流れる電流をI
[A]とすれば、 I≧VREF/R[A] ・・・・・(1) の時、コンパレータ212の出力が”H”から”L”と
なり、スイッチ回路203をOFFする。これにより過
電流状態の場合にもスイッチ回路203が同様にOFF
して外部端子−V0 、+V0 に接続している負荷へのエ
ネルギー供給をストップする。 更に、図3に示された
ように負荷に容量313が接続された場合、容量313
に電荷が蓄積されていなければ二次電池301が容量3
13を蓄積するために瞬間的に電流を流すために二次電
池301の電圧が低下してしまい、過電流状態になって
しまう。このために、過電流検出には遅延時間を設け、
容量に電荷を蓄積する時間は過電流を検出しない様な構
成となっている。即ちスイッチ制御回路302は、二次
電池301と外部端子との間のスイッチ回路303を制
御することで、二次電池301への過充電を防止すると
共に、二次電池301から外部端子に接続した負荷への
エネルギー供給による二次電池301の過渡の蓄電能力
低下を防いでいる。また、負荷が何らかの異常で大電流
を消費した時には過電流検出となり、この場合にもスイ
ッチ回路303が同様にOFFして放電を停止する。
制御回路では、過電流検出に於いて次の様な欠点があ
る。過電流検出用抵抗の電圧検出回路の検出電圧と遅延
時間は、予め想定される負荷が消費する電流とその電流
を消費する時間によって、ただ1組設定される。この電
源装置に、予め想定された以外の負荷が接続されるか、
或は負荷の異常により、負荷が予め想定した電流を超え
る電流を消費した場合、過電流検出回路により遅延時間
経過後スイッチ回路をOFFし、負荷へのエネルギー供
給をストップする前に、該スイッチ回路が発熱し破壊に
至ってしまうという課題があった。
な課題を解決するため、負荷で消費する異なる電流に対
して、異なる2種類以上の過電流検出用抵抗の電圧検出
回路の検出電圧と遅延時間を設定し、負荷電流に応じた
遅延時間経過後に過電流検出を行い、該スイッチ回路が
発熱し破壊に至る前に、放電を停止させたる充放電制御
回路を得ることである。
に、本発明の充放電制御回路では、過電流検出端子の2
種類以上の異なる電圧を検出する回路を設けると共に、
前記回路の信号を受けて放電制御をおこなうことで2種
類以上の異なる負荷電流に対して、適切な遅延時間で放
電停止の機能が図れるようにした。
おいては、負荷で消費する電流により過電流検出状態と
なった時、負荷電流に対して適切な遅延時間経過後に放
電を停止し、該スイッチ回路の破壊を防ぐように作動
し、遅延時間経過前に過電流検出状態から開放されたと
きは、負荷への放電を継続することにより、機器全体の
信頼性と動作の安定性を高めることとなる。
図に基づいて説明する。図1は、本発明の充放電制御回
路の回路ブロック図である。二次電池として電池101
が充放電制御回路の電源端子+V0と−V0との間に挿入
されている。外部端子−V0は電流センス用抵抗10
4、スイッチ回路103を介して二次電池101の負極
側に接続されている。さらに二次電池101に並列にス
イッチ制御回路102、電源電圧の大きさにかかわらず
一定の基準電圧を発生する事の出来る基準電圧回路10
5と基準電圧回路106が接続されている。基準電圧回
路105は基準電圧111を出力し、コンパレータ回路
107の+入力端子に接続され、基準電圧回路106は
基準電圧112を出力し、コンパレータ回路108の+
入力端子に接続されている。更に、コンパレータ回路1
07の出力は遅延回路109に入力され、コンパレータ
回路108の出力は遅延回路110に入力されている。
遅延回路109及び遅延回路110の出力は、スイッチ
制御回路102に入力される。二次電池101の電圧は
スイッチ制御回路102の内部にある過充電検出回路お
よび過放電検出回路により検出されており、過充電状態
および過放電状態になった場合はスイッチ回路103を
OFFするようにスイッチ制御回路102から信号が出
力される。過電流検出のために、コンパレータ107が
電流センス用抵抗104の電圧と基準電圧111を比較
し、また、コンパレータ108が電流センス用抵抗10
4の電圧と基準電圧112を比較している。スイッチ回
路103はFET(Field Effect Tran
sistor)等で構成されることもある。この様な場
合、スイッチ回路103自体が有限の抵抗値を持つため
電流センス用抵抗104は不要となる。
5の基準電圧111は基準電圧回路106の基準電圧1
12よりも高く設定され、遅延回路109の遅延時間は
遅延回路110の遅延時間よりも短く設定されているも
のとする。この様に設定すると、過電流状態が発生して
電流センス用抵抗104の電圧が基準電圧112よりも
高く、基準電圧111よりも低い状態を保持した場合
は、遅延回路110で予め設定された遅延時間後にスイ
ッチ制御回路102によりスイッチ回路103をOFF
するように働く。また同様に過電流状態が発生して、基
準電圧回路105の基準電圧111よりも電流センス用
抵抗104の電圧が高くなった状態を保持した場合は、
遅延回路110が働く前に遅延回路109で予め設定さ
れた遅延時間後にスイッチ制御回路102によりスイッ
チ回路103をOFFするように働く。遅延回路109
と遅延回路110は、一定の遅延時間が得られればどの
様な回路でもよい。スイッチ制御回路102は単純にロ
ジック信号の制御であり、スイッチ回路103にあわせ
て出力形態を変えることができる。
遅延回路を一組追加して、3種類の過電流状態を検出
し、それぞれ異なる遅延時間後にスイッチ制御回路40
2によりスイッチ回路403をOFFするように働く。
基準電圧回路406の基準電圧412は基準電圧回路4
07の基準電圧413よりも高く設定され、基準電圧回
路407の基準電圧413は基準電圧回路408の基準
電圧414よりも高く設定されているとする。さらに、
遅延回路415の遅延時間は遅延回路416の遅延時間
よりも短く設定され、遅延回路416の遅延時間は遅延
回路417の遅延時間よりも短く設定されている。この
様に設定すると、過電流状態が発生して電流センス用抵
抗404の電圧が基準電圧414よりも高く、基準電圧
413よりも低い状態を保持した場合は、遅延回路41
7で予め設定された遅延時間後にスイッチ制御回路40
2によりスイッチ回路403をOFFするように働く。
また同様に過電流状態が発生して、電流センス用抵抗4
04の電圧が基準電圧413よりも高く、基準電圧41
2よりも低い状態を保持した場合は、遅延回路417が
働く前に遅延回路416で予め設定された遅延時間後に
スイッチ制御回路402によりスイッチ回路403をO
FFするように働く。更に、電流センス用抵抗404の
電圧が基準電圧412よりも高くなった状態を保持した
場合は、遅延回路416と遅延回路417が働く前に遅
延回路415で予め設定された遅延時間後にスイッチ制
御回路402によりスイッチ回路403をOFFするよ
うに働く。
延回路の遅延時間の種類を増やせば、同様な方法で過電
流検出端子の複数の異なる電圧を検出出来ると共に、複
数の異なる負荷電流に対して適切な遅延時間で放電の停
止が図れる。図5は、本発明の別の実施の形態を示す回
路ブロック図である。
だけで、基準電圧回路505の基準電圧511はコンパ
レータ回路507とコンパレータ回路508のそれぞれ
+入力端子に接続されている。コンパレータ回路507
とコンパレータ回路508のいずれか一方にはオフセッ
トを持たせてあり、コンパレータ回路507のほうがコ
ンパレータ回路508よりも高い入力電位でコンパレー
タの出力が反転するように設定されているものとする。
さらに、遅延回路509の遅延時間は遅延回路510の
遅延時間よりも短く設定されているものとする。この様
に設定すると、過電流状態が発生して電流センス用抵抗
504の電圧がコンパレータ回路508の反転電位より
も高く、コンパレータ回路507の反転電位よりも低い
状態を保持した場合は、遅延回路510で予め設定され
た遅延時間後にスイッチ制御回路502によりスイッチ
回路503をOFFするように働く。また同様に過電流
状態が発生して、電流センス用抵抗504の電圧がコン
パレータ回路507の反転電位よりも高くなった状態を
保持した場合は、遅延回路510が働く前に遅延回路5
09で予め設定された遅延時間後にスイッチ制御回路5
02によりスイッチ回路503をOFFするように働
く。
タ回路と、遅延回路の遅延時間の種類を増やせば、同様
な方法で過電流検出端子の複数の異なる電圧を検出出来
ると共に、複数の異なる負荷電流に対して適切な遅延時
間で放電の停止が図れる。図6は、図1において二つの
遅延回路を抵抗とコンデンサで一つにまとめた実施例で
ある。
ルFET609のゲートに入力され、コンパレータ回路
608の出力はPチャネルFET610のゲートに入力
されている。PチャネルFET609のドレインは抵抗
614の一端に接続され、PチャネルFET610のド
レインは抵抗615の一端に接続されている。抵抗61
4の他端は、抵抗615の他端に接続されているととも
にコンデンサ613に接続され、さらにスイッチ制御回
路602に入力されている。基準電圧回路605の基準
電圧611は基準電圧回路606の基準電圧612より
も高く設定されているものとする。この様に設定する
と、過電流状態が発生して電流センス用抵抗604の電
圧が基準電圧612よりも高く、基準電圧611よりも
低い状態を保持した場合は、PチャネルFET610が
オンして抵抗615とコンデンサ613の定数で設定さ
れた遅延時間後にスイッチ制御回路602によりスイッ
チ回路603をOFFするように働く。また同様に過電
流状態が発生して、基準電圧回路605の基準電圧61
1よりも電流センス用抵抗604の電圧が高くなった状
態を保持した場合は、PチャネルFET609とPチャ
ネルFET610がオンして抵抗614と抵抗615の
並列の抵抗値とコンデンサ613の定数で設定された遅
延時間後、すなわち抵抗615とコンデンサ613の定
数で設定された遅延時間よりも短い遅延時間後にスイッ
チ制御回路602によりスイッチ回路603をOFFす
るように働く。
チャネルFETと抵抗の数を増やせば、同様な方法で過
電流検出端子の複数の異なる電圧を検出出来ると共に、
複数の異なる負荷電流に対して適切な遅延時間で放電の
停止が図れる。図7は、図6において抵抗614と抵抗
615をそれぞれ定電流源714と定電流源710に置
き換えた場合の実施例で、図6と同様に働く。図7にお
いても、基準電圧回路の基準電圧出力と、PチャネルF
ETと定電流源の数を増やせば、同様な方法で過電流検
出端子の複数の異なる電圧を検出出来ると共に、複数の
異なる負荷電流に対して適切な遅延時間で放電の停止が
図れる。
抗とコンデンサで一つにまとめた別の実施例である。コ
ンパレータ回路807の出力はPチャネルFET809
のゲートに入力され、コンパレータ回路808の出力は
PチャネルFET810のゲートに入力されている。P
チャネルFET810のドレインは抵抗814の一端に
接続されているとともにPチャネルFET809のソー
スに接続されている。PチャネルFET809のドレイ
ンは抵抗814の他端に接続されているとともに抵抗8
15の一端に接続されている。抵抗815の他端はコン
デンサ813に接続され、さらにスイッチ制御回路80
2に入力されている。基準電圧回路805の基準電圧8
11は基準電圧回路806の基準電圧812よりも高く
設定されているものとする。この様に設定すると、過電
流状態が発生して電流センス用抵抗804の電圧が基準
電圧812よりも高く、基準電圧811よりも低い状態
を保持した場合は、PチャネルFET810がオンして
抵抗814と抵抗815の直列の抵抗値とコンデンサ8
13の定数で設定された遅延時間後にスイッチ制御回路
802によりスイッチ回路803をOFFするように働
く。また同様に過電流状態が発生して、基準電圧回路8
05の基準電圧811よりも電流センス用抵抗804の
電圧が高くなった状態を保持した場合は、PチャネルF
ET809とPチャネルFET810がオンして抵抗8
15とコンデンサ813の定数で設定された遅延時間
後、すなわち抵抗814と抵抗815の直列の抵抗値と
コンデンサ813の定数で設定された遅延時間よりも短
い遅延時間後にスイッチ制御回路802によりスイッチ
回路803をOFFするように働く。
チャネルFETと抵抗の数を増やせば、同様な方法で過
電流検出端子の複数の異なる電圧を検出出来ると共に、
複数の異なる負荷電流に対して適切な遅延時間で放電の
停止が図れる。図9は、図6において抵抗とコンデンサ
の位置を逆にした場合の実施例である。基準電圧回路9
05は基準電圧911を出力し、コンパレータ回路90
7の−入力端子に接続され、基準電圧回路906は基準
電圧912を出力し、コンパレータ回路908の−入力
端子に接続されている。コンパレータ回路907の出力
はNチャネルFET909のゲートに入力され、コンパ
レータ回路908の出力はNチャネルFET910のゲ
ートに入力されている。NチャネルFET909のドレ
インは抵抗914の一端に接続され、NチャネルFET
910のドレインは抵抗915の一端に接続されてい
る。抵抗914の他端は、抵抗915の他端に接続され
ているとともにコンデンサ913に接続され、さらにス
イッチ制御回路902に入力されている。基準電圧回路
905の基準電圧911は基準電圧回路906の基準電
圧912よりも高く設定されているものとする。この様
に設定すると、過電流状態が発生して電流センス用抵抗
904の電圧が基準電圧912よりも高く、基準電圧9
11よりも低い状態を保持した場合は、NチャネルFE
T910がオンして抵抗915とコンデンサ913の定
数で設定された遅延時間後にスイッチ制御回路902に
よりスイッチ回路903をOFFするように働く。また
同様に過電流状態が発生して、基準電圧回路905の基
準電圧911よりも電流センス用抵抗904の電圧が高
くなった状態を保持した場合は、NチャネルFET90
9とNチャネルFET910がオンして抵抗914と抵
抗915の並列の抵抗値とコンデンサ913の定数で設
定された遅延時間後、すなわち抵抗915とコンデンサ
913の定数で設定された遅延時間よりも短い遅延時間
後にスイッチ制御回路902によりスイッチ回路903
をOFFするように働く。
チャネルFETと抵抗の数を増やせば、同様な方法で過
電流検出端子の複数の異なる電圧を検出出来ると共に、
複数の異なる負荷電流に対して適切な遅延時間で放電の
停止が図れる。また、抵抗を定電流源に置き換えた場合
でも同様に働く。
コンパレータ回路、遅延回路がいづれも一つづつとなっ
ているが、遅延回路に温度特性を持たせてある。遅延回
路1009は温度が低いと遅延時間が長くなり、温度が
高いと遅延時間が短くなるように設定され、遅延回路1
009はスイッチ回路の発熱の影響を受ける位置に配置
されているものとする。この様に設定すると、過電流状
態が発生して電流センス用抵抗1004の電圧が基準電
圧1011よりも高い場合は、遅延回路1009で予め
設定された遅延時間後にスイッチ制御回路1002によ
りスイッチ回路1003をOFFするように働く。過電
流値が大きい場合等で前記遅延時間前にスイッチ回路1
003が発熱した場合は、遅延回路1009の遅延時間
が短くなり、スイッチ回路1003が破壊に至る前に、
スイッチ回路1003をOFFするように働く。
消費する電流に応じた遅延時間後に放電を停止するとい
う回路構成としたので、充電式電源装置において、負荷
に異常(例えばショート状態)が発生し過剰な電流が流
れ、従来の予測された過電流状態以上の電流が消費され
ても、スイッチ回路が発熱で破壊に至るよりも短い遅延
時間で、スイッチ回路をOFFするように働くため、製
品の使用範囲が広がると共に信頼性が向上するという効
果がある。
た説明図である。
説明図である。
ック図である。
の本発明の充放電制御回路の回路ブロックを示した説明
図である。
タ回路のオフセット電圧を変えた場合の本発明の充放電
制御回路の回路ブロックを示した説明図である。
だ場合の本発明の充放電制御回路の回路ブロックを示し
た説明図である。
組んだ場合の本発明の充放電制御回路の回路ブロックを
示した説明図である。
だ他の場合の本発明の充放電制御回路の回路ブロックを
示した説明図である。
だもう一つの場合の本発明の充放電制御回路の回路ブロ
ックを示した説明図である。
を一つにして遅延回路の遅延時間に温度特性を持たせた
場合の本発明の充放電制御回路の回路ブロックを示した
説明図である。
Claims (2)
- 【請求項1】 電流センス用抵抗の両端の電圧を検出
し、その出力検出信号に遅延を与える充放電制御回路に
おいて、基準電圧を出力する1つの基準電圧回路と、 一方はオフセットを持ち、それぞれ異なるマイナス入力
端子の入力電圧により反転出力し、それぞれ前記基準電
圧をプラス入力端子に入力する第1及び第2のコンパレ
ータ回路と、 それぞれ前記コンパレータ回路の出力信号を異なる遅延
時間にて遅延する第1及び第2の遅延回路と、 を有する
ことを特徴とする充放電制御回路。 - 【請求項2】 電流センス用抵抗の両端の電圧を検出
し、その出力検出信号に遅延を与える充放電制御回路に
おいて、前記電圧の少なくとも異なる2つの電圧値にて検出する
ための第1及び第2のコンパレータ回路と、 外部端子に接続され、それぞれ前記第1及び第2のコン
パレータ回路からの信号によりオンされる第1及び第2
のFETと、それぞれ一端が前記第1及び第2のFET
に接続された第1及び第2の定電流源と、それぞれの前
記第1及び第2の定電流源の他端に接続された1つのコ
ンデンサとからなる遅延回路と、を有することを特徴と
する 充放電制御回路。
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