JP3224505B2 - 液晶制御装置および液晶表示装置 - Google Patents
液晶制御装置および液晶表示装置Info
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Description
【０００１】
【発明の属する技術分野】本発明は液晶表示装置を使用
する携帯型パーソナルコンピュータ等の液晶制御装置お
よび液晶表示装置に関する。
する携帯型パーソナルコンピュータ等の液晶制御装置お
よび液晶表示装置に関する。
【０００２】ＴＦＴを使用した液晶表示装置（ＴＦＴ型
液晶表示装置と称する），あるいはＳＴＮ液晶による液
晶表示装置（ＳＴＮ型液晶表示装置と称する）のいずれ
も，液晶駆動用の回路素子の保護等のために液晶駆動電
源Ｖｄｄ（＝５ボルト）の印加から一定時間以内にクロ
ック信号（クロック（ＣＬＫ）と称する），データ信号
（データ（ＤＡＴＡ）と称する），水平同期信号（Ｈｓ
ｙｎｃと称する），垂直同期信号（Ｖｓｙｎｃと称す
る），データイネーブル信号（ＤＥと称する）の各信号
が供給される必要がある。また，電源供給を停止する場
合にも，液晶駆動信号の入力が終了から一定時間以内に
液晶駆動電源Ｖｄｄの供給を停止する必要がある。
液晶表示装置と称する），あるいはＳＴＮ液晶による液
晶表示装置（ＳＴＮ型液晶表示装置と称する）のいずれ
も，液晶駆動用の回路素子の保護等のために液晶駆動電
源Ｖｄｄ（＝５ボルト）の印加から一定時間以内にクロ
ック信号（クロック（ＣＬＫ）と称する），データ信号
（データ（ＤＡＴＡ）と称する），水平同期信号（Ｈｓ
ｙｎｃと称する），垂直同期信号（Ｖｓｙｎｃと称す
る），データイネーブル信号（ＤＥと称する）の各信号
が供給される必要がある。また，電源供給を停止する場
合にも，液晶駆動信号の入力が終了から一定時間以内に
液晶駆動電源Ｖｄｄの供給を停止する必要がある。
【０００３】
【従来の技術】図１０は従来の液晶制御装置と液晶表示
装置を示す。図１０において，１１１はＡＣアダプタで
あって，１００ボルトの商用交流電源を１７ボルトの直
流電圧に変換するものである。
装置を示す。図１０において，１１１はＡＣアダプタで
あって，１００ボルトの商用交流電源を１７ボルトの直
流電圧に変換するものである。
【０００４】１１２はバッテリである（バッテリ電圧は
８ボルト〜１７ボルトの範囲を変動する）。１１３はＤ
／Ｄコンバータであって，８ボルト〜１７ボルトの入力
電圧を，回路素子および液晶駆動用の電源電圧Ｖｄｄ
（５ボルト）およびＳＴＮ型液晶表示装置の場合に必要
なＶｅｅ（３０ボルト（カラー）もしくは−２０ボルト
（白黒））に変換して出力するものである。
８ボルト〜１７ボルトの範囲を変動する）。１１３はＤ
／Ｄコンバータであって，８ボルト〜１７ボルトの入力
電圧を，回路素子および液晶駆動用の電源電圧Ｖｄｄ
（５ボルト）およびＳＴＮ型液晶表示装置の場合に必要
なＶｅｅ（３０ボルト（カラー）もしくは−２０ボルト
（白黒））に変換して出力するものである。
【０００５】１１４は液晶表示装置である。１１５は液
晶駆動回路である。１２１は液晶制御装置である。
晶駆動回路である。１２１は液晶制御装置である。
【０００６】１２２はシーケンス制御回路であって、液
晶表示装置の電源電圧Ｖｄｄの供給の開始のタイミング
と液晶駆動信号（液晶駆動信号はクロック，データ，Ｈ
ｓｙｎｃ，Ｖｓｙｎｃ，ＤＥ，＊ＤＩＳＰＯＦＦ等の全
部もしくはその一部を意味する）の印加のタイミング，
および電源電圧Ｖｄｄの供給の停止と液晶駆動信号の停
止のタイミングの制御を行うものである。シーケンス制
御回路１２２は液晶制御回路１２３，本体論理部１２５
の制御を行うとともに，＊ＤＩＳＰＯＦＦ（表示終了信
号），ＤＥ信号を生成して液晶駆動回路１１５の制御を
行う。
晶表示装置の電源電圧Ｖｄｄの供給の開始のタイミング
と液晶駆動信号（液晶駆動信号はクロック，データ，Ｈ
ｓｙｎｃ，Ｖｓｙｎｃ，ＤＥ，＊ＤＩＳＰＯＦＦ等の全
部もしくはその一部を意味する）の印加のタイミング，
および電源電圧Ｖｄｄの供給の停止と液晶駆動信号の停
止のタイミングの制御を行うものである。シーケンス制
御回路１２２は液晶制御回路１２３，本体論理部１２５
の制御を行うとともに，＊ＤＩＳＰＯＦＦ（表示終了信
号），ＤＥ信号を生成して液晶駆動回路１１５の制御を
行う。
【０００７】１２３は液晶制御回路であってクロック，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ，ＤＥの液晶表示装置
への入力制御を行うものである。１２５は，本体論理部
である。
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ，ＤＥの液晶表示装置
への入力制御を行うものである。１２５は，本体論理部
である。
【０００８】図１０の構成の動作を説明する。電源スイ
ッチがオンにされ，Ｄ／Ｄコンバータ１１３が動作を開
始する。液晶駆動回路１１５，本体論理部１２５，シー
ケンス制御回路１２２，液晶制御回路１２３にＤ／Ｄコ
ンバータから電源電圧Ｖｄｄ（５Ｖ）が供給されそれぞ
れの動作を開始する（図１０では液晶駆動回路１１５に
対する以外のＶｄｄの信号線は省略している）。また，
液晶制御回路１２３は，本体論理部１２５に制御されて
クロック，データ，ＤＥ，Ｈｓｙｎｃ，Ｖｓｙｎｃを液
晶駆動回路１１５に供給し，データを表示する。本体論
理部１２５は＊ＤＩＳＰＯＦＦをＨとして液晶駆動回路
１１５を活性化する。また，電源スイッチがオフにされ
ると，そのことを本体論理部１２５が検出し，シーケン
ス制御回路１２２に通知するとともに，＊ＤＩＳＰＯＦ
ＦをＬとする。同時に，液晶制御回路１２３を制御して
液晶駆動回路１１５から液晶表示装置１１４に液晶駆動
信号が入力されることを停止する。シーケンス制御回路
１２２は，液晶駆動回路１１５への各駆動信号の供給が
停止された後の一定時間以内に液晶駆動回路１１５への
Ｖｄｄ（５Ｖ）供給を停止するようにＤ／Ｄコンバータ
１１３を制御する。
ッチがオンにされ，Ｄ／Ｄコンバータ１１３が動作を開
始する。液晶駆動回路１１５，本体論理部１２５，シー
ケンス制御回路１２２，液晶制御回路１２３にＤ／Ｄコ
ンバータから電源電圧Ｖｄｄ（５Ｖ）が供給されそれぞ
れの動作を開始する（図１０では液晶駆動回路１１５に
対する以外のＶｄｄの信号線は省略している）。また，
液晶制御回路１２３は，本体論理部１２５に制御されて
クロック，データ，ＤＥ，Ｈｓｙｎｃ，Ｖｓｙｎｃを液
晶駆動回路１１５に供給し，データを表示する。本体論
理部１２５は＊ＤＩＳＰＯＦＦをＨとして液晶駆動回路
１１５を活性化する。また，電源スイッチがオフにされ
ると，そのことを本体論理部１２５が検出し，シーケン
ス制御回路１２２に通知するとともに，＊ＤＩＳＰＯＦ
ＦをＬとする。同時に，液晶制御回路１２３を制御して
液晶駆動回路１１５から液晶表示装置１１４に液晶駆動
信号が入力されることを停止する。シーケンス制御回路
１２２は，液晶駆動回路１１５への各駆動信号の供給が
停止された後の一定時間以内に液晶駆動回路１１５への
Ｖｄｄ（５Ｖ）供給を停止するようにＤ／Ｄコンバータ
１１３を制御する。
【０００９】図１１は従来の液晶駆動制御装置の動作説
明図である（図１１ (a)， (b)の説明において図１０を
参照する）。図１１（ａ）はＴＦＴ型液晶表示装置の動
作に必要な条件を表すタイムチャートである。
明図である（図１１ (a)， (b)の説明において図１０を
参照する）。図１１（ａ）はＴＦＴ型液晶表示装置の動
作に必要な条件を表すタイムチャートである。
【００１０】Ｖｄｄは液晶表示装置に供給される電源電
圧である（Ｖｄｄは本体論理部１２５等の他の各回路に
供給される電源電圧と共通である）。液晶駆動回路１１
５へＶｄｄ（５Ｖ）の印加が開始されてから液晶駆動信
号（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）の印
加の開始時間ａが10ｍｓ以内ないしは50ｍｓ以内である
必要がある。また，電源を停止するときは，液晶駆動回
路１１５へのクロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎ
ｃの印加が終了してから，液晶駆動回路１１５へのＶｄ
ｄの供給を停止するまでの時間ｂが10ｍｓ以内ないしは
50ｍｓ以内である必要がある。
圧である（Ｖｄｄは本体論理部１２５等の他の各回路に
供給される電源電圧と共通である）。液晶駆動回路１１
５へＶｄｄ（５Ｖ）の印加が開始されてから液晶駆動信
号（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）の印
加の開始時間ａが10ｍｓ以内ないしは50ｍｓ以内である
必要がある。また，電源を停止するときは，液晶駆動回
路１１５へのクロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎ
ｃの印加が終了してから，液晶駆動回路１１５へのＶｄ
ｄの供給を停止するまでの時間ｂが10ｍｓ以内ないしは
50ｍｓ以内である必要がある。
【００１１】図１１（ｂ）はＳＴＮ型液晶表示装置の動
作に必要な条件を表すタイムチャートである。Ｖｄｄは
液晶表示装置に供給される電源電圧である（他の各回路
部に供給される電源電圧に共通）。
作に必要な条件を表すタイムチャートである。Ｖｄｄは
液晶表示装置に供給される電源電圧である（他の各回路
部に供給される電源電圧に共通）。
【００１２】Ｖｅｅは液晶への印加電圧であって，カラ
ーの場合に３０ボルト，白黒の場合にー２０ボルトであ
る。液晶駆動回路１１５へのＶｄｄの印加が開始された
後に液晶駆動信号（クロック，データ，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃ）およびＶｅｅの印加が開始される必要があり
（ｃ≧０ｍｓ），液晶駆動信号（クロック，データ，Ｈ
ｓｙｎｃ，Ｖｓｙｎｃ）およびＶｅｅの印加が開始され
た後に＊ＤＩＳＰＯＦＦをオフとする必要がある（ｃ＜
ｄ）。また，電源を停止するときは，まず＊ＤＩＳＰＯ
ＦＦをオフとした後に液晶駆動回路への液晶駆動信号
（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）および
Ｖｅｅの印加を終了する必要がある（ｅ≦ｆ）。さら
に，液晶駆動信号（クロック，データ，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃ）およびＶｅｅの印加が停止された後に液晶駆
動回路へのＶｄｄの印加が終了する必要がある（ｅ≧０
ｍｓ）。さらに電源が投入された時，液晶駆動回路への
Ｖｄｄ，Ｖｅｅの印加が開始された後に，＊ＤＩＳＰＯ
ＦＦが印加される必要がある。
ーの場合に３０ボルト，白黒の場合にー２０ボルトであ
る。液晶駆動回路１１５へのＶｄｄの印加が開始された
後に液晶駆動信号（クロック，データ，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃ）およびＶｅｅの印加が開始される必要があり
（ｃ≧０ｍｓ），液晶駆動信号（クロック，データ，Ｈ
ｓｙｎｃ，Ｖｓｙｎｃ）およびＶｅｅの印加が開始され
た後に＊ＤＩＳＰＯＦＦをオフとする必要がある（ｃ＜
ｄ）。また，電源を停止するときは，まず＊ＤＩＳＰＯ
ＦＦをオフとした後に液晶駆動回路への液晶駆動信号
（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）および
Ｖｅｅの印加を終了する必要がある（ｅ≦ｆ）。さら
に，液晶駆動信号（クロック，データ，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃ）およびＶｅｅの印加が停止された後に液晶駆
動回路へのＶｄｄの印加が終了する必要がある（ｅ≧０
ｍｓ）。さらに電源が投入された時，液晶駆動回路への
Ｖｄｄ，Ｖｅｅの印加が開始された後に，＊ＤＩＳＰＯ
ＦＦが印加される必要がある。
【００１３】
【発明が解決しようとする課題】図１２は発明が解決し
ようとする課題の説明図である。図１２ (a)は液晶表示
装置に対する各信号の供給のタイミングチャートであ
る。
ようとする課題の説明図である。図１２ (a)は液晶表示
装置に対する各信号の供給のタイミングチャートであ
る。
【００１４】Ｖｄｄの供給が開始されてから５ｍｓ後に
Ｈｓｙｎｃ，Ｖｓｙｎｃの供給があり，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃの供給が開始されてから２００ｍｓでクロッ
ク，ＤＥ，データの供給が開始された状態を示す。ま
た，電源スイッチがオフにされた時には，Ｖｄｄの供給
の停止と同時にクロック，ＤＥ，データ，Ｈｓｙｎｃ，
Ｖｓｙｎｃの供給が停止されている。
Ｈｓｙｎｃ，Ｖｓｙｎｃの供給があり，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃの供給が開始されてから２００ｍｓでクロッ
ク，ＤＥ，データの供給が開始された状態を示す。ま
た，電源スイッチがオフにされた時には，Ｖｄｄの供給
の停止と同時にクロック，ＤＥ，データ，Ｈｓｙｎｃ，
Ｖｓｙｎｃの供給が停止されている。
【００１５】図１２ (a)の場合において，Ｖｄｄの供給
の停止と同時にクロック，ＤＥ，データ，Ｈｓｙｎｃ，
Ｖｓｙｎｃの供給が停止されているので，電源電圧オフ
の時の動作のタイミングは図１１のタイミングの条件を
満たしている。しかし，電源スイッチをオンにした時
は，Ｖｄｄの供給の開始から２０５ｍｓ経過後にクロッ
ク，ＤＥ，データの供給が開始されているので図１１の
各信号を印加するタイミングの条件を満たしていない。
の停止と同時にクロック，ＤＥ，データ，Ｈｓｙｎｃ，
Ｖｓｙｎｃの供給が停止されているので，電源電圧オフ
の時の動作のタイミングは図１１のタイミングの条件を
満たしている。しかし，電源スイッチをオンにした時
は，Ｖｄｄの供給の開始から２０５ｍｓ経過後にクロッ
ク，ＤＥ，データの供給が開始されているので図１１の
各信号を印加するタイミングの条件を満たしていない。
【００１６】図１２ (b)は，Ｖｄｄの供給が開始されて
から２０５ｍｓ後に，液晶駆動信号（クロック，ＤＥ，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）の供給があり，Ｖｄ
ｄの供給の停止と同時にクロック，ＤＥ，データ，Ｈｓ
ｙｎｃ，Ｖｓｙｎｃの供給が停止されている状態を示
す。
から２０５ｍｓ後に，液晶駆動信号（クロック，ＤＥ，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）の供給があり，Ｖｄ
ｄの供給の停止と同時にクロック，ＤＥ，データ，Ｈｓ
ｙｎｃ，Ｖｓｙｎｃの供給が停止されている状態を示
す。
【００１７】図１２ (b)の場合も，Ｖｄｄの供給の停止
に対する他の信号のタイミングは図１１ (b)の条件を満
たしているが，Ｖｄｄの供給が開始されてから，２０５
ｍｓ後に液晶駆動信号（クロック，ＤＥ，データ，Ｈｓ
ｙｎｃ，Ｖｓｙｎｃ）が供給されているので，図１１の
各信号のタイミングに必要な条件を満たしていない。
に対する他の信号のタイミングは図１１ (b)の条件を満
たしているが，Ｖｄｄの供給が開始されてから，２０５
ｍｓ後に液晶駆動信号（クロック，ＤＥ，データ，Ｈｓ
ｙｎｃ，Ｖｓｙｎｃ）が供給されているので，図１１の
各信号のタイミングに必要な条件を満たしていない。
【００１８】液晶表示装置を備える電子機器を設計する
場合には，図１１の条件を満たすように本体論理部，シ
ーケンス制御回路，液晶制御回路を設計する必要がある
が，設計ミス等で図１２のように各信号のタイミングが
与えられ，液晶表示装置が正しく動作しないかもしくは
液晶表示装置の回路素子の破壊を生じることがあった。
場合には，図１１の条件を満たすように本体論理部，シ
ーケンス制御回路，液晶制御回路を設計する必要がある
が，設計ミス等で図１２のように各信号のタイミングが
与えられ，液晶表示装置が正しく動作しないかもしくは
液晶表示装置の回路素子の破壊を生じることがあった。
【００１９】本発明は，液晶表示装置を備える電子機器
の設計において上記の条件を考慮することなく，自動的
に上記の動作条件を満たす液晶制御装置を提供すること
を目的とする。
の設計において上記の条件を考慮することなく，自動的
に上記の動作条件を満たす液晶制御装置を提供すること
を目的とする。
【００２０】
【課題を解決するための手段】本発明は，電源供給を開
始されてから一定時間以内に液晶制御信号が入力される
必要のある液晶表示装置の液晶制御装置において，液晶
制御装置は液晶表示装置に対する電源供給の開始から上
記の一定時間以内にダミーの液晶制御信号を発生し，液
晶表示装置に入力するダミー信号発生部を備える構成を
もつ。
始されてから一定時間以内に液晶制御信号が入力される
必要のある液晶表示装置の液晶制御装置において，液晶
制御装置は液晶表示装置に対する電源供給の開始から上
記の一定時間以内にダミーの液晶制御信号を発生し，液
晶表示装置に入力するダミー信号発生部を備える構成を
もつ。
【００２１】図１は本発明の基本構成を示す図である。
図１において，１は電源部である。
図１において，１は電源部である。
【００２２】２は液晶表示装置である。３は液晶制御装
置である。４はダミー信号発生部であって，液晶表示装
置２に対するＶｄｄの供給の開始と液晶駆動信号の供給
の開始のタイミングの条件を満たすようにダミーの液晶
駆動信号（例えば，全画面を黒とする信号等）を供給す
るものである。
置である。４はダミー信号発生部であって，液晶表示装
置２に対するＶｄｄの供給の開始と液晶駆動信号の供給
の開始のタイミングの条件を満たすようにダミーの液晶
駆動信号（例えば，全画面を黒とする信号等）を供給す
るものである。
【００２３】５は液晶制御部であって，液晶駆動信号
（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ等）を液
晶表示装置２に供給するものである。６は本体論理部で
ある。
（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ等）を液
晶表示装置２に供給するものである。６は本体論理部で
ある。
【００２４】７は信号選択部であって，ダミーの液晶駆
動信号（ダミー信号）と本体側の本来の液晶駆動信号
（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ等）を入
力し，本来の液晶駆動信号の入力がない場合にはダミー
の液晶駆動信号を出力し，本来の液晶駆動信号の入力が
ある場合には本来の液晶制御信号を選択して出力するも
のである。
動信号（ダミー信号）と本体側の本来の液晶駆動信号
（クロック，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ等）を入
力し，本来の液晶駆動信号の入力がない場合にはダミー
の液晶駆動信号を出力し，本来の液晶駆動信号の入力が
ある場合には本来の液晶制御信号を選択して出力するも
のである。
【００２５】図１の本発明の基本構成の動作を説明す
る。電源スイッチのオンにより電源部１は液晶表示装置
２，液晶制御装置３等各部に電源（Ｖｄｄ）の供給を開
始する。
る。電源スイッチのオンにより電源部１は液晶表示装置
２，液晶制御装置３等各部に電源（Ｖｄｄ）の供給を開
始する。
【００２６】ダミー信号発生部４は電源電圧Ｖｄｄの供
給が開始されたことにより，電源電圧Ｖｄｄの印加と液
晶駆動信号の入力の開始のタイミングの条件を満たすよ
うに，例えば全画面黒のダミーの液晶駆動信号を発生し
て液晶表示装置２に供給する。ダミー信号は液晶制御部
５からの液晶駆動信号の発生があった時点で供給を停止
する。あるいはＶｄｄの供給の停止まで出し続けていて
も良い。その場合にはダミー信号を考慮して液晶駆動信
号の色のレベルを調整等をするようにする。あるいは信
号選択部７を設け，ダミー信号と本体側の本来の液晶駆
動信号を信号選択部７に入力するようにし，本来の液晶
駆動信号の入力がない場合にはダミーの液晶駆動信号を
出力し，本来の液晶駆動信号の入力がある場合には本来
の液晶制御信号を選択して出力して液晶表示装置２に供
給するようにしても良い。
給が開始されたことにより，電源電圧Ｖｄｄの印加と液
晶駆動信号の入力の開始のタイミングの条件を満たすよ
うに，例えば全画面黒のダミーの液晶駆動信号を発生し
て液晶表示装置２に供給する。ダミー信号は液晶制御部
５からの液晶駆動信号の発生があった時点で供給を停止
する。あるいはＶｄｄの供給の停止まで出し続けていて
も良い。その場合にはダミー信号を考慮して液晶駆動信
号の色のレベルを調整等をするようにする。あるいは信
号選択部７を設け，ダミー信号と本体側の本来の液晶駆
動信号を信号選択部７に入力するようにし，本来の液晶
駆動信号の入力がない場合にはダミーの液晶駆動信号を
出力し，本来の液晶駆動信号の入力がある場合には本来
の液晶制御信号を選択して出力して液晶表示装置２に供
給するようにしても良い。
【００２７】また，電源スイッチのオフにより各部に対
する電源電圧Ｖｄｄの供給が停止すると，それと同時に
液晶駆動信号の発生，ダミー信号の発生も停止する。図
２は本発明の基本構成の動作のタイムチャートの例を示
す。
する電源電圧Ｖｄｄの供給が停止すると，それと同時に
液晶駆動信号の発生，ダミー信号の発生も停止する。図
２は本発明の基本構成の動作のタイムチャートの例を示
す。
【００２８】図２において，Ｖｄｄは液晶表示装置およ
び他の回路部に対する電源電圧である。ダミー信号はダ
ミー信号発生部４の出力である。
び他の回路部に対する電源電圧である。ダミー信号はダ
ミー信号発生部４の出力である。
【００２９】クロック，ＤＥ，データ，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃは液晶制御部５の出力する液晶駆動信号であ
る。図２は，電源部１からのＶｄｄの供給の開始によ
り，ダミー信号発生部４はダミー信号を発生して液晶表
示装置２もしくは信号選択部７に供給する。そして，Ｖ
ｄｄの供給の開始から２０５ｍｓ後にクロック，ＤＥ，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃが液晶表示装置２に供
給される状態を表している。また，電源部１のＶｄｄの
供給の停止と，ダミー信号発生部４，液晶制御部５が動
作を停止し，ダミー信号，クロック，ＤＥ，データ，Ｈ
ｓｙｎｃ，Ｖｓｙｎｃの供給を停止する。
ｓｙｎｃは液晶制御部５の出力する液晶駆動信号であ
る。図２は，電源部１からのＶｄｄの供給の開始によ
り，ダミー信号発生部４はダミー信号を発生して液晶表
示装置２もしくは信号選択部７に供給する。そして，Ｖ
ｄｄの供給の開始から２０５ｍｓ後にクロック，ＤＥ，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃが液晶表示装置２に供
給される状態を表している。また，電源部１のＶｄｄの
供給の停止と，ダミー信号発生部４，液晶制御部５が動
作を停止し，ダミー信号，クロック，ＤＥ，データ，Ｈ
ｓｙｎｃ，Ｖｓｙｎｃの供給を停止する。
【００３０】図２の場合，Ｖｄｄの印加のタイミングと
クロック，ＤＥ，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃのタ
イミングの印加の関係は設計条件を満たしていないが，
ダミー信号がその条件を満たしているので液晶表示装置
２は正常に動作する。
クロック，ＤＥ，データ，Ｈｓｙｎｃ，Ｖｓｙｎｃのタ
イミングの印加の関係は設計条件を満たしていないが，
ダミー信号がその条件を満たしているので液晶表示装置
２は正常に動作する。
【００３１】
【発明の実施の形態】図３は本発明の実施例１である。
図３において，２０は電源部である。
図３において，２０は電源部である。
【００３２】２１はＡＣアダプタである。２２はバッテ
リである。２３はＤ／Ｄコンバータである。
リである。２３はＤ／Ｄコンバータである。
【００３３】２４は液晶表示装置である。２５は液晶駆
動回路である。３１はダミー信号発生部である。
動回路である。３１はダミー信号発生部である。
【００３４】３２はダミー信号発生回路であって，ダミ
ー信号を発生する回路である。３３は信号選択回路（図
１の信号選択部７に相当する）であって，液晶制御回路
３４の出力する液晶駆動信号（クロック，ＤＥ，デー
タ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）（本来の液晶駆動信号）
の入力の有無を判定し，本来の液晶駆動信号のない場合
にはダミー信号発生回路３２の出力するダミー信号を選
択して出力し，本来の液晶駆動信号のある場合には，本
来の液晶駆動信号を選択して出力するものである。
ー信号を発生する回路である。３３は信号選択回路（図
１の信号選択部７に相当する）であって，液晶制御回路
３４の出力する液晶駆動信号（クロック，ＤＥ，デー
タ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）（本来の液晶駆動信号）
の入力の有無を判定し，本来の液晶駆動信号のない場合
にはダミー信号発生回路３２の出力するダミー信号を選
択して出力し，本来の液晶駆動信号のある場合には，本
来の液晶駆動信号を選択して出力するものである。
【００３５】３４は液晶制御回路であって，液晶駆動信
号を出力するものである（図１の液晶制御部に相当す
る）。３５は本体論理部である。
号を出力するものである（図１の液晶制御部に相当す
る）。３５は本体論理部である。
【００３６】図３の本発明の実施例１の構成の動作を説
明する。電源スイッチ（図示せず）のオンによりＤ／Ｄ
コンバータ２３はＡＣアダプタ２１の出力（１７ボル
ト）もしくはバッテリ２２の出力（８〜１７ボルト）を
Ｖｄｄ（５ボルト）に変換して出力する。さらに，必要
ならばその入力電圧をＶｅｅ（３０ボルトもしくは−２
０ボルト）に変換して出力する。
明する。電源スイッチ（図示せず）のオンによりＤ／Ｄ
コンバータ２３はＡＣアダプタ２１の出力（１７ボル
ト）もしくはバッテリ２２の出力（８〜１７ボルト）を
Ｖｄｄ（５ボルト）に変換して出力する。さらに，必要
ならばその入力電圧をＶｅｅ（３０ボルトもしくは−２
０ボルト）に変換して出力する。
【００３７】Ｄ／Ｄコンバータ２３が供給する電源電圧
Ｖｄｄは，液晶駆動回路２５，本体論理部３５，液晶制
御回路３４，信号選択回路３３，ダミー信号発生回路３
２に供給され，それぞれの回路が動作を開始する。ダミ
ー信号発生回路３２は電源Ｖｄｄの供給を受けるとダミ
ーの液晶駆動信号（クロック，ＤＥ，データ，Ｈｓｙｎ
ｃ，Ｖｓｙｎｃ）を発生して信号選択回路３３に出力す
る。信号選択回路３３は液晶制御回路３４から本来の液
晶駆動信号の入力がなければ，ダミー信号を液晶駆動回
路２５に出力する。
Ｖｄｄは，液晶駆動回路２５，本体論理部３５，液晶制
御回路３４，信号選択回路３３，ダミー信号発生回路３
２に供給され，それぞれの回路が動作を開始する。ダミ
ー信号発生回路３２は電源Ｖｄｄの供給を受けるとダミ
ーの液晶駆動信号（クロック，ＤＥ，データ，Ｈｓｙｎ
ｃ，Ｖｓｙｎｃ）を発生して信号選択回路３３に出力す
る。信号選択回路３３は液晶制御回路３４から本来の液
晶駆動信号の入力がなければ，ダミー信号を液晶駆動回
路２５に出力する。
【００３８】本体論理部３５，液晶制御回路３４はＶｄ
ｄの供給を受けることにより動作を開始し，本体論理部
３５は本来の液晶駆動信号（クロック，ＤＥ，データ，
Ｈｓｙｎｃ，Ｖｓｙｎｃ）を発生し，液晶制御回路３４
は信号選択回路３３に出力する。信号選択回路３３は液
晶制御回路３４からの本来の液晶駆動信号の入力を判定
すると，その本来の液晶駆動信号を選択して液晶駆動回
路２５に出力する。
ｄの供給を受けることにより動作を開始し，本体論理部
３５は本来の液晶駆動信号（クロック，ＤＥ，データ，
Ｈｓｙｎｃ，Ｖｓｙｎｃ）を発生し，液晶制御回路３４
は信号選択回路３３に出力する。信号選択回路３３は液
晶制御回路３４からの本来の液晶駆動信号の入力を判定
すると，その本来の液晶駆動信号を選択して液晶駆動回
路２５に出力する。
【００３９】また，電源スイッチのオフによりＤ／Ｄコ
ンバータ２３はＶｄｄの出力を停止する（Ｖｅｅも停止
する）。そのため，装置各部に対する電源供給が停止
し，ダミー信号，本来の液晶駆動信号の発生も停止す
る。
ンバータ２３はＶｄｄの出力を停止する（Ｖｅｅも停止
する）。そのため，装置各部に対する電源供給が停止
し，ダミー信号，本来の液晶駆動信号の発生も停止す
る。
【００４０】図４は本発明のダミー信号発生部の実施例
である。図４において，２３はＤ／Ｄコンバータであ
る。
である。図４において，２３はＤ／Ｄコンバータであ
る。
【００４１】３１はダミー信号発生部である。３２はダ
ミー信号発生回路である。３３は信号選択部である。
ミー信号発生回路である。３３は信号選択部である。
【００４２】３４は液晶制御回路である。３５は本体論
理部である。信号選択部３３において，３８は判定回路
であって，液晶制御回路３４から供給される本来の液晶
駆動信号の入力を判定するものである。
理部である。信号選択部３３において，３８は判定回路
であって，液晶制御回路３４から供給される本来の液晶
駆動信号の入力を判定するものである。
【００４３】３９はマルチプレクサであって，本来の液
晶駆動信号の入力がない場合には，ダミー信号発生回路
３２の出力するダミー信号を出力し，本来の液晶駆動信
号の入力がある場合には，本来の液晶駆動信号を選択し
て出力するものである。
晶駆動信号の入力がない場合には，ダミー信号発生回路
３２の出力するダミー信号を出力し，本来の液晶駆動信
号の入力がある場合には，本来の液晶駆動信号を選択し
て出力するものである。
【００４４】４１は水晶発振器であって，クロック信号
を発生するものである。なお，図３において，Ｄ／Ｄコ
ンバータ２３の出力するＶｄｄはダミー信号発生部３１
の各回路部（水晶発振器４１，ダミー信号発生回路３
２，マルチプレクサ３９，判定回路３８）に印加され
る。また，Ｖｄｄは本体論理部３５，液晶制御回路３４
にも印加される（その電源供給の信号線は図示を省略さ
れている）。
を発生するものである。なお，図３において，Ｄ／Ｄコ
ンバータ２３の出力するＶｄｄはダミー信号発生部３１
の各回路部（水晶発振器４１，ダミー信号発生回路３
２，マルチプレクサ３９，判定回路３８）に印加され
る。また，Ｖｄｄは本体論理部３５，液晶制御回路３４
にも印加される（その電源供給の信号線は図示を省略さ
れている）。
【００４５】図４の構成の動作を説明する。電源スイッ
チのオンによりＤ／Ｄコンバータ２３は動作を開始し，
Ｖｄｄ（５ボルト）および必要ならばＶｅｅを出力す
る。Ｄ／Ｄコンバータ２３の発生するＶｄｄの供給を受
けて各回路部（水晶発振器４１，ダミー信号発生回路３
２，液晶制御回路３４等）が動作を開始し，水晶発振器
４１の発生するクロックを入力して，ダミー信号発生回
路３２はダミーの液晶駆動信号を発生しマルチプレクサ
３９に入力する。また，液晶制御回路３４から送られて
くる本来の液晶駆動信号（クロック，Ｈｓｙｎｃ，Ｖｓ
ｙｎｃ，ＤＥ，データ）はマルチプレクサ３９に入力さ
れる。
チのオンによりＤ／Ｄコンバータ２３は動作を開始し，
Ｖｄｄ（５ボルト）および必要ならばＶｅｅを出力す
る。Ｄ／Ｄコンバータ２３の発生するＶｄｄの供給を受
けて各回路部（水晶発振器４１，ダミー信号発生回路３
２，液晶制御回路３４等）が動作を開始し，水晶発振器
４１の発生するクロックを入力して，ダミー信号発生回
路３２はダミーの液晶駆動信号を発生しマルチプレクサ
３９に入力する。また，液晶制御回路３４から送られて
くる本来の液晶駆動信号（クロック，Ｈｓｙｎｃ，Ｖｓ
ｙｎｃ，ＤＥ，データ）はマルチプレクサ３９に入力さ
れる。
【００４６】判定回路３８は液晶制御回路３４からの本
来の液晶駆動信号の入力の有無を判定する。マルチプレ
クサ３９は本体論理部３５，液晶制御回路３４がＶｄｄ
を印加された直後であって，液晶駆動信号を入力してい
ない状態においては，判定回路３８の判定結果に従って
ダミーの液晶駆動信号を液晶駆動回路（図３参照）に出
力する。また，Ｖｄｄの供給を受けた後に充分に時間が
経過し，液晶制御回路３４から本来の液晶駆動信号が出
力された時には，判定回路３８は本来の液晶駆動信号の
入力を判定し，その判定結果に従ってマルチプレクサ３
９は液晶制御回路３４から出力される本来の液晶駆動信
号を選択して液晶駆動回路に出力する。
来の液晶駆動信号の入力の有無を判定する。マルチプレ
クサ３９は本体論理部３５，液晶制御回路３４がＶｄｄ
を印加された直後であって，液晶駆動信号を入力してい
ない状態においては，判定回路３８の判定結果に従って
ダミーの液晶駆動信号を液晶駆動回路（図３参照）に出
力する。また，Ｖｄｄの供給を受けた後に充分に時間が
経過し，液晶制御回路３４から本来の液晶駆動信号が出
力された時には，判定回路３８は本来の液晶駆動信号の
入力を判定し，その判定結果に従ってマルチプレクサ３
９は液晶制御回路３４から出力される本来の液晶駆動信
号を選択して液晶駆動回路に出力する。
【００４７】図５は本発明の実施例１のタイムチャート
である（ＴＦＴ型液晶表示装置）である。ＶはＡＣアダ
プタもしくはバッテリからＤ／Ｄコンバータに入力され
る＋８〜１７ボルトの電圧を表す。
である（ＴＦＴ型液晶表示装置）である。ＶはＡＣアダ
プタもしくはバッテリからＤ／Ｄコンバータに入力され
る＋８〜１７ボルトの電圧を表す。
【００４８】ＶｄｄはＤ／Ｄコンバータ２３から出力
される電源電圧（５ボルト）である。ダミー信号はダミ
ー信号発生回路３２から出力される信号である。
される電源電圧（５ボルト）である。ダミー信号はダミ
ー信号発生回路３２から出力される信号である。
【００４９】クロック，ＤＥ，データ，Ｈｓｙｎｃ，Ｖ
ｓｙｎｃは液晶制御回路３４から出力される液晶駆動信
号である。判定回路出力は判定回路３８の出力である。
ｓｙｎｃは液晶制御回路３４から出力される液晶駆動信
号である。判定回路出力は判定回路３８の出力である。
【００５０】マルチプレクサ出力はマルチプレクサ３９
の出力である。Ｄ／Ｄコンバータ２３から出力される電
源電圧Ｖｄｄは液晶駆動回路３４および水晶発振器４
１，ダミー信号発生回路３２等の各回路部に供給され
る。そして，Ｖｄｄの供給を受けて水晶発振器４１が動
作を開始し，ダミー信号発生回路３２はダミーの液晶駆
動信号を出力する。その後に，本体論理部３５，液晶制
御回路３４から本来の液晶駆動信号（クロック，ＤＥ，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）が出力される。
の出力である。Ｄ／Ｄコンバータ２３から出力される電
源電圧Ｖｄｄは液晶駆動回路３４および水晶発振器４
１，ダミー信号発生回路３２等の各回路部に供給され
る。そして，Ｖｄｄの供給を受けて水晶発振器４１が動
作を開始し，ダミー信号発生回路３２はダミーの液晶駆
動信号を出力する。その後に，本体論理部３５，液晶制
御回路３４から本来の液晶駆動信号（クロック，ＤＥ，
データ，Ｈｓｙｎｃ，Ｖｓｙｎｃ）が出力される。
【００５１】また，電源スイッチがオフによりＤ／Ｄコ
ンバータ２３の出力が停止することにより各回路部が一
斉に動作を停止し，本来の液晶駆動信号，ダミーの液晶
駆動信号もオフになる。
ンバータ２３の出力が停止することにより各回路部が一
斉に動作を停止し，本来の液晶駆動信号，ダミーの液晶
駆動信号もオフになる。
【００５２】図６は，本発明の実施例１のタイムチャー
トである（ＳＴＮ型液晶表示装置の場合）。図６におい
て，Ｖ＝＋８〜１７ボルトの信号，Ｖｄｄ，水晶発振器
出力，ダミー信号，クロック，ＤＥ，データ，Ｈｓｙｎ
ｃ，Ｖｓｙｎｃ，判定回路出力，マルチプレクサ出力の
各信号は図５と同じである。
トである（ＳＴＮ型液晶表示装置の場合）。図６におい
て，Ｖ＝＋８〜１７ボルトの信号，Ｖｄｄ，水晶発振器
出力，ダミー信号，クロック，ＤＥ，データ，Ｈｓｙｎ
ｃ，Ｖｓｙｎｃ，判定回路出力，マルチプレクサ出力の
各信号は図５と同じである。
【００５３】ＳＴＮ型液晶表示装置の場合には，Ｄ／Ｄ
コンバータ２３によりＶｄｄの供給が開始されるのと同
時に液晶制御用のＶｅｅ信号（カラー液晶の場合３０ボ
ルト，白黒液晶の場合−２０ボルト（図６は白黒の場合
を示す））および＊ＤＩＳＰＯＦＦ（ディスプレイのオ
ン，オフの制御信号）が発生する。
コンバータ２３によりＶｄｄの供給が開始されるのと同
時に液晶制御用のＶｅｅ信号（カラー液晶の場合３０ボ
ルト，白黒液晶の場合−２０ボルト（図６は白黒の場合
を示す））および＊ＤＩＳＰＯＦＦ（ディスプレイのオ
ン，オフの制御信号）が発生する。
【００５４】さらに，電源スイッチがオフになった時
は，Ｖｄｄの供給を停止すると同時にＶｅｅをＬとし，
＊ＤＩＳＰＯＦＦもＬとする。この点以外の各信号のタ
イミングの関係は図５と同様である。
は，Ｖｄｄの供給を停止すると同時にＶｅｅをＬとし，
＊ＤＩＳＰＯＦＦもＬとする。この点以外の各信号のタ
イミングの関係は図５と同様である。
【００５５】図７は本発明の実施例２である。図７は液
晶表示装置の内部に液晶表示装置用の電源回路および液
晶ダミー信号発生部を持つようにしたものである。
晶表示装置の内部に液晶表示装置用の電源回路および液
晶ダミー信号発生部を持つようにしたものである。
【００５６】図７において，４５は液晶電源回路であっ
て，液晶表示装置２４の電源回路である。図７において
図３もしくは図４と同じ参照番号の部分はそれぞれに同
じものである。
て，液晶表示装置２４の電源回路である。図７において
図３もしくは図４と同じ参照番号の部分はそれぞれに同
じものである。
【００５７】図７の構成の動作において，本体の電源ス
イッチのオンによりＤ／Ｄコンバータが動作を開始し，
Ｖｄｄ（５ボルト）を出力する。また，液晶電源回路
４５には本体側のＡＣアダプタ２１およびバッテリ２２
から電力が供給され，Ｄ／Ｄコンバータ２３からＶｄｄ
の供給を受けてＶｄｄ（５ボルト）を液晶表示装置
２４の各部に供給する。必要ならばさらにＶｅｅを液晶
駆動回路２５に供給する。そして，液晶表示装置２４に
おいて水晶発振器４１，ダミー信号発生回路３２，判定
回路３８，マルチプレクサ３９が動作し，ダミー信号お
よび本来の液晶駆動信号を入力し，電源スイッチがオン
とされた直後の本来の液晶駆動信号のない時にはダミー
信号を液晶駆動回路２５に出力する。また，Ｄ／Ｄコン
バータ２３の電源供給の停止と同時に液晶電源回路４５
も動作を停止し，ダミー信号の発生，本来の液晶駆動信
号の発生も停止する。
イッチのオンによりＤ／Ｄコンバータが動作を開始し，
Ｖｄｄ（５ボルト）を出力する。また，液晶電源回路
４５には本体側のＡＣアダプタ２１およびバッテリ２２
から電力が供給され，Ｄ／Ｄコンバータ２３からＶｄｄ
の供給を受けてＶｄｄ（５ボルト）を液晶表示装置
２４の各部に供給する。必要ならばさらにＶｅｅを液晶
駆動回路２５に供給する。そして，液晶表示装置２４に
おいて水晶発振器４１，ダミー信号発生回路３２，判定
回路３８，マルチプレクサ３９が動作し，ダミー信号お
よび本来の液晶駆動信号を入力し，電源スイッチがオン
とされた直後の本来の液晶駆動信号のない時にはダミー
信号を液晶駆動回路２５に出力する。また，Ｄ／Ｄコン
バータ２３の電源供給の停止と同時に液晶電源回路４５
も動作を停止し，ダミー信号の発生，本来の液晶駆動信
号の発生も停止する。
【００５８】図８は本発明の実施例２のタイムチャート
である（ＴＦＴ型液晶表示装置）。図８において，Ｖｄ
ｄはＤ／Ｄコンバータからの出力電圧（５ボルト）で
あり，Ｖｄｄは液晶電源回路の出力電圧（５ボルト）
である。それ以外の各信号は図５と同様である。また，
各信号の動作は前述した通りである。
である（ＴＦＴ型液晶表示装置）。図８において，Ｖｄ
ｄはＤ／Ｄコンバータからの出力電圧（５ボルト）で
あり，Ｖｄｄは液晶電源回路の出力電圧（５ボルト）
である。それ以外の各信号は図５と同様である。また，
各信号の動作は前述した通りである。
【００５９】図９は本発明の実施例２のタイムチャート
である（ＳＴＮ型液晶表示装置）。図９において，Ｖｄ
ｄはＤ／Ｄコンバータからの出力電圧（５ボルト）で
あり，Ｖｄｄは液晶電源回路の出力電圧（５ボルト）
である。それ以外の各信号は図６と同様である。また，
各信号の動作は前述した通りである。
である（ＳＴＮ型液晶表示装置）。図９において，Ｖｄ
ｄはＤ／Ｄコンバータからの出力電圧（５ボルト）で
あり，Ｖｄｄは液晶電源回路の出力電圧（５ボルト）
である。それ以外の各信号は図６と同様である。また，
各信号の動作は前述した通りである。
【００６０】
【発明の効果】本発明によれば，液晶表示装置に対する
電源電圧Ｖｄｄの供給の開始とともにダミーの液晶駆動
信号を発生するので，電源電圧Ｖｄｄの供給の開始から
一定時間以内に液晶駆動信号の供給を必要とする液晶表
示装置の制御回路の設計が容易になる。
電源電圧Ｖｄｄの供給の開始とともにダミーの液晶駆動
信号を発生するので，電源電圧Ｖｄｄの供給の開始から
一定時間以内に液晶駆動信号の供給を必要とする液晶表
示装置の制御回路の設計が容易になる。
【００６１】そのため，液晶表示装置を備える電子機器
の設計の負担が軽くなり，液晶表示装置に対する電源電
圧Ｖｄｄの印加と液晶駆動信号の印加タイミングの設計
ミス等をなくすことができ，電子機器に対する信頼性を
向上させることができる。
の設計の負担が軽くなり，液晶表示装置に対する電源電
圧Ｖｄｄの印加と液晶駆動信号の印加タイミングの設計
ミス等をなくすことができ，電子機器に対する信頼性を
向上させることができる。
【図１】本発明の基本構成を示す図である。
【図２】本発明の基本構成の動作のタイムチャートの例
を示す図である。
を示す図である。
【図３】本発明の実施例１を示す図である。
【図４】本発明のダミー信号発生部の実施例を示す図で
ある。
ある。
【図５】本発明の実施例１のタイムチャートを示す図で
ある（ＴＦＴ型液晶表示装置の場合）。
ある（ＴＦＴ型液晶表示装置の場合）。
【図６】本発明の実施例１のタイムチャートを示す図で
ある（ＳＴＮ型液晶表示装置の場合）。
ある（ＳＴＮ型液晶表示装置の場合）。
【図７】本発明の実施例２を示す図である。
【図８】本発明の実施例２のタイムチャートを示す図で
ある（ＴＦＴ型液晶表示装置の場合）。
ある（ＴＦＴ型液晶表示装置の場合）。
【図９】本発明の実施例２のタイムチャートを示す図で
ある（ＳＴＮ型液晶表示装置の場合）。
ある（ＳＴＮ型液晶表示装置の場合）。
【図１０】従来の液晶制御装置を示す図である。
【図１１】従来の液晶制御装置の動作説明図である。
【図１２】発明が解決しようとする課題の説明図であ
る。
る。
１：電源部 ２：液晶表示装置 ３：液晶制御装置 ４：ダミー信号発生部 ５：液晶制御部 ６：本体論理部 ７：信号選択部
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G09G 3/00 - 3/38 G02F 1/133 505 - 580
Claims (4)
- 【請求項１】 電源供給を開始されてから一定時間以内
に液晶駆動信号が入力される必要のある液晶表示装置の
液晶制御装置において，液晶制御装置は，ダミー信号発生部と液晶制御回路とを
備え， 該液晶制御回路は，本体論理部の制御により発生する本
来の液晶駆動信号を出力するものであり， 該ダミー信号発生部は，液晶表示装置に対する電源供給
の開始によりダミーの液晶駆動信号を発生するダミー信
号発生回路と，該液晶制御回路に接続されていて本体側
で発生する本来の液晶駆動信号の入力を判定する判定回
路と，マルチプレクサとを備え， 該マルチプレクサは該ダミー信号発生回路で発生するダ
ミーの液晶駆動信号と該液晶制御回路が発生する本来の
液晶駆動信号と，該判定回路の出力信号とを入力し，該
判定回路が本来の液晶駆動信号を発生していないことを
表す信号を出力している場合には，ダミーの液晶駆動信
号を出力し，該判定回路が本来の液晶駆動信号を発生し
ていることを表す信号を出力している場合には，本来の
液晶駆動信号を選択して出力するものであり，該ダミー信号発生部は該マルチプレクサの選択した信号
を出力するものであることを特徴とする液晶制御装置。 - 【請求項２】 該ダミー信号発生回路が発生するダミー
の液晶駆動信号は，本来の液晶駆動信号と別に生成され
ることを特徴とする請求項１に記載の液晶制御装置。 - 【請求項３】 電源供給を開始されてから一定時間以内
に液晶駆動信号が入力される必要のある液晶表示装置に
おいて，液晶制御装置は，ダミー信号発生部と液晶制御回路とを
備え， 該液晶制御回路は，本体論理部の制御により発生する本
来の液晶駆動信号を出力するものであり， 該ダミー信号発生部は，液晶表示装置に対する電源供給
の開始によりダミーの液晶駆動信号を発生するダミー信
号発生回路と，該液晶制御回路に接続されていて本体側
で発生する本来の液晶駆動信号の入力を判定する判定回
路と，マルチプレクサとを備え，該 マルチプレクサは該ダミー信号発生回路で発生するダ
ミーの液晶駆動信号と該液晶制御回路が発生する本来の
液晶駆動信号と，該判定回路の出力信号とを入力し，該
判定回路が本来の液晶駆動信号を発生していないことを
表す信号を出力している場合には，ダミーの液晶駆動信
号を出力し，該判定回路が本来の液晶駆動信号を発生し
ていることを表す信号を出力している場合には，本来の
液晶駆動信号を選択して出力するものであり，該ダミー信号発生部は該マルチプレクサの選択した信号
を出力するものであることを特徴とする液晶表示装置。 - 【請求項４】 該ダミー信号発生回路が発生するダミー
の液晶駆動信号は，本来の液晶駆動信号と別に生成され
ることを特徴とする請求項３に記載の液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31193195A JP3224505B2 (ja) | 1995-11-30 | 1995-11-30 | 液晶制御装置および液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31193195A JP3224505B2 (ja) | 1995-11-30 | 1995-11-30 | 液晶制御装置および液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09152846A JPH09152846A (ja) | 1997-06-10 |
| JP3224505B2 true JP3224505B2 (ja) | 2001-10-29 |
Family
ID=18023160
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31193195A Expired - Fee Related JP3224505B2 (ja) | 1995-11-30 | 1995-11-30 | 液晶制御装置および液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3224505B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100471789B1 (ko) * | 1997-12-31 | 2005-07-07 | 삼성전자주식회사 | 티에프티액정표시장치의파워온초기리던던시방지장치 |
| KR102329671B1 (ko) | 2009-12-18 | 2021-11-23 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 |
| US9697788B2 (en) * | 2010-04-28 | 2017-07-04 | Semiconductor Energy Laboratory Co., Ltd. | Liquid crystal display device |
-
1995
- 1995-11-30 JP JP31193195A patent/JP3224505B2/ja not_active Expired - Fee Related
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|---|---|
| JPH09152846A (ja) | 1997-06-10 |
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