JP3148209B2 - サイクロコンバータの制御装置 - Google Patents
サイクロコンバータの制御装置Info
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- JP3148209B2 JP3148209B2 JP12711889A JP12711889A JP3148209B2 JP 3148209 B2 JP3148209 B2 JP 3148209B2 JP 12711889 A JP12711889 A JP 12711889A JP 12711889 A JP12711889 A JP 12711889A JP 3148209 B2 JP3148209 B2 JP 3148209B2
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明はベクトル制御の非循環電流方式サイクロン
コバータの制御装置に関する。
コバータの制御装置に関する。
〔従来の技術〕 第２図は従来のこの種のサイクロコンバータの制御装
置を示すブロック図である。同図において、１は速度設
定器、２は速度制御器、３は磁束指令器、４は磁束制御
器であって、１〜４によりｄ軸およびｑ軸分電流指令発
生回路（第１の信号発生回路）52が構成されている。53
A、53Bは第２および第３の信号発生回路（共に、２相/3
相座標変換器）はベクトル回転器７、２相/3相変換器９
により構成されている。11は交流電動機36の電機子電流
用ゲート制御器、12は３相交流電源、13は３相の非循環
電流方式正弦波サイクロコンバータCC、22はｑ軸分電流
制御器（比例積分増幅器）、23はｄ軸分電流制御器（比
例積分増幅器）、24は一次遅れ演算器、25、27、28は掛
算器、29は割算器、31は積分器、５、26、30、40は固定
ゲインである。33は正弦波及び余弦波発生器、34はベク
トル回転器、35は３相/2相変換器であって、両者により
第４の信号発生回路51が構成されている。37は交流電動
機36に軸結されたレゾルバであって、その出力は速度検
出器32に入力される。
置を示すブロック図である。同図において、１は速度設
定器、２は速度制御器、３は磁束指令器、４は磁束制御
器であって、１〜４によりｄ軸およびｑ軸分電流指令発
生回路（第１の信号発生回路）52が構成されている。53
A、53Bは第２および第３の信号発生回路（共に、２相/3
相座標変換器）はベクトル回転器７、２相/3相変換器９
により構成されている。11は交流電動機36の電機子電流
用ゲート制御器、12は３相交流電源、13は３相の非循環
電流方式正弦波サイクロコンバータCC、22はｑ軸分電流
制御器（比例積分増幅器）、23はｄ軸分電流制御器（比
例積分増幅器）、24は一次遅れ演算器、25、27、28は掛
算器、29は割算器、31は積分器、５、26、30、40は固定
ゲインである。33は正弦波及び余弦波発生器、34はベク
トル回転器、35は３相/2相変換器であって、両者により
第４の信号発生回路51が構成されている。37は交流電動
機36に軸結されたレゾルバであって、その出力は速度検
出器32に入力される。
速度検出器32が検出した交流電動機36の速度フイード
バック値ωｒは速度制御器２および磁束指令器３に送出
する。速度制御器２は速度目標値ωｒ ＊に対応するｑ軸
分電流設定値iq ＊を送出する。交流電動機36の各相出力
電流iR、iS、iTは第４の信号発生回路51で２相交流電流
ｉα、ｉβに変換されたのち、２次磁束回転座標系の値
として２次磁束に直角な直流量に変換され、ｑ軸分電流
フイードバック値iq -d軸分電流フイードバック値id -と
なり、前者とｑ軸分電流設定値iq ＊との偏差εｑがｑ軸
分電流制御器22に供給され、該ｑ軸分電流制御器22はｑ
軸分電圧指令値Vq ＊を送出する。
バック値ωｒは速度制御器２および磁束指令器３に送出
する。速度制御器２は速度目標値ωｒ ＊に対応するｑ軸
分電流設定値iq ＊を送出する。交流電動機36の各相出力
電流iR、iS、iTは第４の信号発生回路51で２相交流電流
ｉα、ｉβに変換されたのち、２次磁束回転座標系の値
として２次磁束に直角な直流量に変換され、ｑ軸分電流
フイードバック値iq -d軸分電流フイードバック値id -と
なり、前者とｑ軸分電流設定値iq ＊との偏差εｑがｑ軸
分電流制御器22に供給され、該ｑ軸分電流制御器22はｑ
軸分電圧指令値Vq ＊を送出する。
磁束制御器４は、磁束指令器３の出力Φ＊と、ｄ軸分
電流フイードバック値id -に対する一次遅れ演算器24の
出力Φ−との偏差が入力されてｄ軸分電流設定値id ＊を
出力し、この値とｄ軸分電流フイードバック値id -との
偏差εｄがｄ軸分電流制御器23に入力される。ｄ軸分電
流制御器23はｄ軸分電圧指令値Vd ＊を出力する。
電流フイードバック値id -に対する一次遅れ演算器24の
出力Φ−との偏差が入力されてｄ軸分電流設定値id ＊を
出力し、この値とｄ軸分電流フイードバック値id -との
偏差εｄがｄ軸分電流制御器23に入力される。ｄ軸分電
流制御器23はｄ軸分電圧指令値Vd ＊を出力する。
積分器31は回転磁界の角周波数ω０を積分して２次磁
束位相θ０を算出し、正弦波および余弦波発生器33に入
力し、この正弦波および余弦波発生器33は２次磁束方向
信号sinθ０およびcosθ０を送出する。
束位相θ０を算出し、正弦波および余弦波発生器33に入
力し、この正弦波および余弦波発生器33は２次磁束方向
信号sinθ０およびcosθ０を送出する。
ｑ軸分電圧指令値Vq ＊は干渉項と誘起電圧項の補償が
行われてvq ＊となり、また、ｄ軸分電圧指令値Vd ＊は干
渉項と誘起電圧項の補償が行われてvd ＊となり、両者
は、２次磁束方向信号sinθ０、cosθ０をパラメータと
して、第２の信号発生回路53Aのベクトル回転器７によ
り２相交流電圧Ｖα＊、Ｖβ＊に変換されたのち３相変
換されて、３相交流電圧設定値VR ＊、VS ＊、VT ＊とな
り、ゲート制御器11に供給される。
行われてvq ＊となり、また、ｄ軸分電圧指令値Vd ＊は干
渉項と誘起電圧項の補償が行われてvd ＊となり、両者
は、２次磁束方向信号sinθ０、cosθ０をパラメータと
して、第２の信号発生回路53Aのベクトル回転器７によ
り２相交流電圧Ｖα＊、Ｖβ＊に変換されたのち３相変
換されて、３相交流電圧設定値VR ＊、VS ＊、VT ＊とな
り、ゲート制御器11に供給される。
サイクロコンバータ13の正群コンバータ41および負群
コンバータ42の切換えに必要なiS ＊、iR ＊、iT ＊は、ｑ
軸分電流設定値iq ＊とｄ軸分電流設定値id ＊を入力され
る第３の信号発生回路53Bで作成されて、ゲート切換器1
4に入り、該ゲート切換器14はこの３相交流電流設定値i
R ＊、iS ＊、iT ＊の正負極性に応じて、ゲートパルスを
正群コンバータ41または負群コンバータ42へ分配する。
コンバータ42の切換えに必要なiS ＊、iR ＊、iT ＊は、ｑ
軸分電流設定値iq ＊とｄ軸分電流設定値id ＊を入力され
る第３の信号発生回路53Bで作成されて、ゲート切換器1
4に入り、該ゲート切換器14はこの３相交流電流設定値i
R ＊、iS ＊、iT ＊の正負極性に応じて、ゲートパルスを
正群コンバータ41または負群コンバータ42へ分配する。
上記したように、ゲート制御器11から送出されるゲー
トパルスは３相交流電流設定値iR ＊、iS ＊、iT ＊の正負
極性に応じて、ゲート切換器14により正群コンバータ41
または負群コンバータ42に入力されるが、正群コンバー
タ41と負群コンバータ42の切換え時の交流短絡を防止す
るために、数msのむだ時間（両群コンバータ41、42が共
にOFFとなる時間）を設けているので、サイクロコンバ
ータ13の交流出力波形にひずみが発生し、ｑ軸およびｄ
軸電流制御器が過度に応答し、誤指令を発生する恐れが
あった。
トパルスは３相交流電流設定値iR ＊、iS ＊、iT ＊の正負
極性に応じて、ゲート切換器14により正群コンバータ41
または負群コンバータ42に入力されるが、正群コンバー
タ41と負群コンバータ42の切換え時の交流短絡を防止す
るために、数msのむだ時間（両群コンバータ41、42が共
にOFFとなる時間）を設けているので、サイクロコンバ
ータ13の交流出力波形にひずみが発生し、ｑ軸およびｄ
軸電流制御器が過度に応答し、誤指令を発生する恐れが
あった。
この発明は上記問題を解消するためになされたもの
で、正負群コンバータの切換え期間中の電流制御器の誤
動作を防止することかできるサイクロコンバータの制御
装置を提供することを目的とする。
で、正負群コンバータの切換え期間中の電流制御器の誤
動作を防止することかできるサイクロコンバータの制御
装置を提供することを目的とする。
この発明は上記目的を達成するため、比例積分増動作
を行って電圧指令値を送出するｑ軸分電流制御器とｄ軸
分電流制御器の積分動作を、正群コンバータと負群コン
バータの切換えの期間中は、休止させる構成としたもの
である。
を行って電圧指令値を送出するｑ軸分電流制御器とｄ軸
分電流制御器の積分動作を、正群コンバータと負群コン
バータの切換えの期間中は、休止させる構成としたもの
である。
この発明では、電流制御器の積分動作が中止されるの
で、電流制御器の積分項は切換開始前の値をホールド
し、交流出力波形の歪みの偏差が蓄積されない。
で、電流制御器の積分項は切換開始前の値をホールド
し、交流出力波形の歪みの偏差が蓄積されない。
以下、この発明の１実施例を図面を参照して説明す
る。
る。
第１図において、ｑ軸分電流制御器22およびｄ軸分電
流制御器23はゲート切換器14の出力を信号線15を通して
受け取る構成となっており、該出力を受け取ったｑ軸分
電流制御器22およびｄ軸分電流制御器23は、前記したむ
だ時間の間、積分項の値をホールドする。他の構成は第
２図のものと同じである。
流制御器23はゲート切換器14の出力を信号線15を通して
受け取る構成となっており、該出力を受け取ったｑ軸分
電流制御器22およびｄ軸分電流制御器23は、前記したむ
だ時間の間、積分項の値をホールドする。他の構成は第
２図のものと同じである。
正群コンバータ41から負群コンバータ42への、また、
その逆の切換え期間中（むだ時間中）は、切換え動作を
行っている相には電流が流れないため、該相の電流波形
が正弦波状にはならない。この間、本実施例では、ｑ軸
分電流制御器22およびｄ軸分電流制御器23は積分項は積
分動作を中止して、その値をホールドするので、歪みの
偏差が蓄積されることはなく、各々が送出するｑ軸分電
圧指令値Vq ＊、ｄ軸分電圧指令値Vd ＊に上記歪み分が含
まれないようになる。
その逆の切換え期間中（むだ時間中）は、切換え動作を
行っている相には電流が流れないため、該相の電流波形
が正弦波状にはならない。この間、本実施例では、ｑ軸
分電流制御器22およびｄ軸分電流制御器23は積分項は積
分動作を中止して、その値をホールドするので、歪みの
偏差が蓄積されることはなく、各々が送出するｑ軸分電
圧指令値Vq ＊、ｄ軸分電圧指令値Vd ＊に上記歪み分が含
まれないようになる。
しかも、本実施例では、従来の制御装置において、ゲ
ート切換器14とｑ軸分電流制御器22およびｄ軸分電流制
御器23との間に上記信号線15を設けるだけで上記効果を
得ることができる利点がある。
ート切換器14とｑ軸分電流制御器22およびｄ軸分電流制
御器23との間に上記信号線15を設けるだけで上記効果を
得ることができる利点がある。
この発明は以上説明した通り、コンバータの切換え期
間中は、電流制御器の積分項は停止する構成としたこと
により、電流制御器の出力に交流出力波形の歪み分が含
まれるのを防ぐことができるので、従来に比して、制御
精度を向上することができる。
間中は、電流制御器の積分項は停止する構成としたこと
により、電流制御器の出力に交流出力波形の歪み分が含
まれるのを防ぐことができるので、従来に比して、制御
精度を向上することができる。
第１図はこの発明の実施例を示すブロック図、第２図は
従来のサイクロコンバータの制御装置を示すブロック図
である。 図において、７、34……ベクトル回転器、９……２相/3
相変換器、11……ゲート制御器、13……サイクンコバー
タ、14……ゲート切換器、22……ｑ軸分電流制御器、23
……ｄ軸分電流制御器、31……正弦波および余弦波発生
器、35……３相/2相変換器、41……正群コンバータ、42
……負群コンバータ。 なお、図中、同一符号は同一または相当部分を示す。
従来のサイクロコンバータの制御装置を示すブロック図
である。 図において、７、34……ベクトル回転器、９……２相/3
相変換器、11……ゲート制御器、13……サイクンコバー
タ、14……ゲート切換器、22……ｑ軸分電流制御器、23
……ｄ軸分電流制御器、31……正弦波および余弦波発生
器、35……３相/2相変換器、41……正群コンバータ、42
……負群コンバータ。 なお、図中、同一符号は同一または相当部分を示す。
フロントページの続き (56)参考文献 特開 昭56−150998（ＪＰ，Ａ) 特開 昭64−69289（ＪＰ，Ａ)
Claims (1)
- 【請求項１】ベクトル制御される非循環電流方式サイク
ロンコンバータの正群コンバータと負群コンバータに与
えるゲートパルスを、３相交流電流設定値の正負極性に
応じて正群コンバータと負群コンバータのいずれかへ切
換えるゲート切換器を有するサイクロコンバータの制御
装置において、比例積分動作を行って電圧指令値を送出
するｑ軸分電流制御器とｄ軸分電流制御器の積分動作
を、上記切換えの期間中は、休止させることを特徴とす
るサイクロコンバータの制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12711889A JP3148209B2 (ja) | 1989-05-19 | 1989-05-19 | サイクロコンバータの制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12711889A JP3148209B2 (ja) | 1989-05-19 | 1989-05-19 | サイクロコンバータの制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02307386A JPH02307386A (ja) | 1990-12-20 |
| JP3148209B2 true JP3148209B2 (ja) | 2001-03-19 |
Family
ID=14952051
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12711889A Expired - Fee Related JP3148209B2 (ja) | 1989-05-19 | 1989-05-19 | サイクロコンバータの制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3148209B2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56150998A (en) * | 1980-04-25 | 1981-11-21 | Toshiba Corp | Controller for synchronous motor |
| JPH06106034B2 (ja) * | 1987-09-08 | 1994-12-21 | 株式会社日立製作所 | 誘導電動機のベクトル制御装置 |
-
1989
- 1989-05-19 JP JP12711889A patent/JP3148209B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02307386A (ja) | 1990-12-20 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |