JP2921844B2 - Image signal processing device - Google Patents
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Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は、画像信号を処理する画像信号装置に関する
ものである。Description: TECHNICAL FIELD The present invention relates to an image signal device that processes an image signal.
［従来の技術］ 従来から知られている静止画像信号復元装置として、
例えば静止画像信号を磁気ディスクに記録し、記録され
た静止画像信号を再生する電子スチルカメラシステムで
ある。第３図は、かかる電子スチルカメラシステムの記
録静止画像信号の周波数スペクトルを示した図で、第３
図に示される輝度信号成分Ｙはエンファシス処理が施さ
れた後、FM変調されており、また、色信号成分Ｃについ
ては２種類の色差信号（Ｒ−Y,B−Ｙ）が線順次化され
た後、エンファシス処理が施され、低域周波数帯域にFM
変調され、更に、輝度信号成分Ｙと色信号成分Ｃとは周
波数多重される事により記録画像信号となる。そして、
該記録画像信号は磁気ディスク上に形成される複数の同
心円状トラックに対して１トラックにつき１フィールド
信号の単位で記録されている。[Related Art] As a conventionally known still image signal restoring device,
For example, an electronic still camera system that records a still image signal on a magnetic disk and reproduces the recorded still image signal. FIG. 3 is a diagram showing a frequency spectrum of a recorded still image signal of the electronic still camera system.
The luminance signal component Y shown in the figure is FM-modulated after being subjected to emphasis processing, and two types of color difference signals (RY, BY) of the color signal component C are line-sequentialized. After that, emphasis processing is applied, and FM is applied to the low frequency band.
After being modulated, the luminance signal component Y and the chrominance signal component C are frequency-multiplexed to become a recording image signal. And
The recording image signal is recorded on a plurality of concentric tracks formed on the magnetic disk in units of one field signal per track.
第４図は、電子スチルカメラシステムにおいて、上述
の様に磁気ディスク上に記録された静止画像信号を再生
し、例えば電話回線１などを介して送信し、更に送信さ
れた信号を受信するための静止画像信号送受信装置の構
成図を示したものである。第４図に示した静止画像信号
送受信装置において、静止画像信号が記録されている磁
気ディスク33はモータ34によってフィールド周期で回転
されている。上述の様に回転している磁気ディスク33よ
り磁気ヘッド32によって再生される信号は、前置振幅器
31によって十分に増幅された後、HPF（ハイパスフィル
タ）23によって輝度信号の成分が分離され、FM復調器2
2,ディエンファシス回路21を介して輝度信号が復元再生
される。また、前置増幅器31の出力はLPF（ローパスフ
ィルタ）30にも入力されており、該LPF30により色信号
成分が分離されてFM復調器29,ディエンファシス回路28
によって、色差線順次信号が復元再生される。FIG. 4 shows an electronic still camera system for reproducing a still image signal recorded on a magnetic disk as described above, transmitting the still image signal through, for example, a telephone line 1 and receiving the transmitted signal. FIG. 2 shows a configuration diagram of a still image signal transmitting / receiving device. In the still image signal transmitting / receiving apparatus shown in FIG. 4, the magnetic disk 33 on which the still image signal is recorded is rotated by a motor 34 at a field cycle. The signal reproduced by the magnetic head 32 from the rotating magnetic disk 33 as described above
After being sufficiently amplified by 31, the luminance signal component is separated by an HPF (high-pass filter) 23, and the FM demodulator 2
2. The luminance signal is restored and reproduced through the de-emphasis circuit 21. The output of the preamplifier 31 is also input to an LPF (low-pass filter) 30. The LPF 30 separates a chrominance signal component, and outputs an FM demodulator 29 and a de-emphasis circuit 28.
Thus, the color difference line sequential signal is restored and reproduced.
そして、上述のようにして復元再生された静止画像信
号を電話回線を介して電送するためには、再生された静
止画像信号を一旦デジタルメモリに取り込み、取り込み
時よりも遅い速度で読み出す事により時間軸伸長し帯域
圧縮を行なわなければならない。そこで、静止画像信号
の電送時においてスイッチSW10およびSW9は図中のｂ側
に接続されており、再生輝度信号はそのまま色差・RGB
変換マトリクス回路15に入力される。一方、再生色差線
順次信号は図中のｂ側に接続されているスイッチSW13を
介して1H（水平周期期間）のDL（遅延線）26及びスイッ
チSW11,SW12,加算器24a,25aにより構成される線同時化
回路に入力され、ここで線同時化された２種類の色差信
号が色差・RGB変換マトリクス回路15に入力される。Then, in order to transmit the still image signal restored and reproduced as described above via a telephone line, the reproduced still image signal is temporarily loaded into a digital memory, and is read out at a slower speed than at the time of capture. Axial extension and band compression must be performed. Therefore, at the time of transmitting the still image signal, the switches SW10 and SW9 are connected to the b side in the figure, and the reproduced luminance signal is directly
It is input to the conversion matrix circuit 15. On the other hand, the reproduced color difference line sequential signal is composed of a 1H (horizontal period) DL (delay line) 26, switches SW11 and SW12, and adders 24a and 25a via a switch SW13 connected to the side b in the drawing. The two types of color difference signals that have been line-synchronized here are input to a color difference / RGB conversion matrix circuit 15.
尚、スイッチSW11およびSW12はそれぞれ、Ｒ−Ｙ信号
が入力される時には図中のｂ側に、またＢ−Ｙ信号が入
力される時には図中のａ側に接続されて、スイッチSW1
1,SW12からはＲ−Ｙ信号とＢ−Ｙ信号とが同時に出力さ
れ更に、1HDL24,25及び加算器24a,25aからなる加算型1H
くし形フィルタにおいて平均化処理された後、色差・RG
B変換マトリクス回路15に供給される。The switches SW11 and SW12 are respectively connected to the side b in the figure when the RY signal is input, and connected to the side a in the figure when the BY signal is input.
1, the RY signal and the BY signal are simultaneously output from SW12, and further, an addition type 1H comprising 1HDL24, 25 and adders 24a, 25a.
After averaging in the comb filter, the color difference
It is supplied to the B conversion matrix circuit 15.
色差・RGB変換マトリクス回路15では入力された輝度
信号と２種類の色差信号とを用いてRGB信号を形成し、
形成されたRGB信号はA/Dコンバータ9,10,11でそれぞれ
１サンプル当り８ビットのデジタル信号に変換され、Ｒ
メモリ6,Gメモリ7,Bメモリ８にそれぞれフィールド信号
単位で取り込まれる。尚、この時、スイッチSW9から出
力される輝度信号は同期分離回路18において同期信号が
分離され、分離された同期信号は図中のｂ側に接続され
ているスイッチSW5を介してメモリ制御回路16に供給さ
れ、メモリタイミング発生回路16は供給された同期信号
に同期して各デジタルメモリ6,7,8の書き込みアドレス
を指示し、取り込み動作を制御している。The color difference / RGB conversion matrix circuit 15 forms an RGB signal using the input luminance signal and two types of color difference signals,
The formed RGB signals are converted into 8-bit digital signals per sample by A / D converters 9, 10, and 11, respectively.
The data is taken into the memory 6, the G memory 7, and the B memory 8 in units of field signals. At this time, the luminance signal output from the switch SW9 is separated from the synchronization signal in the synchronization separation circuit 18, and the separated synchronization signal is supplied to the memory control circuit 16 via the switch SW5 connected to the side b in the figure. The memory timing generation circuit 16 instructs the write address of each of the digital memories 6, 7, 8 in synchronization with the supplied synchronization signal, and controls the fetch operation.
以上の様にしてデジタルメモリ6,7,8の夫々に１フィ
ールド分のRGB信号が取り込まれた後、電話回線を介し
て送信するために、十分に低速なクロックに同期して各
メモリに取り込まれているデータを読み出し、読み出さ
れたデータはスイッチSW1を介してD/Aコンバータ４に供
給され、D/Aコンバータ４においてアナログ信号に変換
し、変調器２によって電話回線に適した信号形態に変調
され、図中のａ側に接続されているスイッチSW14を介し
て伝送路である電話回線１に送信される。尚、変調器２
には、例えばFM変調器もしくはAM変調器が用いられる。
また、上記スイッチSW1はデジタルメモリ6,7,8に取り込
まれているRGB信号を面順次のデジタル信号としてD/Aコ
ンバータ４に供給するためのスイッチで、不図示のシス
テムコントローラによりデジタルメモリ6,7,8の夫々か
ら１フィールド分のデータが出力される毎に接続される
接点が切換わるものである。After the RGB signals for one field have been captured in each of the digital memories 6, 7, 8 as described above, they are captured in each memory in synchronization with a sufficiently low-speed clock for transmission via a telephone line. The read data is supplied to the D / A converter 4 via the switch SW1 and is converted into an analog signal by the D / A converter 4, and the signal form suitable for the telephone line is output by the modulator 2. And transmitted to the telephone line 1 as a transmission line via the switch SW14 connected to the side a in FIG. Note that modulator 2
For example, an FM modulator or an AM modulator is used.
The switch SW1 is a switch for supplying the RGB signals taken in the digital memories 6, 7, 8 to the D / A converter 4 as a frame-sequential digital signal. Each time one field of data is output from each of 7, 8 the contacts to be connected are switched.
一方、電話回線１を介して供給される静止画像信号を
受信する時にはスイッチSW14はｂ側に接続され、該スイ
ッチ14を介して入力される伝送信号は復調器３において
復調され、A/Dコンバータ５によってA/D変換された後、
スイッチSW15を介してデジタルメモリ6,7,8に取り込ま
れる。On the other hand, when a still image signal supplied via the telephone line 1 is received, the switch SW14 is connected to the side b, and the transmission signal input via the switch 14 is demodulated in the demodulator 3 and the A / D converter After A / D conversion by 5,
The data is taken into the digital memories 6, 7, 8 via the switch SW15.
尚、このスイッチSW15は伝送信号がＲ信号,G信号,B信
号の面順次信号に対応して不図示のシステムコントロー
ラにより接続される接点が切換えられる。また、この
時、スイッチSW2,SW3,SW4は図中のｂ側に接続されてい
る。また、送信されてきた伝送信号がフィールド静止画
像信号である場合には、デジタルメモリ6,7,8上で伝送
されないフィールドの画像信号を補間する補間フィール
ド静止画像信号を形成するための演算も同時に行なわれ
る。The switch SW15 switches the contact to be connected by a system controller (not shown) in accordance with the R, G, and B signals in the frame sequence. At this time, the switches SW2, SW3, and SW4 are connected to the b side in the figure. Further, when the transmitted transmission signal is a field still image signal, an operation for forming an interpolated field still image signal for interpolating an image signal of a field not transmitted on the digital memories 6, 7, 8 is simultaneously performed. Done.
また、受信された伝送信号より復元される静止画像信
号を外部モニタ装置に表示したりプリンターによりプリ
ントアウトしたりするため、RGB信号として外部に出力
する必要がある。受信された伝送信号をRGB信号として
外部に出力する場合にはまずデジタルメモリ6,7,8に取
り込まれているデータを読み出すため、同期信号発生器
17より同期信号を発生させ、図中のａ側に接続されてい
るスイッチSW5を介してメモリタイミング発生回路16に
する。そして、メモリタイミング発生回路16によりデジ
タルメモリ6,7,8に取り込まれているデータをもとの静
止画像信号になるように高速に読み出し、D/Aコンバー
タ12,13,14によってそれぞれアナログのR,G,B信号に変
換し、75Ωドライブ回路35,36,37を介して外部装置に出
力される。また、同期信号発生器17において発生される
同期信号は、スイッチSW5及び75Ωドライブ回路38を介
して外部装置に出力される。Further, in order to display a still image signal restored from the received transmission signal on an external monitor device or to print out the image by a printer, it is necessary to output the still image signal to the outside as an RGB signal. To output the received transmission signal as an RGB signal to the outside, first read the data stored in the digital memories 6, 7, and 8 using a synchronization signal generator.
A synchronizing signal is generated from 17 and the signal is supplied to the memory timing generating circuit 16 via the switch SW5 connected to the side a in FIG. Then, the data fetched into the digital memories 6, 7, 8 by the memory timing generation circuit 16 is read out at high speed so as to become the original still image signal, and the analog R / D signals are outputted by the D / A converters 12, 13, 14. , G, B signals and output to external devices via 75Ω drive circuits 35, 36, 37. The synchronization signal generated by the synchronization signal generator 17 is output to an external device via the switch SW5 and the 75Ω drive circuit 38.
以上の様に、伝送信号としてフィールド静止画像信号
が受信された場合でもデジタルメモリ上で補間処理演算
を行なう事によりスキューのないフレーム静止画像信号
を形成して出力することができる。As described above, even when a field still image signal is received as a transmission signal, it is possible to form and output a skew-free frame still image signal by performing interpolation processing on a digital memory.
また、磁気ディスクから再生された静止画像信号を上
述の手順に従って電話回線上に送信する前に、内容をモ
ニタ装置等で確認したい場合がある。この時、再生静止
画像信号がフィールド静止画像信号である場合には補間
フィールド静止画像信号を形成すると共に周知のスキュ
ー補償を施こす必要があるが、この処理を例えばデジタ
ルメモリに１フィールド分の再生静止画像信号を取り込
みデジタルメモリ内で演算処理する事により行なう場合
には処理に時間がかかりすぎるので、従来は第４図に示
すように0.5HのアナログDL19,27および1HのアナログDL2
0によるアナログ回路によって処理していた。Further, before transmitting a still image signal reproduced from a magnetic disk to a telephone line in accordance with the above-described procedure, it may be desired to check the content with a monitor device or the like. At this time, if the reproduced still image signal is a field still image signal, it is necessary to form an interpolated field still image signal and perform well-known skew compensation. In the case of taking a still image signal and performing arithmetic processing in a digital memory, the processing takes too much time. Therefore, conventionally, as shown in FIG. 4, analog DL19 and 27 of 0.5H and analog DL2 of 1H are conventionally used.
0 was processed by the analog circuit.
ここで、上述の再生処理について、さらに詳述する。 Here, the above-described reproduction processing will be described in more detail.
ディエンファシス回路11より出力される再生輝度信号
はそのままスッイチSW10のｂ側、加算器20aに供給され
ると共に、1HのアナログDL20に供給される。そして、加
算器20aにおいて、1HのアナログDL20により1H期間遅延
された信号と遅延されていない信号との平均値を演算す
る事によりスイッチSW10のａ側には補間輝度信号が供給
される。そしてスイッチSW10のａ側とｂ側とをフィール
ド期間毎に切換えることによって、補間処理が施こされ
た輝度信号がスイッチSW10より出力される。尚、上述の
動作において、垂直等化パルス区間中、スイッチSW10は
図中のａ側に接続されている。The reproduced luminance signal output from the de-emphasis circuit 11 is supplied as it is to the adder 20a on the b side of the switch SW10 and to the 1H analog DL 20. Then, the adder 20a calculates the average value of the signal delayed for 1H by the 1H analog DL 20 and the signal that has not been delayed, so that the interpolation luminance signal is supplied to the a side of the switch SW10. Then, by switching the a side and the b side of the switch SW10 for each field period, the luminance signal subjected to the interpolation processing is output from the switch SW10. In the above operation, the switch SW10 is connected to the side a in the figure during the vertical equalization pulse period.
スイッチSW10より出力される輝度信号は0.5Hのアナロ
グDL19とスイッチSW9によってスキュー補償が施こされ
る。すなわち、スイッチSW10がｂ側に接続されている期
間中、スイッチSW9はａ側に接続され、スイッチSW10よ
り出力される輝度信号は0.5HのアナログDL19を介して出
力され、スイッチSW10がａ側に接続されている期間中、
スイッチSW9はｂ側に接続されスイッチSW10より出力さ
れる輝度信号がそのまま出力される。尚、上述の動作に
おいて、0.5HのアナログDL19と1HのアナログDL20とを通
った輝度信号が出力されることはない。また、垂直等化
パルス区間は常にスイッチSW9をｂ側に接続することに
より、インタレースのフレーム輝度信号がスイッチSW9
より出力される。The luminance signal output from the switch SW10 is subjected to skew compensation by the analog DL19 of 0.5H and the switch SW9. That is, during the period when the switch SW10 is connected to the b side, the switch SW9 is connected to the a side, the luminance signal output from the switch SW10 is output via the analog DL19 of 0.5H, and the switch SW10 is connected to the a side. During the connected period,
The switch SW9 is connected to the b side, and the luminance signal output from the switch SW10 is output as it is. In the above-described operation, a luminance signal passing through the analog DL19 of 0.5H and the analog DL20 of 1H is not output. In the vertical equalization pulse section, the switch SW9 is always connected to the b side so that the interlaced frame luminance signal is switched to the switch SW9.
Output.
また、色差信号についてもスキュー補償を行なうた
め、0.5HのアナログDL27とスイッチSW13とを輝度信号の
場合と同様に動作させるスキュー補償を行なった後、前
述と同様に線同時化処理を施こした後、出力される。In addition, in order to perform skew compensation also for the color difference signal, after performing skew compensation for operating the analog DL27 of 0.5H and the switch SW13 in the same manner as the case of the luminance signal, the line synchronization processing was performed in the same manner as described above. Later, it is output.
このようにして形成されたインタレースフレーム静止
画像信号（２種類の色差信号および輝度信号）は色差・
RGB変換マトリクス回路15においてRGB信号に変換され、
スイッチSW6,SW7,SW8、75Ω駆動回路35,36,37,38を介し
て出力される。この時、各スイッチSW6,SW7,SW8はａ側
に、SW5はｂ側に接続されており、同期信号分離回路18
により分離された同期信号も、スイッチSW5,75Ω駆動回
路38を介して出力される。The interlaced frame still image signal (two types of color difference signal and luminance signal) formed in this manner is used for
It is converted into an RGB signal in the RGB conversion matrix circuit 15,
The signals are output via the switches SW6, SW7, SW8 and the 75Ω drive circuits 35, 36, 37, 38. At this time, the switches SW6, SW7, and SW8 are connected to the a side, and the switch SW5 is connected to the b side.
Are also output via the switch SW5, 75Ω drive circuit 38.
［発明が解決しようとする課題］ しかしながら、上記従来の装置において、磁気ディス
ク上に記録された静止画像信号を再生する場合には輝度
信号の補間およびスキュー補償、ならびに、色差信号の
線同時化処理およびスキュー補償を行なうためには、遅
延線として一般にCCD（Charge Coupled Device）などの
アナログ遅延素子が用いられるので、遅延された信号レ
ベルを補正するために非常に敏感な調整が必要になるだ
けでなく、温度ドリフトなどが発生し易く、出力される
静止画像信号にフリッカーが発生し易くなってしまうと
いう欠点があった。[Problems to be Solved by the Invention] However, in the above-described conventional apparatus, when a still image signal recorded on a magnetic disk is reproduced, interpolation and skew compensation of a luminance signal and line synchronization processing of a color difference signal are performed. In order to perform skew compensation, analog delay elements such as CCDs (Charge Coupled Devices) are generally used as delay lines, so that only very sensitive adjustment is required to correct the delayed signal level. However, there is a disadvantage that a temperature drift or the like easily occurs and a flicker is easily generated in the output still image signal.
よって本発明の目的は、上述の点に鑑み、簡単な構成
にて微妙な調整を不要とし安定した画像信号が得られる
画像信号処理装置を提供することにある。Therefore, an object of the present invention is to provide an image signal processing apparatus that can obtain a stable image signal without requiring fine adjustment with a simple configuration in view of the above points.
［課題を解決するための手段］ かかる目的を達成するため、本発明に係る画像信号処
理装置は、画像信号を入力し、入力された画像信号をデ
ィジタルデータに変換し、出力する変換手段と、前記変
換手段から出力されるディジタルデータを入力し、入力
されたディジタルデータを１水平走査期間あるいは1/2
水平走査期間遅延し、出力するためのメモリ手段と、前
記変換手段から出力されるディジタルデータと前記メモ
リ手段から出力されるディジタルデータとを全加算する
ことにより形成されるディジタルデータを出力するため
の全加算手段と、前記メモリ手段から出力されるディジ
タルデータと前記全加算手段から出力されるディジタル
データのいずれか一方を出力する出力手段と、第１の期
間中は前記メモリ手段におけるディジタルデータの遅延
時間を１水平走査期間とすると共に前記出力手段におい
て前記全加算手段から出力されるディジタルデータを出
力させ、第２の期間中は前記メモリ手段におけるディジ
タルデータの遅延時間を1/2水平走査期間とすると共に
前記出力手段において前記メモリ手段から出力されるデ
ィジタルデータを出力させるように、前記メモリ手段お
よび前記出力手段を制御する制御手段とを具えたもので
ある。[Means for Solving the Problems] In order to achieve the above object, an image signal processing apparatus according to the present invention includes a conversion unit that inputs an image signal, converts the input image signal into digital data, and outputs the data. The digital data output from the conversion means is input, and the input digital data is input for one horizontal scanning period or 1/2.
Memory means for delaying and outputting a horizontal scanning period, and outputting digital data formed by fully adding digital data output from the conversion means and digital data output from the memory means. Full addition means, output means for outputting one of digital data output from the memory means and digital data output from the full addition means, and delay of digital data in the memory means during the first period The time is set to one horizontal scanning period and the output means outputs digital data output from the full addition means. During the second period, the delay time of the digital data in the memory means is set to 1/2 horizontal scanning period. Output the digital data output from the memory means. As to, in which and control means for controlling said memory means and said output means.
［作 用］ 上述の構成によれば、簡単な構成にて微妙な調整を不
要とし安定した画像信号が得られる。[Operation] According to the above configuration, a stable image signal can be obtained with a simple configuration without the need for fine adjustment.
［実施例］ 以下、実施例に基づいて本発明を詳細に説明する。EXAMPLES Hereinafter, the present invention will be described in detail based on examples.
第１図は本発明の第１実施例として本発明を適用した
静止画像信号送受信装置の構成を示す図である。尚、第
１図に示した符号のうち、第４図に示した各要素と同一
の部分には、同一の符号を付し詳細な説明を省略する。FIG. 1 is a diagram showing a configuration of a still image signal transmitting / receiving apparatus to which the present invention is applied as a first embodiment of the present invention. In addition, among the reference numerals shown in FIG. 1, the same parts as those shown in FIG. 4 are denoted by the same reference numerals, and detailed description will be omitted.
第１図に示した実施例において、色差・RGB変換マト
リクス回路15に入力されている輝度信号および同時化さ
れた２種類の色差信号は、第４図に示したスキュー補償
回路（DL19,DL27）を介することなく直接入力されてい
る。また、第１図に示した実施例は輝度信号のための補
間回路（DL20）も備えていない。In the embodiment shown in FIG. 1, the luminance signal input to the color difference / RGB conversion matrix circuit 15 and the two kinds of synchronized color difference signals are converted into the skew compensation circuits (DL19, DL27) shown in FIG. Is entered directly without going through. Further, the embodiment shown in FIG. 1 does not include an interpolation circuit (DL20) for a luminance signal.
色差・RGB変換マトリクス回路15から出力されるRGB信
号はそれぞれA/Dコンバータ9,10,11により１サンプル当
り８ビットのデジタルデータに変換される。次に、８ビ
ットのラインメモリ48,49,50と、８ビットの全加算回路
45,46,47と、８ビットのデータセレクタ39,40,41とに供
給され、これらの回路により、スキュー補償および補間
処理動作が行なわれ、再生フィールド静止画像信号がイ
ンタレースフレーム静止画像信号に変換される。The RGB signals output from the color difference / RGB conversion matrix circuit 15 are converted into 8-bit digital data per sample by A / D converters 9, 10, and 11, respectively. Next, an 8-bit line memory 48, 49, 50 and an 8-bit full adder circuit
45, 46, 47 and 8-bit data selectors 39, 40, 41, which perform skew compensation and interpolation processing, and convert the reproduced field still image signal into an interlaced frame still image signal. Is converted.
以下、第１図に示した実施例におけるスキュー補償お
よび補間処理動作について説明する。スキュー補償およ
び補間処理に必要な0.5Hおよび1Hの遅延線は同時には必
要とされないので、本実施例では入力されるアドレスカ
ウンタリセット信号の周期によって遅延時間が制御でき
るラインメモリ48,49,50をスキュー補償時には0.5Hの遅
延線として、補間処理時には1Hの遅延線として用いるよ
うに構成する。Hereinafter, the skew compensation and interpolation processing operations in the embodiment shown in FIG. 1 will be described. Since the 0.5H and 1H delay lines required for the skew compensation and the interpolation processing are not required at the same time, in this embodiment, the line memories 48, 49, and 50 that can control the delay time by the cycle of the input address counter reset signal are used. It is configured to be used as a 0.5H delay line during skew compensation and as a 1H delay line during interpolation processing.
例えば、入力されるリセットパルスによってリードア
ドレスカウンタ（図示せず）がリセットされ、ライトア
ドレスはリードアドレスの例えば１つ小さな値にしてお
くことにより、リセットパルス周期で遅延時間がコント
ロールできることになる。このようにすれば、ラインメ
モリはＲ・Ｇ・Ｂの各信号につき１個ですむ。For example, the read address counter (not shown) is reset by the input reset pulse, and the write address is set to, for example, one smaller than the read address, so that the delay time can be controlled by the reset pulse cycle. In this case, only one line memory is required for each of the R, G, and B signals.
また、全加算回路45,46,47の出力としては、桁上げ出
力を含む上位８ビットを使用する。そして、ラインメモ
リ48,49,50のリセット周期は0.5Hと1Hの間をフィールド
周期で切換える。そして、0.5H周期の時にはデータセレ
クタ39,40,41の図中のｂ側を選択し、1H周期の時には全
加算回路の出力であるａ変を選択することにより、スキ
ュー補償および補間処理が行われ出力される。The outputs of the full adders 45, 46 and 47 use the upper 8 bits including the carry output. Then, the reset cycle of the line memories 48, 49, and 50 is switched between 0.5H and 1H at the field cycle. The skew compensation and interpolation processing are performed by selecting the b side in the figure of the data selectors 39, 40, and 41 in the 0.5H cycle, and selecting the a-variation that is the output of the full adder circuit in the 1H cycle. Output.
また、垂直等化パルス区間においてはリセット周期を
常に0.5H周期にすると共に、各データセレタク39,40,41
のｂ変を選択することによってインタレースフレーム静
止画像信号が得られ、８ビットのデータセレクタ42,43,
44のａ側に入力される。そして、磁気ディスクより再生
された静止画像信号を出力する時には、上記各データセ
レクタ42,43,44のａ側を選択する事により、Ｒ・Ｇ・Ｂ
信号が出力される。In the vertical equalization pulse section, the reset cycle is always set to 0.5H cycle, and each data selector 39, 40, 41
, The interlaced frame still image signal is obtained, and the 8-bit data selectors 42, 43,
It is input to the a side of 44. When the still image signal reproduced from the magnetic disk is output, the R, G, and B are selected by selecting the a side of each of the data selectors 42, 43, and 44.
A signal is output.
また、電話回線を介して受信された伝送信号より静止
画像信号を復元する場合は、データセレクタ42,43,44の
ｂ側が選択される。When restoring a still image signal from a transmission signal received via a telephone line, the b side of the data selectors 42, 43, and 44 is selected.
尚、磁気ディスク上に記録された信号を再生し、静止
画像信号に復元して出力する際には同期信号もスキュー
補償処理をする必要がある。そこで、第１図に示すよう
に、Ｒ信号やＧ信号に比べ階調性を必要しないＢ信号を
７ビットでデジタル処理し、残った１ビットを再生輝度
信号より分離した同期信号のスキュー補償のために使用
する。すなわち、同期信号のために使用する１ビットに
関しては、データセレクタ41のa1側に同期信号分離回路
18により分離した同期信号を入力し、データセレクタ41
のｂ側にはＲ信号やＧ信号と同じくラインメモリ50の出
力を入力させる。そして、データセレクタ41の出力側c1
からフレーム同期信号を出力し、磁気ディスク上に記録
された信号を再生し、静止画像信号に復元して出力する
際にはスイッチSW5および75Ω駆動回路38を介して同期
信号を出力する。When a signal recorded on a magnetic disk is reproduced, restored to a still image signal, and output, a synchronization signal also needs to be subjected to skew compensation processing. Therefore, as shown in FIG. 1, the B signal, which does not require gradation as compared with the R signal and the G signal, is digitally processed with 7 bits, and the remaining 1 bit is separated from the reproduced luminance signal to perform skew compensation of the synchronization signal. Use to That is, for the one bit used for synchronization signals, the synchronization signal separation circuit in a 1 side of the data selector 41
The synchronization signal separated by 18 is input and the data selector 41
On the b side, the output of the line memory 50 is input similarly to the R signal and the G signal. Then, the output side c 1 of the data selector 41
Outputs a frame synchronization signal, reproduces a signal recorded on the magnetic disk, restores the signal to a still image signal, and outputs the still image signal.
尚、第１図に示した実施例において、1HのアナログDL
24,25,26、スイッチSW11,SW12及び加算器24a,25aからな
る線同次化回路では第４図と同じくアナログ信号処理さ
れているが、1HのアナログDL24および25からなる加算型
1Hくし形フィルタによって平均化されるため、1Hのアナ
ログDL26に対し、特にレベル調整，温度ドリフトの補正
をしなくても出力される静止画像信号にフリッカー等は
発生しない。In the embodiment shown in FIG. 1, 1H analog DL
In the line homogenization circuit composed of 24, 25, 26, switches SW11, SW12 and adders 24a, 25a, analog signal processing is performed as in FIG. 4, but an addition type composed of 1H analog DLs 24, 25
Since averaging is performed by the 1H comb filter, no flicker or the like is generated in the output still image signal of the 1H analog DL 26 without particularly performing level adjustment and temperature drift correction.
第２図は、本発明の第２の実施例として本発明を適用
した静止画信号送受信装置の構成を示す図である。尚、
ここでは第１図に示した本発明の第１の実施例との差異
についてのみ説明する。FIG. 2 is a diagram showing a configuration of a still picture signal transmitting / receiving apparatus to which the present invention is applied as a second embodiment of the present invention. still,
Here, only the differences from the first embodiment of the present invention shown in FIG. 1 will be described.
第２図に示す第２の実施例と第１図に示す第１の実施
例との差は Ｒ信号に対応するラインメモリ48の７ビットを使用
し、残りの１ビットを同期信号のために使用し、 データセレクタ39,41の同期用出力を抵抗R1,R2で加
算し、その後LPF（ローパスフィルタ）51を通過させた
ものを再生同期信号として使用している点にある。The difference between the second embodiment shown in FIG. 2 and the first embodiment shown in FIG. 1 is that 7 bits of the line memory 48 corresponding to the R signal are used, and the remaining 1 bit is used for the synchronization signal. In this case, the output for synchronization of the data selectors 39 and 41 is added by the resistors R 1 and R 2 , and the signal that has passed through an LPF (low-pass filter) 51 is used as a reproduction synchronization signal.
この様にすることにより、第１図に示した実施例にお
いて発生していた同期信号のジッタ量を軽減して、外部
装置として接続されるモニタ装置やプリンター装置にお
いてジッタが軽減された静止画像を得る事ができる。In this manner, the amount of jitter of the synchronization signal generated in the embodiment shown in FIG. 1 is reduced, and a still image with reduced jitter in a monitor device or a printer device connected as an external device is obtained. You can get it.
このように本発明の各実施例においては、磁気ディス
ク上に記録された信号を再生し、静止画像信号に復元し
て出力する際に従来使用されていないA/Dコンバータお
よびD/Aコンバータを使用すると共に、新たにラインメ
モリ，加算回路，データセレクタを増設することによ
り、スキュー補償と補間処理を調整が不要で安定かつ確
実に動作をするデジタル処理で実現し、安定した静止画
像信号の復元を行なう事ができるようになる。また、ス
キュー補償及び補間処理には画像メモリを一切使用して
いないので、静止画像信号の送受信中にも磁気ディスク
からの静止画像信号の再生動作を行なう事が可能であ
る。As described above, in each embodiment of the present invention, an A / D converter and a D / A converter which are not conventionally used when reproducing a signal recorded on a magnetic disk, restoring a still image signal, and outputting the signal are output. By using a new line memory, adder circuit, and data selector, skew compensation and interpolation processing are realized by digital processing that operates stably and reliably without adjustment, and restores a stable still image signal. Will be able to do. Further, since no image memory is used for the skew compensation and the interpolation processing, it is possible to perform the operation of reproducing the still image signal from the magnetic disk even while transmitting and receiving the still image signal.
［発明の効果］ 以上述べたとおり、本発明によれば、簡単な構成にて
微妙な調整を不要とし安定した画像信号が得られる画像
信号処理装置を提供することができるようになる。[Effects of the Invention] As described above, according to the present invention, it is possible to provide an image signal processing device which does not require fine adjustment with a simple configuration and can obtain a stable image signal.
第１図および第２図はそれぞれ本発明の実施例としての
静止画像信号送受信装置の構成を示すブロック図、 第３図は磁気ディスクに記録される記録信号の周波数ス
ペクトルを示す図、 第４図は従来の静止画信号送受信装置の一構成例を示す
ブロック図である。 ９〜11……A/Dコンバータ、 12〜14……D/Aコンバータ、 15……色差・RGB変換マトリクス回路、 33……磁気ディスク、 39〜44……セレクタ。1 and 2 are block diagrams showing a configuration of a still image signal transmitting / receiving apparatus as an embodiment of the present invention, FIG. 3 is a diagram showing a frequency spectrum of a recording signal recorded on a magnetic disk, and FIG. FIG. 1 is a block diagram showing a configuration example of a conventional still image signal transmitting / receiving apparatus. 9 to 11 A / D converter, 12 to 14 D / A converter, 15 Color / RGB conversion matrix circuit, 33 Magnetic disk, 39 to 44 Selector.
Claims (1)
ディジタルデータに変換し、出力する変換手段と、 前記変換手段から出力されるディジタルデータを入力
し、入力されたディジタルデータを１水平走査期間ある
いは1/2水平走査期間遅延し、出力するためのメモリ手
段と、 前記変換手段から出力されるディジタルデータと前記メ
モリ手段から出力されるディジタルデータとを全加算す
ることにより形成されるディジタルデータを出力するた
めの全加算手段と、 前記メモリ手段から出力されるディジタルデータと前記
全加算手段から出力されるディジタルデータのいずれか
一方を出力する出力手段と、 第１の期間中は前記メモリ手段におけるディジタルデー
タの遅延時間を１水平走査期間とすると共に前記出力手
段において前記全加算手段から出力されるディジタルデ
ータを出力させ、第２の期間中は前記メモリ手段におけ
るディジタルデータの遅延時間を1/2水平走査期間とす
ると共に前記出力手段において前記メモリ手段から出力
されるディジタルデータを出力させるように、前記メモ
リ手段および前記出力手段を制御する制御手段とを具え
たことを特徴とする画像信号処理装置。A converter for inputting an image signal, converting the input image signal into digital data, and outputting the digital signal; inputting the digital data output from the converter, and converting the input digital data into one horizontal signal; A memory means for delaying and outputting a scanning period or a half horizontal scanning period, and a digital signal formed by fully adding digital data output from the conversion means and digital data output from the memory means. Full addition means for outputting data; output means for outputting one of digital data output from the memory means and digital data output from the full addition means; and the memory during a first period. The delay time of the digital data in the means is set to one horizontal scanning period, and the full adder is used in the output means. The digital data output from the stage is output. During the second period, the delay time of the digital data in the memory means is set to 1/2 horizontal scanning period, and the digital data output from the memory means is output in the output means. An image signal processing apparatus comprising: a memory unit; and a control unit that controls the output unit so as to output the image signal.
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1055222A JP2921844B2 (en) | 1989-03-09 | 1989-03-09 | Image signal processing device |
| US07/830,741 US5159467A (en) | 1989-03-09 | 1992-02-03 | Image signal restoring device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1055222A JP2921844B2 (en) | 1989-03-09 | 1989-03-09 | Image signal processing device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02235487A JPH02235487A (en) | 1990-09-18 |
| JP2921844B2 true JP2921844B2 (en) | 1999-07-19 |
Family
ID=12992582
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1055222A Expired - Fee Related JP2921844B2 (en) | 1989-03-09 | 1989-03-09 | Image signal processing device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2921844B2 (en) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60185479A (en) * | 1984-03-03 | 1985-09-20 | Matsushita Electric Ind Co Ltd | Video signal processing unit |
-
1989
- 1989-03-09 JP JP1055222A patent/JP2921844B2/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02235487A (en) | 1990-09-18 |
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