JP2822914B2 - 同相合成装置 - Google Patents
同相合成装置Info
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- JP2822914B2 JP2822914B2 JP7075089A JP7508995A JP2822914B2 JP 2822914 B2 JP2822914 B2 JP 2822914B2 JP 7075089 A JP7075089 A JP 7075089A JP 7508995 A JP7508995 A JP 7508995A JP 2822914 B2 JP2822914 B2 JP 2822914B2
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Description
【０００１】
【産業上の利用分野】本発明は同相合成装置に関し、特
にスペースダイバーシティにより受信した信号を合成す
る同相合成装置に関する。
にスペースダイバーシティにより受信した信号を合成す
る同相合成装置に関する。
【０００２】
【従来の技術】図４は従来の同相合成装置の一例を示す
ブロック図であり、スペースダイバーシティにより受信
した信号Ｓ１および信号Ｓ２を同相合成している。
ブロック図であり、スペースダイバーシティにより受信
した信号Ｓ１および信号Ｓ２を同相合成している。
【０００３】ここで、移相回路１は、位相制御回路１１
からの制御信号Ｄ１１に基づいて信号Ｓ１の位相を調整
して信号Ｓ３を出力する。ＡＧＣ増幅回路４，５は信号
Ｓ２，Ｓ３をそれぞれ一定レベルして位相比較回路７へ
出力する。位相比較回路７は信号Ｓ２，Ｓ３の位相差を
検出する。位相制御回路１１は、信号Ｓ２，Ｓ３の位相
差が最小になるように制御信号Ｄ１１を生成する。合成
回路２は、信号Ｓ２と信号Ｓ３とを合成して合成信号Ｓ
４を出力する。ＡＧＣ増幅回路６は、合成信号Ｓ４を一
定レベルにして出力する。
からの制御信号Ｄ１１に基づいて信号Ｓ１の位相を調整
して信号Ｓ３を出力する。ＡＧＣ増幅回路４，５は信号
Ｓ２，Ｓ３をそれぞれ一定レベルして位相比較回路７へ
出力する。位相比較回路７は信号Ｓ２，Ｓ３の位相差を
検出する。位相制御回路１１は、信号Ｓ２，Ｓ３の位相
差が最小になるように制御信号Ｄ１１を生成する。合成
回路２は、信号Ｓ２と信号Ｓ３とを合成して合成信号Ｓ
４を出力する。ＡＧＣ増幅回路６は、合成信号Ｓ４を一
定レベルにして出力する。
【０００４】
【発明が解決しようとする課題】上述した従来の同相合
成装置においては、スペースダイバーシティにより受信
した信号の少なくとも一方の受信レベルが、選択性フェ
ージングによって帯域内のある周波数で急激に落込むよ
うな現象が発生した場合、この落込んだ周波数において
は位相が急激に変化するため、位相制御が誤動作して同
相合成が不可能になるという問題点がある。
成装置においては、スペースダイバーシティにより受信
した信号の少なくとも一方の受信レベルが、選択性フェ
ージングによって帯域内のある周波数で急激に落込むよ
うな現象が発生した場合、この落込んだ周波数において
は位相が急激に変化するため、位相制御が誤動作して同
相合成が不可能になるという問題点がある。
【０００５】また、所定の位相差範囲内で制御を行うの
で制御誤差があり、合成信号のレベルが常に最大値にな
るとは限らないという問題点を有している。
で制御誤差があり、合成信号のレベルが常に最大値にな
るとは限らないという問題点を有している。
【０００６】本発明の目的は、選択性フェージングによ
って受信レベルが帯域内で急激に落込むような現象が発
生した場合でも、合成信号のレベルが常に最大値になる
ように制御できる同相合成装置を提供することにある。
って受信レベルが帯域内で急激に落込むような現象が発
生した場合でも、合成信号のレベルが常に最大値になる
ように制御できる同相合成装置を提供することにある。
【０００７】
【課題を解決するための手段】上述の課題を解決するた
め、本発明の同相合成装置は、スペースダイバーシティ
により受信した一方の信号の位相を位相制御信号に応じ
て調整する移相手段と、この移相手段により位相調整さ
れた信号と前記スペースダイバーシティにより受信した
他方の信号とを合成する合成手段と、前記位相調整され
た信号と前記受信した他方の信号との位相差を検出する
位相比較手段と、前記移相手段により位相調整された信
号および前記スペースダイバーシティにより受信した他
方の信号並びに前記合成手段により合成された合成信号
の信号レベルをそれぞれ検出するレベル検出手段と、前
記位相比較手段により検出された前記位相差および前記
レベル検出手段により検出された各信号レベルに基づき
前記合成信号の最大レベルを推定し、前記合成信号のレ
ベルが前記最大レベルになるように前記位相制御信号を
出力する位相制御手段とを備えることを特徴とする。
め、本発明の同相合成装置は、スペースダイバーシティ
により受信した一方の信号の位相を位相制御信号に応じ
て調整する移相手段と、この移相手段により位相調整さ
れた信号と前記スペースダイバーシティにより受信した
他方の信号とを合成する合成手段と、前記位相調整され
た信号と前記受信した他方の信号との位相差を検出する
位相比較手段と、前記移相手段により位相調整された信
号および前記スペースダイバーシティにより受信した他
方の信号並びに前記合成手段により合成された合成信号
の信号レベルをそれぞれ検出するレベル検出手段と、前
記位相比較手段により検出された前記位相差および前記
レベル検出手段により検出された各信号レベルに基づき
前記合成信号の最大レベルを推定し、前記合成信号のレ
ベルが前記最大レベルになるように前記位相制御信号を
出力する位相制御手段とを備えることを特徴とする。
【０００８】上記構成において、前記位相制御手段は、
前記位相比較手段により検出された位相差に基づき前記
位相差を所定制御範囲に保持するための第１の位相制御
信号を生成する比較部と、前記第１の位相制御信号に基
づき位相制御状態を判定する判定部と、前記レベル検出
手段により検出された前記位相調整された信号のレベル
および前記受信した他方の信号のレベルに基づき前記合
成信号の最大レベルを推定する合成最大レベル推定部
と、この合成最大レベル推定部より推定された前記最大
レベルおよび前記レベル検出手段により検出された前記
合成信号のレベルとに基づき前記合成信号のレベルが前
記最大レベルになるように制御するための第２の位相制
御信号を生成する合成レベル最大化制御部と、前記判定
部の判定結果に基づき前記第１の位相制御信号および前
記第２の位相制御信号の内いずれか一方を選択して前記
移相回路へ送出する選択部とを備える。
前記位相比較手段により検出された位相差に基づき前記
位相差を所定制御範囲に保持するための第１の位相制御
信号を生成する比較部と、前記第１の位相制御信号に基
づき位相制御状態を判定する判定部と、前記レベル検出
手段により検出された前記位相調整された信号のレベル
および前記受信した他方の信号のレベルに基づき前記合
成信号の最大レベルを推定する合成最大レベル推定部
と、この合成最大レベル推定部より推定された前記最大
レベルおよび前記レベル検出手段により検出された前記
合成信号のレベルとに基づき前記合成信号のレベルが前
記最大レベルになるように制御するための第２の位相制
御信号を生成する合成レベル最大化制御部と、前記判定
部の判定結果に基づき前記第１の位相制御信号および前
記第２の位相制御信号の内いずれか一方を選択して前記
移相回路へ送出する選択部とを備える。
【０００９】
【実施例】次に本発明について図面を参照して説明す
る。
る。
【００１０】図１は本発明の一実施例を示すブロック図
であり、図４に示した従来例と同一構成要素には同一符
号を付している。
であり、図４に示した従来例と同一構成要素には同一符
号を付している。
【００１１】ここで、移相回路１は、位相制御回路３か
らの位相制御信号Ｄ１０に基づき、スペースダイバーシ
ティにより受信した一方の信号Ｓ１の位相を調整する。
合成回路２は、スペースダイバーシティにより受信した
他方の信号Ｓ２と移相回路１により位相調整された信号
Ｓ３とを合成して合成信号Ｓ４を生成する。ＡＧＣ増幅
回路６は、合成信号Ｓ４を一定レベルにして出力する。
らの位相制御信号Ｄ１０に基づき、スペースダイバーシ
ティにより受信した一方の信号Ｓ１の位相を調整する。
合成回路２は、スペースダイバーシティにより受信した
他方の信号Ｓ２と移相回路１により位相調整された信号
Ｓ３とを合成して合成信号Ｓ４を生成する。ＡＧＣ増幅
回路６は、合成信号Ｓ４を一定レベルにして出力する。
【００１２】ところで、合成回路２により合成される信
号Ｓ２，Ｓ３と合成信号Ｓ４とが、図３に示すようなベ
クトル関係になっているものとする。ここで、信号Ｓ２
と信号Ｓ３との位相差Δθは位相制御範囲内にあり、こ
の位相差Δθが０となるときに合成信号Ｓ４は最大レベ
ルになる。本発明は、信号Ｓ２，Ｓ３の信号レベルに基
づき合成信号の最大レベルを推定し、合成信号Ｓ４が最
大レベルになるように制御する機能を設けたことを特徴
としている。
号Ｓ２，Ｓ３と合成信号Ｓ４とが、図３に示すようなベ
クトル関係になっているものとする。ここで、信号Ｓ２
と信号Ｓ３との位相差Δθは位相制御範囲内にあり、こ
の位相差Δθが０となるときに合成信号Ｓ４は最大レベ
ルになる。本発明は、信号Ｓ２，Ｓ３の信号レベルに基
づき合成信号の最大レベルを推定し、合成信号Ｓ４が最
大レベルになるように制御する機能を設けたことを特徴
としている。
【００１３】さて、位相比較回路７は、ＡＧＣ増幅回路
４，５により一定レベルにされた信号Ｓ２，Ｓ３を受け
て位相差を検出し、位相差を示す電圧Ｖｐを出力する。
レベル検出回路８，９および１０は、信号Ｓ２，Ｓ３お
よび合成信号Ｓ４の信号レベルをそれぞれ検出し、信号
レベルを示す電圧Ｖ２，Ｖ３およびＶ４をそれぞれ出力
する。なお、信号レベルの検出方法としては、ＡＧＣ増
幅回路４，５，６の増幅段での信号をそれぞれ検波する
ようにしてもよいし、あるいは、ＡＧＣ制御電圧に基づ
いて信号レベルを検出するようにしてもよい。
４，５により一定レベルにされた信号Ｓ２，Ｓ３を受け
て位相差を検出し、位相差を示す電圧Ｖｐを出力する。
レベル検出回路８，９および１０は、信号Ｓ２，Ｓ３お
よび合成信号Ｓ４の信号レベルをそれぞれ検出し、信号
レベルを示す電圧Ｖ２，Ｖ３およびＶ４をそれぞれ出力
する。なお、信号レベルの検出方法としては、ＡＧＣ増
幅回路４，５，６の増幅段での信号をそれぞれ検波する
ようにしてもよいし、あるいは、ＡＧＣ制御電圧に基づ
いて信号レベルを検出するようにしてもよい。
【００１４】位相制御回路３は、位相比較回路７が出力
する位相差を示す電圧Ｖｐおよびレベル検出回路８，
９，１０がそれぞれ出力する信号レベルを示す電圧Ｖ
２，Ｖ３，Ｖ４をそれぞれ受け、信号Ｓ２と信号Ｓ３と
の合成信号が最大レベルになるように位相制御信号Ｄ１
０を出力して移相回路１を制御する。
する位相差を示す電圧Ｖｐおよびレベル検出回路８，
９，１０がそれぞれ出力する信号レベルを示す電圧Ｖ
２，Ｖ３，Ｖ４をそれぞれ受け、信号Ｓ２と信号Ｓ３と
の合成信号が最大レベルになるように位相制御信号Ｄ１
０を出力して移相回路１を制御する。
【００１５】図２は位相制御回路３の一構成例を示すブ
ロック図である。
ロック図である。
【００１６】比較部３１，３２は、位相差を示す電圧Ｖ
ｐと基準電圧Ｖｓとを比較して第１の位相制御信号Ｄ
１，Ｄ２を生成する。ここでは、比較部３１が制御範囲
の上限側基準電圧Ｖｓ１と位相差電圧Ｖｐとを比較して
信号Ｄ１を生成し、比較部３２が制御範囲の下限側基準
電圧Ｖｓ２と位相差電圧Ｖｐとを比較して信号Ｄ２を生
成している。また、判定部３３は、第１の位相制御信号
Ｄ１，Ｄ２に基づいて位相制御状態を判定し、すなわ
ち、信号Ｓ２と信号Ｓ３との位相差が所定の制御範囲内
にあって位相制御動作が確立しているか否かを判定して
選択信号Ｄ５を出力する。
ｐと基準電圧Ｖｓとを比較して第１の位相制御信号Ｄ
１，Ｄ２を生成する。ここでは、比較部３１が制御範囲
の上限側基準電圧Ｖｓ１と位相差電圧Ｖｐとを比較して
信号Ｄ１を生成し、比較部３２が制御範囲の下限側基準
電圧Ｖｓ２と位相差電圧Ｖｐとを比較して信号Ｄ２を生
成している。また、判定部３３は、第１の位相制御信号
Ｄ１，Ｄ２に基づいて位相制御状態を判定し、すなわ
ち、信号Ｓ２と信号Ｓ３との位相差が所定の制御範囲内
にあって位相制御動作が確立しているか否かを判定して
選択信号Ｄ５を出力する。
【００１７】合成最大レベル推定部３４は、信号Ｓ２，
Ｓ３の信号レベルを示す電圧Ｖ２，Ｖ３に基づいて合成
信号Ｓ４の最大レベルを推定し、合成信号の最大レベル
を示す電圧Ｖｏを出力する。合成レベル最大化制御部３
５は、合成最大レベルを示す電圧Ｖｏと合成信号Ｓ４の
レベルを示す電圧Ｖ４とに基づいて合成信号Ｓ４が最大
レベルになるように制御する第２の位相制御信号Ｄ３，
Ｄ４を生成する。
Ｓ３の信号レベルを示す電圧Ｖ２，Ｖ３に基づいて合成
信号Ｓ４の最大レベルを推定し、合成信号の最大レベル
を示す電圧Ｖｏを出力する。合成レベル最大化制御部３
５は、合成最大レベルを示す電圧Ｖｏと合成信号Ｓ４の
レベルを示す電圧Ｖ４とに基づいて合成信号Ｓ４が最大
レベルになるように制御する第２の位相制御信号Ｄ３，
Ｄ４を生成する。
【００１８】選択部３６は、選択信号Ｄ５に応じて第１
の位相制御信号Ｄ１，Ｄ２および第２の位相制御信号Ｄ
３，Ｄ４のいずれか一方を選択し、位相制御信号Ｄ１０
として移相回路１へ出力する。この場合、選択信号Ｄ５
が、信号Ｓ２と信号Ｓ３との位相差が所定の制御範囲内
にあることを示しているときは第２の位相制御信号Ｄ
３，Ｄ４を選択し、位相差が所定の制御範囲外にあるこ
とを示しているときは第１の位相制御信号Ｄ１，Ｄ２を
選択する。
の位相制御信号Ｄ１，Ｄ２および第２の位相制御信号Ｄ
３，Ｄ４のいずれか一方を選択し、位相制御信号Ｄ１０
として移相回路１へ出力する。この場合、選択信号Ｄ５
が、信号Ｓ２と信号Ｓ３との位相差が所定の制御範囲内
にあることを示しているときは第２の位相制御信号Ｄ
３，Ｄ４を選択し、位相差が所定の制御範囲外にあるこ
とを示しているときは第１の位相制御信号Ｄ１，Ｄ２を
選択する。
【００１９】いま、位相差が所定の制御範囲内にある位
相制御状態のとき、選択性フェージングによって信号Ｓ
２，Ｓ３の少なくとも一方のレベルが帯域内で急激に落
込むような現象が発生し、位相検出が誤動作して位相差
判定が不能となった場合、信号Ｓ２，Ｓ３の位相状態に
関係なく、合成レベル最大化判定部３５からの第２の位
相制御信号Ｄ３，Ｄ４により位相制御を実行できるの
で、誤動作することなく合成信号レベルが最大になるよ
うに合成できる。
相制御状態のとき、選択性フェージングによって信号Ｓ
２，Ｓ３の少なくとも一方のレベルが帯域内で急激に落
込むような現象が発生し、位相検出が誤動作して位相差
判定が不能となった場合、信号Ｓ２，Ｓ３の位相状態に
関係なく、合成レベル最大化判定部３５からの第２の位
相制御信号Ｄ３，Ｄ４により位相制御を実行できるの
で、誤動作することなく合成信号レベルが最大になるよ
うに合成できる。
【００２０】
【発明の効果】以上説明したように本発明によれば、合
成される信号の位相差を所定の範囲内に保持するための
第１の位相制御信号を生成し、また、合成される信号の
信号レベルを検出して合成後の最大レベルを推定し、検
出した合成信号の信号レベルが推定した最大レベルにな
るように第２の位相制御信号を生成し、第１および第２
の位相制御信号を選択して移相回路を制御することによ
り、選択性フェージングによって受信レベルが帯域内で
急激に落込むような現象が発生しても、誤動作すること
なく合成信号のレベルが常に最大になるように制御でき
るという効果を有している。
成される信号の位相差を所定の範囲内に保持するための
第１の位相制御信号を生成し、また、合成される信号の
信号レベルを検出して合成後の最大レベルを推定し、検
出した合成信号の信号レベルが推定した最大レベルにな
るように第２の位相制御信号を生成し、第１および第２
の位相制御信号を選択して移相回路を制御することによ
り、選択性フェージングによって受信レベルが帯域内で
急激に落込むような現象が発生しても、誤動作すること
なく合成信号のレベルが常に最大になるように制御でき
るという効果を有している。
【図１】本発明の一実施例を示すブロック図である。
【図２】図１示した位相制御回路３の一構成例を示すブ
ロック図である。
ロック図である。
【図３】図１示した信号Ｓ２，Ｓ３と合成信号Ｓ４とを
示すベクトル図である。
示すベクトル図である。
【図４】従来の同相合成装置の一例を示すブロック図で
ある。
ある。
１ 移相回路 ２ 合成回路 ３ 位相制御回路 ４，５，６ ＡＧＣ増幅回路 ７ 位相比較回路 ８，９，１０ レベル検出回路 ３１，３２ 比較部 ３３ 判定部 ３４ 合成最大レベル推定部 ３５ 合成レベル最大化制御部 ３６ 選択部 Ｄ１，Ｄ２ 第１の位相制御信号 Ｄ３，Ｄ４ 第２の位相制御信号 Ｄ５ 選択信号 Ｄ１０ 位相制御信号 Ｓ２，Ｓ３ 合成回路２に入力する信号 Ｓ４ 合成信号 Ｖｐ 信号Ｓ２，Ｓ３の位相差を示す電圧 Ｖ２ 信号Ｓ２のレベルを示す電圧 Ｖ３ 信号Ｓ３のレベルを示す電圧 Ｖ４ 合成信号Ｓ４のレベルを示す電圧 Ｖｏ 合成信号の最大レベルを示す電圧
Claims (2)
- 【請求項１】 スペースダイバーシティにより受信した
一方の信号の位相を位相制御信号に応じて調整する移相
手段と、この移相手段により位相調整された信号と前記
スペースダイバーシティにより受信した他方の信号とを
合成する合成手段と、前記位相調整された信号と前記受
信した他方の信号との位相差を検出する位相比較手段
と、前記移相手段により位相調整された信号および前記
スペースダイバーシティにより受信した他方の信号並び
に前記合成手段により合成された合成信号の信号レベル
をそれぞれ検出するレベル検出手段と、前記位相比較手
段により検出された前記位相差および前記レベル検出手
段により検出された各信号レベルに基づき前記合成信号
の最大レベルを推定し、前記合成信号のレベルが前記最
大レベルになるように前記位相制御信号を出力する位相
制御手段とを備えることを特徴とする同相合成装置。 - 【請求項２】 前記位相制御手段は、前記位相比較手段
により検出された位相差に基づき前記位相差を所定制御
範囲に保持するための第１の位相制御信号を生成する比
較部と、前記第１の位相制御信号に基づき位相制御状態
を判定する判定部と、前記レベル検出手段により検出さ
れた前記位相調整された信号のレベルおよび前記受信し
た他方の信号のレベルに基づき前記合成信号の最大レベ
ルを推定する合成最大レベル推定部と、この合成最大レ
ベル推定部より推定された前記最大レベルおよび前記レ
ベル検出手段により検出された前記合成信号のレベルと
に基づき前記合成信号のレベルが前記最大レベルになる
ように制御するための第２の位相制御信号を生成する合
成レベル最大化制御部と、前記判定部の判定結果に基づ
き前記第１の位相制御信号および前記第２の位相制御信
号の内いずれか一方を選択して前記移相回路へ送出する
選択部とを備えることを特徴とする請求項１記載の同相
合成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7075089A JP2822914B2 (ja) | 1995-03-31 | 1995-03-31 | 同相合成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7075089A JP2822914B2 (ja) | 1995-03-31 | 1995-03-31 | 同相合成装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08274695A JPH08274695A (ja) | 1996-10-18 |
| JP2822914B2 true JP2822914B2 (ja) | 1998-11-11 |
Family
ID=13566101
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7075089A Expired - Fee Related JP2822914B2 (ja) | 1995-03-31 | 1995-03-31 | 同相合成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2822914B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3617487B2 (ja) | 2001-10-30 | 2005-02-02 | 日本電気株式会社 | スペースダイバーシティ受信機及びその動作制御方法並びにプログラム |
| KR100677296B1 (ko) | 2002-03-27 | 2007-02-05 | 엘지전자 주식회사 | 다이버시티 수신 장치 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61131625A (ja) * | 1984-11-29 | 1986-06-19 | Nec Corp | スペ−スダイバ−シチ受信方式 |
| JPH03179932A (ja) * | 1989-12-08 | 1991-08-05 | Fujitsu Ltd | スペースダイバーシチ受信機 |
-
1995
- 1995-03-31 JP JP7075089A patent/JP2822914B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61131625A (ja) * | 1984-11-29 | 1986-06-19 | Nec Corp | スペ−スダイバ−シチ受信方式 |
| JPH03179932A (ja) * | 1989-12-08 | 1991-08-05 | Fujitsu Ltd | スペースダイバーシチ受信機 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH08274695A (ja) | 1996-10-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19970909 |
|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980804 |
|
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