JP2813252B2 - Fault diagnosis method for information processing equipment - Google Patents
Fault diagnosis method for information processing equipmentInfo
- Publication number
- JP2813252B2 JP2813252B2 JP3161219A JP16121991A JP2813252B2 JP 2813252 B2 JP2813252 B2 JP 2813252B2 JP 3161219 A JP3161219 A JP 3161219A JP 16121991 A JP16121991 A JP 16121991A JP 2813252 B2 JP2813252 B2 JP 2813252B2
- Authority
- JP
- Japan
- Prior art keywords
- error
- error information
- control unit
- test
- restart
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Landscapes
- Test And Diagnosis Of Digital Computers (AREA)
Description
【0001】[0001]
【産業上の利用分野】本発明は情報処理装置の障害箇所
診断方式に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method for diagnosing a trouble spot in an information processing apparatus.
【0002】[0002]
【従来の技術】情報処理装置の診断時には、電源投入
後、システムの初期診断処理が行なわれ、次に、各種構
成装置に関するマイクロテストが実行され、その後テス
トプログラムのローディングが行なわれて各入出力制御
部毎にマクロ的なテストが実行されている。2. Description of the Related Art When diagnosing an information processing apparatus, after power is turned on, an initial diagnosis processing of the system is performed, and then a microtest for various components is executed. A macro test is executed for each control unit.
【0003】この各入出力制御部毎に実行されるマクロ
的なテスト中にエラーが発生した場合は、人間が該エラ
ー情報を解析し、被擬箇所と思われる制御部に対して、
マイクロ的なテストを実行してエラー箇所の追求を行っ
ていた。If an error occurs during a macro test performed for each input / output control unit, a human analyzes the error information and sends a message to a control unit considered to be a simulated location.
A micro test was performed to pursue an error location.
【0004】[0004]
【発明が解決しようとする課題】上述したように、従来
は各入出力制御部に対するマクロテスト実行中にエラー
が発生した場合、人間が該エラー情報を解析し、被擬箇
所と思われる制御部に対してマイクロ的なテストを実行
してエラー箇所の追求を行っていた。As described above, conventionally, when an error occurs during the execution of a macro test for each input / output control unit, a human analyzes the error information and a control unit considered to be a simulated location. , A micro test was performed to pursue an error location.
【0005】このため、人間による該エラー情報の解析
およびマイクロテストの実行を行なわせていたため、エ
ラー情報の解析誤りおよびマイクロテスト実行誤り指令
が有り、エラー箇所の追求に長時間を要していた。本発
明はエラー情報を自動的に作成して格納し、マクロテス
ト段階で格納したエラー情報をもとに重点的にエラー発
生制御部にテストを実行するように改良した情報処理装
置の障害箇所診断方式を提供することを目的とする。For this reason, since the analysis of the error information and the execution of the microtest are performed by a human, there are errors in the analysis of the error information and a microtest execution error command, and it takes a long time to pursue the error location. . The present invention automatically creates and stores error information, and based on the error information stored in the macro test stage, executes a test in an error occurrence control unit with emphasis on a fault location diagnosis of an information processing apparatus. The aim is to provide a scheme.
【0006】[0006]
【課題を解決するための手段】前述の課題を解決するた
めに、本発明が採用した手段を図1を参照して説明す
る。図1は本発明の原理図である。情報処理システム全
体の制御を行うプロセッサと入出力装置を制御する複数
の制御部を備えた情報処理装置において、前記制御部
のテストを実行中にエラーが発生したとき、エラーが発
生した制御部に関するエラー情報を作成するエラー情報
作成手段1と、前記エラー情報作成手段1によって作
成されたエラー情報を格納するエラー情報格納手段2
と、前記エラー格納手段2にエラー情報の格納後、シ
ステムの再起動を開始させる再起動手段3と、前記再
起動手段3によってシステムが再起動され、システムテ
スト実行時に、前記エラー情報格納手段2に格納されて
いるエラー情報を解析し、エラー発生制御部に対するテ
ストを重点的に行うマイクロテスト実行手段4と、を備
える。Means for solving the above-mentioned problem will be described with reference to FIG. FIG. 1 is a diagram illustrating the principle of the present invention. In an information processing apparatus including a processor that controls the entire information processing system and a plurality of control units that control input / output devices, when an error occurs during execution of a test of the control unit, the control unit related to the error Error information creation means 1 for creating error information, and error information storage means 2 for storing the error information created by the error information creation means 1
A restart means 3 for starting the restart of the system after storing the error information in the error storage means 2, and a restart of the system by the restart means 3; And a micro-test executing means 4 for analyzing the error information stored in the microcontroller and performing a test on the error occurrence control unit.
【0007】[0007]
【作用】情報作成手段1では、情報処理装置の制御部の
テストを実行中にエラーが発生したとき、エラーが発生
した制御部に関するエラー情報を作成する。エラー情報
格納手段2では、前記エラー情報作成手段1によって作
成されたエラー情報を格納する。When an error occurs during execution of the test of the control unit of the information processing apparatus, the information creation unit creates error information relating to the control unit in which the error has occurred. The error information storage means 2 stores the error information created by the error information creation means 1.
【0008】再起動手段3では、前記エラー情報格納手
段2にエラー情報を格納した後、システムの再起動を開
始させる。マイクロテスト実行手段4では、前記再起動
手段3によってシステムが再起動され、システムテスト
実行時に、前記エラー情報格納手段2に格納されている
エラー情報を読出してエラー発生制御部に対するテスト
を重点的に行なう。[0008] In the restart means 3, after the error information is stored in the error information storage means 2, the restart of the system is started. In the micro test execution means 4, the system is restarted by the restart means 3, and when the system test is executed, the error information stored in the error information storage means 2 is read and the test for the error occurrence control unit is focused. Do.
【0009】以上のように、エラーの発生した制御部に
対するエラー情報を格納し、情報処理装置の再起動時の
マイクロテスト実行時に、格納されたエラー情報を読出
し、エラーの発生した制御部に対するテストを重点的に
行なうようにしたので、人手を介さず自動的に障害箇所
の診断を行なうことができる。As described above, the error information for the control unit in which the error has occurred is stored, and the stored error information is read out when the microtest is executed at the time of restarting the information processing apparatus. , The fault location can be automatically diagnosed without manual intervention.
【0010】[0010]
【実施例】本発明の一実施例を図2および3を参照して
説明する。図2は本発明の一実施例の構成図、図3は同
実施例の動作フローチャートである。なお、エラー情報
格納手段3のエラー情報を格納する図示しないメモリ
は、電源切断に対しても格納されている情報が消えない
不揮発性メモリでできている。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS One embodiment of the present invention will be described with reference to FIGS. FIG. 2 is a block diagram of an embodiment of the present invention, and FIG. 3 is an operation flowchart of the embodiment. The memory (not shown) for storing the error information in the error information storage means 3 is a non-volatile memory that does not lose the stored information even when the power is turned off.
【0011】[実施例の構成]図2において、エラー情
報作成手段1、エラー情報格納手段2、再起動手段3お
よびマイクロテスト実行手段4については図1で説明し
たとおりである。5はフロッピ制御であり、システムに
接続されるフロッピディスクの制御を行なう。[Structure of Embodiment] In FIG. 2, an error information creating means 1, an error information storing means 2, a restart means 3 and a micro test executing means 4 are as described in FIG. Reference numeral 5 denotes a floppy control, which controls a floppy disk connected to the system.
【0012】6はディスク制御部であり、システムに接
続される磁気ディスクの制御を行なう。7はI/Oであ
り、システムに入出力される情報の制御を行なう。8は
システムストレージであり、システムで処理するデータ
などが格納される。Reference numeral 6 denotes a disk control unit which controls a magnetic disk connected to the system. Reference numeral 7 denotes an I / O, which controls information input to and output from the system. Reference numeral 8 denotes a system storage which stores data to be processed by the system.
【0013】9はマクロテスト実行部であり、前記フロ
ッピ制御部5、ディスク制御部6、I/O7、システム
ストレージ8などの制御部に対するマクロテストの実行
を行なう。10はマイクロプログラム起動部であり、シ
ステム起動時に、システムの初期処理およびテスト、マ
イクロプログラムのローディング、OSのローディング
など、システム起動処理が実行される。Reference numeral 9 denotes a macro test execution unit which executes a macro test for the control units such as the floppy control unit 5, disk control unit 6, I / O 7, and system storage 8. Reference numeral 10 denotes a microprogram starting unit, which executes system starting processing such as system initial processing and testing, microprogram loading, and OS loading when the system is started.
【0014】11はシステム処理ユニット(SPU)で
あり、情報処理装置の処理が実行される。 [実施例の動作]図3において、処理S10は情報処理
装置が起動され、マイクロプログラム起動部10が起動
し、マイクロテスト実行手段3によるシステムに対する
マイクロテストが完了し、続いて各制御部に対するマク
ロテストがマクロテスト実行部9によって実行されてい
る状態である。Reference numeral 11 denotes a system processing unit (SPU) for executing processing of the information processing apparatus. [Operation of Embodiment] In FIG. 3, in step S10, the information processing apparatus is activated, the microprogram activation unit 10 is activated, the microtest for the system by the microtest execution unit 3 is completed, and then the macro for each control unit is executed. The test is being executed by the macro test execution unit 9.
【0015】処理S11 処理S10でマクロテスト実
行中にエラーが発生するとエラー情報作成手段1に通知
する。処理S12 エラー情報作成手段1ではエラーの
発生した制御部番号、エラー発生テスト項目等のエラー
情報を作成する。Processing S11 When an error occurs during execution of the macro test in processing S10, the error information creating means 1 is notified. Process S12 The error information creating means 1 creates error information such as the control unit number in which an error has occurred, an error occurrence test item and the like.
【0016】処理S13 処理S12で作成されたエラ
ー情報を不揮発性メモリのエラー情報格納手段2に格納
する。処理S14 エラー情報がエラー情報格納手段2
に格納されると、再起動手段3はマイクロプログラム起
動部10に対して再起動命令を発行する。Step S13 The error information created in step S12 is stored in the error information storage means 2 of the nonvolatile memory. Process S14: The error information is stored in the error information storage unit 2.
The restart unit 3 issues a restart command to the microprogram starting unit 10.
【0017】処理S15 マイクロプログラム起動部1
0では再起動命令を受けると、システムの再起動を開始
し、システムの初期処理およびテスト、マイクロプログ
ラムのローディングなどの一連システム起動処理を実行
する。処理S16マイクロプログラムのローディングが
完了するとシステムに対するマイクロテストがマイクロ
テスト実行手段4によって開始される。Process S15 Microprogram starting unit 1
At 0, when a restart command is received, restart of the system is started, and a series of system startup processing such as initial processing and testing of the system and loading of a microprogram are executed. Processing S16 When the loading of the microprogram is completed, the microtest for the system is started by the microtest execution means 4.
【0018】処理S17 マイクロテスト実行手段4で
は、エラー情報格納手段2に格納されているエラー情報
をリードする。処理S18 マイクロテスト実行手段4
ではリードしたエラー情報を解析し、エラーの発生した
制御部に対するマイクロテストを重点的に実行する。Process S17 The micro test execution means 4 reads the error information stored in the error information storage means 2. Processing S18 Micro test execution means 4
Then, the read error information is analyzed, and the microtest for the control unit in which the error has occurred is mainly executed.
【0019】処理S19 マイクロテスト実行手段4で
は処理S18で重点的に実行したテスト結果の詳細情報
を図示しないメモリ等に格納して処理を終了する。以
上、本発明の一実施例について説明したが、本発明はこ
の実施例に限定されるものではなく、その発明の主旨に
従った各種変形が可能である。Process S19 The microtest executing means 4 stores the detailed information of the test result executed in the process S18 in a memory (not shown) and terminates the process. As described above, one embodiment of the present invention has been described, but the present invention is not limited to this embodiment, and various modifications in accordance with the gist of the invention are possible.
【0020】[0020]
【発明の効果】以上説明したように、本発明によれば次
の効果が得られる。エラーの発生した制御部に対するエ
ラー情報を格納し、情報処理装置の再起動時のマイクロ
テスト実行時に、格納されたエラー情報を読出し、エラ
ーの発生した制御部に対するテストを重点的に行なうよ
うにしたので、人手を介さず自動的に障害箇所の診断を
行なうことができる。As described above, according to the present invention, the following effects can be obtained. Error information for a control unit in which an error has occurred is stored, and when the micro test is executed when the information processing apparatus is restarted, the stored error information is read out, and the test for the control unit in which the error has occurred is performed with priority. Therefore, the fault location can be automatically diagnosed without manual intervention.
【図1】本発明の原理図である。FIG. 1 is a principle diagram of the present invention.
【図2】本発明の一実施例の構成図である。FIG. 2 is a configuration diagram of one embodiment of the present invention.
【図3】同実施例の動作フローチャートである。FIG. 3 is an operation flowchart of the embodiment.
1 エラー情報作成手段 2 エラー情報格納手段 3 再起動手段 4 マイクロテスト実行手段 5 フロッピ制御部 6 ディスク制御部 7 I/O 8 システムストレージ 9 マイクロテスト実行部 10 マイクロプログラム起動部 11 システム処理ユニット(SPU) DESCRIPTION OF SYMBOLS 1 Error information creation means 2 Error information storage means 3 Restart means 4 Micro test execution means 5 Floppy control unit 6 Disk control unit 7 I / O 8 System storage 9 Micro test execution unit 10 Micro program start unit 11 System processing unit (SPU )
フロントページの続き (56)参考文献 特開 平3−127233(JP,A) 特開 昭62−231359(JP,A) 特開 昭58−96352(JP,A) 特開 昭63−201749(JP,A) 特開 昭62−184546(JP,A) (58)調査した分野(Int.Cl.6,DB名) G06F 11/22 - 11/26Continuation of front page (56) References JP-A-3-127233 (JP, A) JP-A-62-231359 (JP, A) JP-A-58-96352 (JP, A) JP-A-63-201749 (JP, A) , A) JP-A-62-184546 (JP, A) (58) Fields investigated (Int. Cl. 6 , DB name) G06F 11/22-11/ 26
Claims (1)
セッサと入出力装置を制御する複数の制御部を備えた情
報処理装置において、 前記制御部のテストを実行中にエラーが発生したと
き、エラーが発生した制御部に関するエラー情報を作成
するエラー情報作成手段1と、 前記エラー情報作成手段1によって作成されたエラー
情報を格納するエラー情報格納手段2と、 前記エラー格納手段2にエラー情報の格納後、システ
ムの再起動を開始させる再起動手段3と、 前記再起動手段3によってシステムが再起動され、シ
ステムテスト実行時に、前記エラー情報格納手段2に格
納されているエラー情報を解析し、エラー発生制御部に
対するテストを重点的に行うマイクロテスト実行手段4
と、 を備えたことを特徴とする情報処理装置の障害箇所診断
方式。An information processing apparatus comprising: a processor that controls the entire information processing system; and a plurality of control units that control input / output devices. When an error occurs during execution of a test of the control unit, the error is generated. Error information creating means 1 for creating error information relating to the control unit that has occurred, error information storing means 2 for storing the error information created by the error information creating means 1, and after storing the error information in the error storing means 2. A restart means 3 for starting a restart of the system; and a restart of the system by the restart means 3. At the time of executing a system test, the error information stored in the error information storage means 2 is analyzed to generate an error. Micro-test execution means 4 that focuses on testing the control unit
A fault location diagnosis method for an information processing device, comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3161219A JP2813252B2 (en) | 1991-07-02 | 1991-07-02 | Fault diagnosis method for information processing equipment |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3161219A JP2813252B2 (en) | 1991-07-02 | 1991-07-02 | Fault diagnosis method for information processing equipment |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0512056A JPH0512056A (en) | 1993-01-22 |
JP2813252B2 true JP2813252B2 (en) | 1998-10-22 |
Family
ID=15730888
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3161219A Expired - Fee Related JP2813252B2 (en) | 1991-07-02 | 1991-07-02 | Fault diagnosis method for information processing equipment |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2813252B2 (en) |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5896352A (en) * | 1981-12-02 | 1983-06-08 | Hitachi Ltd | Microcomputer control system |
JPS62231359A (en) * | 1986-03-31 | 1987-10-09 | Nec Corp | Testing system for input/output device |
JPH03127233A (en) * | 1989-10-13 | 1991-05-30 | Nec Corp | Patrol diagnosing device for computer system |
-
1991
- 1991-07-02 JP JP3161219A patent/JP2813252B2/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH0512056A (en) | 1993-01-22 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH06222952A (en) | Debug supporting device | |
JP2813252B2 (en) | Fault diagnosis method for information processing equipment | |
JPH04352245A (en) | Simulation system | |
JPS62226216A (en) | System rise system | |
JP2002024052A (en) | Error reproduction test method of computer peripheral equipment | |
JP3001470B2 (en) | Boot failure detection system for personal computer | |
JP2998793B2 (en) | Test method for information processing equipment | |
JP3263987B2 (en) | Automatic IPL initial setting processing method | |
JP3073848B2 (en) | Test method for data processing equipment | |
JP2849780B2 (en) | Computer system | |
JP3110391B2 (en) | Program re-execution method | |
JP2812037B2 (en) | Restart control method for business processing programs | |
JPH04275638A (en) | System for testing information processor | |
JPH0652012A (en) | Information processor having diagnostic function for peripheral part of device | |
JPH081607B2 (en) | Pseudo-fault occurrence method in information processing system | |
JP2005031860A (en) | Test case creation device | |
JPH11306032A (en) | Fault occurrence state processing method and operating system | |
JPH05143395A (en) | Diagnostic program execution system and log information display system to be used for the execution system | |
JPH0540708A (en) | Test diagnostic system for input/output processor | |
JPH11259338A (en) | Automatic os test system and storage medium for recording program for automatic os test | |
JPH08106404A (en) | Automatic driver generating device for software test | |
JPH05158726A (en) | Test system for information processor | |
JPH08153025A (en) | Ws memory dump output/ws reraising system | |
JPH0229833A (en) | Maintenance diagnostic system | |
JPH04291629A (en) | Instruction testing system for diagnostic system |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980714 |
|
LAPS | Cancellation because of no payment of annual fees |