JP2795762B2 - Configuration method of matching circuit - Google Patents
Configuration method of matching circuitInfo
- Publication number
- JP2795762B2 JP2795762B2 JP25392791A JP25392791A JP2795762B2 JP 2795762 B2 JP2795762 B2 JP 2795762B2 JP 25392791 A JP25392791 A JP 25392791A JP 25392791 A JP25392791 A JP 25392791A JP 2795762 B2 JP2795762 B2 JP 2795762B2
- Authority
- JP
- Japan
- Prior art keywords
- matching circuit
- impedance
- electrical network
- network
- input terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Landscapes
- Surface Acoustic Wave Elements And Circuit Networks Thereof (AREA)
Description
【０００１】[0001]
【産業上の利用分野】本発明は、小型で良好な周波数特
性を得るための二端子対電気回路網用の整合回路の構成
方法に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method of constructing a matching circuit for a two-port electric network for obtaining a small and good frequency characteristic.
【０００２】[0002]
【従来の技術】従来、このような分野の技術としては、
例えば次のような文献に記載されるものがあった。 文献；電子通信学会編「電子通信ハンドブック」第１版
（昭５４−３−３０）Ｐ．１６９−１７１ 複数の電気回路でシステムを構成するときに、回路間の
整合は常に問題になっており、特に高周波領域の場合に
整合の問題が大きい。一般的には簡単な工夫で回路同士
を接続することがあるが、整合の対象となる電気回路網
の入力端子と出力端子とを同じ周波数において完全に整
合することは困難である。2. Description of the Related Art Conventionally, techniques in such a field include:
For example, there is one described in the following literature. Literature; IEICE Handbook, 1st Edition (1979-3-30) 169-171 When configuring a system with a plurality of electric circuits, matching between circuits is always a problem, and particularly in the case of a high frequency region, the problem of matching is large. Generally, circuits may be connected to each other with a simple device. However, it is difficult to completely match input terminals and output terminals of an electric network to be matched at the same frequency.
【０００３】図２は、一般的な二端子対電気回路網を示
す図である。この二端子対電気回路網１０は、受動素子
（抵抗、インダクタ、キャパシタ等）で構成され、入力
端子１１−１，１１−２及び出力端子１２−１，１２−
２を有している。FIG. 2 is a diagram showing a general two-port electric network. The two-port electric network 10 is composed of passive elements (resistance, inductor, capacitor, etc.), and has input terminals 11-1, 11-2 and output terminals 12-1, 12-.
Two.
【０００４】ここで、回路網１０の内部構成は問題では
なく、このような回路網１０を他の回路と接続するとき
に、何もしないで最初からインピーダンス整合がうまく
ゆくことはまれである。一般的に、接続する入力端子１
１−１，１１−２と出力端子１２−１，１２−２におい
て、インピーダンス不整合が発生し、回路網１０の挿入
損失を増加させる結果になってしまう。このような不整
合損失を除去するためには、電力を消費しない素子、即
ち抵抗分を持たない素子（インダクタ、キャパシタ、無
損失トランス、無損失伝送路等）を用いて、回路網１０
の入力端子１１−１，１１−２と出力端子１２−１，１
２−２において整合回路を構成する。整合回路には、前
記文献に記載されるように種々の種類があるが、機能的
には同じである。以下、従来の二端子対電気回路網用の
整合回路の構成方法を、図３（ａ）〜（ｃ）に示す。Here, the internal configuration of the network 10 is not a problem, and when such a network 10 is connected to another circuit, it is rare that impedance matching is successfully performed from the beginning without doing anything. Generally, input terminal 1 to be connected
Impedance mismatch occurs between 1-1 and 11-2 and output terminals 12-1 and 12-2, resulting in an increase in insertion loss of the network 10. In order to eliminate such a mismatch loss, an element that does not consume power, that is, an element that does not have a resistance component (such as an inductor, a capacitor, a lossless transformer, or a lossless transmission line) is used.
Input terminals 11-1 and 11-2 and output terminals 12-1 and 1
A matching circuit is configured in 2-2. There are various types of matching circuits as described in the above-mentioned literature, but the functions are the same. FIGS. 3A to 3C show a conventional method for configuring a matching circuit for a two-port electrical network.
【０００５】図３（ａ）〜（ｃ）は、従来の二端子対電
気回路網用整合回路の構成過程を示す図である。図３
（ａ）において、二端子対電気回路網２０は、入力端子
２１−１，２１−２と出力端子２２−１，２２−２を有
している。この回路網２０は、受動素子だけで構成され
るため、縦続行列を持つ。FIGS. 3 (a) to 3 (c) are diagrams showing a process of forming a conventional matching circuit for a two-port electric network. FIG.
2A, the two-port electric network 20 has input terminals 21-1 and 21-2 and output terminals 22-1 and 22-2. Since this network 20 is composed of only passive elements, it has a cascade.
【０００６】整合回路を構成する場合、まず回路網２０
の入力端子２１−１，２１−２及び出力端子２２−１，
２２−２のいずれかの端子をあるインピーダンス２３で
終端させる。ここでは、説明の簡単化を図るために、出
力端子２２−１，２２−２をインピーダンス２３で終端
させることとする。インピーダンス２３は、後述するイ
ンピーダンスＺb に等しいものとする。この時、入力端
子２１−１，２１−２からみた回路網２０のインピーダ
ンスをＺ21とする。この二端子対電気回路網２０に他の
電気回路網３０を接続することを考える。回路網３０
は、端子３２−１，３２−２を持ち、その端子３２−
１，３２−２からみた該回路網３０のインピーダンスを
Ｚa とする。When constructing a matching circuit, first, the network 20
Input terminals 21-1, 21-2 and output terminals 22-1,
One of the terminals 22-2 is terminated with a certain impedance 23. Here, in order to simplify the description, the output terminals 22-1 and 22-2 are terminated with the impedance 23. Impedance 23 is assumed to be equal to the impedance Z b, which will be described later. At this time, the impedance of the input terminal 21-1 and 21-2 as seen from the network 20 and Z 21. Consider connecting another electrical network 30 to this two-port electrical network 20. Network 30
Has terminals 32-1 and 32-2.
Let Z a be the impedance of the network 30 as viewed from 1, 32-2.
【０００７】図３（ｂ）において、二端子対電気回路網
２０と回路網３０とは、インピーダンスＺ21とＺa を整
合するための基本的な入力端子側の整合回路４０で接続
されている。そして、二端子対電気回路網２０を整合回
路４０を介して他の回路網３０と接続したまま、インピ
ーダンス２３を撤去する。このとき、出力端子２２−
１，２２−２からみたインピーダンスはＺ22である。こ
の出力端子２２−１，２２−２に他の電気回路網５０を
接続することを考える。回路網５０は、端子５１−１，
５１−２を有し、その端子５１−１，５１−２からみた
該回路網５０のインピーダンスをＺb とする。In FIG. 3B, the two-terminal electrical network 20 and the network 30 are connected by a basic input terminal side matching circuit 40 for matching the impedances Z 21 and Z a . . Then, the impedance 23 is removed while the two-terminal electric network 20 is connected to the other network 30 via the matching circuit 40. At this time, the output terminal 22-
1,22-2 viewed from impedance is Z 22. It is considered that another electric network 50 is connected to the output terminals 22-1 and 22-2. The network 50 has terminals 51-1,
Have 51-2, the impedance of the terminals 51-1 and 51-2 as viewed from the circuit network 50 and Z b.
【０００８】図３（ｃ）に示すように、二端子対電気回
路網２０のインピーダンスＺ22と回路網５０のインピー
ダンスＺb とを整合するためには、それらの回路網２０
と５０を出力端子側の整合回路６０で接続する。これに
より、二端子対電気回路網２０の入力端子２１−１，２
１−２には、入力端子側の整合回路４０を介して回路網
３０を接続し、出力端子２２−１，２２−２には、出力
端子側の整合回路６０を介して回路網５０を接続でき
る。[0008] As shown in FIG. 3 (c), to match an impedance Z b of the impedance Z 22 and circuitry 50 of a two-port electrical network 20, those of the network 20
And 50 are connected by a matching circuit 60 on the output terminal side. Thereby, the input terminals 21-1 and 2-1 of the two-port electric network 20 are obtained.
1-2 is connected to a network 30 via a matching circuit 40 on the input terminal side, and output terminals 22-1 and 22-2 are connected to a network 50 via a matching circuit 60 on the output terminal side. it can.
【０００９】[0009]
【発明が解決しようとする課題】しかしながら、従来の
二端子対電気回路網用の整合回路の構成方法では、次の
ような課題があった。二端子対電気回路網２０の入力端
子２１−１，２１−２に、整合回路４０を介して回路網
３０を接続した後、出力端子２２−１，２２−２に、整
合回路６０を介して回路網５０を接続すると、インピー
ダンスの変動が生じ、整合回路４０が理論的に本来のイ
ンピーダンス整合機能を果たせなくなる。即ち、インピ
ーダンス２３（またはＺb ）で終端したときに設計した
整合回路４０は、整合回路５０が設けられることで、整
合回路としての働きができなくなる。これを改善するた
めには、整合回路４０の微調整が必要であるが、この微
調整を行うと、今度は整合回路６０にも微調整が必要に
なってくる。このような微調整作業は、何回か繰り返し
ているうちに、ある程度安定した整合回路を得ることも
できるが、逆にできない場合もある。However, the conventional method for constructing a matching circuit for a two-port electrical network has the following problems. After the network 30 is connected to the input terminals 21-1 and 21-2 of the two-port electric network 20 via the matching circuit 40, the output terminals 22-1 and 22-2 are connected to the input terminals 21-1 and 22-2 via the matching circuit 60. When the network 50 is connected, the impedance fluctuates, and the matching circuit 40 cannot theoretically perform its original impedance matching function. That is, the matching circuit 40 designed when terminated with the impedance 23 (or Z b ) cannot function as a matching circuit because the matching circuit 50 is provided. In order to improve this, fine adjustment of the matching circuit 40 is necessary. However, when this fine adjustment is performed, fine adjustment of the matching circuit 60 is also required. While such fine adjustment work can be repeated several times, a stable matching circuit can be obtained to some extent, but in some cases, the matching circuit cannot be performed.
【００１０】このように、回路網同士を接続するために
用いた整合回路の構成を、微調整なしでは実現できず、
該整合回路の回路構成を正確に把握できない。その上、
ある特定の周波数において整合を行うときに、入力端子
と出力端子を他の回路網と整合させることが、微調整の
ためにかなり困難である。従って、未だ技術的に十分満
足のゆく整合回路の構成方法を実現できなかった。As described above, the configuration of the matching circuit used for connecting the circuit networks cannot be realized without fine adjustment.
The circuit configuration of the matching circuit cannot be accurately grasped. Moreover,
When matching at a particular frequency, matching the input and output terminals to other networks is quite difficult due to fine tuning. Therefore, it has not been possible to realize a matching circuit configuration method that is technically sufficiently satisfactory.
【００１１】本発明は、前記従来技術が持っていた課題
として、不整合損失をなくすための微調整の必要性と、
その作業の煩雑化の点について解決した整合回路の構成
方法を提供するものである。The present invention has the following problems that the prior art has: a need for fine adjustment for eliminating mismatch loss;
It is an object of the present invention to provide a method of configuring a matching circuit which solves the problem of complicated operations.
【００１２】[0012]
【課題を解決するための手段】前記課題を解決するため
に、本発明の整合回路の構成方法では、受動素子で構成
され（１）式の縦続行列［Ｆ］で表わされる二端子対電
気回路網の入力端子及び出力端子において、前記二端子
対電気回路網の入力端子と、インピーダンスＺa （＝Ｒ
a ±ｊＸa 、但し、Ｒa は抵抗、Ｘa はリアクタンス）
の入力端子側電気回路網とを、接続するためのインピー
ダンス整合用の入力端子側整合回路を構成する場合、及
び前記二端子対電気回路網の出力端子と、インピーダン
スＺb （＝Ｒb ±ｊＸb 、但し、Ｒb は抵抗、Ｘb はリ
アクタンス）の出力端子側電気回路網とを、接続するた
めのインピーダンス整合用の出力端子側整合回路を構成
する場合、前記二端子対電気回路網の複素数成分Ａ，
Ｂ，Ｃ，Ｄから、該二端子対電気回路網の共役影像イン
ピーダンスＺL （＝ＲL −ｊＸL 、但し、ＲL は抵抗、
ＸL はリアクタンス）とＺg （＝Ｒg −ｊＸg 、但し、
Ｒg は抵抗、Ｘg はリアクタンス）とが存在するか否
か、（２）式の存在条件を確認する。そして、前記共役
影像インピーダンスＺL とＺg が存在するときには、前
記入力端子側整合回路及び前記出力端子側整合回路を構
成することが可能であり、該二端子対電気回路網の出力
端子をインピーダンスＺL で終端すれば該二端子対電気
回路網の入力端子から見たインピーダンスはＺg の共役
値Ｚ g に等しく、逆に該二端子対電気回路網の入力端子
をインピーダンスＺg で終端すれば該二端子対電気回路
網の出力端子から見たインピーダンスはＺL の共役値Ｚ
L に等しいことになるので、（３−１）式、（３−２）
式、（４−１）式、（４−２）式、（１１−ａ）式及び
（１１−ｂ）式に示される量に基づき、前記入力端子側
整合回路を構成する素子値Ｙa 、及び前記出力端子側整
合回路を構成する素子値Ｙb を演算して、該入力端子側
整合回路及び該出力端子側整合回路を構成するようにし
ている。前記各式は、次式のようになる。In order to solve the above-mentioned problems, in the method of forming a matching circuit according to the present invention, a two-terminal electric circuit composed of passive elements and represented by a continuation column [F] of formula (1) At the input and output terminals of the network, the input terminal of the two-port electrical network and the impedance Z a (= R
a ± jX a , where Ra is a resistance and X a is a reactance)
An input terminal side electrical network and an output terminal of the case, and the two-terminal pair electrical network constituting the input terminal matching circuit for impedance matching to connect the impedance Z b (= R b ± jX b , where R b is a resistor, and X b is a reactance) on the output terminal side electric circuit network, to form an output terminal side matching circuit for impedance matching for connection, The complex component A,
B, C, from D, the two-conjugate image impedance terminal pair electrical network Z L (= R L -jX L , where, R L is the resistance,
X L is the reactance) and Z g (= R g -jX g , however,
Rg is a resistance, Xg is a reactance), and the existence condition of the equation (2) is confirmed. When the conjugate image impedances Z L and Z g are present, the input terminal side matching circuit and the output terminal side matching circuit can be formed, and the output terminal of the two-port electric network is connected to the impedance. impedance viewed from the input terminal of the two-terminal pair electrical network when terminated with Z L is equal to the conjugate value Z g of Z g, by terminating the input terminal of the two-terminal pair electrical network impedance Z g conversely For example, the impedance seen from the output terminal of the two-port electric network is the conjugate value Z of Z L.
Since it is equal to L , the expression (3-1), (3-2)
Wherein (4-1) equation, (4-2) equation, (11-a) and Formula (11-b) on the basis of the amounts indicated in formula, element values constituting the input terminal matching circuit Y a, and calculates the element values Y b constituting the output terminal matching circuit, so that constitutes the input terminal matching circuit and the output terminal matching circuit. The above equations are as follows.
【００１３】[0013]
【数３】 (Equation 3)
【００１４】[0014]
【数４】 (Equation 4)
【００１５】[0015]
【作用】本発明によれば、以上のように整合回路の構成
方法を構成したので、二端子対電気回路網の複素数成分
Ａ，Ｂ，Ｃ，Ｄからその存在条件を確認することによ
り、回路網同士の接続に用いられる整合回路の存在が、
理論的に該回路網の電気的性質から明確になる。そし
て、所定の数式で示される量に基づき、素子値Ｙa ，Ｙ
b を演算して二端子対電気回路網に対する整合回路を構
成することにより、整合回路が存在するときの該整合回
路の構成と、該整合回路を設けた後の回路網の特性を予
測できる計算方法の提供が行える。従って、前記課題を
解決できるのである。According to the present invention, since the method of constructing a matching circuit is constructed as described above, the existence condition is confirmed from the complex components A, B, C, and D of the two-port electric network, thereby making it possible to obtain the circuit. The existence of a matching circuit used to connect the networks
It becomes theoretically clear from the electrical properties of the network. Then, based on the amounts represented by the predetermined mathematical expressions, the element values Y a , Y
By calculating b to form a matching circuit for the two-port electrical network, a calculation that can predict the configuration of the matching circuit when the matching circuit exists and the characteristics of the network after the matching circuit is provided Provide a method. Therefore, the above problem can be solved.
【００１６】[0016]
【実施例】まず、本実施例における二端子対電気回路網
用整合回路の構成方法の原理を説明する。図２に示すよ
うな受動素子で構成される二端子対電気回路網１０は、
数学的に（１）式に示すような縦続行列（または［Ｆ］
行列、あるいは基本行列ともいう）で表わすことができ
る。そして、（２）式に示す整合回路の存在条件を満た
す縦続行列を持った二端子対電気回路網１０だけが、同
じ周波数において入力端子１１−１，１１−２と出力端
子１２−１，１２−２とも他の回路網と整合できる。こ
こで、（２）式の導出方法を説明する。図２に示すよう
な二端子対電気回路網１０の出力端子１２−１，１２−
２をインピーダンスＺL で終端すると、入力端子１１−
１，１１−２からみたインピーダンスＺ1 は（２−１）
式のようになる。同様に、入力端子１１−１，１１−２
をインピーダンスＺg で終端すると、出力端子１２−
１，１２−２からみたインピーダンスＺ2 は（２−２）
式のようになる。 Ｚ1 ＝（ＡＺL ＋Ｂ）／（ＣＺL ＋Ｄ） ・・・（２−１） 但し、ＺL ＝ＲL −ｊＸL （ＲL は抵抗、ＸL はリアクタンス） Ｚ2 ＝（ＤＺg ＋Ｂ）／（ＣＺg ＋Ａ） ・・・（２−２） 但し、Ｚg ＝Ｒg −ｊＸg （Ｒg は抵抗、Ｘg はリアクタンス） インピーダンスＺL がインピーダンスＺ2 に、インピー
ダンスＺg がインピーダンスＺ1 にそれぞれ等しけれ
ば、ＺL ，Ｚg の一組を影像インピーダンスという。イ
ンピーダンスＺL がインピーダンスＺg の共役インピー
ダンスに、インピーダンスＺg がインピーダンスＺ1 の
共役インピーダンスにそれぞれ等しいとき、この明細書
ではＺL ，Ｚg の一組を共役影像インピーダンスという
ことにする。理論的に、共役影像インピーダンスから整
合回路を設計することができるが、一般的に、二端子対
電気回路網１０には必ずしも共役影像インピーダンスが
存在するわけではない。従って、共役影像インピーダン
スが存在しないときに、整合回路も存在しないわけであ
る。（２−１）式と（２−２）式に基づいて、ＺL とＺ
g が二端子対電気回路網１０の共役影像インピーダンス
とすれば、次式が成立する。 Ｚ g ＝Ｚ1 ＝（ＡＺL ＋Ｂ）／（ＣＺL ＋Ｄ） ・・・（２−３） Ｚ L ＝Ｚ2 ＝（ＤＺg ＋Ｂ）／（ＣＺg ＋Ａ） ・・・（２−４） （２−３）式と（２−４）式を展開して整理すると、次
式が得られる。 （ＡＣ＋ＡＣ）Ｚ L 2 ＋［（ＢＣ−ＢＣ）−（ＡＤ−ＡＤ）］ＺL −（ＢＤ＋ＢＤ）＝０ ・・・（２−５） （ＣＤ＋ＣＤ）Ｚg 2 ＋［（ＢＣ−ＢＣ）−（ＡＤ−ＡＤ）］Ｚg −（ＡＢ＋ＡＢ）＝０ ・・・（２−６） （２−５）式と（２−６）式はそれぞれＺL とＺg の２
次方程式で、同じ根の判定式（後述する（５）式）を持
っている。結果的に、（２−５）式と（２−６）式の根
であるＺL とＺg は、次式のように表すことができる。 ＺL ＝｛−［（ＢＣ−ＢＣ）−（ＡＤ−ＡＤ）］±√△｝ ／［２（ＡＣ＋ＡＣ）］ ・・・（２−７） Ｚg ＝｛−［（ＢＣ−ＢＣ）＋（ＡＤ−ＡＤ）］±√△｝ ／［２（ＣＤ＋ＣＤ）］ ・・・（２−８） （２−７）式と（２−８）式を展開すると、次式のよう
になる。 ＺL ＝ＲL −ｊＸL ・・・（２−９） Ｚg ＝Ｒg −ｊＸg ・・・（２−１０） 但し、 ＲL ＝±√△／［２（ＡＣ＋ＡＣ）］ ・・・（２−１１） ｊＸL ＝−［（ＢＣ−ＢＣ）−（ＡＤ−ＡＤ）］／［２（ＡＣ＋ＡＣ）］ ・・・（２−１２） Ｒg ＝±√△／［２（ＣＤ＋ＣＤ）］ ・・・（２−１３） ｊＸg ＝−［（ＢＣ−ＢＣ）−（ＡＤ−ＡＤ）］／［２（ＣＤ＋ＣＤ）］ ・・・（２−１４） 整合回路を設計することができるためには、（２−９）
式と（２−１０）式の実部ＲL とＲg の値が正でなけれ
ばならず、これを満たすために必然的に次の条件が必要
になってくる。 ＡＣ＋ＡＣ≠０ ・・・（２−１５） ＣＤ＋ＣＤ≠０ ・・・（２−１６） また、（２−９），（２−１０）式と後述する（５）式
より、△が正の値を持たなければならないため、（２）
式の不等式が成立する。つまり、このような（２）式が
成立するとき、整合回路は存在し、その整合回路を（３
−１），（３−２），（４−１），（４−２）式から設
計 （構成）できる。（３−１），（４−１）式のΔは、次
式（５）で表わされる。 Δ＝［（ＢＣ＋ＢＣ）＋（ＡＤ＋ＡＤ）］2 −４ ・・・（５） （３−１），（３−２），（４−１），（４−２）式に
おいて、常に、Ｒg ，ＲL とΔは正の実数で、ｊＸg と
ｊＸL は純虚数である。ｊは−１の平方根（即ち、ｊ2
＝−１）である。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS First, the principle of a method of configuring a matching circuit for a two-port electric network in this embodiment will be described. A two-port electrical network 10 composed of passive elements as shown in FIG.
Mathematically a continuation column (or [F]
Matrix, or elementary matrix). Then, only the two-port electrical network 10 having a cascade of columns that satisfies the condition for the existence of the matching circuit shown in the equation (2) is the only input terminal 11-1, 11-2 and output terminal 12-1, 12 -2 can be matched with other networks. Here, a method of deriving the equation (2) will be described. The output terminals 12-1, 12- of the two-port electrical network 10 as shown in FIG.
2 is terminated by impedance Z L , input terminal 11−
The impedance Z1 viewed from 1, 11-2 is (2-1)
It looks like an expression. Similarly, input terminals 11-1 and 11-2
When terminating impedance Z g, the output terminal 12
1,12-2 seen from the impedance Z 2 is (2-2)
It looks like an expression. Z 1 = (AZ L + B ) / (CZ L + D) ··· (2-1) where, Z L = R L -jX L (R L is the resistance, X L is the reactance) Z 2 = (DZ g + B ) / (CZ g + A) (2-2) where Z g = R g −jX g (R g is a resistance, X g is a reactance). The impedance Z L is the impedance Z 2 , and the impedance Z g is the impedance. equal respectively to Z 1, Z L, a set of a called image impedance Z g. The conjugate impedance of the impedance Z L is the impedance Z g, when the impedance Z g each equal to the conjugate impedance of the impedance Z 1, in this specification will be referred conjugate image impedance of a pair of Z L, Z g. Theoretically, a matching circuit can be designed from the conjugate image impedance, but in general, the conjugate image impedance does not always exist in the two-port electrical network 10. Therefore, when the conjugate image impedance does not exist, the matching circuit does not exist. Based on equations (2-1) and (2-2), Z L and Z
If g is the conjugate image impedance of the two-port electrical network 10, the following equation holds. Z g = Z 1 = (AZ L + B) / (CZ L + D) ··· (2-3) Z L = Z 2 = (DZ g + B) / (CZ g + A) ··· (2-4) By expanding and rearranging the expressions (2-3) and (2-4), the following expression is obtained. (A C + A C) Z L 2 + [(B C - B C) - (A D - A D)] Z L - (B D + B D) = 0 ··· (2-5) (C D + C D) Z g 2 + [(B C - B C) - (A D - A D)] Z g - (A B + A B) = 0 ··· (2-6) (2-5 ) And (2-6) are calculated as Z L and Z g , respectively.
The following equation has the same root determination formula (formula (5) described later). As a result, Z L and Z g which are the roots of the equations (2-5) and (2-6) can be expressed as the following equations. Z L = {- [(B C - B C) - (A D - A D)] ± √ △} / [2 (A C + A C)] ··· (2-7) Z g = {- [(B C - B C) + (a D - a D)] ± √ △} / [2 (C D + C D)] ··· (2-8) (2-7) equation (2 8) When the expression is expanded, the following expression is obtained. Z L = R L -jX L ··· (2-9) Z g = R g -jX g ··· (2-10) where, R L = ± √ △ / [2 (A C + A C) ] ··· (2-11) jX L = - [(B C - B C) - (A D - A D)] / [2 (A C + A C)] ··· (2-12) R g = ± √ △ / [2 (C D + C D)] ··· (2-13) jX g = - [(B C - B C) - (A D - A D)] / [2 (C D + C D)] ··· (in order to be able 2-14) designing the matching circuit, (2-9)
The values of the real parts R L and R g of the equation and the equation (2-10) must be positive, and the following conditions are inevitably required to satisfy these. A C + A C ≠ 0 ··· (2-15) C D + C D ≠ 0 ··· (2-16) Further, (2-9), will be described later (2-10) (5) According to the formula, since な must have a positive value, (2)
The inequality of the expression holds. That is, when equation (2) is satisfied, a matching circuit exists, and the matching circuit is replaced by (3)
-1), (3-2), (4-1), and (4-2) can be designed (configured). Δ in the expressions (3-1) and (4-1) is represented by the following expression (5). Δ = [(B C + B C) + (A D + A D)] 2 -4 ··· (5) (3-1), (3-2), (4-1), (4-2 )), R g , R L and Δ are always positive real numbers, and jX g and jX L are pure imaginary numbers. j is the square root of −1 (ie, j 2
= -1).
【００１７】無損失整合回路の構成は様々であるが、そ
の構成素子値は全て（３−１），（３−２），（４−
１），（４−２）式から計算される。しかし、これらの
整合回路は回路構成がどうであれ、基本的には、次のよ
うな手順（ａ），（ｂ）に従い設計されなければならな
い。Although the configuration of the lossless matching circuit is various, all the component values thereof are (3-1), (3-2), (4-
It is calculated from the expressions 1) and (4-2). However, these matching circuits have to be designed basically according to the following procedures (a) and (b) irrespective of the circuit configuration.
【００１８】（ａ） 入力端子側 図１（ａ），（ｂ）は本実施例における整合回路構成の
基本を示す図であり、同図（ａ）は入力端子側、及び同
図（ｂ）は出力端子側の説明図である。まず、図３に示
す入力端子側電気回路網３０のインピーダンスＺa は、
次式（６）のように表わすことができる。 Ｚa ＝Ｒa ＋ｊＸa ・・・（６） 但し、Ｒa ；正の実数（抵抗） ｊＸa ；純虚数（Ｘa はリアクタンス） そして、例えば前記文献に記載された純抵抗の整合回路
の設計方法を参考にして、純抵抗Ｒa とＲg の整合回路
を設計する。前記文献には、７種類の整合回路が示され
ているが、Ｒa とＲg の値に矛盾のない整合回路ならば
どれを選んでも良い。その一例を図１（ａ）に示す。図
１（ａ）の整合回路７１は、Ｒa とＲgの整合回路であ
る。(A) Input terminal side FIGS. 1 (a) and 1 (b) are diagrams showing the basics of a matching circuit configuration in the present embodiment. FIG. 1 (a) shows the input terminal side and FIG. 1 (b). FIG. 4 is an explanatory diagram on the output terminal side. First, the impedance Z a of the input terminal side electrical network 30 shown in FIG. 3,
It can be expressed as the following equation (6). Z a = R a + jX a (6) where R a is a positive real number (resistance) jX a ; a pure imaginary number (X a is a reactance) and, for example, a pure resistance matching circuit described in the above-mentioned document. and a design method in reference, to design the matching circuit of the pure resistance R a and R g. The literature 7 The type of the matching circuit is shown, may be selected which, if not matching circuit consistent with the value of R a and R g. One example is shown in FIG. The matching circuit 71 in FIG. 1A is a matching circuit for Ra and Rg .
【００１９】次に、図１（ａ）においてインピーダンス
Ｚa の虚部＋ｊＸa を打ち消すための直列型二端子対電
気回路７１ａを設ける。この直列型二端子対電気回路７
１ａは、−ｊＸa を表わせる素子で構成される。Ｘa は
実数で、正なら−ｊＸa を表わせる素子がキャパシタ
で、負なら−ｊＸa を表わせる素子がインダクタであ
る。[0019] Next, an in-line two-terminal pair electrical circuit 71a for canceling the imaginary part + jX a impedance Z a in FIG. 1 (a). This series two-terminal electric circuit 7
1a is configured to -jX a in expressed device. The X a real and positive if -jX a by expressed element capacitor is represented element inductor negative if -jX a.
【００２０】また、理論的に検討した結果から、入力端
子からみた二端子対電気回路網のインピーダンスが、出
力端子側に整合回路及びインピーダンスＺbの回路網と
接続するときに、虚部＋ｊＸg を持つため、これを打ち
消すための直列型二端子対電気回路７１g が必要であ
る。この直列型二端子対電気回路７１g も、−ｊＸg を
表わせる素子で構成される。この素子がインダクタか、
キャパシタになるかは、直列型二端子対電気回路７１a
の場合と同様である。Further, from the results of investigation theoretically, when the impedance of the two-terminal pair electrical network as viewed from the input terminal, to be connected to the circuitry of the matching circuit and the impedance Z b to the output terminal side, the imaginary part + jX g Therefore, a series-type two-port electric circuit 71 g for canceling this is required. This series two-port electric circuit 71 g is also constituted by an element capable of expressing −jX g . Whether this element is an inductor
Either has a capacitor, the series-type two-terminal pair electrical circuit 71 a
Is the same as
【００２１】（ｂ） 出力端子側 同様に、図３に示す出力端子側電気回路網５０のインピ
ーダンスＺb は、次式（７）のように表わすことができ
る。 Ｚb ＝Ｒb ＋ｊＸb ・・・（７） 但し、Ｒb ；正の実数（抵抗） ｊＸb ；純虚数（Ｘb はリアクタンス） Ｒa とＲg の場合と同じように、図１（ｂ）に示すよう
な純抵抗ＲL とＲb の整合回路７２を設計する。次に、
インピーダンスＺb の虚部＋ｊＸb を打ち消すための直
列型二端子対電気回路７２b を設ける。この直列型二端
子対電気回路７２b も、−ｊＸb を表わせる素子で構成
される。直列型二端子対電気回路７２b は、Ｘb の値に
よってキャパシタになったり、インダクタになったりす
る。[0021] (b) the output terminal side as well, the impedance Z b of output terminal electrical network 50 shown in Figure 3, can be expressed by the following equation (7). Z b = R b + jX b ··· (7) where, R b; positive real (resistive) jX b; pure imaginary (X b reactance) As with the R a and R g, 1 ( A matching circuit 72 for the pure resistors RL and Rb as shown in b) is designed. next,
Providing a tandem two-terminal pair electrical circuit 72 b for canceling the imaginary part + jX b of the impedance Z b. The tandem two-terminal pair electrical circuit 72 b is also configured to -jX b in expressed device. Tandem two-terminal pair electrical circuit 72 b are or become capacitor by the value of X b, or become inductor.
【００２２】また、理論的に検討した結果から、出力端
子からみた二端子対電気回路網のインピーダンスが入力
端子側に整合回路及びインピーダンスＺa の回路網と接
続するときに、虚部＋ｊＸL を持つため、これを打ち消
すための直列型二端子対電気回路７２L が必要である。
この直列型二端子対電気回路７２L も、−ｊＸL を表わ
せる素子で構成される。Further, from the results of investigation theoretically, when the impedance of the two-terminal pair electrical network as viewed from the output terminal is connected to the circuitry of the matching circuit and the impedance Z a to the input terminal side, the imaginary part + jX L Therefore, a series-type two-port electric circuit 72 L for canceling this is required.
The tandem two-terminal pair electrical circuit 72 L is also configured to -jX L in expressed device.
【００２３】このようにして図１の整合回路７１，７２
を設けると、二端子対電気回路網は入力端子側にインピ
ーダンスＺa の回路網、出力端子側にインピーダンスＺ
b の回路網と接続するときに、インピーダンス不整合に
よる反射損失が完全に除去される。なお、後述するよう
に、Ｒa とＲg の整合回路７１、及びＲL とＲb の整合
回路７２をうまく選択すれば、少ない素子数で、二端子
対電気回路網の整合回路を構成することができる。As described above, the matching circuits 71 and 72 shown in FIG.
The provision of a two-port electrical network is a network of impedance Z a to the input terminal side, impedance Z to the output terminal side
When connected to the network of b , return loss due to impedance mismatch is completely eliminated. As described later, if successfully selecting a matching circuit 71, and the matching circuit 72 of the R L and R b in R a and R g, with a small number of elements, constitutes a matching circuit of a two-port electrical network be able to.
【００２４】次に、以上のような原理に基づき、本実施
例の整合回路の具体的な構成方法を説明する。値の異な
った２つの純抵抗Ｒ1 とＲ2 の整合回路は、前記文献に
記載されているように種々の形があるが、本実施例で
は、設計の容易さ、及び構成素子の少なさ等を考慮する
と、Ｔ型整合回路が最適な回路と考えられるので、以下
の説明ではＴ型整合回路の具体的な構成方法等を説明す
る。Next, a specific configuration method of the matching circuit of this embodiment will be described based on the above principle. Two different matching circuits pure resistance R 1 and R 2 its value is low of the but literature there are various forms as described, in the present embodiment, ease of design, and components In consideration of the above, the T-type matching circuit is considered to be an optimal circuit, and a specific configuration method and the like of the T-type matching circuit will be described below.
【００２５】図４（ａ），（ｂ）は本実施例における純
抵抗Ｒ1 とＲ2 の整合回路を示す図である。整合回路を
無損失回路にするために、構成素子は抵抗分を持っては
ならない。純抵抗Ｒ1 とＲ2 の値に関わらず、Ｔ型整合
回路は図４（ａ）と（ｂ）の２通りが考えられる。＋ｊ
Ｙはインダクタのインピーダンスで、−ｊＹはキャパシ
タのインピーダンスである。Ｙは次式（８）で与えられ
る。FIGS. 4A and 4B are diagrams showing a matching circuit of the pure resistors R 1 and R 2 in this embodiment. To make the matching circuit a lossless circuit, the components must not have a resistive component. Regardless of the values of the pure resistors R 1 and R 2 , there are two types of T-type matching circuits shown in FIGS. 4A and 4B. + J
Y is the impedance of the inductor, and -jY is the impedance of the capacitor. Y is given by the following equation (8).
【００２６】[0026]
【数５】 (Equation 5)
【００２７】ここで、ＹをＲ1 とＲ2 の整合回路の基本
素子値と呼ぶことにする。Ｙの値は、必ず正である。図
４（ａ）に示す整合回路の縦続行列は次式（９−ａ）、
図４（ｂ）に示す整合回路の縦続行列は次式（９−ｂ）
のようになる。Here, Y is referred to as a basic element value of the matching circuit of R 1 and R 2 . The value of Y is always positive. The vertical continuation column of the matching circuit shown in FIG.
The vertical continuation column of the matching circuit shown in FIG. 4B is expressed by the following equation (9-b).
become that way.
【００２８】[0028]
【数６】 (Equation 6)
【００２９】一方、図５に示すように、１個のインピー
ダンスＺで構成される直列型二端子対電気回路網の縦続
行列は、次式で与えられる。On the other hand, as shown in FIG. 5, the cascade of a series two-terminal electric network composed of one impedance Z is given by the following equation.
【００３０】[0030]
【数７】 (Equation 7)
【００３１】従って、前記の原理で説明したように、−
ｊＸa ，−ｊＸg ，−ｊＸL または−ｊＸb のような素
子で構成された直列型二端子対電気回路網の縦続接続
は、（１０）式のＺの代わりに、それぞれの素子のイン
ピーダンスの値を代入すれば得られる。Therefore, as explained in the above principle,-
The cascade connection of a series two-port electrical network composed of elements such as jX a , -jX g , -jX L or -jX b is equivalent to the impedance of each element instead of Z in equation (10). Can be obtained by substituting the value of
【００３２】図６（ａ），（ｂ）は、図１（ａ）の整合
回路をＴ型整合回路で表わしたもので、Ｔ型整合回路を
基本とする入力端子側整合回路の構成図である。図６の
（ａ）と（ｂ）に示した整合回路の縦続行列は、符号に
おいて異なるところはあるが、機能的には同じである。
図６（ａ）において、整合回路８１と整合回路８２は等
価であるが、構成素子の数が整合回路８１の方が５個、
整合回路８２の方が３個である。図６（ｂ）において、
整合回路８３と整合回路８４も等価であり、構成素子の
数も整合回路８１と８２の場合と同様である。FIGS. 6 (a) and 6 (b) show the matching circuit of FIG. 1 (a) by a T-type matching circuit. is there. The vertical continuation columns of the matching circuits shown in FIGS. 6A and 6B are functionally the same, although there are differences in reference numerals.
In FIG. 6A, the matching circuit 81 and the matching circuit 82 are equivalent, but the number of components is five in the matching circuit 81, and
There are three matching circuits 82. In FIG. 6B,
The matching circuits 83 and 84 are equivalent, and the number of components is the same as that of the matching circuits 81 and 82.
【００３３】図７（ａ），（ｂ）は図１（ｂ）の整合回
路をＴ型整合回路で表わしたものであり、Ｔ型整合回路
を基本とする出力端子側整合回路の構成図である。図７
（ａ）に示す整合回路９１と整合回路９２は等価であ
る。また、図７（ｂ）においても、整合回路９３と整合
回路９４が等価であり、構成素子数の数も、図６の場合
と同様である。FIGS. 7 (a) and 7 (b) show the matching circuit of FIG. 1 (b) as a T-type matching circuit. is there. FIG.
The matching circuit 91 and the matching circuit 92 shown in (a) are equivalent. Also in FIG. 7B, the matching circuit 93 and the matching circuit 94 are equivalent, and the number of components is the same as in FIG.
【００３４】図６のＹa 及び図７のＹb は、それぞれ
（Ｒa ，Ｒg ）と（ＲL ，Ｒb ）の整合回路の基本素子
値で、（８）式に従い、（１１−ａ），（１１−ｂ）式
のように計算できる。最終的に図６（ａ），（ｂ）及び
図７（ａ），（ｂ）に示される各整合回路の縦続行列
は、それぞれ次の（ｉ）〜（iv）のようになる。[0034] Y b of Y a and 7 in FIG. 6, respectively (R a, R g) and (R L, R b) in the base element value of the matching circuit in accordance with equation (8), (11- a) and (11-b) can be calculated. Finally, the cascade columns of the matching circuits shown in FIGS. 6A and 6B and FIGS. 7A and 7B are as shown in the following (i) to (iv), respectively.
【００３５】[0035]
【数８】 (Equation 8)
【００３６】[0036]
【数９】 (Equation 9)
【００３７】Ｔ型整合回路を基本とする二端子対電気回
路網用整合回路の構成方法に関する原理は以上の通りで
ある。次に、二端子対電気回路網として、例えば弾性表
面波フィルタに適用される整合回路の具体的な構成方法
を説明する。The principle of the method of constructing the matching circuit for the two-port electric network based on the T-type matching circuit has been described above. Next, a specific configuration method of a matching circuit applied to, for example, a surface acoustic wave filter as a two-port electric network will be described.
【００３８】図８（ａ），（ｂ）は整合回路を設ける前
の弾性表面波フィルタの特性図であり、同図（ａ）は挿
入損失特性、及び同図（ｂ）は反射損失特性である。FIGS. 8A and 8B are characteristic diagrams of the surface acoustic wave filter before the matching circuit is provided. FIG. 8A shows the insertion loss characteristic, and FIG. 8B shows the reflection loss characteristic. is there.
【００３９】弾性表面波フィルタは、圧電基板上に、弾
性表面波の励振及び受信用の一対の櫛形電極が設けられ
た構造をなし、それは圧電基板の圧電効果を利用した電
気回路なので、受動素子で構成される二端子対電気回路
網とみなすことができるため、縦続行列を持つ。The surface acoustic wave filter has a structure in which a pair of comb-shaped electrodes for exciting and receiving surface acoustic waves is provided on a piezoelectric substrate. Since this is an electric circuit utilizing the piezoelectric effect of the piezoelectric substrate, it is a passive element. Can be regarded as a two-port electrical network composed of:
【００４０】図８（ａ）は挿入損失特性を示し、図８
（ｂ）の実線で示される符号１０１は入力端子側反射損
失特性、破線で示される符号１０２は出力端子側反射損
失特性である。１０１と１０２から明らかなように、両
端子における反射損失は大きいことがわかる。これを改
善するために、例えば８５２.０ＭＨｚにおいて、上述
したような構成方法で整合回路を設計する。この周波数
における弾性表面波フィルタの縦続行列の成分は、次の
通りである。 Ａ＝５．６００９１５×１０-2＋ｊ０．５２９３４７ ・・・（１６−ａ） Ｂ＝４．１３１９０４＋ｊ４５．０２７６５ ・・・（１６−ｂ） Ｃ＝−１．２９１３４３×１０-3＋ｊ２．５９１５９６×１０-2 ・・・（１６−ｃ） Ｄ＝５．７３６９８２×１０-2＋ｊ０．３３１５０９６ ・・・（１６−ｄ） Ａ、Ｂ、Ｃ、Ｄは（２）式の不等式を満足している。従
って、この弾性表面波フィルタの両端子をこの周波数に
おいて整合回路が存在する。構成方法は上述したように
行う。最終的な回路構成は、入力端子側では図６（ａ）
の整合回路８２を、出力端子側では図７（ａ）の整合回
路９２を選択する。その回路を図９に示す。FIG. 8A shows the insertion loss characteristics.
In FIG. 3B, reference numeral 101 shown by a solid line denotes an input terminal side return loss characteristic, and reference numeral 102 shown by a broken line denotes an output terminal side return loss characteristic. As is clear from 101 and 102, the reflection loss at both terminals is large. To improve this, for example, at 852.0 MHz , a matching circuit is designed by the above-described configuration method. The components of the vertical cascade of the surface acoustic wave filter at this frequency are as follows. A = 5.609915 × 10 −2 + j0.529347 (16-a) B = 4.13904 + j45.0.2756 (16-b) C = −1.291343 × 10 −3 + j2.591596 × 10 -2 (16-c) D = 5.736982 × 10 -2 + j0.3315096 (16-d) A, B, C, and D satisfy the inequalities of the expression (2). Therefore, a matching circuit exists between both terminals of the surface acoustic wave filter at this frequency. The configuration method is performed as described above. FIG. 6A shows the final circuit configuration on the input terminal side.
The matching circuit 82 shown in FIG. 7A is selected on the output terminal side. The circuit is shown in FIG.
【００４１】図９は、弾性表面波フィルタ用整合回路の
回路図である。この図９において、弾性表面波フィルタ
１１１の入出力側に、インダクタ及びキャパシタの整合
回路が設けられている。但し、図３に示すような外部の
回路網３０と５０は、図９では単なる回路系の特性イン
ピーダンスＺ0 に等しい信号源の内部抵抗と純抵抗の負
荷である。一般的に広く用いられる回路系は、特性イン
ピーダンス５０Ω回路系である。FIG. 9 is a circuit diagram of a matching circuit for a surface acoustic wave filter. In FIG. 9, a matching circuit for an inductor and a capacitor is provided on the input and output sides of the surface acoustic wave filter 111. However, the external circuit networks 30 and 50 as shown in FIG. 3 are loads of the internal resistance of the signal source and the pure resistance equal to the characteristic impedance Z 0 of the simple circuit system in FIG. A generally widely used circuit system is a characteristic impedance 50Ω circuit system.
【００４２】また、整合回路を設けた後の弾性表面波フ
ィルタの特性図を図１０（ａ），（ｂ）に示す。図１０
（ａ）は挿入損失特性で、図１０（ｂ）の実線の符号１
２１と破線の符号１２２はそれぞれ入力端子及び出力端
子における反射損失特性である。８５２．０ＭＨz にお
いて、両端子における反射損失が完全に除去されたこと
は、該反射損失特性から明らかである。FIGS. 10A and 10B show characteristic diagrams of the surface acoustic wave filter after the matching circuit is provided. FIG.
(A) is an insertion loss characteristic, which is indicated by a solid line symbol 1 in FIG. 10 (b).
The reference numeral 21 and the broken line 122 indicate the return loss characteristics at the input terminal and the output terminal, respectively. In 852.0MH z, that reflection losses at both terminals has been completely removed, it is clear from the reflection loss characteristic.
【００４３】以上のように、本実施例の方法を用いて二
端子対電気回路網用の整合回路を構成（設計）すると、
不整合損失が大きく改善されるばかりか、該整合回路の
微調整もほとんど必要でなくなる。その上、二端子対電
気回路網は整合可能かどうかを事前に正確に予測できる
から、無駄な整合回路の設計も必要でなくなる。従っ
て、整合回路を必要とする全ての装置に、本実施例の構
成方法を適用すれば、その装置の高性能化と低価格化を
図ることができる。As described above, when a matching circuit for a two-port electrical network is constructed (designed) using the method of the present embodiment,
Not only is the mismatch loss greatly improved, but little adjustment of the matching circuit is needed. In addition, since the two-port electric network can accurately predict whether matching is possible in advance, it is not necessary to design a useless matching circuit. Therefore, if the configuration method of this embodiment is applied to all devices that require a matching circuit, it is possible to achieve higher performance and lower cost of the devices.
【００４４】また、本実施例では、弾性表面波フィルタ
を用いて整合回路構成方法の効果を確認したが、本実施
例の整合回路の構成方法は、縦続行列で表わせる全ての
二端子対電気回路網に有効である。In the present embodiment, the effect of the matching circuit configuration method was confirmed using a surface acoustic wave filter. However, the matching circuit configuration method of the present embodiment is applied to all two-terminal electrical pairs that can be represented in a cascade. Useful for networks.
【００４５】[0045]
【発明の効果】以上詳細に説明したように、本発明によ
れば、二端子対電気回路網の縦続行列の成分から、その
存在条件を確認し、所定の数式で示される量に基づき、
素子値Ｙa ，Ｙb を演算して前記二端子対電気回路網に
対する整合回路を構成するようにしている。そのため、
二端子対電気回路網を他の回路網と接続する際に、ある
周波数において該二端子対電気回路網の入力端子及び出
力端子におけるインピーダンス不整合による反射を完全
に除去でき、しかも微調整をほとんど必要としない。従
って、例えば設計時において、二端子対電気回路網が整
合可能かどうかを事前に正確に予測できるから、無駄な
整合回路の設計作業もなくなり、精度の高い整合回路を
的確に製造することが可能となる。As described in detail above, according to the present invention, the existence condition is confirmed from the components of the cascade of the two-port electrical network, and based on the quantity represented by the predetermined mathematical formula,
Element value Y a, and calculates the Y b are to constitute the matching circuit for the two-terminal pair electrical network. for that reason,
When connecting a two-port electrical network to another network, it is possible to completely eliminate reflection due to impedance mismatch at input and output terminals of the two-port electrical network at a certain frequency, and to perform almost no fine adjustment. do not need. Therefore, for example, at the time of design, it is possible to accurately predict in advance whether or not the two-port electric network can be matched, so that there is no need to design a useless matching circuit, and a high-precision matching circuit can be accurately manufactured. Becomes
【図１】本発明の実施例の整合回路構成の基本を示す図
である。FIG. 1 is a diagram showing a basic configuration of a matching circuit according to an embodiment of the present invention.
【図２】一般的な二端子対電気回路網の構成図である。FIG. 2 is a configuration diagram of a general two-port electric network.
【図３】従来の二端子対電気回路網用整合回路の構成過
程を示す図である。FIG. 3 is a diagram showing a configuration process of a conventional two-port electric network matching circuit.
【図４】従来のＲ1 とＲ2 のＴ型整合回路の回路図であ
る。FIG. 4 is a circuit diagram of a conventional T-type matching circuit for R 1 and R 2 .
【図５】従来の１個のインピーダンスＺで構成される直
列型二端子対電気回路網の回路図である。FIG. 5 is a circuit diagram of a conventional two-port electric network composed of a single impedance Z.
【図６】本実施例のＴ型整合回路を基本とする入力端子
側整合回路の構成図である。FIG. 6 is a configuration diagram of an input terminal side matching circuit based on the T-type matching circuit of the present embodiment.
【図７】本実施例のＴ型整合回路を基本とする出力端子
側整合回路の構成図である。FIG. 7 is a configuration diagram of an output terminal side matching circuit based on the T-type matching circuit of the present embodiment.
【図８】本実施例における整合回路を設ける前の弾性表
面波フィルタの特性図である。FIG. 8 is a characteristic diagram of a surface acoustic wave filter before a matching circuit according to the present embodiment is provided.
【図９】本実施例の弾性表面波フィルタ用整合回路の回
路図である。FIG. 9 is a circuit diagram of a surface acoustic wave filter matching circuit of the present embodiment.
【図１０】本実施例における整合回路を設けた後の弾性
表面波フィルタの特性図である。FIG. 10 is a characteristic diagram of the surface acoustic wave filter after the matching circuit according to the present embodiment is provided.
７１，７２，８１〜８４，９１〜９４ 整合回路 ７１a ，７１g ，７２L ，７２b 直列型二端子対電気
回路 １１１ 弾性表面波フ
ィルタ71,72,81～84,91～94 matching circuit 71 a, 71 g, 72 L , 72 b tandem two-terminal pair electrical circuit 111 SAW filter
フロントページの続き (56)参考文献 電子通信ハンドブック（オーム社、昭 和54年）、ＰＰ．169−171 (58)調査した分野(Int.Cl.6，ＤＢ名) H03H 7/38Continuation of the front page (56) References Electronic Communication Handbook (Ohmsha, 1979), PP. 169-171 (58) Field surveyed (Int. Cl. 6 , DB name) H03H 7/38
Claims (1)
［Ｆ］で表わされる二端子対電気回路網の入力端子及び
出力端子において、 前記二端子対電気回路網の入力端子と、インピーダンス
Ｚa （＝Ｒa ±ｊＸa、但し、Ｒa は抵抗、Ｘa はリア
クタンス）の入力端子側電気回路網とを、接続するため
のインピーダンス整合用の入力端子側整合回路を構成す
る場合、及び前記二端子対電気回路網の出力端子と、イ
ンピーダンスＺb （＝Ｒb ±ｊＸb 、但し、Ｒb は抵
抗、Ｘb はリアクタンス）の出力端子側電気回路網と
を、接続するためのインピーダンス整合用の出力端子側
整合回路を構成する場合、 前記二端子対電気回路網の複素数成分Ａ，Ｂ，Ｃ，Ｄか
ら、該二端子対電気回路網の共役影像インピーダンスＺ
L （＝ＲL −ｊＸL 、但し、ＲL は抵抗、ＸLはリアク
タンス）とＺg （＝Ｒg −ｊＸg 、但し、Ｒg は抵抗、
Ｘg はリアクタンス）とが存在するか否か、（２）式の
存在条件を確認し、 前記共役影像インピーダンスＺL とＺg が存在するとき
には、前記入力端子側整合回路及び前記出力端子側整合
回路を構成することが可能であり、該二端子対電気回路
網の出力端子をインピーダンスＺL で終端すれば該二端
子対電気回路網の入力端子から見たインピーダンスはＺ
g の共役値Ｚ g に等しく、逆に該二端子対電気回路網の
入力端子をインピーダンスＺg で終端すれば該二端子対
電気回路網の出力端子から見たインピーダンスはＺL の
共役値Ｚ L に等しいことになるので、（３−１）式、
（３−２）式、（４−１）式、（４−２）式、（１１−
ａ）式及び（１１−ｂ）式に示される量に基づき、前記
入力端子側整合回路を構成する素子値Ｙa 、及び前記出
力端子側整合回路を構成する素子値Ｙb を演算して、該
入力端子側整合回路及び該出力端子側整合回路を構成す
ることを特徴とする整合回路の構成方法。 【数１】 【数２】 1. An input terminal and an output terminal of a two-port electric network constituted by passive elements and represented by a continuation column [F] of the equation (1), comprising: an input terminal of the two-port electric network; Z a (= R a ± jX a, provided that the R a resistor, X a reactance) when configuring the input terminal matching circuit for impedance matching for the input terminal side electrical network, connected to, and an output terminal of the two-terminal pair electrical network, the impedance Z b (= R b ± jX b, where, R b is the resistance, X b reactance) and an output terminal side electrical circuitry, for connection When the output terminal side matching circuit for impedance matching is configured, the conjugate image impedance Z of the two-port electrical network is obtained from the complex components A, B, C, and D of the two-port electrical network.
L (= R L -jX L, where, R L is the resistance, X L is the reactance) and Z g (= R g -jX g , provided that, R g resistor,
Whether X g reactance) and are present, (2) to confirm the presence condition of expression, the conjugated when image impedance Z L and Z g is present, the input terminal matching circuit and the output terminal side matching If the output terminal of the two-port electrical network is terminated with an impedance Z L , the impedance seen from the input terminal of the two-port electrical network is Z
g equals the conjugate value Z g of the impedance viewed from the output terminal of if termination reversed input terminal of the two-terminal pair electrical network impedance Z g the two-terminal pair electrical network of Z L conjugate value Z Since it is equal to L , equation (3-1)
Equations (3-2), (4-1), (4-2), (11-
based on the amount shown in a) and Formula (11-b) wherein said input terminal element values constituting the matching circuit Y a, and calculates the element values Y b constituting the output terminal matching circuit, A method of configuring a matching circuit, comprising configuring the input terminal side matching circuit and the output terminal side matching circuit. (Equation 1) (Equation 2)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25392791A JP2795762B2 (en) | 1991-10-01 | 1991-10-01 | Configuration method of matching circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25392791A JP2795762B2 (en) | 1991-10-01 | 1991-10-01 | Configuration method of matching circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0595246A JPH0595246A (en) | 1993-04-16 |
| JP2795762B2 true JP2795762B2 (en) | 1998-09-10 |
Family
ID=17257963
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25392791A Expired - Fee Related JP2795762B2 (en) | 1991-10-01 | 1991-10-01 | Configuration method of matching circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2795762B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3424971B2 (en) * | 1994-01-20 | 2003-07-07 | 松下電器産業株式会社 | Surface acoustic wave filter |
-
1991
- 1991-10-01 JP JP25392791A patent/JP2795762B2/en not_active Expired - Fee Related
Non-Patent Citations (1)
| Title |
|---|
| 電子通信ハンドブック（オーム社、昭和５４年）、ＰＰ．１６９−１７１ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0595246A (en) | 1993-04-16 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP6179829B2 (en) | Improved design of microwave acoustic wave filters. | |
| CN101572532A (en) | Filter with baw acoustic resonators, with digital reconfiguration and method | |
| WO2006045176A1 (en) | Band reject filters | |
| KR19980070285A (en) | Surface acoustic wave filters with attenuation poles generated by impedance circuits | |
| US6300849B1 (en) | Distributed element filter | |
| JPH01208010A (en) | Monolithic lattice type elastic surface wave filter | |
| JPS6134288B2 (en) | ||
| JP2795762B2 (en) | Configuration method of matching circuit | |
| JP4331277B2 (en) | Surface acoustic wave filter | |
| JP2001244704A (en) | Thin-film resonator filter and method for extending its band width | |
| JP3425394B2 (en) | Surface acoustic wave resonator and surface acoustic wave filter | |
| US5661443A (en) | Apparatus and method for an asymmetrical multi-pole monolithic crystal filter having improved phase response | |
| US11962290B2 (en) | Correction unit for radio frequency filter | |
| US6960966B2 (en) | Surface acoustic wave filter with attenuation poles | |
| JP3921303B2 (en) | Distributed constant filter | |
| JP2001060803A (en) | Distributed constant filter | |
| JP3016250B2 (en) | DC cutoff circuit | |
| Lilhare et al. | A narrow band UHF filter bank using SAW TCRFs | |
| JPH07176979A (en) | Surface acoustic wave filter | |
| RU2190923C1 (en) | Active broadband piezoelectric filter | |
| JPH03258010A (en) | Surface acoustic wave device | |
| JPH0433405A (en) | Surface acoustic filter and mobile radio equipment using the filter | |
| JPH09284075A (en) | Band stop filter | |
| US3501593A (en) | Resonant transfer networks with reactive loads | |
| WO2020263254A1 (en) | Wideband filter with cascaded coupled acoustic resonators and shunt reactive elements |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980616 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080626 Year of fee payment: 10 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
| S202 | Request for registration of non-exclusive licence |
Free format text: JAPANESE INTERMEDIATE CODE: R315201 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| R360 | Written notification for declining of transfer of rights |
Free format text: JAPANESE INTERMEDIATE CODE: R360 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| R360 | Written notification for declining of transfer of rights |
Free format text: JAPANESE INTERMEDIATE CODE: R360 |
|
| R371 | Transfer withdrawn |
Free format text: JAPANESE INTERMEDIATE CODE: R371 |
|
| S202 | Request for registration of non-exclusive licence |
Free format text: JAPANESE INTERMEDIATE CODE: R315201 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| LAPS | Cancellation because of no payment of annual fees |