JP2763013B2 - 半導体装置 - Google Patents
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Description
【発明の詳細な説明】 〔概要〕 半導体装置に係り、特にSOI構造でのボンディングパ
ッドを有する半導体集積回路に関するものであり、 パッド下の絶縁膜を通してパッドと基板間が導通して
も入力リーク電流等の問題を生じない半導体装置を提供
することを目的とし、 絶縁層上に形成された半導体層上にパッドを具備して
なる半導体装置において、前記パッド領域の外側の前記
半導体基板内に前記絶縁層に達する絶縁領域を設け、前
記パット下の該半導体基板を絶縁分離することを構成と
する。
ッドを有する半導体集積回路に関するものであり、 パッド下の絶縁膜を通してパッドと基板間が導通して
も入力リーク電流等の問題を生じない半導体装置を提供
することを目的とし、 絶縁層上に形成された半導体層上にパッドを具備して
なる半導体装置において、前記パッド領域の外側の前記
半導体基板内に前記絶縁層に達する絶縁領域を設け、前
記パット下の該半導体基板を絶縁分離することを構成と
する。
本発明は半導体装置に係り、特にボンディングパッド
を有する半導体集積回路に関するものである。
を有する半導体集積回路に関するものである。
近年、半導体集積回路(IC)は信頼性が要求されてい
るが例えばSOI(Silicon On Insulator)の絶縁膜上に
パッドをボンディングする際、絶縁膜にダメージを与え
信頼性を損なうため、その改良が必要とされている。
るが例えばSOI(Silicon On Insulator)の絶縁膜上に
パッドをボンディングする際、絶縁膜にダメージを与え
信頼性を損なうため、その改良が必要とされている。
SOI構造の半導体装置は例えば第2図に示すように、S
iO2等からなる絶縁層1上にシリコン基板2が設けら
れ、そのシリコン基板2上には約10000Åの厚さのSiO2
膜5、更にその上にAl等からなるボンディングパッド6
が形成されている。
iO2等からなる絶縁層1上にシリコン基板2が設けら
れ、そのシリコン基板2上には約10000Åの厚さのSiO2
膜5、更にその上にAl等からなるボンディングパッド6
が形成されている。
このようなSOI構造のシリコン基板2上のSiO2膜5に
欠陥があると集積回路の信頼性に問題が生ずる。
欠陥があると集積回路の信頼性に問題が生ずる。
すなわち、パッド6下方のSiO2膜5表面にピット(孔
食)が存在したり、パッド6をボンディングする際、そ
の衝撃によってSiO2膜5に損傷、歪割れ等の欠陥を生ぜ
しめ、パッドとシリコン基板間が導通して、端子リーク
が生じた。
食)が存在したり、パッド6をボンディングする際、そ
の衝撃によってSiO2膜5に損傷、歪割れ等の欠陥を生ぜ
しめ、パッドとシリコン基板間が導通して、端子リーク
が生じた。
そこでパッド下方の絶縁膜を単純に厚く形成すること
によって、上記パッドとシリコン基板間の導通を防止す
ることが考えられる。しかしながら、この絶縁膜を、CV
D法等で形成しようとすれば平坦化が確認できにくくな
ってパッドの形成が困難となる。
によって、上記パッドとシリコン基板間の導通を防止す
ることが考えられる。しかしながら、この絶縁膜を、CV
D法等で形成しようとすれば平坦化が確認できにくくな
ってパッドの形成が困難となる。
本発明はパッド下の絶縁膜を通してパッドと基板間が
導通しても入力リーク電流等の問題を生じない半導体装
置を提供することを目的とする。
導通しても入力リーク電流等の問題を生じない半導体装
置を提供することを目的とする。
上記課題は本発明によれば絶縁層上に形成された半導
体層上にパッドを具備してなる半導体装置において、前
記パッド領域の外側の前記基板内に前記絶縁層に達する
絶縁領域を設け、前記パッド下の該半導体基板を絶縁分
離することを特徴とする半導体装置によって解決され
る。
体層上にパッドを具備してなる半導体装置において、前
記パッド領域の外側の前記基板内に前記絶縁層に達する
絶縁領域を設け、前記パッド下の該半導体基板を絶縁分
離することを特徴とする半導体装置によって解決され
る。
本発明に係る半導体層としてはシリコン(Si)が好ま
しく砒化ガリウム(GaAs)、等も用いられる。また本発
明では絶縁分離に用いる絶縁領域はトレンチ(溝)を形
成してその内部をSiO2、 等の絶縁物で埋込むことによって有利に設けられる。
しく砒化ガリウム(GaAs)、等も用いられる。また本発
明では絶縁分離に用いる絶縁領域はトレンチ(溝)を形
成してその内部をSiO2、 等の絶縁物で埋込むことによって有利に設けられる。
また半導体層を形成する絶縁層はSiO2基板、SiO2膜、
サファイア等が用いられる。
サファイア等が用いられる。
本発明によればパッド下の半導体基板が絶縁分離され
るのでパッド下の基板がパッドと導通しても周囲の半導
体基板に何ら影響を与えない。
るのでパッド下の基板がパッドと導通しても周囲の半導
体基板に何ら影響を与えない。
以下本発明の実施例を図面に基づいて説明する。
第1図(a)及び(b)は本発明の一実施例を示すそ
れぞれ概略断面図及び平面図である。
れぞれ概略断面図及び平面図である。
第1図(a)に示すように、SiO2層1上にシリコン
(Si)基板2(2a,2b)が設けられ該シリコン基板2に
設けたトレンチ(溝)10内及びシリコン基板2上にはSi
O2埋込み膜4とSiO2膜5が設けられ、更にSiO2膜5上に
はAlからなるボンディングパッド6及びPSG等からなる
カバー膜が形成されている。
(Si)基板2(2a,2b)が設けられ該シリコン基板2に
設けたトレンチ(溝)10内及びシリコン基板2上にはSi
O2埋込み膜4とSiO2膜5が設けられ、更にSiO2膜5上に
はAlからなるボンディングパッド6及びPSG等からなる
カバー膜が形成されている。
本実施例ではボンディングパッド6下のシリコン基板
2aはSiO2膜5及びSiO2埋込み層4及びSiO2層1からなる
絶縁領域に囲まれ、電気的に分離された構造となってい
る。
2aはSiO2膜5及びSiO2埋込み層4及びSiO2層1からなる
絶縁領域に囲まれ、電気的に分離された構造となってい
る。
このようなSOI構造のシリコン層(基板)部に溝を設
けることによって所定部のシリコン領域を絶縁分離する
ことにより、ボンディング等による入力リークがボンデ
ィングパッド6直下以外のシリコン基板への導通を防止
できる。また第1図(b)によりボンディングパッド下
のSi基板2aが絶縁分離されていることが平面的に理解さ
れる。
けることによって所定部のシリコン領域を絶縁分離する
ことにより、ボンディング等による入力リークがボンデ
ィングパッド6直下以外のシリコン基板への導通を防止
できる。また第1図(b)によりボンディングパッド下
のSi基板2aが絶縁分離されていることが平面的に理解さ
れる。
以下上記実施例の製造方法を説明する。
厚さ約5μmのSi基板2の一方の面にSiO2基板1をは
り合せ、SiO2基板2の他の一方の面に後に形成するボン
ディングパッド幅より広い範囲のSi基板2a領域を形成す
るため、幅約1μmのトレンチ10を、異方性エッチング
により形成する。
り合せ、SiO2基板2の他の一方の面に後に形成するボン
ディングパッド幅より広い範囲のSi基板2a領域を形成す
るため、幅約1μmのトレンチ10を、異方性エッチング
により形成する。
次に、CVD法によりトレンチ10内及びSi基板面にSiO2
埋込み層4及びSiO2膜5を順次形成し、該SiO2埋込み層
4領域内側のSiO2膜5上に厚さ約10000ÅのAlのボンデ
ィングパッド6を形成し、その後CVD法によりPSGからな
るカバー膜7を形成した。
埋込み層4及びSiO2膜5を順次形成し、該SiO2埋込み層
4領域内側のSiO2膜5上に厚さ約10000ÅのAlのボンデ
ィングパッド6を形成し、その後CVD法によりPSGからな
るカバー膜7を形成した。
以上説明した様に、本発明によれば、ボンディングパ
ッド下のSi基板とその周囲のSi基板とが電気的に分離さ
れるので、該パッドとSi基板の導通に際して周囲のSi基
板と絶縁される効果を奏し、ボンディングパッドからの
入力リークを防止することが出来、半導体装置の信頼性
の向上に寄与する。
ッド下のSi基板とその周囲のSi基板とが電気的に分離さ
れるので、該パッドとSi基板の導通に際して周囲のSi基
板と絶縁される効果を奏し、ボンディングパッドからの
入力リークを防止することが出来、半導体装置の信頼性
の向上に寄与する。
第1図(a)及び(b)は本発明の一実施例を示すそれ
ぞれ概略断面図及び平面図であり、 第2図は従来例を説明するための概略断面図である。 1……SiO2層、2(2a,2b)……Si基板、4……SiO2埋
込み膜、5……SiO2膜、6……ボンディングパッド、7
……カバー膜。
ぞれ概略断面図及び平面図であり、 第2図は従来例を説明するための概略断面図である。 1……SiO2層、2(2a,2b)……Si基板、4……SiO2埋
込み膜、5……SiO2膜、6……ボンディングパッド、7
……カバー膜。
Claims (1)
- 【請求項1】絶縁層上に形成された半導体層上にパッド
を具備してなる半導体装置において、 前記パッド領域の外側の前記半導体基板内に前記絶縁層
に達する絶縁領域を設け、前記パッド下の該半導体基板
を絶縁分離することを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1335705A JP2763013B2 (ja) | 1989-12-25 | 1989-12-25 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1335705A JP2763013B2 (ja) | 1989-12-25 | 1989-12-25 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH03195032A JPH03195032A (ja) | 1991-08-26 |
JP2763013B2 true JP2763013B2 (ja) | 1998-06-11 |
Family
ID=18291559
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1335705A Expired - Fee Related JP2763013B2 (ja) | 1989-12-25 | 1989-12-25 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2763013B2 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3422209B2 (ja) * | 1997-03-17 | 2003-06-30 | 株式会社デンソー | 半導体装置 |
JP2005094023A (ja) * | 2004-10-01 | 2005-04-07 | Renesas Technology Corp | 半導体装置 |
-
1989
- 1989-12-25 JP JP1335705A patent/JP2763013B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH03195032A (ja) | 1991-08-26 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |