JP2021129083A - 半導体装置およびその製造方法 - Google Patents
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- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H01L2224/48135—Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
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- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
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- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
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- H01L2224/81138—Aligning involving guiding structures, e.g. spacers or supporting members the guiding structures being at least partially left in the finished device
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- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/8119—Arrangement of the bump connectors prior to mounting
- H01L2224/81191—Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
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- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
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- H01L2224/8312—Aligning
- H01L2224/83136—Aligning involving guiding structures, e.g. spacers or supporting members
- H01L2224/83138—Aligning involving guiding structures, e.g. spacers or supporting members the guiding structures being at least partially left in the finished device
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/83399—Material
- H01L2224/8349—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
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- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/838—Bonding techniques
- H01L2224/8385—Bonding techniques using a polymer adhesive, e.g. an adhesive based on silicone, epoxy, polyimide, polyester
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- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/8538—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/85399—Material
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- H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
- H01L2224/92—Specific sequence of method steps
- H01L2224/921—Connecting a surface with connectors of different types
- H01L2224/9212—Sequential connecting processes
- H01L2224/92122—Sequential connecting processes the first connecting process involving a bump connector
- H01L2224/92125—Sequential connecting processes the first connecting process involving a bump connector the second connecting process involving a layer connector
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- H01L2224/92—Specific sequence of method steps
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- H01L2224/9222—Sequential connecting processes
- H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
- H01L2224/92247—Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a wire connector
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- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06506—Wire or wire-like electrical connections between devices
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- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/0651—Wire or wire-like electrical connections from device to substrate
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- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
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- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06517—Bump or bump-like direct electrical connections from device to substrate
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- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06555—Geometry of the stack, e.g. form of the devices, geometry to facilitate stacking
- H01L2225/06562—Geometry of the stack, e.g. form of the devices, geometry to facilitate stacking at least one device in the stack being rotated or offset
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- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06575—Auxiliary carrier between devices, the carrier having no electrical connection structure
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- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06582—Housing for the assembly, e.g. chip scale package [CSP]
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3121—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L24/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L24/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
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Abstract
【課題】ツールへの樹脂の付着を抑制し、半導体チップを基板に確実に接続可能な半導体装置を提供する。
【解決手段】半導体装置は、第1面と第1面の反対側にある第2面とを有する第1半導体チップを備える。第1接着層は第1半導体チップの第1面に設けられる。第2半導体チップは第3面と該第3面の反対側にある第4面とを有し、第3面に接続バンプを有する。第2半導体チップは第4面において第1接着層を介して第1半導体チップの第1面に接着されている。配線基板は第2半導体チップの第4面側において接続バンプに接続されている。第1樹脂層は第2半導体チップと配線基板との間において接続バンプを被覆し、第3面と第4面との間にある第2半導体チップの側面に設けられている。第1接着層は第2半導体チップの側面の上部を被覆する。第1樹脂層は該側面の下部を被覆する。第1接着層と第1樹脂層は、該側面上において互いに接触している。
【選択図】図2
【解決手段】半導体装置は、第1面と第1面の反対側にある第2面とを有する第1半導体チップを備える。第1接着層は第1半導体チップの第1面に設けられる。第2半導体チップは第3面と該第3面の反対側にある第4面とを有し、第3面に接続バンプを有する。第2半導体チップは第4面において第1接着層を介して第1半導体チップの第1面に接着されている。配線基板は第2半導体チップの第4面側において接続バンプに接続されている。第1樹脂層は第2半導体チップと配線基板との間において接続バンプを被覆し、第3面と第4面との間にある第2半導体チップの側面に設けられている。第1接着層は第2半導体チップの側面の上部を被覆する。第1樹脂層は該側面の下部を被覆する。第1接着層と第1樹脂層は、該側面上において互いに接触している。
【選択図】図2
Description
本実施形態は、半導体装置およびその製造方法に関する。
半導体チップをインタポーザ基板にフリップチップ接続する際に、半導体チップのバンプを被覆するアンダフィルが半導体チップの側面を伝って這い上がってくる。このようなアンダフィルの這い上がりによって、アンダフィルが半導体チップを押圧するマウントツールに付着する問題がある。このような問題に対処するために、マウントツールをフィルムで保護することが考えられる。しかし、この場合、半導体チップごとにフィルムに吸着穴をあける必要があり、スループットが低くなる。また、マウント処理ごとに、フィルムを交換するため、フィルムのコストがかかる。
マスリフローで接続する場合、半導体チップの反りによって、バンプの接続不良が発生するおそれがある。
マウントツールへの樹脂の付着を抑制し、かつ、半導体チップを基板に確実に接続することができる半導体装置とその製造方法を提供する。
本実施形態によつ半導体装置は、第1面と該第1面の反対側にある第2面とを有する第1半導体チップを備える。第1接着層は、第1半導体チップの第1面に設けられている。第2半導体チップは、第3面と該第3面の反対側にある第4面とを有し、第3面に接続バンプを有する。第2半導体チップは、第4面において第1接着層を介して第1半導体チップの第1面に接着されている。配線基板は、第2半導体チップの第4面側において、接続バンプに接続されている。第1樹脂層は、第2半導体チップと配線基板との間において接続バンプを被覆し、第3面と第4面との間にある第2半導体チップの側面に設けられている。第1接着層は、第2半導体チップの側面の上部を被覆する。第1樹脂層は、側面の下部を被覆する。第1接着層と第1樹脂層は、該側面上において互いに接触している。
以下、図面を参照して本発明に係る実施形態を説明する。本実施形態は、本発明を限定するものではない。以下の実施形態において、基板の上下方向は、半導体チップを搭載する面を上とした場合の相対方向を示し、重力加速度に従った上下方向と異なる場合がある。図面は模式的または概念的なものであり、各部分の比率などは、必ずしも現実のものと同一とは限らない。明細書と図面において、既出の図面に関して前述したものと同様の要素には同一の符号を付して詳細な説明は適宜省略する。
(第1実施形態)
図1は、第1実施形態による半導体装置の構成例を示す断面図である。半導体装置1は、半導体チップ10、15、20と、配線基板30と、接着層40、45と、樹脂層50と、ボンディングワイヤ60と、封止樹脂70とを備えている。
図1は、第1実施形態による半導体装置の構成例を示す断面図である。半導体装置1は、半導体チップ10、15、20と、配線基板30と、接着層40、45と、樹脂層50と、ボンディングワイヤ60と、封止樹脂70とを備えている。
半導体装置1は、例えば、NAND型フラッシュメモリのパッケージである。半導体チップ10は、例えば、NAND型フラッシュメモリのメモリチップである。半導体チップ10は、裏面10Aと、裏面10Aの反対側にある表面10Bと、裏面10Aと表面10Bとの間にある側面10Cとを有する。半導体チップ10の表面10Bには、半導体素子11が設けられ、ポリイミド等の保護膜で被覆されている。半導体素子11は、例えば、メモリセルアレイまたは周辺回路(CMOS(Complementary Metal Oxide Semiconductor) 回路)でよい。メモリセルアレイは、複数のメモリセルを三次元に配置した立体型メモリセルアレイでもよい。また、表面10Bには、半導体素子11のいずれかに電気的に接続されたパッド12が設けられている。
接着層40は、半導体チップ10の裏面10Aに設けられている。接着層40は、例えば、DAF(Die Attachment Film))であり、半導体チップ10と半導体チップ20との間を接着する。
半導体チップ20は、例えば、メモリチップを制御するコントローラチップである。半導体チップ20は、配線基板に向かう面である裏面20Aと、裏面20Aの反対側にある表面20Bと、裏面20Aと表面20Bとの間にある側面20Cとを有する。半導体チップ20の裏面20Aには、半導体素子21が設けられ、ポリイミド等の保護膜で被覆されている。半導体素子21は、例えば、コントローラを構成するCMOS回路でよい。裏面20Aには、半導体素子21と電気的に接続されるバンプ25が設けられている。バンプ25には、例えば、はんだ等の低抵抗金属材料が用いられている。
半導体チップ20は、表面20Bにおいて、接着層40を介して半導体チップ10の裏面10Aに接着されている。
配線基板30は、図示しないが、例えば、複数の配線層と複数の絶縁層とを含むプリント基板やインタポーザでよい。配線層には、例えば、銅等の低抵抗金属が用いられる。絶縁層には、例えば、ガラスエポキシ樹脂等の絶縁性材料が用いられる。配線基板30の表面には、配線層のいずれかに電気的に接続されるパッド32が設けられている。半導体チップ20の金属バンプ25は、配線基板30の表面上のパッド(図示せず)を介して配線層に接続されている。これにより、配線基板30の配線層を介して、半導体チップ10、20を制御することができる。
樹脂層50は、例えば、アンダフィルまたはNCP(Non-Conductive Past)等の樹脂である。樹脂層50は、半導体チップ20と配線基板30との間においてバンプ25を被覆しており、バンプ25と配線基板30との間の接続を保護している。また、半導体チップ20のバンプ25を配線基板30に接続する際に、樹脂層50は、液体で供給される。従って、樹脂層50は、半導体チップ20と配線基板30との間を充填するとともに、半導体チップ20の側面20Cを伝って這い上がり、該側面20Cの少なくとも下部を被覆する。尚、樹脂層50の構成については、図2を参照して後で説明する。
半導体チップ10の表面10B上には、他の半導体チップ15が積層されていてもよい。半導体チップ15は、接着層45を介して半導体チップ10の表面10B上に接着されている。半導体チップ15は、半導体チップ10と同様の構成を有するメモリチップであってもよく、他の構成の半導体チップであってもよい。また、図では、コントローラチップとしての半導体チップ20の他、2つの半導体チップ20、15が積層されている。しかし、半導体チップの積層数は、3以上であってもよい。また、コントローラチップも配線基板30の表面に対して平行に複数個配置されていてもよい。
ボンディングワイヤ60は、半導体チップ10、15、20のパッド12、16、32を接続している。
さらに、封止樹脂70が、半導体チップ10、15、20、樹脂層50、ボンディングワイヤ60等を埋め込み封止している。これにより、半導体装置1は、複数の半導体チップ10、15、20を1つの半導体パッケージとして構成されている。
図2は、図1の枠B1の内部のより詳細な構成を示す断面図である。本実施形態において、接着層40は、半導体チップ10の裏面10Aと半導体チップ20の表面20Bとの間に設けられており、半導体チップ20の側面20Cの上部を被覆している。即ち、接着層40は、半導体チップ20の表面20Bから側面20Cの上部を途中まで被覆している。
一方、樹脂層50は、上述の通り、半導体チップ20の裏面20Aから側面20Cを伝って這い上がっており、側面20Cの下部を被覆している。即ち、樹脂層50は、半導体チップ20の裏面20Aから側面20Cの下部を途中まで被覆している。
接着層40と樹脂層50とは、側面20C上において互いに接触しており、それらの間に封止樹脂70は入り込んでいない。よって、側面20Cは、接着層40および樹脂層50によって被覆されており、封止樹脂70と接触していない。封止樹脂70は、接着層40および樹脂層50によって半導体チップ20の側面20Cから離間している。
また、樹脂層50は、樹脂層50と半導体チップ20の側面20Cとの境界部において窪みRCを有する。接着層40は、接着層40と側面20Cとの境界部において窪みRCに対応する突出部PRを有する。このように、窪みRCおよび突出部PRが形成されるのは、半導体チップ10を半導体チップ20に接着層40で接着した後に、樹脂層50が半導体チップ20の側面20Cを伝って這い上がっているからである。つまり、半導体チップ10を半導体チップ20に接着層40で接着し、半導体チップ20のバンプ25を配線基板30に接続し、その後、樹脂層50を半導体チップ20と配線基板30との間に供給している。あるいは、半導体チップ10を半導体チップ20に接着層40で接着し、樹脂層50を配線基板30上に塗布し、その後、樹脂層50内に半導体チップ20のバンプ25を入れて配線基板30に接続している。このような半導体装置1の製造工程順によって、窪みRCおよび突出部PRが形成される。
また、半導体チップ20は、樹脂層50に接触するよりも先に、接着層40に接着される。従って、接着層40が半導体チップ20の表面20Bの全体を被覆する。一方、樹脂層50は半導体チップ20の表面20Bに接触していない。即ち、半導体チップ20の表面20Bと接着層40との間に樹脂層50は入り込まず、介在していない。
図3は、半導体チップ10、20および樹脂層50の位置関係を示す該略平面図である。半導体チップ10は、半導体チップ20よりも大きく、半導体チップ10の表面10Bの上方から見たとき、半導体チップ10の外縁は、半導体チップ20の外縁よりも外側ある。樹脂層50は、半導体チップ20の裏面20Aおよび側面20Cに設けられ、半導体チップ20の周囲を囲むように設けられている。樹脂層50は、図1に示すように、半導体チップ10の裏面10Aと配線基板30との間にも設けられている。樹脂層50は、半導体チップ20の裏面20A側から這い上がっているので、その側面が順テーパー状になっている。接着層40近傍においては、樹脂層50は、接着層40の底面に沿って順テーパー状に逆方向の傾斜を有する。
次に、本実施形態による半導体装置1の製造方法について説明する。
図4〜図11は、第1実施形態による半導体装置の製造方法の一例を示す断面図である。
まず、半導体チップ10の表面10Bにグラインド樹脂テープTP1を貼り付ける。次に、図4に示すように、グラインド樹脂テープTP1で半導体チップ10の表面10Bの半導体素子11を保護しながら、CMP(Chemical Mechanical Polishing)法を用いて半導体チップ10の裏面10Aを研磨し薄化する。このとき、半導体チップ10は、まだ個片化されておらず、半導体ウェハ(半導体基板)10Wの状態である。CMPのグラインダGDで、半導体ウェハ10Wの裏面10Aを研磨する。このとき半導体ウェハ10Wは他に機械的に研削、研磨し薄化してもよいし、ウェットエッチングで薄化してもよい。
次に、半導体ウェハ10Wの裏面10Aに接着層40を接着する。次に、図5に示すように、ダイシング樹脂テープTP2上に半導体ウェハ10Wの裏面10Aを、接着層40を介して貼り付ける。
次に、図6に示すように、ダイシング樹脂テープTP2上で、半導体ウェハ10Wをダイシングして半導体ウェハ10Wを半導体チップ10に個片化する。このとき、半導体ウェハ10Wの表面10Bが上方に向いているので、ダイシングのアライメントが容易になる。ダイシングは、レーザダイシングまたはブレードダイシングで実行すればよい。ダイシング樹脂テープTP2を拡張させることによって、半導体ウェハ10Wを半導体チップ10に個片化してもよい。
次に、図7に示すように、ダイシング後の半導体チップ10の表面10Bに他の樹脂テープTP3を貼り付けて、半導体チップ10を樹脂テープTP3へ移動させる。これにより、接着層40からダイシング樹脂テープTP2が除去され、接着層40が露出される。
次に、図8に示すように、半導体チップ20の表面20Bを半導体チップ10の裏面10Aの接着層40に接着する。半導体チップ20の裏面20Aには、バンプ25が設けられている。半導体チップ20は、半導体チップ10のそれぞれに対応するように接着される。
次に、図9に示すように、配線基板30の表面のバンプ25の接続位置に液状の樹脂層50の材料を塗布する。樹脂層50には、例えば、アンダフィル材またはNCPを用いる。樹脂層50の材料は、還元剤を含むNCPであってもよい。あるいは、還元剤(フラックス)をバンプ25に供給した後、バンプ25を樹脂層50に接触させながら配線基板30にフリップチップ接続してもよい。還元剤によってバンプ25の表面の金属酸化膜を除去しながら、半導体チップ20を配線基板30にフリップチップ接続することができる。これにより、バンプ25と配線基板30のパッドとの接触不良を抑制する。
次に、図8の半導体チップ10、20をマウントツールMTでピックアップする。図10に示すように、マウントツールMTは、半導体チップ10の裏面10Aおよび半導体チップ20の裏面20Aを配線基板30の表面に対向させて、半導体チップ20のバンプ25を樹脂層50に接触させる。さらに、マウントツールMTは、バンプ25を樹脂層50内で配線基板30に接続する。熱処理により、バンプ25を配線基板30のパッドに接続する。このとき、樹脂層50は、半導体チップ20の側面20Cを伝って這い上がる。しかし、半導体チップ20の表面20Bは接着層40で被覆されているため、樹脂層50が表面20Bに付着することはない。樹脂層50は、半導体チップ20と配線基板30との間においてバンプ25を被覆し、半導体チップ20の側面20Cの下部に形成される。
尚、半導体チップ20の厚みは、例えば、20μm〜70μmであることが好ましい。半導体チップ20の厚みが20μm未満の場合、半導体チップ20に形成されたトランジスタの空乏層の影響で、半導体チップの動作が困難となる。一方、半導体チップ20の厚みが70μmを超える場合、樹脂層50は、接着層40まで達しない場合がある。この場合、半導体チップ20の側面20Cが樹脂層50で被覆されず、保護されないおそれがある。この場合、封止樹脂70が半導体チップ20の側面20Cに接触するおそれがある。
さらに、マウントツールMTは、他の半導体チップ15を半導体チップ10上に積層する。半導体チップ15は、接着層45によって半導体チップ10の表面10B上に接着される。
次に、ボンディングワイヤ60を用いて、半導体チップ10、15、20および配線基板30のパッドを接続する。その後、モールド成形工程において、封止樹脂70で配線基板30上の半導体チップ10、20、15を樹脂封止する。これにより、図1に示す半導体装置1のパッケージが完成する。
このように、本実施形態によれば、半導体チップ20は、半導体チップ10上に接着された後、配線基板30上に半導体チップ10とともにフリップチップ接続される。
もし、半導体チップ20のみを配線基板30にフリップチップ接続する場合、マウントツールMTは、半導体チップ20を吸着して、配線基板30上の樹脂層50に接触させながらバンプ25を配線基板30に接続する。この場合、樹脂層50が半導体チップ20の側面20Cを伝って這い上がってくる。アンダフィルがマウントツールMTに付着しないように、マウントツールの表面をフィルム(図示せず)で保護することが考えられる。しかし、この場合、上述のとおり、半導体チップ20ごとにフィルムに吸着穴をあける必要があり、スループットが低くなる。また、マウント処理ごとに、フィルムを交換するため、フィルムのコストがかかる。さらに、樹脂層50が半導体チップ20の表面20B上にも回り込み、半導体チップ20と接着層40との間に樹脂層50が入り込んでしまう。この場合、信頼性試験の吸湿リフローにおいて、半導体チップ20と接着層40とが剥離するおそれがある。
これに対し、本実施形態による製造方法では、半導体チップ20は、半導体チップ10上に接着された後、配線基板30上に半導体チップ10とともにフリップチップ接続される。このように、半導体チップ10、20の積層工程と、半導体チップ20のフリップチップ接続工程との順序を逆にする。これにより、樹脂層50は、半導体チップ20の側面20Cを伝って這い上がっても、半導体チップ10に妨げられてマウントツールMTまでは到達しない。従って、本実施形態は、マウントツールMTを被覆するフィルムを必要とせず、スループットを短縮し、かつ、製造コストを低減させることができる。
また、半導体チップ10、20の積層工程を半導体チップ20のフリップチップ接続工程よりも先に実行するので、樹脂層50は半導体チップ20の表面20B上に回り込まない。即ち、樹脂層50が半導体チップ20の側面20Cを這い上がっても、半導体チップ20の表面20Bには、接着層40がすでに接着されているので、樹脂層50は、半導体チップ20の表面20Bに接触しない。一方、接着層40は、図2に示すように、半導体チップ20の裏面20Aおよびその側面20Cの上部にも接触している。よって、半導体チップ20と接着層40との密着性が向上し、信頼性試験の吸湿リフローにおいて、半導体チップ20と接着層40とが剥離することを抑制することができる。
半導体チップ10の表面10Bの上方から見たとき、半導体チップ10は、半導体チップ20よりも大きく、半導体チップ10の外縁は、半導体チップ20の外縁の外側にあることが好ましい。これにより、樹脂層50が、マウントツールMTへ達することをより効果的に抑制することができる。
ただし、半導体チップ10は、必ずしも半導体チップ20よりも大きくなくても構わない。半導体チップ10の大きさが半導体チップ20の大きさと等しいかそれより小さくても、半導体チップ10は、マウントツールMTと半導体チップ20との距離を、その厚みの分だけ離すことができる。従って、半導体チップ10、20の積層工程と、半導体チップ20のフリップチップ接続工程との順序を逆にするだけでも、本実施形態の効果は得ることができる。
樹脂層50は、半導体チップ20の裏面20Aと配線基板30との間においてバンプ25の周囲を満たすように設けられる。さらに、樹脂層50は、図2に示すように、半導体チップ20の側面20Cを伝って接着層40の底面の一部に接触する。これにより、半導体チップ20の側面20Cを良好に保護することができる。
半導体チップ20は、半導体チップ10に接着された状態で配線基板30へフリップチップ接続される。従って、半導体チップ20の厚みが70μm以下で薄くても、半導体チップ20の反りは半導体チップ10によって矯正される。その結果、フリップチップ接続において、バンプ25は配線基板30に確実に接続され得る。
(第2実施形態)
第1実施形態では、図5および図6に示すように、ダイシングのアライメントのために、樹脂テープTP1から樹脂テープTP2へ半導体ウェハ10Wを移動させて、半導体ウェハ10Wの表面10Bを上に向けている。
第1実施形態では、図5および図6に示すように、ダイシングのアライメントのために、樹脂テープTP1から樹脂テープTP2へ半導体ウェハ10Wを移動させて、半導体ウェハ10Wの表面10Bを上に向けている。
しかし、例えば、赤外線等を用いてアライメントする場合、半導体ウェハ10Wの裏面10Aからアライメントが可能である。この場合、樹脂テープTP1から樹脂テープTP2へ半導体ウェハ10Wを移動させる必要がない。従って、第2実施形態では、樹脂テープTP1を共通に用いて、半導体ウェハ10Wの研磨、ダイシングおよび半導体チップ20の貼り付けを行っている。
図12および図13は、第2実施形態による半導体装置の製造方法の一例を示す断面図である。図4に示すように、樹脂テープTP1上に半導体ウェハ10Wの表面10Bを貼り付け、そのまま樹脂テープTP1上において、半導体ウェハ10Wの裏面10Aを研磨し、裏面10Aに接着層40を形成する。
図12および図13に示すように、半導体ウェハ10Wを樹脂テープTP1に貼り付けたまま、半導体ウェハ10Wをダイシングして半導体ウェハ10Wを半導体チップ10に個片化する。次に、図8に示すように、半導体チップ20の表面20Bを半導体チップ10の裏面10Aの接着層40に接着する。その後、図9〜図11に示す工程を経て、図1に示す半導体装置1のパッケージが完成する。
第2実施形態によれば、樹脂テープを頻繁に変更する必要がないので、スループットをさらに短縮し、かつ、製造コストをさらに削減することができる。
第2実施形態の構成は、第1実施形態の構成と同様でよい。従って、第2実施形態は、第1実施形態の効果も得ることができる。
(第3実施形態)
図14は、第3実施形態による半導体装置の構成例を示す断面図である。第3実施形態によれば、接着層40が半導体チップ20の表面20Bのサイズで設けられている。接着層40は、半導体チップ10の裏面10Aの全体には設けられておらず、その一部の領域に設けられる。第3実施形態のその他の構成は、第1または第2実施形態の対応する構成と同様でよい。従って、第3実施形態は、第1または第2実施形態と同様の効果を得ることができる。
図14は、第3実施形態による半導体装置の構成例を示す断面図である。第3実施形態によれば、接着層40が半導体チップ20の表面20Bのサイズで設けられている。接着層40は、半導体チップ10の裏面10Aの全体には設けられておらず、その一部の領域に設けられる。第3実施形態のその他の構成は、第1または第2実施形態の対応する構成と同様でよい。従って、第3実施形態は、第1または第2実施形態と同様の効果を得ることができる。
図15および図16は、第3実施形態による半導体装置の製造方法の一例を示す断面図である。図4の工程を経た後、図15に示すように、半導体ウェハ10Wを樹脂テープTP1に貼り付けたまま、半導体ウェハ10Wをダイシングして半導体ウェハ10Wを半導体チップ10に個片化する。このとき、半導体ウェハ10Wには、接着層40は貼り付けられていない。
図15では図示しないが、接着層40は、半導体チップ20に貼り付けられている。即ち、接着層40は、半導体チップ20がダイシングされる前に半導体ウェハの表面20Bに貼り付けられている。この半導体ウェハをダイシングで個片化することによって、接着層40を有する半導体チップ20が形成される。接着層40は、ダイシングによって、半導体チップ20と同じサイズに切断される。
次に、図16に示すように、半導体チップ20を半導体チップ10の裏面10A上に配置する。これにより、半導体チップ20は、半導体チップ10の裏面10A上に接着層40によって貼り付けられる。
その後、図9〜図11に示す工程を経て、図14に示す半導体装置1のパッケージが完成する。
第3実施形態では、接着層40が半導体チップ10の裏面10A全体を被覆していない。しかし、接着層40は、半導体チップ10と半導体チップ20との間の全体を埋めている。従って、第3実施形態でも、樹脂層50は、半導体チップ20の表面20Bに接触しない。よって、第3実施形態は、第1実施形態の効果を得ることができる。また、第3実施形態は、第2実施形態と同様に、樹脂テープを頻繁に変更する必要がないので、第2実施形態と同様の効果も得ることができる。
(第4実施形態)
図17は、第4実施形態による半導体装置の構成例を示す断面図である。第4実施形態によれば、樹脂層50が、半導体チップ10の裏面10Aの直下に全体に設けられている。即ち、樹脂層50は、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。
図17は、第4実施形態による半導体装置の構成例を示す断面図である。第4実施形態によれば、樹脂層50が、半導体チップ10の裏面10Aの直下に全体に設けられている。即ち、樹脂層50は、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。
樹脂層50は、図9に示す工程において、配線基板30上に供給する樹脂層50の液体材料の量を、半導体チップ10の裏面10Aと配線基板30の表面との間の空間の容積と略等しくなるようにすればよい。あるいは、樹脂層50の液体材料は、半導体チップ20を半導体チップ10とともに配線基板30上にフリップチップ接続した後に、半導体チップ10の裏面10Aと配線基板30の表面との間の空間を埋めるように供給されてもよい。
樹脂層50は固化すると、半導体チップ10を支持することができる。よって、第4実施形態では、後述するスペーサチップが不要になる。第4実施形態のその他の構成は、第1実施形態と同様でよい。これにより、第4実施形態は、第1実施形態と同様の効果を得ることができる。
(第5実施形態)
図18は、第5実施形態による半導体装置の構成例を示す断面図である。第5実施形態によれば、スペーサチップ80が、半導体チップ20の両側に配置されている。スペーサチップ80は、半導体チップ10の裏面10Aの直下に設けられている。即ち、半導体チップ20の周囲において、スペーサチップ80は、半導体チップ10と配線基板30との間に設けられている。半導体チップ10の表面10Bの上方から見たときに、スペーサチップ80は、半導体チップ20の周囲を囲むように四角形の枠形状を有してもよい。あるいは、スペーサチップ80は、半導体チップ20の四方に分割して配置されていてもよい。
図18は、第5実施形態による半導体装置の構成例を示す断面図である。第5実施形態によれば、スペーサチップ80が、半導体チップ20の両側に配置されている。スペーサチップ80は、半導体チップ10の裏面10Aの直下に設けられている。即ち、半導体チップ20の周囲において、スペーサチップ80は、半導体チップ10と配線基板30との間に設けられている。半導体チップ10の表面10Bの上方から見たときに、スペーサチップ80は、半導体チップ20の周囲を囲むように四角形の枠形状を有してもよい。あるいは、スペーサチップ80は、半導体チップ20の四方に分割して配置されていてもよい。
スペーサチップ80の裏面は、配線基板30の表面上に接着層47によって接着されている。また、スペーサチップ80の表面は、半導体チップ10の裏面10Aにおいて接着層40に接着されている。半導体チップ10と配線基板30との間においてスペーサチップ80の周囲には、封止樹脂70が埋め込まれている。
スペーサチップ80は、半導体チップ20と略等しい厚みを有する。また、スペーサチップ80は、半導体チップ20の基板(例えば、シリコン基板)と同じ材料でよい。よって、スペーサチップ80は、半導体チップ20の周囲において、半導体チップ10を支持することができ、半導体チップ10の反りを矯正し半導体チップ10を平坦にすることができる。第5実施形態のその他の構成は、第1実施形態と同様でよい。これにより、第5実施形態は、さらに第1実施形態と同様の効果を得ることができる。
図19および図20は、第5実施形態による半導体装置の製造方法の一例を示す断面図である。図4〜図8の工程を経た後、図19に示すように、スペーサチップ80を半導体チップ20の周囲の接着層40上に接着する。スペーサチップ80には、予め接着層47が設けられている。次に、図9に示す工程を経た後、半導体チップ10、20をマウントツールMTでピックアップする。次に、図20に示すように、半導体チップ10の裏面10Aおよび半導体チップ20の裏面20Aを配線基板30の表面に対向させて、半導体チップ20を配線基板30にフリップチップ接続する。半導体チップ20のバンプ25を配線基板30に接続する際に、スペーサチップ80を半導体チップ10と配線基板30との間に設ける。接着層47は、半導体チップ20を配線基板30にフリップチップ接続する際にスペーサチップ80を配線基板30に接着する。
その後、図11の工程を経て、図18に示す半導体装置1が完成する。
第5実施形態によれば、スペーサチップ80は、半導体チップ20の周囲において、半導体チップ10を支持することができ、半導体チップ10の反りを矯正し半導体チップ10を平坦にすることができる。
(変形例)
図21は、第5実施形態の変形例による半導体装置の製造方法の一例を示す断面図である。本変形例では、スペーサチップ80を配線基板30上に予め接着しておく。その後、図10および図11に示す工程を経て、半導体チップ20を配線基板30上にフリップチップ接続する。これにより、第5実施形態と同様の構造を有する半導体装置1が得られる。
図21は、第5実施形態の変形例による半導体装置の製造方法の一例を示す断面図である。本変形例では、スペーサチップ80を配線基板30上に予め接着しておく。その後、図10および図11に示す工程を経て、半導体チップ20を配線基板30上にフリップチップ接続する。これにより、第5実施形態と同様の構造を有する半導体装置1が得られる。
(第6実施形態)
図22は、第6実施形態による半導体装置の構成例を示す断面図である。第6実施形態は、第4および5実施形態の組み合わせである。第6実施形態によれば、第5実施形態と同様に、半導体チップ20の周囲において、スペーサチップ80は、半導体チップ10と配線基板30との間に設けられている。
図22は、第6実施形態による半導体装置の構成例を示す断面図である。第6実施形態は、第4および5実施形態の組み合わせである。第6実施形態によれば、第5実施形態と同様に、半導体チップ20の周囲において、スペーサチップ80は、半導体チップ10と配線基板30との間に設けられている。
さらに、樹脂層50が、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。これにより、半導体チップ20およびスペーサチップ80の周囲(側面)は、樹脂層50によって被覆され保護される。
第6実施形態のその他の構成は、第4または第5実施形態と同様でよい。従って、第6実施形態は、第4および第5実施形態の効果を得ることができる。
(第7実施形態)
図23は、第7実施形態による半導体装置の構成例を示す断面図である。第7実施形態は、第3実施形態に第5実施形態のスペーサチップ80を組み合わせた実施形態である。従って、接着層40は、半導体チップ20の表面20Bのサイズで設けられており、半導体チップ20の表面20Bと半導体チップ10の裏面10Aとの間にのみ設けられている。さらに、半導体チップ20の周囲において、スペーサチップ80は、半導体チップ10と配線基板30との間に設けられている。従って、スペーサチップ80と半導体チップ10との間には、接着層40が設けられておらず、封止樹脂70が充填されている。
図23は、第7実施形態による半導体装置の構成例を示す断面図である。第7実施形態は、第3実施形態に第5実施形態のスペーサチップ80を組み合わせた実施形態である。従って、接着層40は、半導体チップ20の表面20Bのサイズで設けられており、半導体チップ20の表面20Bと半導体チップ10の裏面10Aとの間にのみ設けられている。さらに、半導体チップ20の周囲において、スペーサチップ80は、半導体チップ10と配線基板30との間に設けられている。従って、スペーサチップ80と半導体チップ10との間には、接着層40が設けられておらず、封止樹脂70が充填されている。
第7実施形態のその他の構成は、第3または第5実施形態の対応する構成と同様でよい。従って、第7実施形態は、第3および第5実施形態の効果を得ることができる。
尚、第7実施形態では、スペーサチップ80は、接着層40によって半導体チップ10に接着されていない。従って、第7実施形態の製造方法において、第7実施形態のスペーサチップ80は、上記第5実施形態の変形例のように、配線基板30上に接着層47で予め接着しておけばよい。これにより、スペーサチップ80は、配線基板30の所定位置に接着層47によって固定される。
(第8実施形態)
図24は、第8実施形態による半導体装置の構成例を示す断面図である。第8実施形態では、第5実施形態のスペーサチップ80の下に接着層47が設けられていない。スペーサチップ80と配線基板30との間には、封止樹脂70が充填されている。一方、スペーサチップ80は、接着層40に接着している。
図24は、第8実施形態による半導体装置の構成例を示す断面図である。第8実施形態では、第5実施形態のスペーサチップ80の下に接着層47が設けられていない。スペーサチップ80と配線基板30との間には、封止樹脂70が充填されている。一方、スペーサチップ80は、接着層40に接着している。
第8実施形態のその他の構成は、第5実施形態の対応する構成と同様でよい。従って、第8実施形態は、第5実施形態の効果を得ることができる。
尚、第8実施形態では、接着層47が設けられていないので、第8実施形態の製造方法では、スペーサチップ80は、第5実施形態と同様に、接着層40を介して半導体チップ10に接着される。これにより、スペーサチップ80は、半導体チップ20のフリップチップ接続の際に、配線基板30の所定位置に配置される。
(第9実施形態)
図25は、第9実施形態による半導体装置の構成例を示す断面図である。第9実施形態では、第8実施形態の接着層40が半導体チップ20およびスペーサチップ80において連続しておらずそれぞれ分離されている。従って、接着層40は、半導体チップ20と半導体チップ10との間、および、スペーサチップ80と半導体チップ10との間のそれぞれに対応して設けられている。第9実施形態のその他の構成は、第8実施形態の対応する構成と同様でよい。従って、第9実施形態は、第8実施形態の効果を得ることができる。
図25は、第9実施形態による半導体装置の構成例を示す断面図である。第9実施形態では、第8実施形態の接着層40が半導体チップ20およびスペーサチップ80において連続しておらずそれぞれ分離されている。従って、接着層40は、半導体チップ20と半導体チップ10との間、および、スペーサチップ80と半導体チップ10との間のそれぞれに対応して設けられている。第9実施形態のその他の構成は、第8実施形態の対応する構成と同様でよい。従って、第9実施形態は、第8実施形態の効果を得ることができる。
尚、第9実施形態の製造方法では、スペーサチップ80に接着層40を予め設けて、スペーサチップ80を半導体チップ10に接着する。これにより、スペーサチップ80は、半導体チップ20のフリップチップ接続の際に、配線基板30の所定位置に配置される。
(第10実施形態)
図26は、第10実施形態による半導体装置の構成例を示す断面図である。第10実施形態では、第4および図10実施形態の組み合わせである。第10実施形態によれば、半導体チップ20およびスペーサチップ80の周囲において、樹脂層50が、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。これにより、半導体チップ20およびスペーサチップ80の周囲(側面)は、樹脂層50によって被覆され保護される。さらに、スペーサチップ80と配線基板30との間にも、樹脂層50が充填される。
図26は、第10実施形態による半導体装置の構成例を示す断面図である。第10実施形態では、第4および図10実施形態の組み合わせである。第10実施形態によれば、半導体チップ20およびスペーサチップ80の周囲において、樹脂層50が、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。これにより、半導体チップ20およびスペーサチップ80の周囲(側面)は、樹脂層50によって被覆され保護される。さらに、スペーサチップ80と配線基板30との間にも、樹脂層50が充填される。
第10実施形態のその他の構成は、10実施形態の対応する構成と同様でよい。従って、第10実施形態は、第4および第9実施形態の効果を得ることができる。
(第11実施形態)
図27は、第11実施形態による半導体装置の構成例を示す断面図である。第11実施形態では、第4および第7実施形態の組み合わせである。第11実施形態によれば、半導体チップ20およびスペーサチップ80の周囲において、樹脂層50が、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。これにより、半導体チップ20およびスペーサチップ80の周囲(側面)は、樹脂層50によって被覆され保護される。さらに、スペーサチップ80と半導体チップ10との間にも、樹脂層50が充填される。
図27は、第11実施形態による半導体装置の構成例を示す断面図である。第11実施形態では、第4および第7実施形態の組み合わせである。第11実施形態によれば、半導体チップ20およびスペーサチップ80の周囲において、樹脂層50が、半導体チップ10の裏面10Aと配線基板30の表面との間に全体的に充填されている。これにより、半導体チップ20およびスペーサチップ80の周囲(側面)は、樹脂層50によって被覆され保護される。さらに、スペーサチップ80と半導体チップ10との間にも、樹脂層50が充填される。
第11実施形態のその他の構成は、第7実施形態の対応する構成と同様でよい。従って、第11実施形態は、第4および第7実施形態の効果を得ることができる。
本発明のいくつかの実施形態を説明したが、これらの実施形態は、例として提示したものであり、発明の範囲を限定することは意図していない。これら実施形態は、その他の様々な形態で実施されることが可能であり、発明の要旨を逸脱しない範囲で、種々の省略、置き換え、変更を行うことができる。これら実施形態やその変形は、発明の範囲や要旨に含まれると同様に、特許請求の範囲に記載された発明とその均等の範囲に含まれるものである。
1 半導体装置、10、15、20 半導体チップ、30 配線基板、40、45 接着層、50 樹脂層、60 ボンディングワイヤ、70 封止樹脂、80 スペーサチップ
Claims (9)
- 第1面と該第1面の反対側にある第2面とを有する第1半導体チップと、
前記第1半導体チップの前記第1面に設けられた第1接着層と、
第3面と該第3面の反対側にある第4面とを有し、前記第3面に接続バンプを有する第2半導体チップであって、前記第4面において前記第1接着層を介して前記第1半導体チップの前記第1面に接着された第2半導体チップと、
前記第2半導体チップの前記第3面側において、前記接続バンプに接続された配線基板と、
前記第2半導体チップと前記配線基板との間において前記接続バンプを被覆し、前記第3面と前記第4面との間にある前記第2半導体チップの側面に設けられた第1樹脂層とを備え、
前記第1接着層は、前記第2半導体チップの前記側面の上部を被覆し、
前記第1樹脂層は、該側面の下部を被覆し、
前記第1接着層と前記第1樹脂層は、該側面上において互いに接触している、半導体装置。 - 前記第1樹脂層は、該第1樹脂層と前記第2半導体チップの前記側面との境界部において窪みを有し、
前記第1接着層は、該第1接着層と前記第2半導体チップの前記側面との境界部において前記窪みに対応する突出部を有する、請求項1に記載の半導体装置。 - 前記第1樹脂層は、前記第2半導体チップの前記第3面から前記側面の途中まで被覆している、請求項1または請求項2に記載の半導体装置。
- 前記第1接着層は、前記第2半導体チップの前記第4面から前記側面の途中まで被覆している、請求項1から請求項3のいずれか一項に記載の半導体装置。
- 前記第1半導体チップの前記第2面の上方から見たときに、前記第1半導体チップの外縁は、前記第2半導体チップの外縁よりも外側にあり、
前記第1樹脂層は、前記第1半導体チップの前記第1面と前記配線基板との間に設けられている、請求項1から請求項4のいずれか一項に記載の半導体装置。 - 前記第1半導体チップの前記第2面の上方から見たときに、前記第1半導体チップの外縁は、前記第2半導体チップの外縁よりも外側にあり、
前記第2半導体チップの周囲において、前記第1半導体チップと前記配線基板との間に設けられた第3半導体チップをさらに備えている、請求項1から請求項5のいずれか一項に記載の半導体装置。 - 前記第1半導体チップの前記第2面の上方から見たときに、前記第1半導体チップの外縁は、前記第2半導体チップの外縁よりも外側にあり、
前記第2半導体チップの周囲において、前記第1半導体チップと前記配線基板との間に設けられた第3半導体チップと、
前記第1半導体チップと前記配線基板との間において前記第3半導体チップの周囲を埋め込む第2樹脂層とをさらに備えている、請求項1から請求項4のいずれか一項に記載の半導体装置。 - 第1面と該第1面の反対側にある第2面とを有する第1半導体基板の該第1面に第1接着層を形成し、
前記第1半導体基板を複数の第1半導体チップに個片化し、
第3面と該第3面の反対側にある第4面とを有し、前記第3面に接続バンプを有する第2半導体チップの該第4面を前記第1接着層に接着し、
前記第1半導体チップの前記第1面を配線基板に対向させて前記第2半導体チップの前記接続バンプを配線基板に接続し、
前記第2半導体チップと前記配線基板との間において前記接続バンプを被覆し、前記第2半導体チップの側面の下部に第1樹脂層を形成することを具備する、半導体装置の製造方法。 - 第1樹脂テープ上に前記第1半導体基板の前記第2面を貼り付け、前記第1半導体基板の前記第1面を研磨し、前記第1面に前記第1接着層を形成し、
第2樹脂テープ上に前記第1半導体基板の前記第1面を、前記第1接着層を介して貼り付け、前記第1半導体基板を前記第1半導体チップに個片化し、
第3樹脂テープ上に前記第1半導体チップの前記第2面を貼り付け、前記第2半導体チップの前記第4面を前記第1半導体チップの前記第1面の前記第1接着層に接着し、
前記配線基板上に前記第1樹脂層の材料を塗布し、
前記第1半導体チップの前記第1面を前記配線基板に対向させて前記第2半導体チップの前記接続バンプを前記第1樹脂層内で前記配線基板に接続する、請求項8に記載の方法。
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WO2023190235A1 (ja) * | 2022-03-30 | 2023-10-05 | 株式会社レゾナック | 半導体用接着フィルム、ダイシングダイボンディングフィルム、及び半導体装置を製造する方法 |
WO2023188170A1 (ja) * | 2022-03-30 | 2023-10-05 | 株式会社レゾナック | 半導体用接着フィルム、ダイシングダイボンディングフィルム、及び半導体装置を製造する方法 |
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