JP2018033261A - Pulse generating circuit - Google Patents
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Abstract
Description
本発明はパルス発生回路に関する。詳しくは、例えば誘電体バリア放電を行うためのパルス発生回路に係るものである。 The present invention relates to a pulse generation circuit. Specifically, for example, the present invention relates to a pulse generation circuit for performing dielectric barrier discharge.
オゾンは、フッ素に次ぐ強い酸化作用があり、殺菌、ウィルスの不活化、脱臭、脱色、有機物の除去などに利用されている。 Ozone has the strongest oxidizing action after fluorine, and is used for sterilization, virus inactivation, deodorization, decolorization, removal of organic substances, and the like.
このようなオゾンを発生させる方法の一つとして、誘電体バリア放電がある。誘電体バリア放電は、絶縁体である誘電体を介して気体に交流電圧を印加し、気体中に放電を起こすタイプの放電である。
交流電圧だと負荷の発熱が大きく、冷却が必要になるため、交流電圧の代わりにパルス状の電圧を印加し、負荷の発熱を抑えることが検討されている。
One method for generating ozone is dielectric barrier discharge. Dielectric barrier discharge is a type of discharge in which an alternating voltage is applied to a gas through a dielectric that is an insulator to cause a discharge in the gas.
Since the load generates a large amount of heat when it is an AC voltage and cooling is required, it has been studied to apply a pulse voltage instead of the AC voltage to suppress the heat generation of the load.
また、パルス状の電圧を印加するためのパルス発生回路として、従来、様々なものが提案されている。 Conventionally, various pulse generation circuits for applying a pulse voltage have been proposed.
例えば特許文献1には、図11に示すようなパルス発生回路が記載されている。
すなわち、特許文献1に記載のパルス発生回路100は、トランス112と、トランス112の一次側に接続された直流電源部114と、トランス112の二次側に接続された放電負荷116とを備える。
For example,
That is, the
また、特許文献1に記載のパルス発生回路100は、トランス112の一次巻線118と直流電源部114との間に接続され、逆並列で接続されたダイオード120を有する半導体スイッチ122と、半導体スイッチ122をオン/オフ制御して、半導体スイッチ122のオン動作とオフ動作とを繰り返す駆動回路124とを備える。
In addition, the
また、直流電源部114は、直流電源126とコンデンサ128(容量C1)とが並列に接続されて構成されている。
また、半導体スイッチ122は、ダイオード120が内蔵されたSiC−MOSFET132を有する。
The DC
The
また、駆動回路124は、半導体スイッチ122をオン/オフ制御するための制御信号Scを生成する制御信号生成回路134と、バッファ136とを有する。
In addition, the
また、半導体スイッチ122のゲートには、制御信号生成回路134からの制御信号Scがバッファ136を介してゲート電圧Vgとして印加され、半導体スイッチ122のオンおよびオフが制御される。
Further, the control signal Sc from the control
また、放電負荷116は、トランス112の二次側に接続された一対の電極と、一対の電極の間に介在する処理空間とで構成され、これに予備容量を接続することが好ましい旨が特許文献1に記載されている。
In addition, the
しかしながら、特許文献1に記載のパルス発生回路において予備容量を接続しても、予備容量に余分な電圧が残ってしまい、放電負荷に付与する高電圧パルスにテールが付いて、時間が経つと放電負荷を破損させてしまうので、正常な放電を行うことができなくなる。
However, even if a spare capacitor is connected in the pulse generation circuit described in
本発明は、以上の点に鑑みて創案されたものであり、負荷を破損させるおそれがないパルス発生回路を提供することを目的とする。 The present invention has been made in view of the above points, and an object of the present invention is to provide a pulse generation circuit that does not cause damage to a load.
上記の目的を達成するために、本発明のパルス発生回路は、電圧を昇圧可能な昇圧トランスと、充電可能な第1のコンデンサと、制御信号に基づいてオンおよびオフにする制御が可能であり、かつ、前記第1のコンデンサに充電された電圧を前記昇圧トランスの1次側巻線へ送出可能なトランジスタと、前記昇圧トランスの2次側巻線と電気的に接続されており、かつ、同昇圧トランスから送出された電流で充電可能な第2のコンデンサと、該第2のコンデンサと電気的に接続されており、かつ、同第2のコンデンサに充電された電圧を外部へパルス状に出力可能な出力端子と、前記第2のコンデンサと電気的に接続されており、かつ、前記出力端子から出力されたパルス状電圧の値が所定の値に達した場合に、同第2のコンデンサに充電された電圧を減少可能な磁気スイッチとを備える。 In order to achieve the above object, the pulse generation circuit of the present invention can be controlled to be turned on and off based on a control signal, a step-up transformer capable of boosting a voltage, a first capacitor capable of being charged, and a control signal. And a transistor capable of sending a voltage charged in the first capacitor to a primary side winding of the step-up transformer, and a secondary side winding of the step-up transformer, and electrically connected, and A second capacitor that can be charged with a current sent from the step-up transformer, and a voltage that is electrically connected to the second capacitor and charged to the second capacitor is pulsed to the outside. When the output terminal capable of outputting and the second capacitor are electrically connected and the value of the pulse voltage output from the output terminal reaches a predetermined value, the second capacitor Charged to And and a magnetic switch which can reduce the voltage.
ここで、電圧を昇圧可能な昇圧トランスによって、電圧を高くすることができる。 Here, the voltage can be increased by a step-up transformer capable of boosting the voltage.
また、第2のコンデンサと電気的に接続されており、かつ、出力端子から出力されたパルス状電圧の値が所定の値に達した場合に、第2のコンデンサに充電された電圧を減少可能な磁気スイッチによって、第2のコンデンサに余分な電圧が残り難いため、発生させた高電圧パルスにテールが付かず、出力端子から出力される電圧のパルス幅を短くすることができる。 Moreover, when the value of the pulse voltage output from the output terminal reaches a predetermined value when electrically connected to the second capacitor, the voltage charged in the second capacitor can be reduced. Since an extra voltage hardly remains in the second capacitor by the magnetic switch, the generated high voltage pulse is not tailed, and the pulse width of the voltage output from the output terminal can be shortened.
また、本発明のパルス発生回路において、昇圧トランスは可飽和トランスを有し、トランジスタは、可飽和トランスが飽和したときにオフにする制御が可能であるものとすることができる。 In the pulse generation circuit of the present invention, the step-up transformer may have a saturable transformer, and the transistor can be controlled to be turned off when the saturable transformer is saturated.
この場合、昇圧トランスが電圧を昇圧中は第1のコンデンサに充電された電圧を送出でき、昇圧トランスが電圧を昇圧しなくなったときには第1のコンデンサに充電された電圧を送出しなくなるので、第1のコンデンサに充電された電圧を昇圧のために効率よく消費することができる。 In this case, the voltage charged in the first capacitor can be sent out while the boosting transformer is boosting the voltage, and when the boosting transformer stops boosting the voltage, the voltage charged in the first capacitor is not sent out. The voltage charged in one capacitor can be efficiently consumed for boosting.
さらに、本発明のパルス発生回路において、磁気スイッチは、第1のコンデンサと第2のコンデンサとを電気的に連結しており、本発明のパルス発生回路は、磁気スイッチと電気的に直列で接続されており、かつ、第1のコンデンサから第2のコンデンサへの電圧の送出を阻止可能なダイオードを備えるものとすることができる。 Further, in the pulse generation circuit of the present invention, the magnetic switch electrically connects the first capacitor and the second capacitor, and the pulse generation circuit of the present invention is electrically connected in series with the magnetic switch. And a diode capable of preventing the voltage from being sent from the first capacitor to the second capacitor.
この場合、第2のコンデンサに余分な電圧をさらに残り難くすると共に、第1のコンデンサに残った電圧が第2のコンデンサへ移らないようにすることができ、さらに消費電力を抑えることができる。 In this case, it is possible to make it difficult for an excessive voltage to remain in the second capacitor, and it is possible to prevent the voltage remaining in the first capacitor from being transferred to the second capacitor, thereby further reducing power consumption.
また、本発明のパルス発生回路において、トランジスタは、SiC−MOSFETであるものとすることができる。 In the pulse generation circuit of the present invention, the transistor may be a SiC-MOSFET.
この場合、絶縁ゲートバイポーラトランジスタの場合よりもトランジスタのオフ動作が速いので、第1のコンデンサの残存電圧が低くなるということを防いだり、第1のコンデンサに電圧が残らないということを防いだりできる。 In this case, since the off-operation of the transistor is faster than in the case of the insulated gate bipolar transistor, it is possible to prevent the remaining voltage of the first capacitor from being lowered, or to prevent the voltage from remaining in the first capacitor. .
本発明に係るパルス発生回路は、負荷を破損させるおそれがない。 The pulse generation circuit according to the present invention has no risk of damaging the load.
以下、本発明の実施の形態について図面を参照しながら説明し、本発明の理解に供する。 Hereinafter, embodiments of the present invention will be described with reference to the drawings to facilitate understanding of the present invention.
<第1の実施形態>
図1は、本発明を適用したパルス発生回路の第1の実施形態を示す概略図である。
<First Embodiment>
FIG. 1 is a schematic diagram showing a first embodiment of a pulse generation circuit to which the present invention is applied.
図1に示す本発明のパルス発生回路1は、第1の回路領域2と第2の回路領域3を備える。ここで、第1の回路領域2と第2の回路領域3は互いに、電圧を昇圧可能な昇圧トランス4を介して電気的に接続されている。
The
また、昇圧トランス4は、1次側巻線10および2次側巻線11を有するパルストランス(PT)4Aと、1次側巻線17および2次側巻線18を有し、かつ、パルストランス4Aの2次側巻線11に1次側巻線17が電気的に接続された可飽和トランス(ST)4Bとで構成されている。
The step-
また、可飽和トランス4Bは、飽和するまで、すなわちオフの間、トランスとして機能し、昇圧を行う。
一方、可飽和トランス4Bは、飽和すると、すなわちオンになると、トランスとして機能しなくなり、昇圧を行なわなくなる。
Further, the
On the other hand, when the
また、パルストランス4Aの1次側巻線10と2次側巻線11の巻数比は、通常の巻数比を適用できるが、1次側巻線10と2次側巻線11の巻数比は例えば1:4であるものとすることができる。
Further, as the turn ratio of the primary side winding 10 and the secondary side winding 11 of the
また、可飽和トランス4Bの1次側巻線17と2次側巻線18の巻数比は、1次側巻線17の巻数の方が2次側巻線18の巻数よりも少ないのであれば、どのような巻数比であってもよいが、例えば1次側巻線17と2次側巻線18の巻数比は例えば2:5であるものとすることができる。
Further, if the turn ratio of the primary side winding 17 and the secondary side winding 18 of the
また、本発明のパルス発生回路1の第1の回路領域2は、所定の電圧まで充電される第1のコンデンサ(C0)5と、第1のコンデンサ5の両端に電気的に接続されており第1のコンデンサ5を充電可能な充電器13とを有する。
The
また、本発明のパルス発生回路1の第1の回路領域2は、パルストランス4Aの1次側巻線10の一端と電気的に接続された第1の磁気スイッチ(SI0)9を有する。
The
また、本発明のパルス発生回路1の第1の回路領域2は、パルストランス4Aの1次側巻線10の他端と電気的に接続された絶縁ゲートバイポーラトランジスタ(IGBT)6を有する。
ここで、絶縁ゲートバイポーラトランジスタはトランジスタの一例である。
The
Here, the insulated gate bipolar transistor is an example of a transistor.
また、第1の磁気スイッチ9の、パルストランス4Aに接続された側とは反対側が、第1のコンデンサ5の一端と電気的に接続されている。
Further, the side of the first
また、絶縁ゲートバイポーラトランジスタ6の、パルストランス4Aに接続された側とは反対側が、第1のコンデンサ5の他端と電気的に接続されている。
また、図1に示すように、第1のコンデンサ5の他端側は接地されている。
The side of the insulated gate
Further, as shown in FIG. 1, the other end of the
また、絶縁ゲートバイポーラトランジスタ6は、制御信号に基づいてオンおよびオフにする制御が可能であり、かつ、第1のコンデンサ5に充電された電圧をパルストランス4Aの1次側巻線10へ送出可能である。
The insulated gate
また、絶縁ゲートバイポーラトランジスタ6は、可飽和トランス4Bが飽和したときにオフにする制御が可能であるが、SiC−MOSFETよりもオフになる動作が遅い。
The insulated gate
また、本発明のパルス発生回路1は、絶縁ゲートバイポーラトランジスタ6をオンおよびオフに制御するための制御信号を絶縁ゲートバイポーラトランジスタ6へ送出可能な制御回路14を備える。
Further, the
また、本発明のパルス発生回路1の第2の回路領域3は、可飽和トランス4Bの2次側巻線18の一端と電気的に接続された第2のコンデンサ(C1)7を有する。
また、第2のコンデンサ7は、可飽和トランス4Bの2次側巻線18から送出された電流で充電可能である。
Further, the
The
また、本発明のパルス発生回路1の第2の回路領域3は、所定の間隔を設けて配置された一対の出力端子8を有する。
すなわち、一対の出力端子8間には空間が形成されている。
Further, the
That is, a space is formed between the pair of
ここで、一方の出力端子8は、可飽和トランス4Bの2次側巻線18の他端と電気的に接続されている。
また、他方の出力端子8は、第2のコンデンサ7の、可飽和トランス4Bの2次側巻線18の一端に接続された側とは反対側と電気的に接続されている。
Here, one
The
また、一対の出力端子8は、第2のコンデンサ7に充電された電圧を外部へパルス状に出力可能である。
すなわち、一対の出力端子8は、一対の出力端子8間に形成された空間にパルス状電圧を出力可能である。
The pair of
That is, the pair of
また、一対の出力端子8間に形成された空間には、昇圧されたパルス状電圧が印加される対象となる負荷15が、出力端子8と電気的に接続されて配置されている。
Further, a
ここで負荷15は、一対の出力端子8にそれぞれ電気的に接続された一対の電極19と、一対の電極19それぞれの片側を覆うように取付けられた一対のガラスなどの絶縁物20とで構成されている。
また、図1に示すように、一対の絶縁物20間には空間が形成されている。
Here, the
In addition, as shown in FIG. 1, a space is formed between the pair of
また、本発明のパルス発生回路1の第2の回路領域3は、図1に示すように一対の出力端子8と電気的に並列に接続された高速ダイオード(FRD)16を有する。
また、図1に示すように、高速ダイオード16の一端側は接地されている。
In addition, the
Further, as shown in FIG. 1, one end side of the
また、本発明のパルス発生回路1は、第2の磁気スイッチ(SI1)12を備える。
ここで、第2の磁気スイッチ12は、第2のコンデンサ7と電気的に並列に接続されており、かつ、出力端子8から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ7に充電された電圧を減少可能、具体的には第2のコンデンサ7に蓄積されたエネルギーを消費可能である。
Moreover, the
Here, the second
また、本発明のパルス発生回路において、絶縁ゲートバイポーラトランジスタすなわちトランジスタは、必ずしも可飽和トランスが飽和したときにオフにする制御が可能でなくてもよい。 In the pulse generation circuit of the present invention, the insulated gate bipolar transistor, that is, the transistor does not necessarily need to be controlled to be turned off when the saturable transformer is saturated.
しかし、トランジスタが、可飽和トランスが飽和したときにオフにする制御が可能であれば、昇圧トランスが電圧を昇圧中は第1のコンデンサに充電された電圧を送出でき、昇圧トランスが電圧を昇圧しなくなったときには第1のコンデンサに充電された電圧を送出しなくなるので、第1のコンデンサが蓄えたエネルギーを出力パルス発生のためだけに使用するので電源効率が良くなり、好ましい。 However, if the transistor can be controlled to be turned off when the saturable transformer is saturated, the voltage charged in the first capacitor can be sent while the boost transformer is boosting the voltage, and the boost transformer boosts the voltage. Since the voltage charged in the first capacitor is not sent when it stops, the energy stored in the first capacitor is used only for the generation of the output pulse, which improves the power supply efficiency and is preferable.
また、磁気スイッチは、出力端子から出力されたパルス状電圧の値が、例えば電圧時間積0.001〜0.002Vsに達した場合に、第2のコンデンサが蓄積したエネルギーを消費可能であるものとすることができる。 The magnetic switch is capable of consuming the energy accumulated by the second capacitor when the value of the pulse voltage output from the output terminal reaches, for example, a voltage time product of 0.001 to 0.002 Vs. It can be.
次に、図1に示した本発明のパルス発生回路1がパルス状電圧を負荷15に印加するときの状況を、図1および図2を参照しながら説明する。
Next, the situation when the
図2は、図1に示した本発明のパルス発生回路における電圧および電流と、経過時間との関係を示すグラフの一例である。
図2に示すグラフにおいて、縦軸は電圧値および電流値を示し、横軸は経過時間(秒)を示す。
FIG. 2 is an example of a graph showing the relationship between voltage and current and elapsed time in the pulse generation circuit of the present invention shown in FIG.
In the graph shown in FIG. 2, the vertical axis represents the voltage value and the current value, and the horizontal axis represents the elapsed time (seconds).
充電器13が第1のコンデンサ5への充電を開始すると、第1のコンデンサ5は、所定の電圧まで充電される。
第1のコンデンサ5が所定の電圧まで充電されると、第1のコンデンサ5への充電が終了する。
When the
When the
第1のコンデンサ5が所定の電圧まで充電された後、制御回路14から制御信号が絶縁ゲートバイポーラトランジスタ6へ送出され、絶縁ゲートバイポーラトランジスタ6がオンに制御され、その後、第1の磁気スイッチ9もオンになる(ステップ1A)。
After the
絶縁ゲートバイポーラトランジスタ6と第1の磁気スイッチ9がオンになると、第1のコンデンサ5に充電された電圧(VCO)が、パルストランス4Aの1次側巻線10へ送出され、図2に示すように第1のコンデンサ5に充電された電圧(VCO)の値は減少する。
When the insulated gate
第1のコンデンサ5に充電された電圧(VCO)の値の減少と共に、図1に示すように本発明のパルス発生回路1の第1の回路領域2に、第1のパルス電流(I0)が流れる。
また、第1のパルス電流(I0)が流れることと同期して、本発明のパルス発生回路1の第2の回路領域3に、第2のパルス電流(I0´)が流れる。
また、第2のパルス電流(I0´)が流れると、第2のコンデンサ7が充電され、図2に示すように第2のコンデンサ7に充電された電圧(VC1)の値が徐々に増加する(ステップ1B)。
As the value of the voltage (V CO ) charged in the
Further, in synchronization with the flow of the first pulse current (I 0 ), the second pulse current (I 0 ′) flows in the
When the second pulse current (I 0 ′) flows, the
一方、第2のコンデンサ7が充電されている途中に、可飽和トランス4Bが飽和し、高速ダイオード16に急峻な逆電流が流れる(ステップ1C)。
すなわち、図2に示すように第2のパルス電流(I0´)の値を示す線が、急峻にグラフの下方へと延び始め、ゼロ基準線36を越えて図2のグラフの上側のプロット領域とは反対側の下側のプロット領域に達する。
On the other hand, while the
That is, as shown in FIG. 2, the line indicating the value of the second pulse current (I 0 ′) starts to sharply extend downward in the graph, exceeds the zero
なお、図2に示すように逆電流が流れ始めた直後は、まだ順電流の方が多いため、第2のコンデンサ7に充電された電圧(VC1)の値は増加を続けるが、第2のパルス電流(I0´)の値を示す線が、ゼロ基準線36を越えて図2のグラフの上側のプロット領域とは反対側の下側のプロット領域に存在している間は、第2のコンデンサ7に充電された電圧(VC1)の値は減少を続ける。
As shown in FIG. 2, immediately after the reverse current starts to flow, the forward current is still larger, so the value of the voltage (V C1 ) charged in the
高速ダイオード16に急峻な逆電流が流れると、高速ダイオード16が高速で逆電流を遮断するので、一対の出力端子8からパルス状に電圧が出力され、負荷15に電圧(VL)が印加される(ステップ1D)。この電圧が1発目の高電圧のパルス状電圧である。
When a steep reverse current flows through the high-
すなわち、逆電流が遮断されると、図2に示すように、第2のパルス電流(I0´)の値を示す線が反転して急峻にグラフの上方へと延び始めるのと同時に、パルス状電圧(VL)の値を示す線が上方へと延び始める。
また、反転した第2のパルス電流(I0´)の値を示す線はゼロ基準線36にまで達する。
That is, when the reverse current is interrupted, as shown in FIG. 2, the line indicating the value of the second pulse current (I 0 ′) inverts and starts to sharply extend upward in the graph. A line indicating the value of the voltage (V L ) starts to extend upward.
The line indicating the value of the inverted second pulse current (I 0 ′) reaches the zero
そして、図2に示すように、反転した第2のパルス電流(I0´)の値を示す線がゼロ基準線36に到達したときに、負荷15に印加されたパルス状電圧(VL)の値は最大値となる。
As shown in FIG. 2, when the line indicating the value of the inverted second pulse current (I 0 ′) reaches the zero
ここで、負荷15に印加されたパルス状電圧(VL)は下記の式で表される。
VL={L(di/dt)+VC1}
Here, the pulse voltage (V L ) applied to the
V L = {L (di / dt) + V C1 }
「dt」は、第2のパルス電流(I0´)の値を示す線がグラフの上方へ延び始めてからゼロ基準線36に達するまでの経過時間であり、「di」は、「第2のパルス電流(I0´)の値を示す線がグラフの上方へ延び始めたときの第2のパルス電流(I0´)の値」と「第2のパルス電流(I0´)の値を示す線がゼロ基準線36に到達したときの第2のパルス電流(I0´)の値」との差分である。
また、「L」はインダクタンスである。
“Dt” is an elapsed time from when the line indicating the value of the second pulse current (I 0 ′) starts to extend upward in the graph until the zero
“L” is an inductance.
また、「L(di/dt)」は、飽和後の可飽和トランス4Bに流れる電流変化(di/dt)により、可飽和トランス4Bの2次側巻線18の両端に発生する電圧である。
“L (di / dt)” is a voltage generated at both ends of the secondary winding 18 of the
次に、負荷15に印加されたパルス状電圧(VL)の値が最大値に達したときに、第2の磁気スイッチ12が飽和する(ステップ1E)。
Next, when the value of the pulse voltage (V L ) applied to the
第2の磁気スイッチ12が飽和すると、第2のコンデンサ7に充電された電圧(VC1)を、第2の磁気スイッチ12が放電する、すなわち磁気スイッチ12が消費するので、図2に示すように、負荷15に印加されたパルス状電圧(VL)の値を示す線は負荷によらずゼロ基準線36まで急峻に立ち下がる(ステップ1F)。
When the second
また、第2の磁気スイッチ12が、第2のコンデンサ7に蓄積されたエネルギーを消費するので、第2のコンデンサ7には電圧は残らない(ステップ1G)。
Also, since the second
また、ステップ1Aからステップ1Gまで進む間も、絶縁ゲートバイポーラトランジスタ6と第1の磁気スイッチ9はオンの状態のままであるので、図2に示すように、第1のコンデンサ5に充電された電圧(VCO)の値は減少を続けている。
そして、第1のコンデンサ5に充電されていた電圧(VCO)はゼロになる。
Further, since the insulated gate
The voltage (V CO ) charged in the
また、第1のコンデンサ5の電圧がゼロになった後、第1の磁気スイッチ9はオフになり、その後、絶縁ゲートバイポーラトランジスタ6をオフにする(ステップ1H)。
そして、再び充電器13が第1のコンデンサ5への充電を開始し、ステップ1A〜ステップ1Gが行われ、2発目の高電圧のパルス状電圧(VL)を負荷15へ印加する(ステップ1J)。
Further, after the voltage of the
Then, the
また、出力されるパルス状電圧の周期Tは制御回路14の制御信号によって自由に可変できる。
Further, the period T of the output pulse voltage can be freely changed by the control signal of the
このように、第2のコンデンサ7に蓄積されたエネルギーを、第2の磁気スイッチ12が消費するので、負荷15に印加されたパルス状電圧(VL)の値を示す線はゼロ基準線36まで急峻に立ち下がり、出力端子から出力される電圧のパルス幅を短くすることができる。
また、第2のコンデンサ7には電圧は残らないので、発生させた高電圧パルスにテールが付かない。
その結果、負荷15における放電が安定し、放電により発生する物質例えばオゾンも安定する。
As described above, since the energy stored in the
In addition, since no voltage remains in the
As a result, the discharge in the
<第2の実施形態>
図3は、本発明を適用したパルス発生回路の第2の実施形態を示す概略図である。
<Second Embodiment>
FIG. 3 is a schematic diagram showing a second embodiment of a pulse generation circuit to which the present invention is applied.
図3に示す本発明のパルス発生回路21は、第1の回路領域22と第2の回路領域23を備える。ここで、第1の回路領域22と第2の回路領域23は互いに、電圧を昇圧可能な昇圧トランス4を介して電気的に接続されている。
昇圧トランス4の構成は第1の実施形態で使用された昇圧トランスの構成と同じなので、昇圧トランス4の構成の説明を省略する。
The
Since the configuration of the step-up
また、本発明のパルス発生回路21の第1の回路領域22は、所定の電圧まで充電される第1のコンデンサ(C0)5と、第1のコンデンサ5の両端に電気的に接続されており第1のコンデンサ5を充電可能な充電器13とを有する。
The
なお、本発明の第2の実施形態のパルス発生回路21は、本発明の第1の実施形態のパルス発生回路と異なり、パルストランス4Aの1次側巻線10の一端と電気的に接続された磁気スイッチを有していない。
Note that, unlike the pulse generation circuit of the first embodiment of the present invention, the
また、パルストランス4Aの1次側巻線10の一端と第1のコンデンサ5の一端とが電気的に接続されている。
One end of the primary winding 10 of the
また、本発明のパルス発生回路21の第1の回路領域22は、パルストランス4Aの1次側巻線10の他端と電気的に接続されたSiC−MOSFET24を有する。
ここで、SiC−MOSFETはトランジスタの一例である。
The
Here, the SiC-MOSFET is an example of a transistor.
また、SiC−MOSFET24の、パルストランス4Aに接続された側とは反対側が、第1のコンデンサ5の他端と電気的に接続されている。
また、図3に示すように、第1のコンデンサ5の他端側は接地されている。
The side of the SiC-
Further, as shown in FIG. 3, the other end of the
また、SiC−MOSFET24は、制御信号に基づいてオンおよびオフにする制御が可能であり、かつ、第1のコンデンサ5に充電された電圧をパルストランス4Aの1次側巻線10へ送出可能である。
Further, the SiC-
また、SiC−MOSFET24は、可飽和トランス4Bが飽和したときにオフにする制御が可能である。
The SiC-
また、本発明のパルス発生回路21は、SiC−MOSFET24をオンおよびオフに制御するための制御信号をSiC−MOSFET24へ送出可能な制御回路14を備える。
Further, the
また、本発明のパルス発生回路21の第2の回路領域23は、可飽和トランス4Bの2次側巻線18の一端と電気的に接続された第2のコンデンサ(C1)7を有する。
また、第2のコンデンサ7は、可飽和トランス4Bの2次側巻線18から送出された電流で充電可能である。
In addition, the
The
また、本発明のパルス発生回路21の第2の回路領域23は、所定の間隔を設けて配置された一対の出力端子8を有する。
すなわち、一対の出力端子8間には空間が形成されている。
In addition, the
That is, a space is formed between the pair of
ここで、一方の出力端子8は、可飽和トランス4Bの2次側巻線18の他端と電気的に接続されている。
また、他方の出力端子8は、第2のコンデンサ7の、可飽和トランス4Bの2次側巻線18の一端に接続された側とは反対側と電気的に接続されている。
Here, one
The
また、一対の出力端子8は、第2のコンデンサ7に充電された電圧を外部へパルス状に出力可能である。
すなわち、一対の出力端子8は、一対の出力端子8間に形成された空間にパルス状電圧を出力可能である。
The pair of
That is, the pair of
また、一対の出力端子8間に形成された空間には、昇圧されたパルス状電圧が印加される対象となる負荷15が、出力端子8と電気的に接続されて配置されている。
負荷15の構成は第1の実施形態で使用された負荷の構成と同じなので、負荷15の構成の説明を省略する。
Further, a
Since the configuration of the
また、本発明のパルス発生回路21の第2の回路領域23は、図3に示すように一対の出力端子8と電気的に並列に接続された高速ダイオード(FRD)16を有する。
また、図3に示すように、高速ダイオード16の一端側は接地されている。
Further, the
As shown in FIG. 3, one end side of the
また、本発明のパルス発生回路21は、磁気スイッチ(SI1)25を備える。
ここで、磁気スイッチ25は、第2のコンデンサ7と電気的に並列に接続されており、かつ、出力端子8から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ7が蓄積したエネルギーを消費可能である。
Further, the
Here, the
次に、図3に示した本発明のパルス発生回路21がパルス状電圧を負荷15に印加するときの状況を、図3および図4を参照しながら説明する。
Next, the situation when the
図4は、図3に示した本発明のパルス発生回路における電圧および電流と、経過時間との関係を示すグラフの一例である。
図4に示すグラフにおいて、縦軸は電圧値および電流値を示し、横軸は経過時間(秒)を示す。
FIG. 4 is an example of a graph showing the relationship between voltage and current and elapsed time in the pulse generation circuit of the present invention shown in FIG.
In the graph shown in FIG. 4, the vertical axis represents the voltage value and the current value, and the horizontal axis represents the elapsed time (seconds).
充電器13が第1のコンデンサ5への充電を開始すると、第1のコンデンサ5は、所定の電圧まで充電される。
第1のコンデンサ5が所定の電圧まで充電されると、第1のコンデンサ5への充電が終了する。
When the
When the
第1のコンデンサ5が所定の電圧まで充電された後、制御回路14から制御信号がSiC−MOSFET24へ送出され、SiC−MOSFET24がオンに制御され、第1のコンデンサ5から第1のパルス電流(I0)が流れる(ステップ21A)。
After the
SiC−MOSFET24がオンになると、第1のコンデンサ5に充電された電圧(VCO)が、パルストランス4Aの1次側巻線10へ送出され、図4に示すように第1のコンデンサ5に充電された電圧(VCO)の値は減少する。
When the SiC-
また、第1のパルス電流(I0)が流れることと同期して、本発明のパルス発生回路21の第2の回路領域23に、第2のパルス電流(I0´)が流れる。
また、第2のパルス電流(I0´)が流れると、第2のコンデンサ7が充電され、図4に示すように第2のコンデンサ7に充電された電圧(VC1)の値が徐々に増加する(ステップ21B)。
Further, in synchronization with the flow of the first pulse current (I 0 ), the second pulse current (I 0 ′) flows in the
When the second pulse current (I 0 ′) flows, the
一方、第2のコンデンサ7が充電されている途中に、可飽和トランス4Bが飽和し、高速ダイオード16に急峻な逆電流が流れる(ステップ21C)。
すなわち、図4に示すように第2のパルス電流(I0´)の値を示す線が、急峻にグラフの下方へと延び始め、ゼロ基準線36を越えて図4のグラフの上側のプロット領域とは反対側の下側のプロット領域に達する。
On the other hand, while the
That is, as shown in FIG. 4, a line indicating the value of the second pulse current (I 0 ′) starts to extend sharply downward in the graph, and passes the zero
また、可飽和トランス4Bの飽和に併せてSiC−MOSFET24をオフにし、図4に示すように第1のコンデンサ5に充電された電圧(VCO)の値の減少が止まり、第1のコンデンサ5に電圧(VCO)が残る(ステップ21C)。
Also, the SiC-
なお、図4に示すように逆電流が流れ始めた直後は、まだ順電流の方が多いため、第2のコンデンサ7に充電された電圧(VC1)の値は増加を続けるが、第2のパルス電流(I0´)の値を示す線が、ゼロ基準線36を越えて図4のグラフの上側のプロット領域とは反対側の下側のプロット領域に存在している間は、第2のコンデンサ7に充電された電圧(VC1)の値は減少を続ける。
As shown in FIG. 4, immediately after the reverse current starts to flow, the forward current is still larger, so the value of the voltage (V C1 ) charged in the
高速ダイオード16に急峻な逆電流が流れると、高速ダイオード16が高速で逆電流を遮断するので、一対の出力端子8からパルス状に電圧が出力され、負荷15に電圧(VL)が印加される(ステップ21D)。この電圧が1発目の高電圧のパルス状電圧である。
When a steep reverse current flows through the high-
すなわち、逆電流が遮断されると、図4に示すように、第2のパルス電流(I0´)の値を示す線が反転して急峻にグラフの上方へと延び始めるのと同時に、パルス状電圧(VL)の値を示す線が上方へと延び始める。
また、反転した第2のパルス電流(I0´)の値を示す線はゼロ基準線36にまで達する。
That is, when the reverse current is interrupted, as shown in FIG. 4, the line indicating the value of the second pulse current (I 0 ′) inverts and starts to rapidly extend upward in the graph. A line indicating the value of the voltage (V L ) starts to extend upward.
The line indicating the value of the inverted second pulse current (I 0 ′) reaches the zero
そして、図4に示すように、反転した第2のパルス電流(I0´)の値を示す線がゼロ基準線36に到達したときに、負荷15に印加されたパルス状電圧(VL)の値は最大値となる。
Then, as shown in FIG. 4, when the line indicating the value of the inverted second pulse current (I 0 ′) reaches the zero
ここで、負荷15に印加されたパルス状電圧(VL)は、第1の実施形態と同様に下記の式で表される。
VL={L(di/dt)+VC1}
Here, the pulse voltage (V L ) applied to the
V L = {L (di / dt) + V C1 }
次に、負荷15に印加されたパルス状電圧(VL)の値が最大値に達したときに、磁気スイッチ25が飽和する(ステップ21E)。
Next, when the value of the pulse voltage (V L ) applied to the
磁気スイッチ25が飽和すると、第2のコンデンサ7に充電された電圧(VC1)を、磁気スイッチ25が消費するので、図4に示すように、負荷15に印加されたパルス状電圧(VL)の値を示す線は負荷によらずゼロ基準線36まで急峻に立ち下がる(ステップ21F)。
When the
また、磁気スイッチ25が、第2のコンデンサ7に蓄積されたエネルギーを消費するので、第2のコンデンサ7には電圧は残らない(ステップ21G)。
Further, since the
そして、再び充電器13が第1のコンデンサ5への充電を開始し、ステップ21A〜ステップ21Gが行われ、2発目の高電圧のパルス状電圧(VL)を負荷15へ印加する(ステップ21H)。
Then, the
また、出力されるパルス状電圧の周期Tは制御回路14の制御信号によって自由に可変できる。
Further, the period T of the output pulse voltage can be freely changed by the control signal of the
このように、第2のコンデンサ7に蓄積されたエネルギーを、磁気スイッチ25が消費するので、負荷15に印加されたパルス状電圧(VL)の値を示す線はゼロ基準線36まで急峻に立ち下がり、出力端子から出力される電圧のパルス幅を短くすることができる。
また、第2のコンデンサ7には電圧は残らないので、発生させた高電圧パルスにテールが付かない。
その結果、負荷15における放電が安定し、放電により発生する物質例えばオゾンも安定する。
Thus, since the
In addition, since no voltage remains in the
As a result, the discharge in the
さらに、第1の実施形態と異なり、第1のコンデンサ5に電圧が残るので、2発目以降のパルス状電圧を印加するときには、第1のコンデンサ5への充電が早く完了する。
Further, unlike the first embodiment, since the voltage remains in the
<第3の実施形態>
図5は、本発明を適用したパルス発生回路の第3の実施形態を示す概略図である。
<Third Embodiment>
FIG. 5 is a schematic diagram showing a third embodiment of a pulse generation circuit to which the present invention is applied.
図5に示す本発明のパルス発生回路31は、第1の回路領域32と第2の回路領域33を備える。ここで、第1の回路領域32と第2の回路領域33は互いに、電圧を昇圧可能な昇圧トランス4を介して電気的に接続されている。
昇圧トランス4の構成は第1の実施形態で使用された昇圧トランスの構成と同じなので、昇圧トランス4の構成の説明を省略する。
The
Since the configuration of the step-up
また、本発明のパルス発生回路31の第1の回路領域32は、所定の電圧まで充電される第1のコンデンサ(C0)5と、第1のコンデンサ5の両端に電気的に接続されており第1のコンデンサ5を充電可能な充電器13とを有する。
The
なお、本発明の第3の実施形態のパルス発生回路31は、本発明の第1の実施形態のパルス発生回路と異なり、パルストランス4Aの1次側巻線10の一端と電気的に接続された磁気スイッチを有していない。
Unlike the pulse generation circuit of the first embodiment of the present invention, the
また、パルストランス4Aの1次側巻線10の一端と第1のコンデンサ5の一端とが電気的に接続されている。
One end of the primary winding 10 of the
また、本発明のパルス発生回路31の第1の回路領域32は、パルストランス4Aの1次側巻線10の他端と電気的に接続されたSiC−MOSFET24を有する。
ここで、SiC−MOSFETはトランジスタの一例である。
The
Here, the SiC-MOSFET is an example of a transistor.
また、SiC−MOSFET24の、パルストランス4Aに接続された側とは反対側が、第1のコンデンサ5の他端と電気的に接続されている。
また、図5に示すように、第1のコンデンサ5の他端側は接地されている。
The side of the SiC-
As shown in FIG. 5, the other end side of the
また、SiC−MOSFET24は、制御信号に基づいてオンおよびオフにする制御が可能であり、かつ、第1のコンデンサ5に充電された電圧をパルストランス4Aの1次側巻線10へ送出可能である。
Further, the SiC-
また、SiC−MOSFET24は、可飽和トランス4Bが飽和したときにオフにする制御が可能である。
The SiC-
また、本発明のパルス発生回路31は、SiC−MOSFET24をオンおよびオフに制御するための制御信号をSiC−MOSFET24へ送出可能な制御回路14を備える。
Further, the
また、本発明のパルス発生回路31の第2の回路領域33は、可飽和トランス4Bの2次側巻線18の一端と電気的に接続された第2のコンデンサ(C1)7を有する。
また、第2のコンデンサ7は、可飽和トランス4Bの2次側巻線18から送出された電流で充電可能である。
The
The
また、本発明のパルス発生回路31の第2の回路領域33は、所定の間隔を設けて配置された一対の出力端子8を有する。
すなわち、一対の出力端子8間には空間が形成されている。
Further, the
That is, a space is formed between the pair of
ここで、一方の出力端子8は、可飽和トランス4Bの2次側巻線18の他端と電気的に接続されている。
また、他方の出力端子8は、第2のコンデンサ7の、可飽和トランス4Bの2次側巻線18の一端に接続された側とは反対側と電気的に接続されている。
Here, one
The
また、一対の出力端子8は、第2のコンデンサ7に充電された電圧を外部へパルス状に出力可能である。
すなわち、一対の出力端子8は、一対の出力端子8間に形成された空間にパルス状電圧を出力可能である。
The pair of
That is, the pair of
また、一対の出力端子8間に形成された空間には、昇圧されたパルス状電圧が印加される対象となる負荷15が、出力端子8と電気的に接続されて配置されている。
負荷15の構成は第1の実施形態で使用された負荷の構成と同じなので、負荷15の構成の説明を省略する。
Further, a
Since the configuration of the
また、本発明のパルス発生回路31の第2の回路領域33は、図5に示すように一対の出力端子8と電気的に並列に接続された高速ダイオード(FRD)16を有する。
また、図5に示すように、高速ダイオード16の一端側は接地されている。
Further, the
Further, as shown in FIG. 5, one end side of the
また、本発明のパルス発生回路31は、磁気スイッチ(SI1)34を備える。
ここで、磁気スイッチ34は、第2のコンデンサ7と電気的に接続されており、かつ、出力端子8から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ7に充電された電圧を減少可能である。
Further, the
Here, the
また、磁気スイッチ34は、図5に示すように第1のコンデンサ5と第2のコンデンサ7とを電気的に連結している。
すなわち、磁気スイッチ34は、出力端子8から出力されたパルス状電圧の値が最大値に達した場合に、第2のコンデンサ7に充電された電圧を第1のコンデンサ5へ送出可能すなわち回生可能である。
Further, the
That is, the
また、本発明のパルス発生回路31は、ダイオード35を備える。
ここで、ダイオード35は、図5に示すように磁気スイッチ34と電気的に直列で接続されている。
また、ダイオード35は、第1のコンデンサ5から第2のコンデンサ7への電圧の送出を阻止可能である。
The
Here, the
The
次に、図5に示した本発明のパルス発生回路31がパルス状電圧を負荷15に印加するときの状況を、図5および図6を参照しながら説明する。
Next, the situation when the
図6は、図5に示した本発明のパルス発生回路における電圧および電流と、経過時間との関係を示すグラフの一例である。
図6に示すグラフにおいて、縦軸は電圧値および電流値を示し、横軸は経過時間(秒)を示す。
FIG. 6 is an example of a graph showing the relationship between voltage and current and elapsed time in the pulse generation circuit of the present invention shown in FIG.
In the graph shown in FIG. 6, the vertical axis indicates the voltage value and the current value, and the horizontal axis indicates the elapsed time (seconds).
充電器13が第1のコンデンサ5への充電を開始すると、第1のコンデンサ5は、所定の電圧まで充電される。
第1のコンデンサ5が所定の電圧まで充電されると、第1のコンデンサ5への充電が終了する。
When the
When the
第1のコンデンサ5が所定の電圧まで充電された後、制御回路14から制御信号がSiC−MOSFET24へ送出され、SiC−MOSFET24がオンに制御され、第1のコンデンサ5から第1のパルス電流(I0)が流れる(ステップ31A)。
After the
SiC−MOSFET24がオンになると、第1のコンデンサ5に充電された電圧(VCO)が、パルストランス4Aの1次側巻線10へ送出され、図6に示すように第1のコンデンサ5に充電された電圧(VCO)の値は減少する。
When the SiC-
また、第1のパルス電流(I0)が流れることと同期して、本発明のパルス発生回路31の第2の回路領域33に、第2のパルス電流(I0´)が流れる。
また、第2のパルス電流(I0´)が流れると、第2のコンデンサ7が充電され、図6に示すように第2のコンデンサ7に充電された電圧(VC1)の値が徐々に増加する(ステップ31B)。
Further, in synchronization with the flow of the first pulse current (I 0 ), the second pulse current (I 0 ′) flows in the
When the second pulse current (I 0 ′) flows, the
一方、第2のコンデンサ7が充電されている途中に、可飽和トランス4Bが飽和し、高速ダイオード16に急峻な逆電流が流れる(ステップ31C)。
すなわち、図6に示すように第2のパルス電流(I0´)の値を示す線が、急峻にグラフの下方へと延び始め、ゼロ基準線36を越えて図6のグラフの上側のプロット領域とは反対側の下側のプロット領域に達する。
On the other hand, the
That is, as shown in FIG. 6, the line indicating the value of the second pulse current (I 0 ′) starts to extend sharply downward in the graph, passes the zero
また、可飽和トランス4Bの飽和に伴いSiC−MOSFET24をオフにし、図6に示すように第1のコンデンサ5に充電された電圧(VCO)の値の減少が止まり、第1のコンデンサ5に電圧(VCO)が残る(ステップ31C)。
Further, as the
なお、図6に示すように逆電流が流れ始めた直後は、まだ順電流の方が多いため、第2のコンデンサ7に充電された電圧(VC1)の値は増加を続けるが、第2のパルス電流(I0´)の値を示す線が、ゼロ基準線36を越えて図6のグラフの上側のプロット領域とは反対側の下側のプロット領域に存在している間は、第2のコンデンサ7に充電された電圧(VC1)の値は減少を続ける。
As shown in FIG. 6, immediately after the reverse current starts to flow, the forward current is still larger, so the value of the voltage (V C1 ) charged in the
高速ダイオード16に急峻な逆電流が流れると、高速ダイオード16が高速で逆電流を遮断するので、一対の出力端子8からパルス状に電圧が出力され、負荷15に電圧(VL)が印加される(ステップ31D)。この電圧が1発目の高電圧のパルス状電圧である。
When a steep reverse current flows through the high-
すなわち、逆電流が遮断されると、図6に示すように、第2のパルス電流(I0´)の値を示す線が反転して急峻にグラフの上方へと延び始めるのと同時に、パルス状電圧(VL)の値を示す線が上方へと延び始める。
また、反転した第2のパルス電流(I0´)の値を示す線はゼロ基準線36にまで達する。
That is, when the reverse current is interrupted, as shown in FIG. 6, the line indicating the value of the second pulse current (I 0 ′) inverts and starts to extend sharply upward at the same time as the pulse. A line indicating the value of the voltage (V L ) starts to extend upward.
The line indicating the value of the inverted second pulse current (I 0 ′) reaches the zero
そして、図6に示すように、反転した第2のパルス電流(I0´)の値を示す線がゼロ基準線36に到達したときに、負荷15に印加されたパルス状電圧(VL)の値は最大値となる。
As shown in FIG. 6, when the line indicating the value of the inverted second pulse current (I 0 ′) reaches the zero
ここで、負荷15に印加されたパルス状電圧(VL)は、第1の実施形態と同様に下記の式で表される。
VL={L(di/dt)+VC1}
Here, the pulse voltage (V L ) applied to the
V L = {L (di / dt) + V C1 }
次に、負荷15に印加されたパルス状電圧(VL)の値が最大値に達したときに、磁気スイッチ34が飽和する(ステップ31E)。
Next, when the value of the pulse voltage (V L ) applied to the
磁気スイッチ34が飽和すると、第2のコンデンサ7に充電された電圧(VC1)を、磁気スイッチ34が減少させる。
When the
すなわち、磁気スイッチ34が、第2のコンデンサ7に蓄積されたエネルギーを、第1のコンデンサ5へ回生する。
また、ダイオード35が、第1のコンデンサ5から第2のコンデンサ7への電圧の送出を阻止する。
That is, the
The
従って、図6に示すように第1のコンデンサ5に充電された電圧(VCO)が増加し、かつ、負荷15に印加されたパルス状電圧(VL)の値を示す線は負荷によらずゼロ基準線36まで急峻に立ち下がる。
Therefore, as shown in FIG. 6, the voltage (V CO ) charged in the
また、磁気スイッチ34が、第2のコンデンサ7に蓄積されたエネルギーを、第1のコンデンサ5へ回生し、かつ、ダイオード35が、第1のコンデンサ5から第2のコンデンサ7への電圧の送出を阻止するので、第2のコンデンサ7に充電された電圧(VC1)の値はゼロになり、そして第1のコンデンサ5に充電された電圧(VCO)の値の増加が止まり、回生が完了する(ステップ31F)。
The
また、磁気スイッチ34が、第2のコンデンサ7に蓄積されたエネルギーを、第1のコンデンサ5へ回生し、かつ、ダイオード35が、第1のコンデンサ5から第2のコンデンサ7への電圧の送出を阻止するので、第2のコンデンサ7には電圧は残らない(ステップ31G)。
The
そして、再び充電器13が第1のコンデンサ5への充電を開始し、ステップ31A〜ステップ31Gが行われ、2発目の高電圧のパルス状電圧(VL)を負荷15へ印加する(ステップ31H)。
Then, the
また、出力されるパルス状電圧の周期Tは制御回路14の制御信号によって自由に可変できる。
Further, the period T of the output pulse voltage can be freely changed by the control signal of the
このように、磁気スイッチ34が、第2のコンデンサ7に充電された電圧(VC1)を減少させるので、負荷15に印加されたパルス状電圧(VL)の値を示す線は負荷によらずゼロ基準線36まで急峻に立ち下がり、出力端子から出力される電圧のパルス幅を短くすることができる。
また、第2のコンデンサ7には電圧は残らないので、発生させた高電圧パルスにテールが付かない。
その結果、負荷15における放電が安定し、放電により発生する物質例えばオゾンも安定する。
Thus, since the
In addition, since no voltage remains in the
As a result, the discharge in the
さらに、第1の実施形態および第2の実施形態と異なり、磁気スイッチ34が、第2のコンデンサ7に蓄積されたエネルギーを、第1のコンデンサ5へ回生し、かつ、ダイオード35が、第1のコンデンサ5から第2のコンデンサ7への電圧の送出を阻止するので、さらに消費電力を抑えることができる。
Further, unlike the first and second embodiments, the
<第1の比較形態>
図7は、一般的なパルス発生回路の第1の例を示す概略図である。
<First comparative form>
FIG. 7 is a schematic diagram showing a first example of a general pulse generation circuit.
図7に示す一般的なパルス発生回路61は、本発明の第1の実施形態のパルス発生回路1とは異なり、出力端子68から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ67に充電された電圧を減少可能である磁気スイッチを備えていない。
Unlike the
その他の点において、一般的なパルス発生回路61と本発明の第1の実施形態のパルス発生回路1は実質的に同じである。
In other respects, the general
すなわち、一般的なパルス発生回路61は、第1の回路領域62と第2の回路領域63を備え、第1の回路領域62と第2の回路領域63は昇圧トランス64を介して電気的に接続されている。
That is, a general
また、パルス発生回路61の第1の回路領域62は、第1のコンデンサ(C0)65と、充電器73と、絶縁ゲートバイポーラトランジスタ(IGBT)66と、絶縁ゲートバイポーラトランジスタが発熱して損失が増すことを防ぐための磁気スイッチ69を有する。
また、パルス発生回路61は制御回路74を備える。
Further, the
The
また、パルス発生回路61の第2の回路領域63は、第2のコンデンサ(C1)67と、高速ダイオード(FRD)76と、一対の出力端子68を有する。
The
また、負荷75が、出力端子68と電気的に接続されて配置されている。ここで、負荷75の構成は、負荷15の構成と実質的に同じであるので、負荷75の構成の説明を省略する。
A
次に、図7に示したパルス発生回路61がパルス状電圧を負荷75に印加するときの状況を、図7および図8を参照しながら説明する。
Next, the situation when the
図8は、図7に示したパルス発生回路における電圧および電流と、経過時間との関係を示すグラフの一例である。
図8に示すグラフにおいて、縦軸は電圧値および電流値を示し、横軸は経過時間(秒)を示す。
FIG. 8 is an example of a graph showing the relationship between the voltage and current in the pulse generation circuit shown in FIG. 7 and the elapsed time.
In the graph shown in FIG. 8, the vertical axis represents the voltage value and the current value, and the horizontal axis represents the elapsed time (seconds).
本発明の第1の実施形態のステップ1A〜ステップ1Dと同様に、充電器73が第1のコンデンサ65を充電し、絶縁ゲートバイポーラトランジスタ66と磁気スイッチ69がオンになり(ステップ61A)、第2のコンデンサ67に充電された電圧(VC1)の値が徐々に増加し(ステップ61B)、高速ダイオード76に急峻な逆電流が流れ(ステップ61C)、負荷75に1発目の高電圧のパルス状電圧(VL)が印加される(ステップ61D)。
As in
負荷75に印加されたパルス状電圧(VL)の値が最大値に達した後、パルス状電圧(VL)の値が低下してくると放電がつかなくなり、負荷75に電流が流れず、第2のコンデンサ67に残った電荷を放電できずに、図8に示すように第2のコンデンサ67の電圧(VC1)が残ったままとなる(ステップ61E)。
After the value of the pulse voltage (V L ) applied to the
その結果、図8に示すように、負荷75に印加されたパルス状電圧(VL)の値を示す線はゼロ基準線36まで急峻に立ち下がらず、大きなテールがパルスに付いてしまい、時間が経つと負荷75を破損させてしまう。
As a result, as shown in FIG. 8, the line indicating the value of the pulse voltage (V L ) applied to the
また、ステップ61Aからステップ61Eまで進む間も、絶縁ゲートバイポーラトランジスタ66と磁気スイッチ69はオンの状態のままであるので、図8に示すように、第1のコンデンサ65に充電された電圧(VCO)の値は減少を続けており、そして、第1のコンデンサ65に充電された電圧(VCO)はゼロになる。
Further, since the insulated gate
また、第1のコンデンサ65の電圧がゼロになった後、磁気スイッチ69はオフになり、その後、絶縁ゲートバイポーラトランジスタ66をオフにする(ステップ61F)。
Further, after the voltage of the
そして、再び充電器73が第1のコンデンサ65への充電を開始し、ステップ61A〜ステップ61Dが行われ、2発目のパルス状電圧(VL)を負荷75へ印加する(ステップ61G)。
Then, the
しかし、第2のコンデンサ67に残った電圧の影響で、第2のコンデンサ67の充電電流が小さいため、その分、可飽和トランス64Bが飽和したときの逆電流も小さくなり、1発目のパルス状電圧のときよりも電流変化(di/dt)が小さくなるので、負荷75に印加される2発目のパルス状電圧(VL)の最大値は、1発目のパルス状電圧の最大値よりも小さくなる。
However, since the charging current of the
このように、本発明の第1の実施形態のパルス発生回路1とは異なり、第1の比較形態のパルス発生回路61は、出力端子68から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ67に充電された電圧を減少させないので、負荷75に印加されたパルス状電圧(VL)の値を示す線はゼロ基準線36まで急峻に立ち下がらず、出力される電圧のパルス幅を短くすることができない。
また、第2のコンデンサ67に電圧が残るので、発生させた高電圧パルスにテールが付いてしまう。
その結果、負荷75における放電が不安定となり、放電により発生する物質例えばオゾンの量が減って、生成効率が悪くなる。
Thus, unlike the
In addition, since a voltage remains in the
As a result, the discharge in the
<第2の比較形態>
図9は、一般的なパルス発生回路の第2の例を示す概略図である。
<Second comparative form>
FIG. 9 is a schematic diagram showing a second example of a general pulse generation circuit.
図9に示す一般的なパルス発生回路81は、図7に示す第1の比較形態のパルス発生回路61とは異なり、絶縁ゲートバイポーラトランジスタではなく、代わりにSiC−MOSFET84を備え、その結果、絶縁ゲートバイポーラトランジスタが発熱して損失が増すことを防ぐための磁気スイッチを備えていない。
Unlike the
その他の点において、一般的なパルス発生回路81と図7に示す第1の比較形態のパルス発生回路61は実質的に同じである。
In other respects, the general
すなわち、一般的なパルス発生回路81も、出力端子68から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ67に充電された電圧を減少可能である磁気スイッチを備えていない。
That is, the general
また、一般的なパルス発生回路81は、第1の回路領域82と第2の回路領域83を備え、第1の回路領域82と第2の回路領域83は昇圧トランス64を介して電気的に接続されている。
The general
また、パルス発生回路81の第1の回路領域82は、第1のコンデンサ(C0)65と充電器73を有する。
また、パルス発生回路81は制御回路74を備える。
The
The
また、パルス発生回路81の第2の回路領域83は、第2のコンデンサ(C1)67と、高速ダイオード(FRD)76と、一対の出力端子68を有する。
The
また、負荷75が、出力端子68と電気的に接続されて配置されている。ここで、負荷75の構成は、負荷15の構成と実質的に同じであるので、負荷75の構成の説明を省略する。
A
次に、図9に示したパルス発生回路81がパルス状電圧を負荷75に印加するときの状況を、図9および図10を参照しながら説明する。
Next, the situation when the
図10は、図9に示したパルス発生回路における電圧および電流と、経過時間との関係を示すグラフの一例である。
図10に示すグラフにおいて、縦軸は電圧値および電流値を示し、横軸は経過時間(秒)を示す。
FIG. 10 is an example of a graph showing the relationship between the voltage and current in the pulse generation circuit shown in FIG. 9 and the elapsed time.
In the graph shown in FIG. 10, the vertical axis represents the voltage value and the current value, and the horizontal axis represents the elapsed time (seconds).
本発明の第2の実施形態のステップ21A〜ステップ21Dと同様に、充電器73が第1のコンデンサ65を充電し、SiC−MOSFET84をオンにし、第1のコンデンサ65から第1のパルス電流(I0)が流れ(ステップ81A)、第2のコンデンサ67に充電された電圧(VC1)の値が徐々に増加し(ステップ81B)、可飽和トランス64Bが飽和して高速ダイオード76に急峻な逆電流が流れ(ステップ81C)、負荷75に1発目の高電圧のパルス状電圧(VL)が印加される(ステップ81D)。
Similarly to step 21A to step 21D of the second embodiment of the present invention, the
負荷75に印加されたパルス状電圧(VL)の値が最大値に達した後、パルス状電圧(VL)の値が低下してくると放電がつかなくなり、負荷75に電流が流れず、第2のコンデンサ67に残った電荷を放電できずに、図8に示すように第2のコンデンサ67の電圧(VC1)が残ったままとなる(ステップ81E)。
After the value of the pulse voltage (V L ) applied to the
その結果、図10に示すように、負荷75に印加されたパルス状電圧(VL)の値を示す線はゼロ基準線36まで急峻に立ち下がらず、大きなテールがパルスに付いてしまい、時間が経つと負荷75を破損させてしまう。
As a result, as shown in FIG. 10, the line indicating the value of the pulse voltage (V L ) applied to the
なお、パルス発生回路81はSiC−MOSFET84を備えているので、ステップ81Cにおいて可飽和トランス64Bの飽和に併せてSiC−MOSFET84をオフにし、図10に示すように第1のコンデンサ65に充電された電圧(VCO)の減少が止まり、第1のコンデンサ65に電圧(VCO)が残る。
Since the
そして、再び充電器73が第1のコンデンサ65への充電を開始し、ステップ81A〜ステップ81Dが行われ、2発目のパルス状電圧(VL)を負荷75へ印加する(ステップ81F)。
Then, the
しかし、第2のコンデンサ67に残った電圧の影響で、第2のコンデンサ67の充電電流が小さいため、その分、可飽和トランス64Bが飽和したときの逆電流も小さくなり、1発目のパルス状電圧のときよりも電流変化(di/dt)が小さくなるので、負荷75に印加される2発目のパルス状電圧(VL)の最大値は、1発目のパルス状電圧の最大値よりも小さくなる。
However, since the charging current of the
このように、本発明の第2の実施形態のパルス発生回路21とは異なり、第2の比較形態のパルス発生回路81は、出力端子68から出力されたパルス状電圧の値が所定の値例えば最大値に達した場合に、第2のコンデンサ67に充電された電圧を減少させないので、負荷75に印加されたパルス状電圧(VL)の値を示す線はゼロ基準線36まで急峻に立ち下がらず、出力される電圧のパルス幅を短くすることができない。
また、第2のコンデンサ67に電圧が残るので、発生させた高電圧パルスにテールが付いてしまう。
その結果、負荷75における放電が不安定となり、放電により発生する物質例えばオゾンの量が減って、生成効率が悪くなる。
Thus, unlike the
In addition, since a voltage remains in the
As a result, the discharge in the
以上のように、本発明のパルス発生回路は、第2のコンデンサと電気的に接続されており、かつ、出力端子から出力されたパルス状電圧の値が所定の値に達した場合に、第2のコンデンサに充電された電圧を減少可能な磁気スイッチを備えているので、第2のコンデンサに余分な電圧が残り難いため、発生させた高電圧パルスにテールが付かず、出力端子から出力される電圧のパルス幅を短くすることができる。 As described above, the pulse generation circuit of the present invention is electrically connected to the second capacitor, and when the value of the pulse voltage output from the output terminal reaches a predetermined value, Since the magnetic switch that can reduce the voltage charged in the capacitor No. 2 is provided, it is difficult for an excess voltage to remain in the second capacitor, so the generated high voltage pulse does not have a tail and is output from the output terminal. The pulse width of the voltage to be reduced can be shortened.
従って、本発明のパルス発生回路は、負荷を破損させるおそれがない。 Therefore, the pulse generation circuit of the present invention has no fear of damaging the load.
また、本発明のパルス発生回路を用いることで、発生させた高電圧パルスにテールが付かず、電極などの負荷を破損させるおそれがないので、本発明のパルス発生回路は、テールがない高電圧パルスを必要とする全ての回路として用いられることが可能である。
すなわち、本発明のパルス発生回路は、誘電体バリア放電を行う機器や誘電体を使わないで放電を行う機器に用いられることが可能であり、具体的には例えば、空気清浄機、エキシマランプに用いられることが可能である。
Further, since the generated high voltage pulse does not have a tail by using the pulse generating circuit of the present invention and there is no possibility of damaging a load such as an electrode, the pulse generating circuit of the present invention has a high voltage without a tail. It can be used as any circuit that requires a pulse.
That is, the pulse generation circuit of the present invention can be used in a device that performs dielectric barrier discharge or a device that discharges without using a dielectric, and specifically, for example, in an air cleaner or an excimer lamp. Can be used.
1 パルス発生回路
2 第1の回路領域
3 第2の回路領域
4 昇圧トランス
4A パルストランス
4B 可飽和トランス
5 第1のコンデンサ
6 絶縁ゲートバイポーラトランジスタ
7 第2のコンデンサ
8 出力端子
9 第1の磁気スイッチ
10 1次側巻線
11 2次側巻線
12 第2の磁気スイッチ
13 充電器
14 制御回路
15 負荷
16 高速ダイオード
17 1次側巻線
18 2次側巻線
19 電極
20 絶縁物
21 パルス発生回路
22 第1の回路領域
23 第2の回路領域
24 SiC−MOSFET
25 磁気スイッチ
31 パルス発生回路
32 第1の回路領域
33 第2の回路領域
34 磁気スイッチ
35 ダイオード
36 ゼロ基準線
DESCRIPTION OF
25
Claims (4)
充電可能な第1のコンデンサと、
制御信号に基づいてオンおよびオフにする制御が可能であり、かつ、前記第1のコンデンサに充電された電圧を前記昇圧トランスの1次側巻線へ送出可能なトランジスタと、
前記昇圧トランスの2次側巻線と電気的に接続されており、かつ、同昇圧トランスから送出された電流で充電可能な第2のコンデンサと、
該第2のコンデンサと電気的に接続されており、かつ、同第2のコンデンサに充電された電圧を外部へパルス状に出力可能な出力端子と、
前記第2のコンデンサと電気的に接続されており、かつ、前記出力端子から出力されたパルス状電圧の値が所定の値に達した場合に、同第2のコンデンサに充電された電圧を減少可能な磁気スイッチとを備える
パルス発生回路。 A step-up transformer capable of boosting the voltage;
A first chargeable capacitor;
A transistor capable of being turned on and off based on a control signal, and capable of sending a voltage charged in the first capacitor to a primary winding of the step-up transformer;
A second capacitor that is electrically connected to the secondary winding of the step-up transformer and can be charged with a current sent from the step-up transformer;
An output terminal electrically connected to the second capacitor and capable of outputting the voltage charged in the second capacitor to the outside in a pulsed manner;
When the pulse voltage output from the output terminal reaches a predetermined value when electrically connected to the second capacitor, the voltage charged in the second capacitor is reduced. Pulse generation circuit comprising a magnetic switch capable.
前記トランジスタは、前記可飽和トランスが飽和したときにオフにする制御が可能である
請求項1に記載のパルス発生回路。 The step-up transformer has a saturable transformer,
The pulse generation circuit according to claim 1, wherein the transistor can be controlled to be turned off when the saturable transformer is saturated.
前記磁気スイッチと電気的に直列で接続されており、かつ、前記第1のコンデンサから前記第2のコンデンサへの電圧の送出を阻止可能なダイオードを備える
請求項1または請求項2に記載のパルス発生回路。 The magnetic switch electrically connects the first capacitor and the second capacitor,
The pulse according to claim 1, further comprising: a diode electrically connected in series with the magnetic switch and capable of preventing a voltage from being sent from the first capacitor to the second capacitor. Generation circuit.
請求項1、請求項2または請求項3に記載のパルス発生回路。 The pulse generation circuit according to claim 1, wherein the transistor is a SiC-MOSFET.
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN117792142A (en) * | 2024-02-28 | 2024-03-29 | 中国空气动力研究与发展中心高速空气动力研究所 | High-power high-frequency pulse plasma power supply and charging and discharging method thereof |
CN117792142B (en) * | 2024-02-28 | 2024-05-14 | 中国空气动力研究与发展中心高速空气动力研究所 | High-power high-frequency pulse plasma power supply and charging and discharging method thereof |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07307648A (en) * | 1994-05-12 | 1995-11-21 | Meidensha Corp | Charging device for capacitor |
US5936988A (en) * | 1997-12-15 | 1999-08-10 | Cymer, Inc. | High pulse rate pulse power system |
JP2003250279A (en) * | 2002-02-25 | 2003-09-05 | Gigaphoton Inc | Regenerative circuit of high voltage pulse generating apparatus |
JP2014036502A (en) * | 2012-08-08 | 2014-02-24 | Ngk Insulators Ltd | Pulse generation circuit |
JP2015220929A (en) * | 2014-05-20 | 2015-12-07 | 国立大学法人 熊本大学 | Pulse power supply device and design method thereof |
-
2016
- 2016-08-25 JP JP2016164946A patent/JP6692545B2/en active Active
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07307648A (en) * | 1994-05-12 | 1995-11-21 | Meidensha Corp | Charging device for capacitor |
US5936988A (en) * | 1997-12-15 | 1999-08-10 | Cymer, Inc. | High pulse rate pulse power system |
JP2003250279A (en) * | 2002-02-25 | 2003-09-05 | Gigaphoton Inc | Regenerative circuit of high voltage pulse generating apparatus |
JP2014036502A (en) * | 2012-08-08 | 2014-02-24 | Ngk Insulators Ltd | Pulse generation circuit |
JP2015220929A (en) * | 2014-05-20 | 2015-12-07 | 国立大学法人 熊本大学 | Pulse power supply device and design method thereof |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN117792142A (en) * | 2024-02-28 | 2024-03-29 | 中国空气动力研究与发展中心高速空气动力研究所 | High-power high-frequency pulse plasma power supply and charging and discharging method thereof |
CN117792142B (en) * | 2024-02-28 | 2024-05-14 | 中国空气动力研究与发展中心高速空气动力研究所 | High-power high-frequency pulse plasma power supply and charging and discharging method thereof |
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