JP2014123973A - 注入同期型奇数分周器及びpll回路 - Google Patents
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Abstract
【解決手段】注入同期型分周器100は、NチャネルMOS型トランジスタ111とPチャネルMOS型トランジスタ112から構成される第1増幅回路141と、同様な構成の第2増幅回路142と第3増幅回路143とをリング状に3段縦続接続したリング発振器140と、各段のNチャネルMOS型トランジスタ111,121,131のソースがドレインに接続されたNチャネルMOS型トランジスタ150と、各段のPチャネルMOS型トランジスタ112,122,132のゲートに注入信号I1を注入し、かつNチャネルMOS型トランジスタ150のゲートに注入信号I1の逆相信号を差動信号として注入する差動信号注入回路160とを備える。
【選択図】図6
Description
図6は、本発明の実施の形態1に係る注入同期型分周器の構成を示す回路図である。本実施の形態は、PLL回路に搭載される注入同期型分周器に適用可能である。
図12は、本発明の実施の形態2に係る注入同期型分周器の構成を示す回路図である。図6と同一構成部分には同一符号を付して重複箇所の説明を省略する。
図14は、本発明の実施の形態3に係る注入同期型分周器の構成を示す回路図である。図12と同一構成部分には同一符号を付して重複箇所の説明を省略する。
図15は、本発明の実施の形態4に係る固定分周回路(プリスケーラ)の構成を示す図である。
図16は、本発明の実施の形態5に係るPLL回路の構成を示す図である。
111,121,131,150,212,222,232,251,252,253,350 NチャネルMOS型トランジスタ
112,122,132,212,222,232 PチャネルMOS型トランジスタ
140,240 リング発振器
141 第1増幅回路
142 第2増幅回路
143 第3増幅回路
160 差動信号注入回路
250 電流源
400 固定分周回路
410 基準信号発振器
420 電圧制御発振器
430 位相周波数比較器
440 チャージポンプ
450 ループフィルタ
500 PLL回路
Claims (6)
- NチャネルMOS型トランジスタとPチャネルMOS型トランジスタとを含む増幅回路をリング状に(2n+1)(nは任意の自然数)段縦続接続した第1のリング発振器と、
NチャネルMOS型トランジスタとPチャネルMOS型トランジスタとを含む増幅回路をリング状に(2n+1)(nは任意の自然数)段縦続接続した第2のリング発振器と、
前記第1及び第2のリング発振器に接続され、前記第1及び第2のリング発振器を駆動させるNチャネルMOS型トランジスタからなる電流源と、
前記第1のリング発振器に注入信号を出力し、前記第2のリング発振器に前記注入信号の逆相信号を差動信号として出力する差動信号注入回路と、
を備え、
前記電流源の前記NチャネルMOS型トランジスタのドレインは、前記第1及び第2のリング発振器の各段のNチャネルMOS型トランジスタのソースに接続し、
前記差動信号注入回路は、前記第1のリング発振器の前記PチャネルMOS型トランジスタのゲートに前記注入信号を出力し、かつ、前記第2のリング発振器の前記PチャネルMOS型トランジスタのゲートに前記差動信号を出力する、
注入同期型奇数分周器。 - NチャネルMOS型トランジスタとPチャネルMOS型トランジスタとを含む増幅回路をリング状に(2n+1)(nは任意の自然数)段縦続接続した第1のリング発振器と、
NチャネルMOS型トランジスタとPチャネルMOS型トランジスタとを含む増幅回路をリング状に(2n+1)(nは任意の自然数)段縦続接続した第2のリング発振器と、
前記第1及び第2のリング発振器に接続され、前記第1及び第2のリング発振器を駆動させるNチャネルMOS型トランジスタからなる電流源と、
前記第1のリング発振器に注入信号を出力し、前記第2のリング発振器に前記注入信号の逆相信号を差動信号として出力する差動信号注入回路と、
を備え、
前記電流源の前記NチャネルMOS型トランジスタのドレインは、前記第1及び第2のリング発振器の所定段のNチャネルMOS型トランジスタのソースに接続し、
前記差動信号注入回路は、前記第1のリング発振器のPチャネルMOS型トランジスタのゲートに前記注入信号を出力し、かつ、前記第2のリング発振器のPチャネルMOS型トランジスタのゲートに前記差動信号を出力する、
注入同期型奇数分周器。 - 前記所定段のNチャネルMOS型トランジスタは、前記第1及び第2のリング発振器の増幅回路の出力段のNチャネルMOS型トランジスタである、請求項2記載の注入同期型奇数分周器。
- 前記電流源のNチャネルMOS型トランジスタは、抵抗又はインダクタを含む受動素子である、請求項1乃至3のいずれかに記載の注入同期型奇数分周器。
- 前記差動信号注入回路は、前記第1及び第2のリング発振器の発振周波数のm(2n+1)(mは任意の自然数)倍の周波数の信号を注入する請求項1乃至4のいずれかに記載の注入同期型奇数分周器。
- 基準信号を出力する基準信号発振器と、
高周波信号を出力する電圧制御発振器と、
前記高周波信号を分周する注入同期型分周器と、
前記注入同期型分周器の分周と前記基準信号発振器の出力信号とを比較し、位相と周波数の誤差を出力する位相周波数比較器と、
前記位相周波数比較器により検波された位相と周波数の誤差を電流に変換するチャージポンプと、
前記電圧制御発振器の制御電圧を生成し、生成した制御電圧を前記電圧制御発振器に出力するループフィルタとを備え、
前記制御電圧は、前記位相周波数比較器で検波される誤差が小さくなるように前記電圧制御発振器を制御する、周波数負帰還動作を行うPLL回路であって、
前記注入同期型分周器は、請求項1乃至5のいずれかに記載の注入同期型奇数分周器であるPLL回路。
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