JP2014052535A - Data line driver and liquid crystal display device - Google Patents
Data line driver and liquid crystal display device Download PDFInfo
- Publication number
- JP2014052535A JP2014052535A JP2012197460A JP2012197460A JP2014052535A JP 2014052535 A JP2014052535 A JP 2014052535A JP 2012197460 A JP2012197460 A JP 2012197460A JP 2012197460 A JP2012197460 A JP 2012197460A JP 2014052535 A JP2014052535 A JP 2014052535A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- polarity
- output
- charge share
- switch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
Description
本発明は、データ線ドライバ及び液晶表示装置に関し、特に、チャージシェアを行うように構成されたデータ線ドライバ及び液晶表示装置に関する。 The present invention relates to a data line driver and a liquid crystal display device, and more particularly to a data line driver and a liquid crystal display device configured to perform charge sharing.
近年、液晶表示パネルの大型化、高精細化に伴い、液晶表示パネルに形成される配線の負荷も大きくなってきており、表示パネルの駆動に使われる消費電力が増大するという問題がある。 In recent years, with the increase in size and definition of a liquid crystal display panel, the load of wiring formed on the liquid crystal display panel has increased, and there is a problem that power consumption used for driving the display panel increases.
消費電力の増大に対する一つの対策としては、いわゆるチャージシェアが知られている。チャージシェアとは、液晶表示パネルのデータ線を駆動するデータ線ドライバの出力端子を(例えば、各水平期間(水平同期期間とも呼ばれることがある)の出力ラッチタイミング期間において)一定期間ショートさせる事により、液晶表示パネルの電荷を有効に利用する技術である。 A so-called charge share is known as one countermeasure against the increase in power consumption. Charge sharing means that the output terminal of the data line driver that drives the data line of the liquid crystal display panel is short-circuited for a certain period (for example, in the output latch timing period of each horizontal period (sometimes referred to as horizontal synchronization period)). This is a technique for effectively using the charge of a liquid crystal display panel.
一般に、チャージシェア方式は、各画素の画素電極に印加される電圧(以下、「画素電圧」という。)の極性(基準電圧に対する正/負)を、所定の時間的周期、空間的周期で反転させる反転駆動方式と併用される。例えば、1出力ごとに極性が反転される1ドット反転駆動方式、また、2出力ごとに極性が反転される2ドット反転駆動方式がある。チャージシェア駆動方式と反転駆動方式とを併用する液晶表示装置は、例えば、特開2010−256401号公報、及び、特開2006−292899号公報に開示されている。 In general, in the charge sharing method, the polarity (positive / negative with respect to a reference voltage) of a voltage applied to the pixel electrode of each pixel (hereinafter referred to as “pixel voltage”) is inverted at a predetermined time period and spatial period. It is used together with the inversion driving method. For example, there is a one-dot inversion driving method in which the polarity is inverted every output, and a two-dot inversion driving method in which the polarity is inverted every two outputs. Liquid crystal display devices using both the charge share driving method and the inversion driving method are disclosed in, for example, Japanese Patent Application Laid-Open Nos. 2010-256401 and 2006-292899.
駆動方式は、表示される画像の種類や表示装置の用途に応じて選択されることが望ましく、加えて、チャージシェア方式も、駆動方式に応じて最適に選択されることが求められる。しかしながら、データ線ドライバを表示される画像の種類や表示装置の用途に応じて異なる設計にすることは不経済である。したがって、データ線ドライバは、複数の駆動方式に対応可能に設計されることが望まれ、更に、各駆動方式に適したチャージシェアを行うように設計されることが望まれる。このとき、駆動方式に応じた最適なチャージシェア方式の選択及び切替を、より少ない数の外部制御信号で、可能であれば特別な外部制御信号を供給せずに自動的に行うことができることが好ましい。しかしながら、このような要求に応える液晶表示装置のデータ線ドライバは知られていない。 The driving method is preferably selected according to the type of image to be displayed and the application of the display device. In addition, the charge sharing method is also required to be optimally selected according to the driving method. However, it is uneconomical to design the data line driver differently depending on the type of image to be displayed and the application of the display device. Therefore, it is desirable that the data line driver be designed so as to be compatible with a plurality of driving methods, and it is desirable that the data line driver be designed so as to perform charge sharing suitable for each driving method. At this time, selection and switching of the optimum charge sharing method according to the driving method can be automatically performed with a smaller number of external control signals and, if possible, without supplying a special external control signal. preferable. However, a data line driver of a liquid crystal display device that meets such a requirement is not known.
このように、従来のデータ線ドライバには、複数の駆動方式に最適なチャージシェア方式に対応可能であると共に、チャージシェア方式の選択及び切替を、より少ない数の外部制御信号で行うという要求に対応していないという問題がある。 As described above, the conventional data line driver is compatible with the charge sharing method that is optimal for a plurality of driving methods, and the charge sharing method is selected and switched with a smaller number of external control signals. There is a problem that it is not supported.
その他の課題と新規な特徴は、本明細書の記述および添付図面から明らかになるであろう。 Other problems and novel features will become apparent from the description of the specification and the accompanying drawings.
一実施形態では、液晶表示パネルの複数のデータ線を駆動するデータ線ドライバが、複数のデータ線にそれぞれに接続される複数の出力端子と、データ線を駆動する駆動電圧を出力する複数の出力バッファと、第1及び第2チャージシェアラインと、複数の出力端子のそれぞれと第1チャージシェアラインとの間にそれぞれに接続された複数の第1スイッチと、複数の出力端子のそれぞれと第2チャージシェアラインとの間にそれぞれに接続された複数の第2スイッチと、複数の出力端子の隣接する2つの出力端子の間に接続された第3スイッチと、極性信号の反転を検知し、極性信号の反転の有無に応じて第1スイッチ、第2スイッチ及び第3スイッチを制御する極性判定回路とを具備する。 In one embodiment, a data line driver that drives a plurality of data lines of a liquid crystal display panel has a plurality of output terminals that are respectively connected to the plurality of data lines, and a plurality of outputs that output a driving voltage that drives the data lines. A buffer, first and second charge share lines, a plurality of first switches respectively connected between each of the plurality of output terminals and the first charge share line, and each of the plurality of output terminals and the second A plurality of second switches connected to each of the charge share lines, a third switch connected between two adjacent output terminals of the plurality of output terminals, and the polarity signal is detected to be inverted. A polarity determination circuit for controlling the first switch, the second switch, and the third switch in accordance with the presence or absence of signal inversion.
上記の実施形態によれば、複数の駆動方式に対応可能であると共に、駆動方式の選択及び切替をより少ない数の制御信号で行うことができる液晶表示装置が提供される。 According to the above-described embodiment, a liquid crystal display device that can support a plurality of driving methods and can perform selection and switching of the driving methods with a smaller number of control signals is provided.
図1は、一実施形態の液晶表示装置の構成を示すブロック図である。当該液晶表示装置は、データ線ドライバ1と、ゲート線ドライバ2と、LCD(液晶表示)パネル3とを備えている。LCDパネル3は、ゲート線21と、データ線22と、これらの交点の近傍にそれぞれに設けられた画素23とを備えている。本実施形態では、ゲート線21とデータ線22とが直交するように設けられている。以下において、ゲート線21が延伸する方向を「水平方向」、データ線22が延伸する方向を「垂直方向」と呼ぶことがある。また、同一のゲート線21に対応する画素23の列を「ライン」と呼ぶことがある。データ線ドライバ1は、LCDパネル3のデータ線22を駆動し、ゲート線ドライバ2は、ゲート線21を駆動する。
FIG. 1 is a block diagram illustrating a configuration of a liquid crystal display device according to an embodiment. The liquid crystal display device includes a
LCDパネル3の各画素23は、TFT(thin film transistor)23aと、画素電極23bとを備えている。各ゲート線21は、対応する画素23のTFT23aのゲートとして使用される。TFT23aの一方のソース/ドレインはデータ線22に接続され、他方のソース/ドレインは画素電極23bに接続されている。画素電極23bは、共通電極24と対向するように設けられており、画素電極23bと共通電極24との間には液晶が満たされて液晶容量が形成されている。以下において、共通電極24の電位(基準電圧)を、共通電位Vcomという。
Each
データ線ドライバ1は、外部(例えば、タイミングコントローラ)から供給される垂直同期信号Vsync、水平同期信号Hsync、ドット制御信号SDOT及び極性信号POLを含む外部制御信号、並びに、画素データDINに応答して、LCDパネル3のデータ線22を駆動する。ここで、画素データDINとは、LCDパネル3の各画素23の階調を示すデータである。
本実施形態では、データ線ドライバ1が、チャージシェアと反転駆動とを併用する駆動に対応可能に構成されている。加えて、データ線ドライバ1が、次の4つの反転駆動:1ライン1ドット反転駆動、1ラインMドット反転駆動、Nライン1ドット反転駆動、NラインMドット反転駆動に対応するように構成されている。ここで、1ライン1ドット反転駆動とは、水平方向、及び垂直方向の両方において、1個の画素23毎に駆動電圧の極性を反転させる駆動方式である。1ラインMドット反転駆動とは、垂直方向においては1個の画素毎に駆動電圧の極性を反転させる一方で、水平方向においてはM個の画素23毎に駆動電圧の極性を反転させる駆動方式である。Nライン1ドット反転駆動とは、垂直方向においてはNライン毎に(即ち、N個の画素23毎に)駆動電圧の極性を反転させる一方で、水平方向においては1個の画素23毎に駆動電圧の極性を反転させる駆動方式である。
更に、NラインMドット反転駆動とは、垂直方向においてはNライン毎に駆動電圧の極性を反転させる一方で、水平方向においてはM個の画素23毎に駆動電圧の極性を反転させる駆動方式である。なお、本明細書においては、駆動電圧の極性は、共通電位Vcomを基準として定義する。駆動電圧が共通電位Vcomよりも高い場合、駆動電圧の極性は「正」であると定義され、駆動電圧が共通電位Vcomよりも低い場合、駆動電圧の極性は「負」であると定義される。
In the present embodiment, the
Further, the N line M dot inversion driving is a driving method in which the polarity of the driving voltage is inverted every N lines in the vertical direction, while the polarity of the driving voltage is inverted every
ここで、本実施形態の液晶表示装置では、極性信号POLの反転を検知することで駆動電圧の極性が反転されるライン数(1ライン又はNライン)に応じてチャージチェア方式を自動的に切り替えている。即ち、液晶表示装置の制御において広く使用されている極性信号POLの反転を検出することで、駆動電圧の極性が反転されるライン数に応じたチャージチェア方式の切り替えが行われる。これにより、本実施形態の液晶表示装置では、チャージシェアと反転駆動との両方を行うために外部から供給される制御信号の数が低減されている。以下では、本実施形態におけるデータ線ドライバ1の構成と動作について詳細に説明する。
Here, in the liquid crystal display device of the present embodiment, the charge chair method is automatically switched according to the number of lines (1 line or N lines) where the polarity of the drive voltage is inverted by detecting the inversion of the polarity signal POL. ing. That is, by detecting the inversion of the polarity signal POL widely used in the control of the liquid crystal display device, the charge chair system is switched according to the number of lines where the polarity of the drive voltage is inverted. Thereby, in the liquid crystal display device of the present embodiment, the number of control signals supplied from the outside in order to perform both charge sharing and inversion driving is reduced. Hereinafter, the configuration and operation of the
データ線ドライバ1は、データレジスタ回路11とラッチ回路12と、D/A変換回路13と、出力バッファ141〜14nと、極性判定回路151〜15nと、チャージシェア回路16と、出力端子171〜17nと、制御回路18とを備えている。
The
データレジスタ回路11は、外部からシリアルに転送されてくる画素データDINを受け取って保存する。データレジスタ回路11は、1ラインの画素23に対応する画素データDINを保存する容量を持っている。
Data register
ラッチ回路12は、制御回路18から供給されるラッチ信号STBに応答してデータレジスタ回路11から1ラインの画素23に対応する画素データDINをラッチする。ラッチ信号STBがアサートされると(本実施形態では“H”レベルにされると)、ラッチ回路12は、1ラインの画素23に対応する画素データDINをデータレジスタ回路11からラッチし、D/A変換回路13に供給する。ラッチ信号STBは、各水平期間において、出力端子171〜17nからの駆動電圧の出力の開始の前にアサートされ、各水平期間において駆動電圧の生成に用いられる画素データDINをデータレジスタ回路11からラッチ回路12にラッチさせる役割を有している。
D/A変換回路13は、ラッチ回路12から受け取った画素データDINに対してデジタル−アナログ変換を行い、画素データDINのデータ値に対応する電圧レベルを有する階調電圧を出力する。D/A変換回路13からは、1ラインの画素23に対応する数の階調電圧が出力される。本実施形態では、D/A変換回路13から出力される階調電圧の数はN個である。
D / A
D/A変換回路13から出力される階調電圧の極性は、外部から供給される極性信号POL及びドット制御信号SDOTに応じて決定される。極性信号POLは、出力端子171〜17nから出力される駆動電圧の極性の反転を指示する信号であり、極性信号POLが“H”レベルから“L”レベルに、又は、“L”レベルから“H”レベルに反転されると、出力端子171〜17nから出力される駆動電圧の極性も反転される。一方、ドット制御信号SDOTは、水平方向について駆動電圧の極性が反転される空間的周期を指定するための信号である。ドット制御信号SDOTにより、水平方向において1個の画素23毎に駆動電圧の極性が反転される動作と、水平方向においてM個の画素23毎に駆動電圧の極性が反転される動作との切り替えが行われる。水平方向において1個の画素23毎に駆動電圧の極性が反転される場合、出力端子17から出力される駆動電圧の極性は、1個の出力端子17毎に反転される。同様に、水平方向においてM個の画素23毎に駆動電圧の極性が反転される場合、出力端子17から出力される駆動電圧の極性は、M個の出力端子17毎に反転される。
The polarity of the gray scale voltage outputted from the D /
出力バッファ141〜14nは、データ線22を駆動可能な駆動能力を有する電圧フォロアであり、D/A変換回路13から受け取った階調電圧に対応する駆動電圧を介して出力端子171〜17nに出力する。出力端子171〜17nにはLCDパネル3のデータ線22が接続されており、駆動電圧は、出力端子171〜17nからデータ線22に出力され、更に、選択された画素23(対応するゲート線21が活性化された画素23)に供給される。
The output buffers 14 1 to 14 n are voltage followers having a driving capability capable of driving the data line 22, and output terminals 17 1 to 17 n via a driving voltage corresponding to the gradation voltage received from the D /
極性判定回路151〜15nとチャージシェア回路16とは、チャージシェアを行うために用いられる回路群である。極性判定回路15は、外部から供給される極性信号POL、チャージシェア信号CS及びドット制御信号SDOTに応答して後述のチャージシェア回路16に含まれる各スイッチを制御する。チャージシェア回路16は、出力端子17をショートするためのスイッチ群を備えている。極性判定回路15及びチャージシェア回路16の構成と動作については、後に詳細に説明する。
The
制御回路18は、垂直同期信号Vsync、水平同期信号Hsync、ドット制御信号SDOT及びその他の外部制御信号に応答して各種の制御信号を生成し、これにより、データ線ドライバ1の各回路の制御を行う。本実施形態では、制御回路18によって生成される制御信号は、ラッチ信号STB、チャージシェア信号CS、及び、内部ドット制御信号SDOT_1〜SDOT_2Mを含む。ここで、Mは、水平方向において駆動電圧の極性が反転される画素23の周期であり、Mドット反転駆動が行われる場合、2M個の内部ドット制御信号が生成される。ラッチ信号STBは、上述の通り、ラッチ回路12にデータレジスタ回路11から画素データDINをラッチさせる制御を行うための信号である。ラッチ信号STBは、垂直同期信号Vsync、及び、水平同期信号Hsyncに同期して生成される。チャージシェア信号CSは、極性判定回路15及びチャージシェア回路16にチャージシェアのための動作を行わせる制御を行うための信号である。内部ドット制御信号SDOT_1〜SDOT_2Mは、上述のドット制御信号SDOTから生成される信号であり、ドット制御信号SDOTによって指定された駆動電圧の極性が反転される空間的周期を実現するように極性判定回路151〜15nを制御する信号である。
The
図2は、本実施形態におけるチャージシェア回路16の構成を示す回路図である。チャージシェア回路16は、スイッチSW1、SW2、SW31、SW32、正極側チャージシェアライン16a、及び、負極側チャージシェアライン16bを備えている。スイッチSW1、SW2、SW31、SW32は、出力バッファ141〜14n、正極側チャージシェアライン16a、負極側チャージシェアライン16b及び出力端子171〜17nの間の接続関係を切り替えるためのスイッチ回路部を構成している。スイッチSW1は、出力バッファ141〜14nと出力端子171〜17nの間に接続されており、チャージシェア動作を行う際に(即ち、チャージシェア信号CSがアサートされている間の期間に)、出力バッファ141〜14nを出力端子171〜17nから切り離す。スイッチSW2は、隣接する出力端子172i−1、172i(iは、1以上n/2以下の自然数)の間に接続されており、チャージシェア動作を行う際に隣接する出力端子172i−1、172iをショートする機能を有している。スイッチSW31は、出力端子171〜17nと正極側チャージシェアライン16aとの間に接続されており、スイッチSW32は、出力端子171〜17nと負極側チャージシェアライン16bとの間に接続されている。後述されるように、正極側チャージシェアライン16aは、1ドットNライン反転駆動又はMドットNライン反転駆動が行われる場合のチャージシェア動作において、直前に正極性の駆動電圧が供給されたデータ線22についてチャージシェアを行うために使用される。一方、負極側チャージシェアライン16bは、1ドットNライン反転駆動又はMドットNライン反転駆動が行われる場合のチャージシェア動作において、直前に負極性の駆動電圧が供給されたデータ線22についてチャージシェアを行うために使用される。
FIG. 2 is a circuit diagram showing a configuration of the
出力端子17jに接続されたスイッチSW31、SW32は、対応する極性判定回路15jによって制御される。また、隣接する出力端子172i−1、172iの間に接続されたスイッチSW2は、奇数番目の極性判定回路152i−1によって制御される。
Switch SW31, which is connected to the output terminal 17 j SW32 is controlled by the corresponding
図3Aは、本実施形態における奇数番目の極性判定回路152i−1のそれぞれの構成を示す回路図であり、図3Bは、偶数番目の極性判定回路152iのそれぞれの構成を示す回路図である。奇数番目の極性判定回路152i−1は、それぞれ、インバータ31、セレクタ32、フリップフロップ33、34、XOR(排他的論理和)ゲート35、ORゲート36、37、ANDゲート38〜40、及び、インバータ41を備えている。
3A is a circuit diagram showing a configuration of each of the odd-numbered
インバータ31は、極性信号POLの反転信号である極性信号/POLを生成する。セレクタ32は、各極性判定回路15に供給される内部ドット制御信号SDOT_kに応答して極性信号POL、/POLの一方を選択極性信号POLSELとして出力する。詳細には、セレクタ32は、内部ドット制御信号SDOT_kが“HIGH”レベルである場合、極性信号POLを選択極性信号POLSELとして選択し、内部ドット制御信号SDOT_kが“LOW”レベルである場合、極性信号/POLを選択極性信号POLSELとして選択する。ここで、各極性判定回路15に供給される内部ドット制御信号SDOT_kは、内部ドット制御信号SDOT_1〜SDOT_2Mのいずれかである。各極性判定回路15に内部ドット制御信号SDOT_1〜SDOT_2Mのいずれが供給されるかについては、後で詳細に説明する。
The
フリップフロップ33、34と、XORゲート35は、選択極性信号POLSELの反転を検知する検知回路を構成している。ここで、選択極性信号POLSELは、極性信号POLと、その反転信号である極性信号/POLのいずれかであるから、選択極性信号POLSELの反転を検出することは、極性信号POLの反転を検出することと等価であることに留意されたい。
The flip-
詳細には、フリップフロップ33のデータ入力には選択極性信号POLSELが入力され、フリップフロップ34のデータ入力は、フリップフロップ33のデータ出力に接続されている。フリップフロップ34のデータ出力は、XORゲート35の一方の入力に接続されている。XORゲート35の他方の入力には選択極性信号POLSELが入力される。フリップフロップ33、34のクロック端子にはラッチ信号STBが入力される。ラッチ信号STBは、各水平期間の開始直後のブランキング期間に(即ち、駆動電圧の出力が開始される直前に)アサートされる。結果として、ラッチ信号STBがアサートされると、フリップフロップ33は、現在の水平期間の選択極性信号POLSELの値を保持し、フリップフロップ34は、直前の水平期間の選択極性信号POLSELの値を保持することになる。XORゲート35は、フリップフロップ34の出力と選択極性信号POLSELとを比較する比較器として動作し、フリップフロップ34の出力と選択極性信号POLSELとが相違するときにその出力信号を“H”レベルに設定する。結果として、現在の水平期間の選択極性信号POLSELが直前の水平期間の選択極性信号POLSELから反転されたときにXORゲート35の出力信号が“H”レベルにされる。そして、選択極性信号POLSELの反転を検出することは、極性信号POLの反転を検出することと等価であるから、XORゲート35の出力信号は、極性信号POLが反転の有無を示す信号になる。XORゲート35の出力信号が、極性信号POLが反転の有無を示す極性信号反転信号SLINEとして用いられる。
Specifically, the selection polarity signal POL SEL is input to the data input of the flip-
ORゲート36、37、ANDゲート38、39、40及びインバータ41は、選択極性信号POLSEL、極性信号反転信号SLINE、及び、チャージシェア信号CSから、チャージシェア回路16のスイッチSW2、SW31、SW32を制御する制御信号を生成する論理回路を構成している。
The OR
上述の構成の極性判定回路152i−1では、極性信号POLが反転された場合(即ち、極性信号反転信号SLINEが“H”レベルである場合)、チャージシェア信号CSがアサートされている期間(“H”レベルに設定されている期間)においてスイッチSW2、SW31、SW32を制御する制御信号が全てアサートされる。この場合、スイッチSW2、SW31、SW32がオンされる。一方、極性信号POLが反転されない場合、スイッチSW2を制御する信号はネゲートされる一方、スイッチSW31、SW32を制御する信号は、選択極性信号POLSELに応じて生成される。詳細には、極性信号POLが反転されないときには、選択極性信号POLSELが“H”レベルであり、且つ、チャージシェア信号CSがアサートされている場合にスイッチSW32を制御する信号がアサートされ、スイッチSW31を制御する信号がネゲートされる。また、極性信号POLが反転されないときには、選択極性信号POLSELが“L”レベルであり、且つ、チャージシェア信号CSがアサートされている場合にスイッチSW31を制御する信号がアサートされ、スイッチSW32を制御する信号がネゲートされる。 In the polarity determination circuit 152i-1 having the above-described configuration, when the polarity signal POL is inverted (that is, when the polarity signal inversion signal SLINE is at "H" level), the period during which the charge share signal CS is asserted All control signals for controlling the switches SW2, SW31, and SW32 are asserted (in a period set to “H” level). In this case, the switches SW2, SW31, and SW32 are turned on. On the other hand, when the polarity signal POL is not inverted, the signal for controlling the switch SW2 is negated, while the signal for controlling the switches SW31 and SW32 is generated according to the selection polarity signal POL SEL . Specifically, when the polarity signal POL is not inverted, the signal for controlling the switch SW32 is asserted when the selection polarity signal POL SEL is at the “H” level and the charge share signal CS is asserted, and the switch SW31 A signal for controlling is negated. When the polarity signal POL is not inverted, the signal for controlling the switch SW31 is asserted when the selected polarity signal POL SEL is at the “L” level and the charge share signal CS is asserted, and the switch SW32 is controlled. The signal to be negated is negated.
また、図3Bに図示されているように、偶数番目の極性判定回路152iの構成は、スイッチSW2を制御する制御信号を出力するANDゲート38が設けられないこと以外、奇数番目の極性判定回路152i−1と同一である。
Further, as shown in FIG. 3B, the even-numbered polarity determination circuit 152i has an odd-numbered polarity determination circuit except that an AND
上記において、各極性判定回路15に供給される内部ドット制御信号SDOT_kは、
2M個の極性判定回路15を周期として切り替えられる。即ち、極性判定回路15(2Mk+1)〜152M(k+1)(kは0以上の整数)に、それぞれ、内部ドット制御信号SDOT_1〜SDOT_2Mが供給される。例えば、2ドット反転駆動が行われる場合(M=2)の場合、極性判定回路151〜154に、それぞれ、内部ドット制御信号SDOT_1〜SDOT_4が供給される。図2には、M=2の例が図示されている。内部ドット制御信号SDOT_1〜SDOT_2Mの値は、水平方向における駆動電圧の極性が反転される周期に応じて決定される。
In the above, the internal dot control signal SDOT_k supplied to each
2M
図4A乃至図7Bは、本実施形態における極性判定回路15及びチャージシェア回路16の動作を示すタイミングチャートである。ここでは、一例として、本実施形態の液晶表示装置において、1ライン1ドット反転駆動、1ライン2ドット反転駆動、2ライン1ドット反転駆動、2ライン2ドット反転駆動のいずれかが選択的に行われ、チャージシェア動作も反転駆動方式の選択に応じて切り替えられるとして説明を行う。即ち、N=M=2の場合について説明を行う。この場合、4つの内部ドット制御信号SDOT_1〜SDOT_4が生成されることになる。以下では、これらの反転駆動のそれぞれについて、極性判定回路151〜154、及び、それらによって制御されるスイッチSW2、SW31、SW32の、第4k乃至4k+3水平期間における動作について説明する。ただし、他の極性判定回路15及びスイッチSW2、SW31、SW32の動作、及び、他の水平期間における動作も同様であることは当業者には容易に理解されよう。
4A to 7B are timing charts showing operations of the
(1ライン1ドット反転駆動)
図4A、図4Bは、1ライン1ドット反転駆動が行われる場合のチャージシェア動作を示すタイミングチャートである。1ライン1ドット反転駆動では、各出力端子17から出力される駆動電圧の極性が、1個の出力端子17毎に反転されると共に、1水平期間毎に反転される。この場合、内部ドット制御信号SDOT_1、SDOT_3は、“HIGH”レベルに設定され、内部ドット制御信号SDOT_2、SDOT_4は、“LOW”レベルに設定される。内部ドット制御信号SDOT_1、SDOT_3に応答して、奇数番目の極性判定回路151、153においては選択極性信号POLSELとして極性信号POLが選択される。一方、偶数番目の極性判定回路152、154においては、内部ドット制御信号SDOT_2、SDOT_4に応答して極性信号POLの反転信号である極性信号/POLが選択される。
(1
4A and 4B are timing charts showing the charge sharing operation when 1-line 1-dot inversion driving is performed. In 1-line 1-dot inversion driving, the polarity of the driving voltage output from each output terminal 17 is inverted for each output terminal 17 and inverted for each horizontal period. In this case, the internal dot control signals S DOT — 1 and S DOT — 3 are set to “HIGH” level, and the internal dot control signals S DOT — 2 and S DOT — 4 are set to “LOW” level. In response to the internal dot control signals S DOT_1 and S DOT_3 , the odd
詳細には、奇数番目の水平期間(第4k+1、第4k+3水平期間)では、奇数番目の出力端子171、173から正極性の駆動電圧が出力され、偶数番目の出力端子172、174から負極性の駆動電圧が出力される。詳細には、D/A変換回路13は、極性信号POLとドット制御信号SDOTに応答して、出力バッファ141、143に正極性の階調電圧を出力すると共に出力バッファ142、144に負極性の階調電圧を出力する。出力バッファ141〜144は、供給された階調電圧に対応する駆動電圧を出力端子171〜174に出力する。一方、偶数番目の水平期間(第4k+2、第4k+4)水平期間では、奇数番目の出力端子171、173から負極性の駆動電圧が出力され、偶数番目の出力端子172、174から正極性の駆動電圧が出力される。
Specifically, in the odd-numbered horizontal period (the 4k + 1 and 4k + 3 horizontal periods), the odd-numbered output terminals 17 1 and 17 3 output the positive drive voltage, and the even-numbered output terminals 17 2 and 17 4. To output a negative drive voltage. Specifically, the D /
極性判定回路151〜154は、各水平期間において極性信号POL(又は選択極性信号POLSEL)が反転されることを検出し、極性信号反転信号SLINEを各水平期間において“H”レベルに設定する。このため、各水平期間において、チャージシェア信号CSがアサートされている間にスイッチSW2、SW31、SW32がオンされる。これにより、チャージシェア信号CSがアサートされている間、全ての出力端子171〜174がショートされてチャージシェアが行われる。上述されているように、チャージシェアが行われている間(即ち、チャージシェア信号CSがアサートされている間)、スイッチSW1がオフされることに留意されたい。
The
(1ライン2ドット反転駆動)
図5A、図5Bは、1ライン2ドット反転駆動が行われる場合のチャージシェア動作を示すタイミングチャートである。1ライン2ドット反転駆動では、各出力端子17から出力される駆動電圧の極性が、2個の出力端子17毎に反転されると共に、1水平期間毎に反転される。この場合、内部ドット制御信号SDOT_1、SDOT_2は、“HIGH”レベルに設定され、内部ドット制御信号SDOT_3、SDOT_4は、“LOW”レベルに設定される。内部ドット制御信号SDOT_1、SDOT_2に応答して、極性判定回路151、152においては選択極性信号POLSELとして極性信号POLが選択される。一方、極性判定回路153、154においては、内部ドット制御信号SDOT_3、SDOT_4に応答して極性信号POLの反転信号である極性信号/POLが選択される。
(1
5A and 5B are timing charts showing a charge sharing operation when 1-line 2-dot inversion driving is performed. In the one-line two-dot inversion driving, the polarity of the driving voltage output from each output terminal 17 is inverted every two output terminals 17 and is inverted every horizontal period. In this case, the internal dot control signals S DOT — 1 and S DOT — 2 are set to “HIGH” level, and the internal dot control signals S DOT — 3 and S DOT — 4 are set to “LOW” level. In response to the internal dot control signals S DOT_1 and S DOT_2 , the
詳細には、奇数番目の水平期間(第4k+1、第4k+3水平期間)では、出力端子171、172から正極性の駆動電圧が出力され、出力端子173、174から負極性の駆動電圧が出力される。詳細には、D/A変換回路13は、極性信号POLとドット制御信号SDOTに応答して、出力バッファ141、142に正極性の階調電圧を出力すると共に出力バッファ143、144に負極性の階調電圧を出力する。出力バッファ141〜144は、供給された階調電圧に対応する駆動電圧を出力端子171〜174に出力する。一方、偶数番目の水平期間(第4k+2、第4k+4水平期間)では、出力端子171、173から負極性の駆動電圧が出力され、出力端子172、174から正極性の駆動電圧が出力される。
Specifically, odd-numbered horizontal period (
極性判定回路151〜154は、極性信号POL(又は選択極性信号POLSEL)が各水平期間において反転されることを検出し、極性信号反転信号SLINEを各水平期間において“H”レベルに設定する。このため、各水平期間において、チャージシェア信号CSがアサートされている間にスイッチSW2、SW31、SW32がオンされる。これにより、チャージシェア信号CSがアサートされている間、全ての出力端子171〜174がショートされてチャージシェアが行われる。
The
(2ライン1ドット反転駆動)
図6A、図6Bは、2ライン1ドット反転駆動が行われる場合のチャージシェア動作を示すタイミングチャートである。2ライン1ドット反転駆動では、各出力端子17から出力される駆動電圧の極性が、隣接する出力端子17の間で逆にされると共に、2水平期間毎に反転される。
この場合、内部ドット制御信号SDOT_1、SDOT_3は、“HIGH”レベルに設定され、内部ドット制御信号SDOT_2、SDOT_4は、“LOW”レベルに設定される。内部ドット制御信号SDOT_1、SDOT_3に応答して、極性判定回路151、153においては選択極性信号POLSELとして極性信号POLが選択される。一方、極性判定回路152、154においては、内部ドット制御信号SDOT_2、SDOT_4に応答して極性信号/POLが選択される。
(2-line, 1-dot inversion drive)
6A and 6B are timing charts showing the charge sharing operation when 2-line 1-dot inversion driving is performed. In the 2-line 1-dot inversion drive, the polarity of the drive voltage output from each output terminal 17 is reversed between adjacent output terminals 17 and inverted every two horizontal periods.
In this case, the internal dot control signals S DOT — 1 and S DOT — 3 are set to “HIGH” level, and the internal dot control signals S DOT — 2 and S DOT — 4 are set to “LOW” level. In response to the internal dot control signals S DOT — 1 and S DOT — 3 , the
詳細には、第4k+1、第4k+2水平期間では、奇数番目の出力端子171、173から正極性の駆動電圧が出力され、偶数番目の出力端子172、174から負極性の駆動電圧が出力される。また、第4k+3、第4k+4水平期間では、奇数番目の出力端子171、173から負極性の駆動電圧が出力され、偶数番目の出力端子172、174から正極性の駆動電圧が出力される。
In particular, the 4k + 1, in the first 4k + 2 horizontal periods, the odd-numbered
2ライン1ドット反転駆動においては、各出力端子17から出力される駆動電圧の極性が反転されない場合に、正極性の駆動電圧を出力する出力端子17と負極性の駆動電圧を出力する出力端子17とで別々にチャージシェアを行う必要がある。このため、上述のチャージシェア回路16の構成では、正極性の駆動電圧を出力している出力端子17が正極側チャージシェアライン16aに接続されるとともに、負極性の駆動電圧を出力している出力端子17を負極側チャージシェアライン16bに接続される。上述の極性判定回路15は、このような動作を行うようにチャージシェア回路16の各スイッチを制御する。
In the two-line one-dot inversion driving, when the polarity of the driving voltage output from each output terminal 17 is not inverted, the output terminal 17 that outputs a positive driving voltage and the output terminal 17 that outputs a negative driving voltage. It is necessary to do charge sharing separately. Therefore, in the configuration of the
詳細には、第4k+1水平期間では、その直前の水平期間から極性信号POLが反転されるので、各極性判定回路15において極性信号POLの反転が検出されて極性信号反転信号SLINEが“H”レベルに設定される。このため、各水平期間において、チャージシェア信号CSがアサートされている間にスイッチSW2、SW31、SW32がオンされる。これにより、チャージシェア信号CSがアサートされている間、全ての出力端子171〜174がショートされてチャージシェアが行われる。このとき、スイッチSW1は、チャージシェア信号CSがアサートされている間、オフされる。
Specifically, in the 4k + 1 horizontal period, since the polarity signal POL is inverted from the immediately preceding horizontal period, the
第4k+1水平期間に続く第4k+2水平期間では、その直前の水平期間(第4k+1水平期間)から極性信号POLが反転されず、よって極性信号反転信号SLINEが“L”レベルに設定される。この場合、スイッチSW2がオフされると共に、各極性判定回路15において選択された選択極性信号POLSELに応答してスイッチSW31、SW32が制御される。
In the 4k + 2 horizontal period following the 4k + 1 horizontal period, the polarity signal POL is not inverted from the immediately preceding horizontal period (the 4k + 1 horizontal period), and therefore the polarity signal inversion signal S LINE is set to the “L” level. In this case, the switch SW2 is turned off and the switches SW31 and SW32 are controlled in response to the selection polarity signal POL SEL selected in each
詳細には、極性判定回路151、153においては、選択極性信号POLSEL(即ち、極性信号POL)が“H”レベルであることに応答して、チャージシェア信号CSがアサートされている期間において、極性判定回路151、153に接続されたスイッチSW32がオンされる。ここで、極性判定回路151、153に接続されたスイッチSW31はオフのままに維持される。これにより、直前に正極性の駆動電圧が出力されていた出力端子171、173が正極側チャージシェアライン16aに接続され、出力端子171、173の間のチャージシェア動作が行われる。
Specifically, in the
一方、極性判定回路152、154においては、選択極性信号POLSEL(即ち、極性信号/POL)が“L”レベルであることに応答して、チャージシェア信号CSがアサートされている間、極性判定回路152、154に接続されたスイッチSW31がオンされる。極性判定回路152、154に接続されたスイッチSW32はオフのままに維持される。これにより、直前に負極性の駆動電圧が出力されていた出力端子172、174が負極側チャージシェアライン16bに接続され、出力端子172、174の間のチャージシェア動作が行われる。
On the other hand, in the
更に、第4k+3水平期間では、その直前の水平期間(第4k+2水平期間)から極性信号POLが反転されるので、各極性判定回路15において極性信号POLの極性の反転が検出されて極性信号反転信号SLINEが“H”レベルに設定される。このため、各水平期間において、チャージシェア信号CSがアサートされている間にスイッチSW2、SW31、SW32がオンされる。これにより、チャージシェア信号CSがアサートされている間、全ての出力端子171〜174がショートされてチャージシェアが行われる。このとき、スイッチSW1は、チャージシェア信号CSがアサートされている間、オフされる。
Furthermore, in the 4k + 3 horizontal period, since the polarity signal POL is inverted from the immediately preceding horizontal period (the 4k + 2 horizontal period), the
第4k+3水平期間に続く第4k+4水平期間では、その直前の水平期間(第4k+3水平期間)から極性信号POLが反転されず、よって極性信号反転信号SLINEが“L”レベルに設定される。この場合、スイッチSW2がオフされると共に、各極性判定回路15において選択された選択極性信号POLSELに応答してスイッチSW31、SW32が制御される。
In the 4k + 4 horizontal period following the 4k + 3 horizontal period, the polarity signal POL is not inverted from the immediately preceding horizontal period (the 4k + 3 horizontal period), and thus the polarity signal inversion signal S LINE is set to the “L” level. In this case, the switch SW2 is turned off and the switches SW31 and SW32 are controlled in response to the selection polarity signal POL SEL selected in each
詳細には、極性判定回路151、153においては、選択極性信号POLSEL(即ち、極性信号POL)が“L”レベルであることに応答して、チャージシェア信号CSがアサートされている期間において、極性判定回路151、153に接続されたスイッチSW31がオンされる。ここで、極性判定回路151、153に接続されたスイッチSW32はオフのままに維持される。これにより、直前に負極性の駆動電圧が出力されていた出力端子171、173が負極側チャージシェアライン16bに接続され、出力端子171、173の間のチャージシェア動作が行われる。
Specifically, in the
一方、極性判定回路152、154においては、選択極性信号POLSEL(即ち、極性信号/POL)が“H”レベルであることに応答して、チャージシェア信号CSがアサートされている間、極性判定回路152、154に接続されたスイッチSW32がオンされる。極性判定回路152、154に接続されたスイッチSW31はオフのままに維持される。これにより、直前に正極性の駆動電圧が出力されていた出力端子172、174が正極側チャージシェアライン16aに接続され、出力端子172、174の間のチャージシェア動作が行われる。
On the other hand, in the
(2ライン2ドット反転駆動)
図7A、図7Bは、2ライン2ドット反転駆動が行われる場合のチャージシェア動作を示すタイミングチャートである。2ライン2ドット反転駆動では、各出力端子17から出力される駆動電圧の極性が2個の出力端子17の間で反転されると共に、2水平期間毎に反転される。この場合、内部ドット制御信号SDOT_1、SDOT_2は、“HIGH”レベルに設定され、内部ドット制御信号SDOT_3、SDOT_4は、“LOW”レベルに設定される。内部ドット制御信号SDOT_1、SDOT_2に応答して、極性判定回路151、152においては選択極性信号POLSELとして極性信号POLが選択される。一方、極性判定回路153、154においては、内部ドット制御信号SDOT_3、SDOT_4に応答して極性信号/POLが選択される。
(2-line 2-dot inversion drive)
7A and 7B are timing charts showing a charge sharing operation when 2-line 2-dot inversion driving is performed. In the 2-line 2-dot inversion drive, the polarity of the drive voltage output from each output terminal 17 is inverted between the two output terminals 17 and inverted every two horizontal periods. In this case, the internal dot control signals S DOT — 1 and S DOT — 2 are set to “HIGH” level, and the internal dot control signals S DOT — 3 and S DOT — 4 are set to “LOW” level. In response to the internal dot control signals S DOT_1 and S DOT_2 , the
詳細には、第4k+1、第4k+2水平期間では、出力端子171、172から正極性の駆動電圧が出力され、出力端子173、174から負極性の駆動電圧が出力される。また、第4k+3、第4k+4水平期間では、出力端子171、172から負極性の駆動電圧が出力され、出力端子173、174から正極性の駆動電圧が出力される。
In particular, the 4k + 1, in the first 4k + 2 horizontal period, the
2ライン2ドット反転駆動においても、各出力端子17から出力される駆動電圧の極性が反転されない場合に、正極性の駆動電圧を出力する出力端子17と負極性の駆動電圧を出力する出力端子17とで別々にチャージシェアを行う必要がある。このため、上述のチャージシェア回路16の構成では、正極性の駆動電圧を出力している出力端子17が正極側チャージシェアライン16aに接続されるとともに、負極性の駆動電圧を出力している出力端子17を負極側チャージシェアライン16bに接続される。上述の極性判定回路15は、このような動作を行うようにチャージシェア回路16の各スイッチを制御する。
Even in the 2-line 2-dot inversion driving, when the polarity of the driving voltage output from each output terminal 17 is not inverted, the output terminal 17 that outputs a positive driving voltage and the output terminal 17 that outputs a negative driving voltage. It is necessary to do charge sharing separately. Therefore, in the configuration of the
詳細には、第4k+1水平期間では、その直前の水平期間から極性信号POLが反転されるので、各極性判定回路15において極性信号POLの反転が検出されて極性信号反転信号SLINEが“H”レベルに設定される。このため、各水平期間において、チャージシェア信号CSがアサートされている間にスイッチSW2、SW31、SW32がオンされる。これにより、チャージシェア信号CSがアサートされている間、全ての出力端子171〜174がショートされてチャージシェアが行われる。このとき、スイッチSW1は、チャージシェア信号CSがアサートされている間、オフされる。
Specifically, in the 4k + 1 horizontal period, since the polarity signal POL is inverted from the immediately preceding horizontal period, the
第4k+1水平期間に続く第4k+2水平期間では、その直前の水平期間(第4k+1水平期間)から極性信号POLが反転されず、よって極性信号反転信号SLINEが“L”レベルに設定される。この場合、スイッチSW2がオフされると共に、各極性判定回路15において選択された選択極性信号POLSELに応答してスイッチSW31、SW32が制御される。
In the 4k + 2 horizontal period following the 4k + 1 horizontal period, the polarity signal POL is not inverted from the immediately preceding horizontal period (the 4k + 1 horizontal period), and therefore the polarity signal inversion signal S LINE is set to the “L” level. In this case, the switch SW2 is turned off and the switches SW31 and SW32 are controlled in response to the selection polarity signal POL SEL selected in each
詳細には、極性判定回路151、152においては、選択極性信号POLSEL(即ち、極性信号POL)が“H”レベルであることに応答して、チャージシェア信号CSがアサートされている期間において、極性判定回路151、152に接続されたスイッチSW32がオンされる。ここで、極性判定回路151、152に接続されたスイッチSW31はオフのままに維持される。これにより、直前に正極性の駆動電圧が出力されていた出力端子171、172が正極側チャージシェアライン16aに接続され、出力端子171、172の間のチャージシェア動作が行われる。
Specifically, in the
一方、極性判定回路153、154においては、選択極性信号POLSEL(即ち、極性信号/POL)が“L”レベルであることに応答して、チャージシェア信号CSがアサートされている間、極性判定回路153、154に接続されたスイッチSW31がオンされる。極性判定回路152、154に接続されたスイッチSW32はオフのままに維持される。これにより、直前に負極性の駆動電圧が出力されていた出力端子173、174が負極側チャージシェアライン16bに接続され、出力端子173、174の間のチャージシェア動作が行われる。
On the other hand, in the
更に、第4k+3水平期間では、その直前の水平期間(第4k+2水平期間)から極性信号POLが反転されるので、各極性判定回路15において極性信号POLの極性の反転が検出されて極性信号反転信号SLINEが“H”レベルに設定される。このため、各水平期間において、チャージシェア信号CSがアサートされている間にスイッチSW2、SW31、SW32がオンされる。これにより、チャージシェア信号CSがアサートされている間、全ての出力端子171〜174がショートされてチャージシェアが行われる。
Furthermore, in the 4k + 3 horizontal period, since the polarity signal POL is inverted from the immediately preceding horizontal period (the 4k + 2 horizontal period), the
第4k+3水平期間に続く第4k+4水平期間では、その直前の水平期間(第4k+3水平期間)から極性信号POLが反転されず、よって極性信号反転信号SLINEが“L”レベルに設定される。この場合、スイッチSW2がオフされると共に、各極性判定回路15において選択された選択極性信号POLSELに応答してスイッチSW31、SW32が制御される。
In the 4k + 4 horizontal period following the 4k + 3 horizontal period, the polarity signal POL is not inverted from the immediately preceding horizontal period (the 4k + 3 horizontal period), and thus the polarity signal inversion signal S LINE is set to the “L” level. In this case, the switch SW2 is turned off and the switches SW31 and SW32 are controlled in response to the selection polarity signal POL SEL selected in each
詳細には、極性判定回路151、152においては、選択極性信号POLSEL(即ち、極性信号POL)が“L”レベルであることに応答して、チャージシェア信号CSがアサートされている期間において、極性判定回路151、152に接続されたスイッチSW31がオンされる。ここで、極性判定回路151、152に接続されたスイッチSW32はオフのままに維持される。これにより、直前に負極性の駆動電圧が出力されていた出力端子171、172が負極側チャージシェアライン16bに接続され、出力端子171、172の間のチャージシェア動作が行われる。
Specifically, in the
一方、極性判定回路153、154においては、選択極性信号POLSEL(即ち、極性信号/POL)が“H”レベルであることに応答して、チャージシェア信号CSがアサートされている間、極性判定回路153、154に接続されたスイッチSW32がオンされる。極性判定回路153、154に接続されたスイッチSW31はオフのままに維持される。これにより、直前に正極性の駆動電圧が出力されていた出力端子173、174が、正極側チャージシェアライン16aに接続され、出力端子173、174の間のチャージシェア動作が行われる。
On the other hand, in the
以上では、1ライン1ドット反転駆動と1ライン2ドット反転駆動と、2ライン1ドット反転駆動と2ライン2ドット反転駆動のそれぞれの場合のチャージシェア動作が説明されているが、駆動電圧の極性が反転される空間的周期、時間的周期は、これらに限定されない。一般に、本実施形態の液晶表示装置の構成は、NラインMドット反転駆動(N、Mは2以上の整数)、及び、それに応じたチャージシェア動作に対応している。例えば、Nライン反転駆動及びそれに応じたチャージシェア動作は、極性信号POLをNライン毎に(即ち、N水平期間毎に)反転することで容易に実現できる。本実施形態の液晶表示装置の構成では、極性信号POLの反転が検出され、反転の検出の有無に応じてチャージシェア回路16のスイッチが制御される。これにより、Nライン反転駆動及びそれに応じたチャージシェア動作を容易に実現することができる。
The above describes the charge sharing operation in each case of 1-line 1-dot inversion drive, 1-line 2-dot inversion drive, 2-line 1-dot inversion drive, and 2-line 2-dot inversion drive. The spatial period and the temporal period in which are inverted are not limited to these. In general, the configuration of the liquid crystal display device according to the present embodiment corresponds to N line M dot inversion driving (N and M are integers of 2 or more) and a charge sharing operation corresponding thereto. For example, the N line inversion driving and the charge sharing operation corresponding thereto can be easily realized by inverting the polarity signal POL every N lines (that is, every N horizontal periods). In the configuration of the liquid crystal display device of the present embodiment, inversion of the polarity signal POL is detected, and the switch of the
また、Mドット反転駆動及びそれに応じたチャージシェア動作を行うためには、内部ドット制御信号SDOT_1〜SDOT_2Mにより、D/A変換回路13が出力バッファ141〜14nに出力する階調電圧の極性を、出力端子17から出力される駆動電圧の極性がM個の出力端子17毎に反転されるように選択すればよい。この場合、極性判定回路151〜15nにおける選択極性信号POLSELの選択も、M個の極性判定回路15毎に(即ち、2M個の極性判定回路15を周期として)切り替えられる。例えば、1ライン4ドット反転駆動及びそれに応じたチャージシェア動作が行われる場合、極性判定回路158j+1〜158j+4が選択極性信号POLSELとして極性信号POLを選択する一方で、極性判定回路158j+5〜158j+8が選択極性信号POLSELとして極性信号/POLを選択するように設定される。
Further, in order to perform M dot inversion driving and a charge sharing operation corresponding to the M dot inversion drive, the gradation voltage output from the D /
以上に説明されているように、本実施形態の液晶表示装置では、極性信号POLの反転を検知することで駆動電圧の極性が反転されるライン数(1ライン又はNライン)に最適なチャージシェア方式の切り替えが自動的に行われている。即ち、駆動電圧の極性が反転されるライン数を指定する信号を外部から供給せずにチャージシェア方式の切り替えが自動的に行われる。これにより、本実施形態の液晶表示装置では、チャージシェアと反転駆動との両方を行うために外部から供給される制御信号の数が低減されている。 As described above, in the liquid crystal display device of this embodiment, the charge share optimum for the number of lines (1 line or N lines) where the polarity of the drive voltage is inverted by detecting the inversion of the polarity signal POL. The system is automatically switched. That is, switching of the charge share method is automatically performed without supplying a signal specifying the number of lines whose polarity of the drive voltage is inverted from the outside. Thereby, in the liquid crystal display device of the present embodiment, the number of control signals supplied from the outside in order to perform both charge sharing and inversion driving is reduced.
なお、上記の実施形態では、内部ドット制御信号SDOT_1〜SDOT_2Mが、外部から供給されるドット制御信号SDOTに応答して制御回路18によって生成されているが、内部ドット制御信号SDOT_1〜SDOT_2Mは、画像の種別(動画、静止画等)に応答して動的に生成されてもよい。この場合、制御回路18に画素データDINが供給され、制御回路18は、画素データDINから画像の種別を判別する。制御回路18は、判別された画像の種別に応じて、1ドット反転又はMドット反転のいずれが行われるかを決定し、決定された反転駆動の種別に応じた値の内部ドット制御信号SDOT_1〜SDOT_2Mを生成する。
In the above embodiments, the internal dot control signal S DOT_1 ~S DOT_2M is has been generated by the
以上、本発明者によってなされた発明を実施の形態に基づき具体的に説明したが、本発明は前記実施の形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることはいうまでもない。 As mentioned above, the invention made by the present inventor has been specifically described based on the embodiment. However, the present invention is not limited to the embodiment, and various modifications can be made without departing from the scope of the invention. Needless to say.
1:データ線ドライバ
2:ゲート線ドライバ
3:LCDパネル
11:データレジスタ回路
12:ラッチ回路
13:D/A変換回路
14:出力バッファ
15:極性判定回路
16:チャージシェア回路
16a:正極側チャージシェアライン
16b:負極側チャージシェアライン
17:出力端子
18:制御回路
21:ゲート線
22:データ線
23:画素
23a:TFT
23b:画素電極
24:共通電極
31:インバータ
32:セレクタ
33、34:フリップフロップ
35:XORゲート
36、37:ORゲート
38、39、40:ANDゲート
1: Data line driver 2: Gate line driver 3: LCD panel 11: Data register circuit 12: Latch circuit 13: D / A conversion circuit 14: Output buffer 15: Polarity determination circuit 16: Charge share circuit 16a: Positive side charge share Line 16b: Negative-side charge share line 17: Output terminal 18: Control circuit 21: Gate line 22: Data line 23:
23b: pixel electrode 24: common electrode 31: inverter 32:
Claims (10)
前記複数のデータ線にそれぞれに接続される複数の出力端子と、
前記データ線を駆動する駆動電圧を出力する複数の出力バッファと、
第1及び第2チャージシェアラインと、
前記複数の出力端子のそれぞれと前記第1チャージシェアラインとの間にそれぞれに接続された複数の第1スイッチと、
前記複数の出力端子のそれぞれと前記第2チャージシェアラインとの間にそれぞれに接続された複数の第2スイッチと、
前記複数の出力端子の隣接する2つの出力端子の間に接続された第3スイッチと、
極性信号の反転を検知し、前記極性信号の反転の有無に応じて前記第1スイッチ、前記第2スイッチ及び前記第3スイッチを制御する極性判定回路
とを具備する
データ線ドライバ。 A data line driver for driving a plurality of data lines of a liquid crystal display panel,
A plurality of output terminals respectively connected to the plurality of data lines;
A plurality of output buffers for outputting drive voltages for driving the data lines;
First and second charge share lines;
A plurality of first switches respectively connected between each of the plurality of output terminals and the first charge share line;
A plurality of second switches respectively connected between each of the plurality of output terminals and the second charge share line;
A third switch connected between two adjacent output terminals of the plurality of output terminals;
A data line driver, comprising: a polarity determination circuit that detects inversion of a polarity signal and controls the first switch, the second switch, and the third switch according to whether the polarity signal is inverted.
前記極性判定回路は、前記極性信号の反転が検知されない場合に、当該データ線ドライバにおけるチャージシェア動作の実施を指示するチャージシェア信号に応答して、前記複数の出力端子のうち正極性の駆動電圧が出力されるべき出力端子を前記第1チャージシェアラインに接続し、前記複数の出力端子のうち負極性の駆動電圧が出力されるべき出力端子を前記第2チャージシェアラインに接続するように前記第1スイッチ及び前記第2スイッチを制御する
データ線ドライバ。 The data line driver according to claim 1,
The polarity determination circuit responds to a charge share signal instructing execution of a charge share operation in the data line driver when no inversion of the polarity signal is detected, and a positive drive voltage among the plurality of output terminals Is connected to the first charge share line, and among the plurality of output terminals, an output terminal to which a negative drive voltage is to be output is connected to the second charge share line. A data line driver for controlling the first switch and the second switch.
前記極性判定回路は、前記極性信号の反転が検知された場合に、当該データ線ドライバにおけるチャージシェア動作の実施を指示するチャージシェア信号に応答して、前記複数の出力端子のうち正極性の駆動電圧が出力されるべき出力端子を前記第1チャージシェアラインに接続し、前記複数の出力端子のうち負極性の駆動電圧が出力されるべき出力端子を前記第2チャージシェアラインに接続するように前記第1スイッチ及び前記第2スイッチを制御する
データ線ドライバ。 The data line driver according to claim 1 or 2,
The polarity determination circuit responds to a charge share signal instructing execution of a charge share operation in the data line driver when the inversion of the polarity signal is detected, and drives the positive polarity among the plurality of output terminals. An output terminal to which a voltage is to be output is connected to the first charge share line, and an output terminal to which a negative drive voltage is to be output is connected to the second charge share line among the plurality of output terminals. A data line driver for controlling the first switch and the second switch;
前記極性判定回路は、
前記極性信号の反転を検知し、前記極性信号の反転の有無を示す極性信号反転信号を出力する検知回路と、
前記チャージシェア信号と、前記極性信号反転信号と、前記極性信号とに応答して前記第1スイッチ及び前記第2スイッチを制御する制御信号を生成する論理回路
とを備える
データ線ドライバ。 A data line driver according to claim 2 or 3,
The polarity determination circuit includes:
A detection circuit that detects inversion of the polarity signal and outputs a polarity signal inversion signal indicating presence / absence of inversion of the polarity signal;
A data line driver comprising: a logic circuit that generates a control signal for controlling the first switch and the second switch in response to the charge share signal, the polarity signal inversion signal, and the polarity signal.
更に、
外部からシリアルに転送されてくる前記液晶表示パネルの各画素の階調を示す画素データを受け取るデータレジスタ回路と、
ラッチ信号に応答してデータレジスタ回路から前記画素データをラッチするラッチ回路と、
前記ラッチ回路から出力される前記画素データに対してデジタル−アナログ変換を行って前記画素データに対応する階調電圧を出力するD/A変換回路
とを具備し、
前記複数の出力バッファは、前記階調電圧に応答して前記駆動電圧を出力し、
前記検知回路は、
前記ラッチ信号に応答して前記極性信号又は前記極性信号の反転信号のいずれかをラッチする第1フリップフロップと、
前記ラッチ信号に応答して前記第1フリップフロップの出力信号をラッチする第2フリップフロップと、
前記第1フリップフロップにラッチされる信号と前記第2フリップフロップとを比較して前記極性信号反転信号を生成する比較器
とを備える
データ線ドライバ。 The data line driver according to claim 4, wherein
Furthermore,
A data register circuit for receiving pixel data indicating the gradation of each pixel of the liquid crystal display panel transferred serially from the outside;
A latch circuit that latches the pixel data from the data register circuit in response to a latch signal;
A D / A conversion circuit that performs digital-analog conversion on the pixel data output from the latch circuit and outputs a gradation voltage corresponding to the pixel data;
The plurality of output buffers output the driving voltage in response to the gradation voltage,
The detection circuit includes:
A first flip-flop that latches either the polarity signal or an inverted signal of the polarity signal in response to the latch signal;
A second flip-flop that latches the output signal of the first flip-flop in response to the latch signal;
A data line driver comprising: a comparator that compares the signal latched by the first flip-flop with the second flip-flop to generate the polarity signal inversion signal.
データ線ドライバ
とを具備し、
前記データ線ドライバは、
前記複数のデータ線にそれぞれに接続される複数の出力端子と、
前記データ線を駆動する駆動電圧を出力する複数の出力バッファと、
第1及び第2チャージシェアラインと、
前記複数の出力端子のそれぞれと前記第1チャージシェアラインとの間にそれぞれに接続された複数の第1スイッチと、
前記複数の出力端子のそれぞれと前記第2チャージシェアラインとの間にそれぞれに接続された複数の第2スイッチと、
前記複数の出力端子の隣接する2つの出力端子の間に接続された第3スイッチと、
極性信号の反転を検知し、前記極性信号の反転の有無に応じて前記第1スイッチ、前記第2スイッチ及び前記第3スイッチを制御する極性判定回路
とを具備する
液晶表示装置。 A liquid crystal display panel having a plurality of data lines;
A data line driver,
The data line driver is
A plurality of output terminals respectively connected to the plurality of data lines;
A plurality of output buffers for outputting drive voltages for driving the data lines;
First and second charge share lines;
A plurality of first switches respectively connected between each of the plurality of output terminals and the first charge share line;
A plurality of second switches respectively connected between each of the plurality of output terminals and the second charge share line;
A third switch connected between two adjacent output terminals of the plurality of output terminals;
A liquid crystal display device comprising: a polarity determination circuit that detects inversion of a polarity signal and controls the first switch, the second switch, and the third switch according to whether the polarity signal is inverted.
前記極性判定回路は、前記極性信号の反転が検知されない場合に、当該データ線ドライバにおけるチャージシェア動作の実施を指示するチャージシェア信号に応答して、前記複数の出力端子のうち正極性の駆動電圧が出力されるべき出力端子を前記第1チャージシェアラインに接続し、前記複数の出力端子のうち負極性の駆動電圧が出力されるべき出力端子を前記第2チャージシェアラインに接続するように前記第1スイッチ及び前記第2スイッチを制御する
液晶表示装置。 The liquid crystal display device according to claim 6,
The polarity determination circuit responds to a charge share signal instructing execution of a charge share operation in the data line driver when no inversion of the polarity signal is detected, and a positive drive voltage among the plurality of output terminals Is connected to the first charge share line, and among the plurality of output terminals, an output terminal to which a negative drive voltage is to be output is connected to the second charge share line. A liquid crystal display device for controlling the first switch and the second switch.
前記極性判定回路は、前記極性信号の反転が検知された場合に、当該データ線ドライバにおけるチャージシェア動作の実施を指示するチャージシェア信号に応答して、前記複数の出力端子のうち正極性の駆動電圧が出力されるべき出力端子を前記第1チャージシェアラインに接続し、前記複数の出力端子のうち負極性の駆動電圧が出力されるべき出力端子を前記第2チャージシェアラインに接続するように前記第1スイッチ及び前記第2スイッチを制御する
液晶表示装置。 The liquid crystal display device according to claim 6 or 7,
The polarity determination circuit responds to a charge share signal instructing execution of a charge share operation in the data line driver when the inversion of the polarity signal is detected, and drives the positive polarity among the plurality of output terminals. An output terminal to which a voltage is to be output is connected to the first charge share line, and an output terminal to which a negative drive voltage is to be output is connected to the second charge share line among the plurality of output terminals. A liquid crystal display device that controls the first switch and the second switch.
前記極性判定回路は、
前記極性信号の反転を検知し、前記極性信号の反転の有無を示す極性信号反転信号を出力する検知回路と、
前記チャージシェア信号と、前記極性信号反転信号と、前記極性信号とに応答して前記第1スイッチ及び前記第2スイッチを制御する制御信号を生成する論理回路
とを備える
液晶表示装置。 The liquid crystal display device according to claim 7 or 8,
The polarity determination circuit includes:
A detection circuit that detects inversion of the polarity signal and outputs a polarity signal inversion signal indicating presence / absence of inversion of the polarity signal;
A liquid crystal display device comprising: a logic circuit that generates a control signal for controlling the first switch and the second switch in response to the charge share signal, the polarity signal inversion signal, and the polarity signal.
更に、
外部からシリアルに転送されてくる前記液晶表示パネルの各画素の階調を示す画素データを受け取るデータレジスタ回路と、
ラッチ信号に応答してデータレジスタ回路から前記画素データをラッチするラッチ回路と、
前記ラッチ回路から出力される前記画素データに対してデジタル−アナログ変換を行って前記画素データに対応する階調電圧を出力するD/A変換回路
とを具備し、
前記複数の出力バッファは、前記階調電圧に応答して前記駆動電圧を出力し、
前記検知回路は、
前記ラッチ信号に応答して前記極性信号又は前記極性信号の反転信号のいずれかをラッチする第1フリップフロップと、
前記ラッチ信号に応答して前記第1フリップフロップの出力信号をラッチする第2フリップフロップと、
前記第1フリップフロップにラッチされる信号と前記第2フリップフロップとを比較して前記極性信号反転信号を生成する比較器
とを備える
液晶表示装置。 The liquid crystal display device according to claim 9,
Furthermore,
A data register circuit for receiving pixel data indicating the gradation of each pixel of the liquid crystal display panel transferred serially from the outside;
A latch circuit that latches the pixel data from the data register circuit in response to a latch signal;
A D / A conversion circuit that performs digital-analog conversion on the pixel data output from the latch circuit and outputs a gradation voltage corresponding to the pixel data;
The plurality of output buffers output the driving voltage in response to the gradation voltage,
The detection circuit includes:
A first flip-flop that latches either the polarity signal or an inverted signal of the polarity signal in response to the latch signal;
A second flip-flop that latches the output signal of the first flip-flop in response to the latch signal;
A liquid crystal display device comprising: a comparator that compares the signal latched by the first flip-flop with the second flip-flop to generate the polarity signal inversion signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012197460A JP2014052535A (en) | 2012-09-07 | 2012-09-07 | Data line driver and liquid crystal display device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012197460A JP2014052535A (en) | 2012-09-07 | 2012-09-07 | Data line driver and liquid crystal display device |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2014052535A true JP2014052535A (en) | 2014-03-20 |
Family
ID=50611059
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2012197460A Pending JP2014052535A (en) | 2012-09-07 | 2012-09-07 | Data line driver and liquid crystal display device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2014052535A (en) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105807518A (en) * | 2016-05-19 | 2016-07-27 | 武汉华星光电技术有限公司 | Liquid crystal display panel |
CN108074514A (en) * | 2016-11-17 | 2018-05-25 | 元太科技工业股份有限公司 | Dot structure and driving method |
WO2020248998A1 (en) * | 2019-06-11 | 2020-12-17 | 惠科股份有限公司 | Charge sharing circuit and method for display panel, and display panel |
US10896650B2 (en) | 2016-06-01 | 2021-01-19 | Sharp Kabushiki Kaisha | Video signal line drive circuit, display device including same, and drive method for video signal line |
CN112581910A (en) * | 2019-09-29 | 2021-03-30 | 上海和辉光电有限公司 | Array substrate, display panel and display method |
-
2012
- 2012-09-07 JP JP2012197460A patent/JP2014052535A/en active Pending
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105807518A (en) * | 2016-05-19 | 2016-07-27 | 武汉华星光电技术有限公司 | Liquid crystal display panel |
CN105807518B (en) * | 2016-05-19 | 2019-01-01 | 武汉华星光电技术有限公司 | Liquid crystal display panel |
US10896650B2 (en) | 2016-06-01 | 2021-01-19 | Sharp Kabushiki Kaisha | Video signal line drive circuit, display device including same, and drive method for video signal line |
CN108074514A (en) * | 2016-11-17 | 2018-05-25 | 元太科技工业股份有限公司 | Dot structure and driving method |
CN108074514B (en) * | 2016-11-17 | 2020-11-13 | 元太科技工业股份有限公司 | Pixel structure and driving method |
WO2020248998A1 (en) * | 2019-06-11 | 2020-12-17 | 惠科股份有限公司 | Charge sharing circuit and method for display panel, and display panel |
US11450292B2 (en) | 2019-06-11 | 2022-09-20 | HKC Corporation Limited | Charge sharing circuit and method for liquid crystal display panel to improve display effect |
CN112581910A (en) * | 2019-09-29 | 2021-03-30 | 上海和辉光电有限公司 | Array substrate, display panel and display method |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US8063896B2 (en) | Liquid crystal display device, source driver, and method of driving a liquid crystal display panel | |
USRE39366E1 (en) | Liquid crystal driver and liquid crystal display device using the same | |
JP2020003802A (en) | Display device and driving method thereof | |
US8674976B2 (en) | Liquid crystal display capable of reducing power consumption and method for driving the same | |
US7710373B2 (en) | Liquid crystal display device for improved inversion drive | |
US8928639B2 (en) | Display device and driving method thereof | |
KR100791840B1 (en) | Source driver and display device having the same | |
US20100265234A1 (en) | Driver and display apparatus using the same | |
US6930664B2 (en) | Liquid crystal display | |
JP2012141609A (en) | Display driving circuit, display device including the same, and method of operating the display driving circuit | |
KR101329970B1 (en) | Liquid crystal display device | |
JP2008152076A (en) | Liquid crystal display device, source driver and method for driving liquid crystal display panel | |
JP2009009087A (en) | Liquid crystal display and driving method thereof | |
JP2006524365A (en) | Display system with frame buffer and power saving sequence | |
KR20150077807A (en) | Display Device Being Capable Of Driving In Low-Speed | |
US9024859B2 (en) | Data driver configured to up-scale an image in response to received control signal and display device having the same | |
JP2014052535A (en) | Data line driver and liquid crystal display device | |
KR100742668B1 (en) | Driver circuit for display device and display device | |
KR101261603B1 (en) | Display device | |
US7924258B2 (en) | Gate driving apparatus for preventing distortion of gate start pulse and image display device using the same and driving method thereof | |
KR20140042010A (en) | Display device and driving method thereof | |
KR100480180B1 (en) | Liquid crystal display apparatus driven 2-dot inversion type and method of dirving the same | |
JP2011150241A (en) | Display device, display panel drive, and method for driving display panel | |
JP2011209461A (en) | Liquid crystal display device | |
JP2016035488A (en) | Timing controller and display device using the same |