JP2013110161A5 - - Google Patents

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Description

本発明の一態様に係る素子形成用基板は、支持基板上に絶縁膜を介して接着されたGe層又はSiGe層を有する素子形成用基板であって、前記絶縁膜は、酸化膜、高誘電率絶縁膜、及び金属元素とGeとの金属化合物絶縁膜を含む複数の膜の積層構造であることを特徴とする。
また、本発明の別の一態様に係る素子形成用基板の製造方法は、Ge基板の表面上に金属元素とGeとの金属化合物絶縁膜を形成する工程と、前記金属化合物絶縁膜上に高誘電率絶縁膜を形成する工程と、前記金属化合物絶縁膜及び前記高誘電率絶縁膜が形成された前記Ge基板と表面に酸化膜が形成された支持基板とを、前記高誘電率絶縁膜と前記酸化膜とを接触させて接着する工程と、前記支持基板に接着された前記Ge基板を、該Ge基板の裏面側から研磨して薄くする工程と、を含むことを特徴とする。

Claims (8)

  1. 支持基板上に絶縁膜を介して接着されたGe層又はSiGe層を有する素子形成用基板であって、
    前記絶縁膜は、酸化膜、高誘電率絶縁膜、及び金属元素とGeとの金属化合物絶縁膜を含む複数の膜の積層構造であることを特徴とする素子形成用基板。
  2. 支持基板上に絶縁膜を介して接着されたGe層又はSiGe層を有する素子形成用基板であって、
    前記絶縁膜は、酸化膜、高誘電率絶縁膜、及びGe酸化膜を含む複数の膜の積層構造であることを特徴とする素子形成用基板。
  3. 前記酸化膜は、Si酸化膜であることを特徴とする請求項1又は2に記載の素子形成用基板。
  4. 前記支持基板は、Si基板であることを特徴とする請求項1乃至3のいずれかに記載の素子形成用基板。
  5. Ge基板の表面上に金属元素とGeとの金属化合物絶縁膜を形成する工程と、
    前記金属化合物絶縁膜上に高誘電率絶縁膜を形成する工程と、
    前記金属化合物絶縁膜及び前記高誘電率絶縁膜が形成された前記Ge基板と表面に酸化膜が形成された支持基板とを、前記高誘電率絶縁膜と前記酸化膜とを接触させて接着する工程と、
    前記支持基板に接着された前記Ge基板を、該Ge基板の裏面側から研磨して薄くする工程と、
    を含むことを特徴とする素子形成用基板の製造方法。
  6. Ge基板の表面上に高誘電率絶縁膜を形成する工程と、
    プラズマ酸化又は熱酸化により、前記Ge基板と前記高誘電率絶縁膜との間に、Ge酸化膜を形成する工程と、
    前記高誘電率絶縁膜及び前記Ge酸化膜が形成された前記Ge基板と表面に酸化膜が形成された支持基板とを、前記高誘電率絶縁膜と前記酸化膜とを接触させて接着する工程と、
    前記支持基板に接着された前記Ge基板を、該Ge基板の裏面側から研磨して薄くする工程と、
    を含むことを特徴とする素子形成用基板の製造方法。
  7. 前記酸化膜は、Si酸化膜であることを特徴とする請求項5又は6に記載の素子形成用基板の製造方法。
  8. 前記支持基板は、Si基板であることを特徴とする請求項5乃至7のいずれかに記載の素子形成用基板の製造方法。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106463416A (zh) * 2014-06-13 2017-02-22 英特尔公司 用于晶圆键合的表面包封
CN106611740B (zh) * 2015-10-27 2020-05-12 中国科学院微电子研究所 衬底及其制造方法
US11502106B2 (en) * 2020-02-11 2022-11-15 Globalfoundries U.S. Inc. Multi-layered substrates of semiconductor devices

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050252449A1 (en) * 2004-05-12 2005-11-17 Nguyen Son T Control of gas flow and delivery to suppress the formation of particles in an MOCVD/ALD system
FR2896619B1 (fr) * 2006-01-23 2008-05-23 Soitec Silicon On Insulator Procede de fabrication d'un substrat composite a proprietes electriques ameliorees
JP4504390B2 (ja) * 2007-02-27 2010-07-14 株式会社東芝 相補型半導体装置
JP4768788B2 (ja) * 2008-09-12 2011-09-07 株式会社東芝 半導体装置およびその製造方法
JP2010232568A (ja) * 2009-03-29 2010-10-14 Univ Of Tokyo 半導体デバイス及びその製造方法
JP5235784B2 (ja) * 2009-05-25 2013-07-10 パナソニック株式会社 半導体装置
US8557679B2 (en) * 2010-06-30 2013-10-15 Corning Incorporated Oxygen plasma conversion process for preparing a surface for bonding
US8772873B2 (en) * 2011-01-24 2014-07-08 Tsinghua University Ge-on-insulator structure and method for forming the same

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