JP2012090012A - 高周波用スイッチ回路 - Google Patents
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Abstract
【解決手段】第1および第2MOSFET回路11,21のゲート端子と第1および第2制御端子CT1,CT2との間に一端が接続され、他端がグランドGNDに接続されることにより、第1および第2制御端子CT1,CT2からグランドGNDへ向かう方向が順方向となるような少なくとも1つの整流素子D11,D12,D21,D22を含む第1および第2整流回路12,22と、第1および第2整流回路12,22の整流素子の少なくとも1つの順方向電流入力端子側と第1および第2MOSFET回路11,21の何れかの主端子側とが接続された接続部3とを備えている。
【選択図】図1
Description
まず、本発明の第1実施形態における高周波用スイッチ回路について説明する。図1は本発明の第1実施形態に係る高周波用スイッチ回路の概略構成を示す回路図である。図1に示すように、本実施形態におけるスイッチ回路1Aは、共通信号端子T3と第1信号端子T1との接続を制御する第1制御端子CT1の第1制御電圧VC1および/または共通信号端子T3と第2信号端子T2との接続を制御する第2制御端子CT2の第2制御電圧VC2を用いて第1信号端子T1および第2信号端子T2のうち共通信号端子T3と接続される信号端子T1,T2を切り替える高周波用スイッチ回路として構成されている。スイッチ回路1Aは、共通信号端子T3と第1信号端子T1との接続または非接続の切り替えを行う第1信号部S1と、共通信号端子T3と第2信号端子T2との接続または非接続の切り替えを行う第2信号部S2とを備えている。
次に、本発明の第2実施形態に係る高周波用スイッチ回路について説明する。図4は本発明の第2実施形態に係る高周波用スイッチ回路の概略構成を示す回路図である。本実施形態において第1実施形態と同様の構成については同じ符号を付し、説明を省略する。本実施形態におけるスイッチ回路1Bが第1実施形態と異なる点は、第2信号部S2と同じ構成を有し、共通信号端子T3と少なくとも1つ(本実施形態においては2つ)のさらなる信号端子(第3および第4信号端子T4,T5)との接続を切り替える少なくとも1つのさらなる信号部(第3および第4信号部S4,S5)を備えていることである。
次に、本発明の第3実施形態に係る高周波用スイッチ回路について説明する。図5は本発明の第3実施形態に係る高周波用スイッチ回路の概略構成を示す回路図である。本実施形態において第1実施形態と同様の構成については同じ符号を付し、説明を省略する。本実施形態におけるスイッチ回路1Cが第1実施形態と異なる点は、接続部として第1接続部3C1および第2接続部3C2を有し、第1接続部3C1が、第1整流回路12の整流素子の少なくとも1つの順方向電流入力端子側と第1MOSFET回路11の第1信号端子T1側の主端子(本実施形態においてはドレイン端子)とを接続し、かつ、第2接続部3C2が、第2整流回路22の整流素子の少なくとも1つの順方向電流入力端子側と第2MOSFET回路21の第2信号端子T2側の主端子(本実施形態においてはドレイン端子)とを接続するよう構成されていることである。より具体的には、図5に示すように、第1接続部3C1,3C2は、それぞれ第1および第2整流回路12,22の整流素子D11,D21のアノード端子と第1および第2MOSFET回路11,21のドレイン端子との間に設けられた第6抵抗素子38,39を有している。また、スイッチ回路1Cは、一端が第1および第2MOSFET回路11,21のソース端子に接続され、他端がグランドGNDに接続された第7抵抗素子40を有している。
次に、本発明の第4実施形態に係る高周波用スイッチ回路について説明する。以上の第1〜第3実施形態においては、信号部に整流回路が設けられ、オン信号である制御電圧が制御端子に印加された場合に、当該制御電圧から整流回路に設けられた少なくとも1つの整流素子によってグランドGNDの電位から当該整流素子の閾値電圧分だけクランプした電圧を取り出すこととしていたが、制御電圧の変動が無視できる場合等、抵抗回路のみでMOSFET素子の主端子に印加する電圧を設定できる場合には、必ずしも整流回路は必要ではない。図6は本発明の第4実施形態に係る高周波用スイッチ回路の概略構成を示す回路図である。本実施形態において第1実施形態と同様の構成については同じ符号を付し、説明を省略する。
3,3B,3C1,2C2,3D 接続部
11 第1MOSFET回路
12 第1整流回路
13,23 MOSFET素子
14,24 第1抵抗素子
15,25 第2抵抗素子
16,26 第3抵抗素子
21 第2MOSFET回路
22 第2整流回路
31 共通接続部
32,33 第4抵抗素子
34 共通抵抗回路
35,36 分圧抵抗素子
37 第5抵抗素子
38,39 第6抵抗素子
40 第7抵抗素子
41 第3MOSFET回路
42 第3整流回路
51 第4MOSFET回路
52 第4整流回路
CT1 第1制御端子
CT2 第2制御端子
CT4 第3制御端子
CT5 第4制御端子
D11,D12,D21,D22 整流素子
S1,S1D 第1信号部
S2,S2D 第2信号部
S4 第3信号部
S5 第4信号部
T1 第1信号端子
T2 第2信号端子
T3 共通信号端子
T4 第3信号端子
T5 第4信号端子
Claims (8)
- 共通信号端子と第1信号端子との接続を制御する第1制御端子に印加される第1制御電圧および/または前記共通信号端子と第2信号端子との接続を制御する第2制御端子に印加される第2制御電圧を用いて前記第1信号端子および前記第2信号端子のうち前記共通信号端子と接続される信号端子を切り替える高周波用スイッチ回路であって、
主端子の一方が前記共通信号端子に接続され、前記主端子の他方が前記第1信号端子に接続され、ゲート端子が前記第1制御端子に接続された第1MOSFET回路と、前記第1MOSFET回路のゲート端子と前記第1制御端子との間に一端が接続され、他端がグランドに接続されることにより、前記第1制御端子からグランドへ向かう方向が順方向となるような少なくとも1つの整流素子を含む第1整流回路と、を有する第1信号部と、
主端子の一方が前記共通信号端子に接続され、前記主端子の他方が前記第2信号端子に接続され、ゲート端子が前記第2制御端子に接続された第2MOSFET回路と、前記第2MOSFET回路のゲート端子と前記第2制御端子との間に一端が接続され、他端がグランドに接続されることにより、前記第2制御端子からグランドへ向かう方向が順方向となるような少なくとも1つの整流素子を含む第2整流回路と、を有する第2信号部と、
前記第1整流回路の整流素子の少なくとも1つの順方向電流入力端子側と前記第1MOSFET回路の何れかの主端子側とが接続され、かつ、前記第2整流回路の整流素子の少なくとも1つの順方向電流入力端子側と前記第2MOSFET回路の何れかの主端子側とが接続された接続部と、を備えた、高周波用スイッチ回路。 - 前記接続部は、前記第1整流回路の整流素子の少なくとも1つの順方向電流入力端子側と前記第2整流回路の整流素子の少なくとも1つの順方向電流入力端子側とが接続された共通接続部と、前記共通接続部と前記共通信号端子との間に設けられた共通抵抗回路と、を備えた、請求項1に記載の高周波用スイッチ回路。
- 前記共通抵抗回路は、前記接続部における電圧を分圧する分圧抵抗素子を有している、請求項2に記載の高周波用スイッチ回路。
- 前記第1整流回路および前記第2整流回路は、それぞれ、直列接続される少なくとも2つの整流素子を含み、前記接続部は、前記第1整流回路の互いに直列接続される2つの整流素子の間と前記第1MOSFET回路の何れかの主端子側とを接続し、かつ、前記第2整流回路の互いに直列接続される2つの整流素子の間と前記第2MOSFET回路のいずれかの主端子側とを接続するように構成される、請求項1に記載の高周波用スイッチ回路。
- 前記接続部は、前記第1整流回路の整流素子の少なくとも1つの順方向電流入力端子側と前記第1MOSFET回路の前記第1信号端子側の主端子とを接続し、かつ、前記第2整流回路の整流素子の少なくとも1つの順方向電流入力端子側と前記第2MOSFET回路の前記第2信号端子側の主端子とを接続するよう構成されている、請求項1に記載の高周波用スイッチ回路。
- 前記第1MOSFET回路および前記第2MOSFET回路は、それぞれ、MOSFET素子と、当該MOSFET素子の主端子間に設けられ、当該MOSFET素子に電流が流れないときに主端子間の電圧を一定にするための抵抗素子とを有する、請求項1に記載の高周波用スイッチ回路。
- 前記第2信号部と同じ構成を有し、前記共通信号端子と少なくとも1つのさらなる信号端子との接続を切り替える少なくとも1つのさらなる信号部を備えた請求項1に記載の高周波用スイッチ回路。
- 共通信号端子と第1信号端子との接続を制御する第1制御端子に印加される第1制御電圧および/または前記共通信号端子と第2信号端子との接続を制御する第2制御端子に印加される第2制御電圧を用いて前記第1信号端子および前記第2信号端子のうち前記共通信号端子と接続される信号端子を切り替える高周波用スイッチ回路であって、
主端子の一方が前記共通信号端子に接続され、前記主端子の他方が前記第1信号端子に接続され、ゲート端子が前記第1制御端子に接続された第1MOSFET回路と、
主端子の一方が前記共通信号端子に接続され、前記主端子の他方が前記第2信号端子に接続され、ゲート端子が前記第2制御端子に接続された第2MOSFET回路と、
前記第1MOSFET回路のゲート端子と前記第1制御端子との間に一端が接続される第1抵抗回路と、
前記第2MOSFET回路のゲート端子と前記第2制御端子との間に一端が接続される第2抵抗回路と、
前記第1抵抗回路の他端と前記第2抵抗回路の他端とが接続された共通接続部と、
前記共通接続部と前記共通信号端子との間に設けられた共通抵抗回路と、を備えた、高周波用スイッチ回路。
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