JP2011210758A - ウェハ接合半導体装置の製造方法 - Google Patents

ウェハ接合半導体装置の製造方法 Download PDF

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Abstract

【課題】低コストかつ簡便なプロセスにより、ウェハ接合時の反りを低減した、ウェハ接合半導体装置を提供する。
【解決手段】第1のウェハ基板1と第2のウェハ基板2を接合するウェハ接合半導体装置の製造方法において、予め第1のウェハ基板1と第2のウェハ基板2のウェハ接合面側に、加熱時に接合機能を有する接合部材3および5を形成する第1の工程と、第1の工程により形成された前記接合部材の表面に、反応性を有する少なくとも2つの粉体材料を含んだフラックスペースト4を供給する第2の工程と、第2の工程により供給された前記フラックスペースト4の反応を開始させるための励起を行う第3の工程とを含む、ウェハ接合半導体装置の製造方法。
【選択図】図2

Description

本発明は、ウェハ同士を接合するウェハレベルパッケージ(WLP:Wafer Level Package)の反りを低減するウェハ接合プロセスに関する。
半導体装置のパッケージング方法として、従来はモールド樹脂による樹脂封止が主流であったが、近年はパーケージコストの低減と同時に、パーケージサイズの小型化が可能なウェハレベルパッケージの適用が拡大している。ウェハレベルパッケージングでは、半導体ウェハとキャップウェハは各種方法により接合されている。この接合方法は大別して、ウェハ同士を直接接合する方法と、接合部材を用いてウェハ同士を接合する間接接合に分類される。直接接合の方法としては、陽極接合、常温接合等が知られている。間接接合の方法としては、接合部材として、はんだ材、低融点ガラスを用いた融着接合、もしくは接着樹脂を用いた接着接合が用いられている。
しかしながら、いずれの接合方法であろうとも加熱工程が必要となる。一般に、このような加熱が加えられた場合、半導体ウェハとキャップウェハを接合した基板(以下、接合基板と表記)は、半導体ウェハとキャップウェハの熱膨張係数差により大きく反ることとなる。この接合基板の反りは、製品の特性不良、製品ハンドリング不良に繋がる虞がある。
上記に示した接合基板の反りを低減する手法として、様々な接合プロセスが提案されている。
例えば特許文献1には、予めハーフカットが施された半導体ウェハ(もしくはキャップウェハ)をウェハ接合することにより、接合基板の反りを低減させるウェハ接合プロセスが記載されている。
また、特許文献2には、反応性フォイルの発熱反応を利用することにより、局所的かつ短時間の加熱でウェハ同士を接合させ、接合基板の反りを低減させるウェハ接合プロセスが記載されている。
特開2009−177034号公報 特表2009−530867号公報
しかしながら、特許文献1、特許文献2の技術ではコストまたは接合品質の点で問題が生じる。
特許文献1の接合プロセスでは、予めハーフカットが施された半導体ウェハ(もしくはキャップウェハ)を用いている。接合前にウェハにダイシング等で加工を施した場合、ウェハ表面がダイシング屑等で汚染される可能性が高くなる。このようなにウェハ表面が汚染されていると、ウェハ接合界面にその汚染異物が介在することとなる。この汚染異物は、ウェハ接合の強度、信頼性を損なうことに繋がる虞がある。また、ハーフダイシングが施されていることにより、ウェハ自体の強度が低下している。そのため、ウェハ接合時のハンドリングが困難となる虞がある。
また、特許文献2の接合プロセスでは、半導体ウェハとキャップウェハの間に反応性フォイルを介在させ、反応性フォイルの発熱により、予めウェハ表面に形成された接合部材を溶融させウェハ接合を行っている。このような、フォイル状のものが接合部材間に存在する場合、表面酸化が問題となる。上記接合部材としてはんだを考慮した場合、反応性フォイル表面に酸化膜が存在していると、反応性フォイルの反応熱により溶融したはんだは、反応性フォイルには濡れず、接合後のはんだ中にボイドが存在することとなる。このボイドの存在も同様に、ウェハ接合の強度、信頼性を損なうことに繋がる虞がある。この表面酸化膜の影響を回避する方法の一つとしては、接合前に反応性フォイルに表面処理(スパッタリング、フラックス塗布、ケミカルエッチング等)を施し、反応性フォイルの表面酸化膜を除去する必要がある。しかしながら、これら表面処理は工程の追加に繋がるため、低コストの観点から望ましいことではない。
本発明は、上記欠点を鑑みてなされたものであり、簡便なプロセスかつ低コストで、ウェハ接合時の反りの低減を実現し、かつ従来技術における欠点を克服することを目的としている。
上記課題を解決するために、本発明は特許請求の範囲に記載のとおり、ウェハ接合プロセスにおいて、反応性を有する少なくとも2つの粉体材料を含んだフラックスペーストを使用している点に最大の特徴がある。具体的には、第1のウェハ基板と第2のウェハ基板を接合するウェハ接合半導体装置の製造方法において、予め第1のウェハ基板と第2のウェハ基板のウェハ接合面側に、加熱時に接合機能を有する接合部材を形成する第1の工程と、第1の工程により形成された前記接合部材の表面に、反応性を有する少なくとも2つの粉体材料を含んだフラックスペーストを供給する第2の工程と、第2の工程により供給された前記フラックスペーストの反応を開始させるための励起を行う第3の工程とを含むことを特徴とするものである。
また、他の観点における本発明は第1のウェハ基板と、前記第1のウェハ基板上に搭載される機能素子と、第2のウエハ基板とを備え、前記第1のウェハ基板と前記第2のウェハ基板を接合することにより、前記機能素子が封止されるウェハ接合半導体装置の製造方法において、前記第1のウェハ基板上の前記機能素子が搭載される箇所に、加熱時に接合機能を有する接合部材を形成する第1の工程と、第1の工程により形成された前記接合部材の表面に、反応性を有する少なくとも2つの粉体材料を含んだフラックスペーストを供給する第2の工程と、第2の工程により供給された前記第1のフラックスペースト上に、前記機能素子を搭載する第3の工程と、第3の工程により供給された反応性を有する粉体材料を含んだ前記フラックスペーストの反応を開始させるための、励起を行う第4の工程とを含むことを特徴とするものである。
本発明による接合プロセスをとれば、低コストかつ簡便なプロセスにより、ウェハ接合時の反りを低減した、ウェハ接合半導体装置を提供することができる。
実施例1におけるウェハ接合構成を説明する図面である。 実施例1におけるウェハ接合プロセスを説明する図面である。 実施例1における反応性粉体材料を含んだフラックスペーストの構成例を説明する図面である。 実施例1における反応性粉体材料を含んだフラックスペーストの外部励起方法の一形態を説明する図面である。 実施例2におけるウェハ接合構成を説明する図面である。 実施例2におけるウェハ接合プロセスを説明する図面である。
以下、本発明の実施の形態について、図面を参照しながら説明をする。なお、実質同一部位には同じ参照番号を振り、説明は繰り返さない。
まず、本発明の実施例1について、図1から図4を用いて説明する。
図1は、実施例1におけるウェハ接合構成を説明する図面である。図2は、実施例1におけるウェハ接合プロセスを説明する断面図面である。図3は、実施例1における反応性粉体材料を含んだフラックスペーストの構成例を説明する図面である。図4は、実施例1における反応性粉体材料を含んだフラックスペーストの外部励起方法の一形態を説明する図面である。なお、図2および図4において、基板の上面と下面は同一断面ではなく展開断面図であることは、当事者が容易に読み取れるものである。これは以下の実施例でも同様である。
まず、図1を用いて実施例1におけるウェハ接合構成を説明する。
実施例1は、第1のウェハ基板1と第2のウェハ基板2をウェハ接合することを想定した実施例である。第1のウェハ基板1は、半導体装置の基板として最も用いられるSiウェハ(熱膨張係数:3.3ppm/K)である。第2のウェハ基板2は、光学デバイスへの適用を想定し、透光性を持つアモルファスガラス材料(熱膨張係数:3.3〜8.0ppm/K)を用いる。一般に、Siウェハとの接合を考えた場合、第2のウェハ基板2のガラス材料としてはホウ酸系ガラスが用いられる。これは、ホウ酸系ガラスの熱膨張係数がSiのそれと近いため、熱膨張係数差による基板の反りが問題となることがないためである。しかしながら、屈折率、透過率等の光学性質を重視した場合、ホウ酸系ガラスが必ずしも最適なガラス材料でないことがある。本実施例でも、第2のウェハ基板2は、ホウ酸系ガラス以外のアモルファスガラス材料である。
第1のウェハ基板1の表面には、第1のウェハ基板と第2のウェハ基板を接合するための接合部材3が存在している。本実施例では、接合部材3として蒸着はんだを予め、第1のウェハ基板1の表面に形成している。さらに、その接合部材3の上には、反応性粉体材料含有フラックスペースト4が供給されており、この反応性粉体材料含有フラックスペースト4が発熱反応した際の熱により、接合部材3に接合機能を発揮し、第1のウェハ基板1と第2のウェハ基板2が接合される構成となっている。
なお、第1のウェハ基板1は、Siに限られる必要はなく、InP、GaAs、SiC、SiGe、GaN等の他の半導体ウェハでもかまわない。さらに、第1のウェハ基板1は、半導体材料に限らず、ガラス材料、セラミック材料、金属材料等のほかの材質であってもかまわないことはいうまでもない。
また、第2のウェハ基板も同等に、ガラス材料に限らず、、半導体材料、セラミック材料、金属材料等のほかの材質であってもかまわない。
また、接合部材3は、蒸着はんだに限られる必要はなく、はんだペースト、熱硬化型接着剤等の加熱により接合機能を発揮する部材であってもかまわない。
次に、図2を用いて実施例1におけるウェハ接合プロセスを説明する。
まず、図2(a)で第1のウェハ基板1の第2のウェハ基板2との接合面側に加熱時に接合機能を有する接合部材5として蒸着はんだを形成する。なお、接合部材5として蒸着はんだ等のはんだ材料を用いる場合、第1のウェハ基板1の第2のウェハ基板2との接合面側には、はんだの濡れ性を確保するために金属メタライズ5が形成されている。この金属メタライズ5の構成は、Ni2〜5μmとAu0.05μmをめっきした積層構造となっている。なお、はんだ材料により接合を行う場合、接合後にはんだ材とAuの界面に金属間化合物が形成される。この金属間化合物は硬く応力緩衝効果が弱いため、衝撃等に対する接合の信頼性を低下させる。また、Auが残存するとその後の高温放置により金属間化合物がさらに成長し、はんだ中にカーケンダルボイドが発生し、信頼性および気密性が低下することが懸念される。そのため、Auめっき厚さは極力薄くすることが好適である。本実施例では、Auめっき厚さは0.05μmとしている。
次に図2(b)で反応性粉体材料含有フラックスペースト4を、図1(a)で第1のウェハ基板1上に形成された接合部材5(蒸着はんだ)上に供給する。本実施例では、反応性粉体材料含有フラックスペースト4の供給方法として、スピンコートによる塗布により供給を行っている。なお、反応性粉体材料含有フラックスペースト4の供給方法は、スピンコートに限らず、噴霧、スキージによる塗布等でもかまわない。本発明では、反応性材料がペースト状となっていることから供給方法の自由度は従来技術に比べ高くなっている点が、メリットの1つとなっている。反応性粉体材料含有フラックスペースト4の構成は、図3に示すように一般的にはんだ接合等で酸化膜除去のために用いられるフラックスペースト42中に、自己伝播合成反応(SHS:Self−Propagating High−Temperature Synthesis)を起こす少なくとも2つ以上の反応性粉体材料43、44が含有されている構成となっている。本実施例では、反応性粉体材料43、44としてそれぞれAl、Niを用いている。当然ながら、反応性粉体材料43、44はAl、Niにとらわれる必要はなく、TiとC、AlとTi等の自己伝播合成反応を起こす組み合わせであればよい。さらに、反応性粉体材料は2つの材料の組み合わせに限らず、自己伝播合成反応を起こす組み合わせであれば、それ以上の材料の組み合わせでよいことはいうまでもない。これは、以下の実施例でも同様である。
次に、図2(c)で第1のウェハ基板1と第2のウェハ基板2のウェハ合わせを行った後、外部励起6により、第1のウェハ基板1と第2のウェハ基板2の間に存在する反応性粉体材料含有フラックスペースト4の反応を開始させる。本実施例では、外部励起6としてレーザ励起を用いている。反応性粉体材料含有フラックスペースト4にレーザ光を照射することにより、反応性粉体材料含有フラックスペースト4に含有された反応性粉体材料43、44が反応を起こす。この反応は自己伝播合成反応であるため、一部が反応を起こすことで反応性粉体材料含有フラックスペースト4全体にその反応が伝播することとなる。その伝播速度は非常に速く、一般に1秒以下で反応は完了し、その際の発熱温度は1000℃以上となる。そのため、非常に少ない外部励起エネルギーかつ短時間で、ウェハ接合界面全体を加熱することが可能である。また、短時間で反応が完了するため、第1のウェハ基板1および第2のウェハ基板2の温度上昇が必要以上に大きくならず、第1のウェハ基板1および第2のウェハ基板2の熱膨張係数差に起因する接合基板の反りを低減させることが可能となる。
なお、外部励起6の方法としてはレーザ励起にとらわれる必要はなく、スパーク、電圧印加、加熱等、反応性粉体材料含有フラックスペースト4中の反応性粉体材料43、44が自己伝播合成を開始するものであればよいことは言うまでもない。ここで、レーザ励起、スパーク、電圧印加といった方法は、局所的に加熱することが可能なため、第1のウェハ基板1および第2のウェハ基板2の温度上昇を抑えることができるというメリットがある。一方、加熱であっても、自己伝播反応をするのに必要な量だけ加熱するものなので、反応熱による反りは少なくなる。図4に、外部励起方法の一形態を示す。図4では、第1のウェハ基板1と第2のウェハ基板2の間に電圧印加することにより、反応性粉体材料含有フラックスペースト4に電圧励起を加える。この電圧励起により、反応性粉体材料43、44が自己伝播合成を起こし、発熱を得るものである。本方法は、例えば陽極接合装置等のウェハ接合機構と電圧印加機構を備えた設備との整合性の高いプロセスであり、新たな設備投資を行わずに済む点と従来のウェハ接合プロセスを変更せずに済むという点にメリットがあるものである。
次に、図2(d)で上記反応性粉体材料含有フラックスペースト4の反応熱により、第1のウェハ基板1上に形成された接合部材3(蒸着はんだ)が溶融し、第1のウェハ基板1と第2のウェハ基板2が接合される。なお、第1のウェハ基板1と第2のウェハ基板2が接合された後のはんだ中には、自己伝播合成により合成された反応性粉体材料43、44の反応合成物41が残存することとなる。
以上、本実施例で説明したウェハ接合プロセスによれば、短時間で終了する反応性粉体材料含有フラックスペースト4中での自己伝播合成の発熱により、はんだ材料を溶融させていることから、ウェハ接合時における第1のウェハ基板1および第2のウェハ基板2の温度上昇を抑えることができる。換言すると、第1のウェハ基板1および第2のウェハ基板2の温度上昇が小さくなることから、第1のウェハ基板1および第2のウェハ基板2の熱膨張係数差に起因する接合基板の反りを低減させることが可能となる。
また、フラックスペースト内で自己伝播反応を起こしていることから、フラックスペーストによる酸化膜除去の効果が期待でき、ボイドおよび濡れ不良等のはんだ接合不良を回避することも可能となる。
また、付随されるメリットしては既述のとおり、反応性材料がペースト状となっていることによる供給方法の自由度向上、ならびに接合に要するエネルギー供給が非常に少ない点が挙げられる。
本発明の実施例2について、図5および図6を用いて説明する。図5は、実施例2におけるウェハ接合構成を説明する図面である。図6は、実施例2におけるウェハ接合プロセスを説明する図面である。
まず、図5を用いて実施例2におけるウェハ接合構成を説明する。
実施例2は、第1のウェハ基板1上に機能素子7が搭載され、第2のウェハ基板2をウェハ接合することで機能素子7を封止することを想定した実施例である。本実施例でも実施例1と同様に第1のウェハ基板1は、半導体装置の基板として最も用いられるSiウェハ(熱膨張係数:3.3ppm/K)である。第1のウェハ基板1上にはSi異方性エッチングにより台形凹部11が形成されている。台形凹部11には、機能素子7として面発光素子(VCSEL:Vertical Cavity Surface Emitting Laser)が搭載されている。第2のウェハ基板2は、VCSEL(機能素子7)からの光を透過させることを考慮し、アモルファスガラス材料(熱膨張係数:3.3〜8.0ppm/K)を用いている。
第1のウェハ基板1の表面には、第1のウェハ基板と第2のウェハ基板を接合するための接合部材3が存在している。本実施例でも、実施例1と同様に、接合部材3として蒸着はんだを予め、第1のウェハ基板1の表面に形成している。さらに、その接合部材3の上には、反応性粉体材料含有フラックスペースト4が供給されており、この反応性粉体材料含有フラックスペースト4が発熱反応した際の熱により、接合部材3に接合機能を発揮し、第1のウェハ基板1と第2のウェハ基板2がウェハ接合されることにより、機能素子7がパッケージングされ、ウェハレベルパッケージングされた光学デバイスモジュールが形成されている。
なお、機能素子7はVCSELにとらわれる必要はなく、フォトダイオード(PD:Photo Diode)等の受光素子でもかわない。さらに、機能素子7は光素子に限らず、論理IC、センサIC等でもかまわない。
機能素子7として、光素子を用いた場合、第2のウェハ基板2はガラス材料に限らず、機能素子7が発光または受光する波長の光が透過する材料であればかまわない。また、機能素子7が光素子でない場合は、ガラス材料、セラミック材料、金属材料等のほかの材質であってもかまわないことはいうまでもない。
なお、第1のウェハ基板1は、Siに限られる必要はなく、InP、GaAs、SiC、SiGe、GaN等の他の半導体ウェハでもかまわない。さらに、第1のウェハ基板1は、半導体材料に限らす、ガラス材料、セラミック材料、金属材料等のほかの材質であってもかまわないことはいうまでもない。
また、接合部材3は、蒸着はんだに限られる必要はなく、はんだペースト、熱硬化型接着剤等の加熱により接合機能を発揮する部材であってもかまわない。
次に、図6を用いて実施例1におけるウェハ接合プロセスを説明する。
まず、図6(a)で機能素子7が搭載される箇所である第1のウェハ基板1の台形凹部11に加熱により接合機能を有する接合部材5として蒸着はんだを形成する。本実施例でも実施例1と同様に、はんだの濡れ性を確保するために金属メタライズ5が形成されている。この金属メタライズ5の構成は、Ni2〜5μmとAu0.05μmをめっきした積層構造となっている。
次に図6(b)で反応性粉体材料含有フラックスペースト4を、図6(a)で第1のウェハ基板1の台形凹部11に形成された蒸着はんだ上に供給する。反応性粉体材料含有フラックスペースト4はディスペンスにより供給している。
次に、図6(c)(d)でフラックスペースト4が形成された第1のウェハ基板1の台形凹部11のフラックスペースト4上に機能素子7を搭載した後、外部励起6としてレーザ励起を行うことにより、図6(b)で供給した反応性粉体材料含有フラックスペースト4の自己伝播合成反応を起こす。本実施例でも実施例1と同様に、反応性粉体材料含有フラックスペースト4の構成は、図3に示すように一般的にはんだ接合等で酸化膜除去のために用いられるフラックスペースト42中に、自己伝播合成反応(SHS:Self−Propagating High−Temperature Synthesis)を起こす少なくとも2つ以上の反応性粉体材料43、44が含有されている構成となっている。その際の発熱により、図6(a)で供給した接合部材3(蒸着はんだ)を溶融させ、第1のウェハ基板1と機能素子7を接合する。なお、本工程の後、第1のウェハ基板1と機能素子7を接合するはんだ中には、自己伝播合成により合成された反応性粉体材料43、44の反応合成物41が残存することとなるが煩雑となるため、図6(d)には図示していない。
本実施例では、図6(a)〜(d)の工程を逐次繰り返すことにより、第1のウェハ基板に形成されたすべての台形凹部11に機能素子7を接合することとなる。
一般に、ウェハレベルパッケージングにより半導体装置を製造する場合、第1のウェハ基板1上に機能素子7を逐次搭載していくこととなる。この際、一般的にははんだ材料を用いて、機能素子7は第1のウェハ基板1に接合される。機能素子7の搭載位置ずれの許容度の大きい半導体装置では、はんだ材料としてはんだペーストを用いて機能素子7をすべて第1のウェハ基板1上に仮搭載した後に、リフロー炉を通すことにより接合を行う。
一方、機能素子7の搭載位置精度が要求される光学デバイスモジュールにウェハレベルパッケージングを適用する際は、搭載位置ずれが発生するリフロー炉は利用できない。そのため、熱圧着等で機能素子7を加熱し、はんだ材料を溶融させることにより、機能素子7を逐次接合していくほかなかった。しかしながら、この手法により機能素子7の逐次接合をすると、接合時の加熱が近接する機能素子7の搭載部に形成されたはんだ材料に影響を与える。最悪の場合、はんだ材料表面に酸化膜が形成され以降の機能素子7が接合できなくなる可能性がある。
しかしながら、本実施例の図6(a)〜(d)のプロセスでは、はんだ材料を溶融させる熱源として、反応性粉体材料含有フラックスペースト4の自己伝播合成反応時の発熱を利用しているため、局所的かつ短時間の加熱となる。そのため、近接する機能素子7の搭載部のはんだ材料への影響が極めて小さい方法であり、機能素子7の逐次搭載には好適な手法であるといえる。
本実施例では、第1のウェハ基板1の台形凹部11に機能素子7を逐次搭載した後、第1のウェハ基板1と第2のウェハ基板2をウェハ接合することにより、パッケージングを行う。第1のウェハ基板1と第2のウェハ基板2をウェハ接合方法は、実施例1と同様である。
具体的には、図6(e)で第1のウェハ基板1の第2のウェハ基板2との接合面側に加熱により接合機能を有する接合部材5として蒸着はんだを形成する。第1のウェハ基板1の第2のウェハ基板2との接合面側には、はんだの濡れ性を確保するために、Ni2〜5μmとAu0.05μmからなる金属メタライズ5が形成されている。
次に図6(f)で反応性粉体材料含有フラックスペースト4を、図6(e)で第1のウェハ基板1上に形成された蒸着はんだ上に供給する。本実施例でも、反応性粉体材料含有フラックスペースト4の供給方法として、スピンコートによる塗布により供給を行っている。また、ここでも実施例1と同様に、反応性粉体材料含有フラックスペースト4の構成は、図3に示すように一般的にはんだ接合等で酸化膜除去のために用いられるフラックスペースト42中に、自己伝播合成反応(SHS:Self−Propagating High−Temperature Synthesis)を起こす少なくとも2つ以上の反応性粉体材料43、44が含有されている構成となっている。
次に、図6(g)(h)で第1のウェハ基板1と第2のウェハ基板2のウェハ合わせを行った後、外部励起6により、第1のウェハ基板1と第2のウェハ基板2の間に存在する反応性粉体材料含有フラックスペースト4の反応を開始させる。この際の反応熱により、第1のウェハ基板1上に形成された蒸着はんだを溶融させ、第1のウェハ基板1と第2のウェハ基板2を接合させる。なお、本実施例でも外部励起6としてレーザ励起を用いているが、前述の図4のように第1のウェハ基板1と第2のウェハ基板2の間に電圧印加することにより外部励起を印加する方法でもかまわない。
以上、本実施例で説明したウェハ接合プロセスによれば、局所的かつ短時間の加熱で終了する反応性粉体材料含有フラックスペースト4中での自己伝播合成の発熱により、はんだ材料を溶融させていることから、近接する機能素子7の搭載部のはんだ材料への影響が極めて少なくなるため、機能素子7の逐次搭載が可能となる。
また、短時間で終了する反応性粉体材料含有フラックスペースト4中での自己伝播合成の発熱により、はんだ材料を溶融させていることから、ウェハ接合時における第1のウェハ基板1および第2のウェハ基板2の温度上昇を抑えることができる。換言すると、第1のウェハ基板1および第2のウェハ基板2の温度上昇が小さくなることから、第1のウェハ基板1および第2のウェハ基板2の熱膨張係数差に起因する接合基板の反りを低減させることが可能となる。
また、フラックスペースト内で自己伝播反応を起こしていることから、フラックスペーストによる酸化膜除去の効果が期待でき、ボイドおよび濡れ不良等のはんだ接合不良を回避することも可能となる。
また、付随されるメリットしては既述のとおり、反応性材料がペースト状となっていることによる供給方法の自由度向上、ならびに接合に要するエネルギー供給が非常に少ない点が挙げられる。
本発明は半導体装置の製造において、気密封止、ウェハレベルパッケージングを目的としたウェハ接合プロセスとして利用可能である。
1・・・第1のウェハ基板
12・・・台形凹部
2・・・第2のウェハ基板
3・・・接合部材
4・・・反応性粉体材料含有フラックスペースト
41・・・反応合成物
42・・・フラックスペースト
43・・・第1の反応性粉体材料
44・・・第2の反応性粉体材料
5・・・金属メタライズ
6・・・外部励起
7・・・機能素子

Claims (12)

  1. 第1のウェハ基板と第2のウェハ基板を接合するウェハ接合半導体装置の製造方法において、予め第1のウェハ基板と第2のウェハ基板のウェハ接合面側に、加熱時に接合機能を有する接合部材を形成する第1の工程と、
    第1の工程により形成された前記接合部材の表面に、反応性を有する少なくとも2つの粉体材料を含んだフラックスペーストを供給する第2の工程と、
    第2の工程により供給された前記フラックスペーストの反応を開始させるための励起を行う第3の工程とを含むウェハ接合半導体装置の製造方法。
  2. 前記フラックスペーストは自己伝播合成反応を起こすことを特徴とする請求項1に記載のウェハ接合半導体装置の製造方法。
  3. 前記第3の工程では、レーザ光を照射することにより励起を行う請求項1または2のいずれかに記載のウェハ接合半導体装置の製造方法。
  4. 第1のウェハ基板の接合部材を形成していない面と、第2のウェハ基板の接合部材を形成していない面の間に電圧印加することにより、前記フラックスペーストの反応を開始させ、前記第1のウェハ基板と前記第2のウェハ基板を接合することを特徴とする請求項1または2のいずれかに記載のウェハ接合半導体装置の製造方法。
  5. 第1のウェハ基板と、
    前記第1のウェハ基板上に搭載される機能素子と、
    第2のウエハ基板とを備え、
    前記第1のウェハ基板と前記第2のウェハ基板を接合することにより、前記機能素子が封止されるウェハ接合半導体装置の製造方法において、
    前記第1のウェハ基板上の前記機能素子が搭載される箇所に、加熱時に接合機能を有する接合部材を形成する第1の工程と、
    前記第1の工程により形成された前記接合部材の表面に、反応性を有する少なくとも2つの粉体材料を含んだフラックスペーストを供給する第2の工程と、
    前記第2の工程により供給された前記フラックスペースト上に、前記機能素子を搭載する第3の工程と、
    前記第3の工程により供給された前記フラックスペーストの反応を開始させるための励起を行う第4の工程とを含むウェハ接合半導体装置の製造方法。
  6. 前記第4の工程後に、前記第1のウェハ基板と前記第2のウェハ基板のウェハ接合面側に、加熱時に接合機能を有する接合部材を形成する第5の工程と、
    前記第5の工程により形成された前記接合部材の表面に、前記フラックスペーストを供給する第6の工程と、
    前記第6の工程により供給された前記フラックスペーストの反応を開始させるための励起を行う第7の工程とを含む請求項5に記載のウェハ接合半導体装置の製造方法。
  7. 前記機能素子は発光素子または受光素子であり、前記第2のウエハ基板は光を透過する材料であることを特徴とする請求項5または6のいずれかに記載のウエハ接合半導体装置の製造方法。
  8. 前記フラックスペーストは自己伝播合成反応を起こすことを特徴とする請求項5または6のいずれかに記載のウェハ接合半導体装置の製造方法。
  9. 前記第4の工程または前記第7の工程では、レーザ光を照射することにより励起を行う請求項5乃至8のいずれかに記載のウェハ接合半導体装置の製造方法。
  10. 第1のウェハ基板の接合部材を形成していない面と、第2のウェハ基板の接合部材を形成していない面の間に電圧印加することにより、前記フラックスペーストの反応を開始させ、前記第1のウェハ基板と前記第2のウェハ基板を接合することを特徴とする請求項5乃至8のいずれかに記載のウェハ接合半導体装置の製造方法。
  11. 前記反応性を有する少なくとも2つの粉体材料が、
    アルミニウムとニッケル、
    または、アルミニウムとチタン、
    または、チタンと炭素、
    であることを特徴とする
    請求項1乃至10のいずれかに記載のウェハ接合半導体装置の製造方法。
  12. 前記加熱時に接合機能を有する接合部材として、蒸着はんだを用いていることを特徴とする請求項1乃至11のいずれかに記載のウェハ接合半導体装置の製造方法。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR101526278B1 (ko) * 2012-12-21 2015-06-05 제일모직주식회사 경화 필름과 도전 필름을 포함하는 분리형 이방 도전성 필름
US20160121395A1 (en) * 2013-05-23 2016-05-05 Hitachi, Ltd. Reactive powder, bonding material using reactive powder, bonded body bonded with bonding material and method for producing bonded body
JP6315262B2 (ja) 2014-06-12 2018-04-25 ソニー株式会社 固体撮像素子、固体撮像素子の製造方法、及び、撮像装置
US9728934B2 (en) 2015-08-31 2017-08-08 Avago Technologies General Ip (Singapore) Pte. Ltd. Back-side-emitting vertical cavity surface emitting laser (VCSEL) wafer bonded to a heat-dissipation wafer, devices and methods
US10290594B2 (en) * 2016-07-28 2019-05-14 International Business Machines Corporation Fragmenting computer chips
KR102609312B1 (ko) 2016-09-13 2023-12-01 삼성전자주식회사 웨이퍼 워피지 개선 장치 및 방법
US10410892B2 (en) * 2016-11-18 2019-09-10 Taiwan Semiconductor Manufacturing Company Ltd. Method of semiconductor wafer bonding and system thereof
JP6899293B2 (ja) * 2017-09-13 2021-07-07 株式会社ディスコ 積層ウェーハの製造方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6245465A (ja) * 1985-08-26 1987-02-27 Oki Electric Ind Co Ltd 半田付け方法
JPH07136795A (ja) * 1993-11-16 1995-05-30 Showa Denko Kk はんだペースト
JPH09300094A (ja) * 1996-05-10 1997-11-25 Omron Corp 半田付け材料、並びに、それを用いた接合方法及び装置
JP2007324465A (ja) * 2006-06-02 2007-12-13 Nissan Motor Co Ltd 半導体パッケージおよびその製造方法、半導体パッケージ集合体

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3325000B2 (ja) * 1999-05-28 2002-09-17 ソニーケミカル株式会社 半導体素子の実装方法
KR100442830B1 (ko) * 2001-12-04 2004-08-02 삼성전자주식회사 저온의 산화방지 허메틱 실링 방법
US7098072B2 (en) * 2002-03-01 2006-08-29 Agng, Llc Fluxless assembly of chip size semiconductor packages
US20040232535A1 (en) * 2003-05-22 2004-11-25 Terry Tarn Microelectromechanical device packages with integral heaters
US6933171B2 (en) * 2003-10-21 2005-08-23 Intel Corporation Large bumps for optical flip chips
JP2005183904A (ja) * 2003-12-22 2005-07-07 Rohm & Haas Electronic Materials Llc 電子部品にはんだ領域を形成する方法及びはんだ領域を有する電子部品
US7750356B2 (en) * 2005-05-04 2010-07-06 Avago Technologies Fiber Ip (Singapore) Pte. Ltd. Silicon optical package with 45 degree turning mirror
CN101394997A (zh) 2006-03-24 2009-03-25 派克汉尼芬公司 反应性箔组合件
JP5091696B2 (ja) 2008-01-26 2012-12-05 株式会社フジクラ 半導体パッケージの製造方法

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6245465A (ja) * 1985-08-26 1987-02-27 Oki Electric Ind Co Ltd 半田付け方法
JPH07136795A (ja) * 1993-11-16 1995-05-30 Showa Denko Kk はんだペースト
JPH09300094A (ja) * 1996-05-10 1997-11-25 Omron Corp 半田付け材料、並びに、それを用いた接合方法及び装置
JP2007324465A (ja) * 2006-06-02 2007-12-13 Nissan Motor Co Ltd 半導体パッケージおよびその製造方法、半導体パッケージ集合体

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015213026A (ja) * 2014-05-06 2015-11-26 公立大学法人兵庫県立大学 自己伝播発熱性形成体、自己伝播発熱性形成体の製造装置及び製造方法

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