JP2011188092A - クロック乗せ換え回路、及びクロック乗せ換え方法 - Google Patents
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Abstract
【解決手段】クロック乗せ換え回路は、第1のクロック信号に同期した信号波の値を示す時系列の複数の入力データをタップにて保持し、タップ係数指定手段により指定された複数のタップ係数をタップに保持している該複数の入力データのそれぞれに乗算し、各タップの乗算の結果を加算して得られたデータを出力データとして第2のクロック信号に同期して複数の出力データを出力する複数段のタップと、第1のクロック信号に対する第2のクロック信号の位相遅れを位相差として第2のクロック信号に同期して取得し、第2のクロック信号の該位相差を取得したタイミングにおける信号波の値を前記タップに保持されている入力データに基づいて算出するためのタップ係数を、位相差に応じて第2のクロック信号に同期して指定するタップ係数指定手段と、を有する。
【選択図】図1
Description
10 位相比較部
20 デジタルフィルタ部
11 TAP係数指定部
12 不整合判断部
111 クロック逓倍回路
112 CLK Aパルス生成回路
113 Nビット自走カウンタ
114 Nビットカウンタ
115、121 ラッチレジスタ
122 比較回路
1121、1122、1123 フリップフロップ
1124 インバータ
1125 ANDゲート
201 制御部
2011 TAP係数テーブル
2021、2022 フリップフロップ
2031、2032 乗算器
2041 加算器
Claims (9)
- 第1のクロック信号に同期した信号波の値を示す時系列の複数の入力データをタップにて保持し、タップ係数指定手段により指定された複数のタップ係数を前記タップに保持している該複数の入力データのそれぞれに乗算し、前記各タップの乗算の結果を加算して得られたデータを出力データとして、第2のクロック信号に同期して複数の出力データを出力する複数段のタップと、
前記第1のクロック信号に対する前記第2のクロック信号の位相遅れを位相差として該第2のクロック信号に同期して取得し、前記第2のクロック信号の該位相差を取得したタイミングにおける前記信号波の値を前記タップに保持されている入力データに基づいて算出するためのタップ係数を、前記位相差に応じて、前記第2のクロック信号に同期して指定するタップ係数指定手段と、
を有するクロック乗せ換え回路。 - 前記クロック乗せ換え回路は、位相差ごとに、異なる組み合わせの複数のタップ係数を記載した複数のテーブルを更に有し、
前記タップ係数指定手段は、取得した前記位相差に対応する前記テーブルを指定し、
前記複数段のタップは、前記タップ係数指定手段により指定された前記テーブルに記載された組み合わせの各タップ係数を前記複数の入力データのそれぞれに乗算する、請求項1に記載のクロック乗せ換え回路。 - 前記クロック乗せ換え回路は、
前記タップ係数指定手段により取得された前記位相差に基づいて、出力データのデータ飛びが生じる場合にデータ飛び通知信号を出力する制御信号出力手段を更に有し、
前記乗せ換え手段は、
前記制御信号出力手段により前記データ飛び通知信号が出力されたならば、タップ係数を切り替えることにより、1つの入力データに異なる2つのタップ係数を乗算する、請求項1又は2に記載のクロック乗せ換え回路。 - 前記制御信号出力手段は、
前記タップ係数指定手段により取得された前記位相差に基づいて、同一の出力データの重複出力が生じる場合に重複出力通知信号を更に出力し、
前記乗せ換え手段は、
前記制御信号出力手段により前記重複出力通知信号が出力されたならば、2つの入力データに対し、1つの出力データを出力する、請求項3に記載のクロック乗せ換え回路。 - 前記タップ係数指定手段は、
前記第2のクロック信号を、所定の逓倍数で逓倍して逓倍クロック信号を生成する逓倍手段と、
前記第1のクロック信号のパルス幅を、前記逓倍手段により生成された前記逓倍クロック信号のパルス幅に変調するパルス幅変調手段と、
前記パルス幅変調手段により変調された前記第1のクロック信号に応じて初期値から計数を開始し、前記逓倍手段により生成された前記逓倍クロック信号に同期して、最大値まで計数する第1の計数手段と、
前記第2のクロック信号に同期して前記初期値から計数を開始し、前記逓倍手段により生成された前記逓倍クロック信号に同期して、前記最大値まで計数する第2の計数手段と、
前記第1の計数手段により計数された前記計数値を前記位相差として保持し、該位相差に応じたタップ係数を指定し、前記第2の計数手段により計数された前記計数値が所定値となったとき、保持した該位相差を更新する第1の保持手段と、
を有する、請求項4に記載のクロック乗せ換え回路。 - 前記制御信号出力手段は、
前記第1の保持手段により保持された前記計数値を保持し、前記第2の計数手段により保持された前記計数値が前記所定値となったとき、保持する該計数値を更新する第2の保持手段と、
前記第1の保持手段により保持された前記計数値と、前記第2の保持手段により保持された前記計数値とに基づいて、前記データ飛び通知信号を出力する制御信号出力回路と、
を有する請求項5に記載のクロック乗せ換え回路。 - 前記比較手段は、前記第1の保持手段により保持された計数値が前記初期値であり、且つ、前記第2の保持手段により保持された計数値が前記最大値であれば、前記データ飛び通知信号を出力する、請求項6に記載のクロック乗せ換え回路。
- 前記比較手段は、前記第1の保持手段により保持された計数値が前記最大値であり、且つ、前記第2の保持手段により保持された計数値が前記初期値であれば、前記重複出力通知信号を出力する、請求項6又は7に記載のクロック乗せ換え回路。
- タップ係数指定手段が、前記第1のクロック信号に対する第2のクロック信号の位相遅れを位相差として該第2のクロック信号に同期して取得し、前記第2のクロック信号の該位相差を取得したタイミングにおける前記信号波の値を前記タップに保持されている入力データに基づいて算出するためのタップ係数を、前記位相差に応じて、前記第2のクロック信号に同期して指定し、
複数段のタップが、前記第1のクロック信号に同期した信号波の値を示す時系列の複数の入力データをタップにて保持し、タップ係数指定手段により指定された複数のタップ係数を前記タップに保持している該複数の入力データのそれぞれに乗算し、前記各タップの乗算の結果を加算して得られたデータを出力データとして、前記第2のクロック信号に同期して複数の出力データを出力する、クロック乗せ換え方法。
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