JP2011090241A - 表示装置、及び、表示装置の駆動方法 - Google Patents
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Abstract
【解決手段】各表示素子行群を構成する複数の表示素子行の数Qと単位時間t0との積によって表される期間TQにおいて、表示素子行群を構成するQ×N個の表示素子に対して、閾値電圧キャンセル処理を、表示素子行単位で行い、次いで、表示素子行を構成するN個の表示素子に対して映像信号を駆動トランジスタのゲート電極に印加する書込み処理を、Q回、順次行う表示装置の駆動方法であって、期間TQの半分を超えない期間内に書込み処理を、Q回、順次行うと共に、表示素子行群を構成する各表示素子行における閾値電圧キャンセル処理の終了から書込み処理の開始までの期間の長さが一定となるように、閾値電圧キャンセル処理を行う。
【選択図】 図5
Description
駆動回路及び電流駆動型の発光部を有する表示素子が、行方向と列方向とに2次元マトリクス状に配列されて成り、
駆動回路は、ゲート電極とソース/ドレイン領域とを有する駆動トランジスタを少なくとも備えており、駆動トランジスタのソース/ドレイン領域を介して発光部に電流が流れる表示装置に関する。
表示素子の行数をMとし、各行を構成する表示素子の数をNとし、第1行から第M行までの表示素子を行毎に走査する全時間をMで除した時間を単位時間t0としたとき、
M行の表示素子を複数の表示素子行群に分け、各表示素子行群を構成する複数の表示素子行の数Qと単位時間t0との積によって表される期間TQにおいて、
表示素子行群を構成するQ×N個の表示素子に対して、所定の基準電圧を駆動トランジスタのゲート電極に印加すると共に一方のソース/ドレイン領域に所定の駆動電圧を印加し、以て、他方のソース/ドレイン領域の電位を基準電圧から駆動トランジスタの閾値電圧を減じた電位に向かって変化させる閾値電圧キャンセル処理を、表示素子行単位で行い、次いで、
表示素子行を構成するN個の表示素子に対して映像信号を駆動トランジスタのゲート電極に印加する書込み処理を、Q回、順次行う表示装置の駆動方法であって、
期間TQの半分を超えない期間内に書込み処理を、Q回、順次行うと共に、表示素子行群を構成する各表示素子行における閾値電圧キャンセル処理の終了から書込み処理の開始までの期間の長さが一定となるように、閾値電圧キャンセル処理を行う表示装置の駆動方法である。
表示素子の行数をMとし、各行を構成する表示素子の数をNとし、第1行から第M行までの表示素子を行毎に走査する全時間をMで除した時間を単位時間t0としたとき、
M行の表示素子を複数の表示素子行群に分け、各表示素子行群を構成する複数の表示素子行の数Qと単位時間t0との積によって表される期間TQにおいて、
表示素子行群を構成するQ×N個の表示素子に対して、所定の基準電圧を駆動トランジスタのゲート電極に印加すると共に一方のソース/ドレイン領域に所定の駆動電圧を印加し、以て、他方のソース/ドレイン領域の電位を基準電圧から駆動トランジスタの閾値電圧を減じた電位に向かって変化させる閾値電圧キャンセル処理が、表示素子行単位で行われ、次いで、
表示素子行を構成するN個の表示素子に対して映像信号を駆動トランジスタのゲート電極に印加する書込み処理が、Q回、順次行われる表示装置であって、
期間TQの半分を超えない期間内に書込み処理が、Q回、順次行われると共に、表示素子行群を構成する各表示素子行における閾値電圧キャンセル処理の終了から書込み処理の開始までの期間の長さが一定となるように、閾値電圧キャンセル処理が行われる表示装置である。
1.本発明の表示装置、及び、本発明の表示装置の駆動方法、全般に関する説明
2.実施例
本発明の表示装置、及び、本発明の表示装置の駆動方法(以下、これらを総称して、単に、本発明と呼ぶ場合がある)にあっては、M行の表示素子を複数の表示素子行群に分ける。表示素子行群を構成する複数の表示素子行は、隣接して配置されていてもよいし、複数の表示素子行の全てあるいはその一部は離間して配置されている構成であってもよい。表示装置における制御の容易性といった観点等からは、複数の表示素子行は、隣接して配置されている構成が好ましい。
駆動回路は、走査線に接続されたゲート電極と、データ線に接続された一方のソース/ドレイン領域と、駆動トランジスタのゲート電極に接続された他方のソース/ドレイン領域とを有する書込みトランジスタを更に備えており、
走査線からの走査信号に基づいて書込みトランジスタを導通状態とし、データ線から映像信号及び所定の基準電圧を駆動トランジスタのゲート電極に印加する構成とすることができる。
発光部は、駆動トランジスタの他方のソース/ドレイン領域に接続されており、
各書込み処理の後、駆動トランジスタのゲート電極への映像信号の印加が停止されることによって、容量部に保持された電圧の値に応じた電流が駆動トランジスタのソース/ドレイン領域を介して発光部に流れる構成とすることができる。
駆動トランジスタの一方のソース/ドレイン領域は給電線に接続されており、給電線から所定の駆動電圧を駆動トランジスタの一方のソース/ドレイン領域に印加する構成とすることができる。
μ :実効的な移動度
L :チャネル長
W :チャネル幅
Vgs:ゲート電極とソース領域との間の電位差
Vth:閾値電圧
Cox:(ゲート絶縁層の比誘電率)×(真空の誘電率)/(ゲート絶縁層の厚さ)
k≡(1/2)・(W/L)・Cox
とする。
=ta+(Q−1)×(ta−tb) (A)
・・・1ボルト(黒表示)〜8ボルト(白表示)
VCC-H :発光部ELPに電流を流すための駆動電圧
・・・20ボルト
VCC-L :第2ノード初期化電圧
・・・−10ボルト
VOfs :駆動トランジスタTRDのゲート電極の電位(第1ノードND1の電位)を初期
化するための基準電圧
・・・0ボルト
Vth :駆動トランジスタTRDの閾値電圧
・・・3ボルト
VCat :発光部ELPのカソード電極に印加される電圧
・・・0ボルト
Vth-EL:発光部ELPの閾値電圧
・・・3ボルト
この[期間−TP(2)-1]は、例えば、前の表示フレームにおける動作であり、前回の各種の処理完了後に第[p,q]行の表示素子10が発光状態にある期間である。即ち、第[p,q]行、第n列目の副画素を構成する表示素子10における発光部ELPには、後述する式(5)に基づくドレイン電流I’dsが流れており、第[p,q]行、第n列目の副画素を構成する表示素子10の輝度は、係るドレイン電流I’dsに対応した値である。ここで、書込みトランジスタTRWは非導通状態であり、駆動トランジスタTRDは導通状態である。第[p,q]行の表示素子10の発光状態は、発光期間の長さが一定となるように継続される。図6に示す例では、第p’番目の表示素子行群に対応する期間TQ(便宜のため、TQ(p’)と表す)における、第[p’,q]行の表示素子行DLに対応する映像信号VSig_[p',q]がデータ線DTLに印加される期間の終期まで継続される。
この[期間−TP(2)0]は、例えば、前の表示フレームから現表示フレームにおける動作である。即ち、この[期間−TP(2)0]は、前の表示フレームにおける、第[p’,q+1]行の表示素子行DLに対応する映像信号VSig_[p',q+1]の印加の始期から、現表示フレームにおける期間TQ(p)の始期までの期間である。そして、この[期間−TP(2)0]において、第[p,q]行の表示素子10は、原則として非発光状態にある。[期間−TP(2)0]の始期において、電源部100から給電線PS1[p,q]に供給される電圧が駆動電圧VCC-Hから第2ノード初期化電圧VCC-Lに切り替えられる。その結果、第2ノードND2の電位はVCC-Lまで低下し、発光部ELPのアノード電極とカソード電極との間に逆方向電圧が印加され、発光部ELPは非発光状態となる。また、第2ノードND2の電位低下に倣うように、第1ノードND1(駆動トランジスタTRDのゲート電極)の電位も低下する。
そして、現表示フレームにおける期間TQ(p)が開始する。データ線DTLnの電圧が、前期間TQ(p−1)における映像信号から、基準電圧VOfsに切り替わる。
この[期間−TP(2)2]は、図4に示す閾値電圧キャンセル処理を行う期間に相当する。この期間の長さは、図4を参照して説明したように、ta’=ta+(Q−1)×(ta−tb)である。そして、基準電圧VOfsを駆動トランジスタTRDのゲート電極に印加すると共に一方のソース/ドレイン領域に所定の駆動電圧を印加し、以て、他方のソース/ドレイン領域の電位を基準電圧VOfsから駆動トランジスタTRDの閾値電圧Vthを減じた電位に向かって変化させる閾値電圧キャンセル処理を、表示素子行単位で行う。
この[期間−TP(2)3]は、図4を参照して説明した「待ち期間」に相当する。この期間の長さは、図4を参照して説明したように、(Q−1)×tbである。[期間−TP(2)3]の開始時、走査線SCL[p,q]をローレベルとすることによって、書込みトランジスタTRWを非導通状態とする(図8の(A))。
第[p,q]行の表示素子行DLに対応する映像信号VSig_[p,q]がデータ線DTLnに印加されるこの期間内に、書込み処理を行う。走査線SCL[p,q]からの走査信号により書込みトランジスタTRWを導通状態とする。そして、書込みトランジスタTRWを介して、データ線DTLnから映像信号VSig_[p,q]を第1ノードND1に印加する。その結果、第1ノードND1の電位はVSig_[p,q]へと上昇する。駆動トランジスタTRDは導通状態である。
Vs ≒VOfs−Vth+ΔVW
Vgs≒VSig_[p,q]−(VOfs−Vth+ΔVW) (3)
書込み処理の後、駆動トランジスタTRDのゲート電極への映像信号の印加が停止されることによって、容量部C1に保持された電圧の値に応じた電流が駆動トランジスタTRDのソース/ドレイン領域を介して発光部ELPに流れる。
Claims (8)
- 駆動回路及び電流駆動型の発光部を有する表示素子が、行方向と列方向とに2次元マトリクス状に配列されて成り、
駆動回路は、ゲート電極とソース/ドレイン領域とを有する駆動トランジスタを少なくとも備えており、駆動トランジスタのソース/ドレイン領域を介して発光部に電流が流れる表示装置を用いて、
表示素子の行数をMとし、各行を構成する表示素子の数をNとし、第1行から第M行までの表示素子を行毎に走査する全時間をMで除した時間を単位時間t0としたとき、
M行の表示素子を複数の表示素子行群に分け、各表示素子行群を構成する複数の表示素子行の数Qと単位時間t0との積によって表される期間TQにおいて、
表示素子行群を構成するQ×N個の表示素子に対して、所定の基準電圧を駆動トランジスタのゲート電極に印加すると共に一方のソース/ドレイン領域に所定の駆動電圧を印加し、以て、他方のソース/ドレイン領域の電位を基準電圧から駆動トランジスタの閾値電圧を減じた電位に向かって変化させる閾値電圧キャンセル処理を、表示素子行単位で行い、次いで、
表示素子行を構成するN個の表示素子に対して映像信号を駆動トランジスタのゲート電極に印加する書込み処理を、Q回、順次行う表示装置の駆動方法であって、
期間TQの半分を超えない期間内に書込み処理を、Q回、順次行うと共に、表示素子行群を構成する各表示素子行における閾値電圧キャンセル処理の終了から書込み処理の開始までの期間の長さが一定となるように、閾値電圧キャンセル処理を行う表示装置の駆動方法。 - 表示素子行群を構成する各表示素子行において閾値電圧キャンセル処理を行う期間の長さは一定である請求項1に記載の表示装置の駆動方法。
- 表示装置は、更に、行方向に延びる複数の走査線と、列方向に延びる複数のデータ線とを備えており、
駆動回路は、走査線に接続されたゲート電極と、データ線に接続された一方のソース/ドレイン領域と、駆動トランジスタのゲート電極に接続された他方のソース/ドレイン領域とを有する書込みトランジスタを更に備えており、
走査線からの走査信号に基づいて書込みトランジスタを導通状態とし、データ線から映像信号及び所定の基準電圧を駆動トランジスタのゲート電極に印加する請求項1に記載の表示装置の駆動方法。 - 駆動トランジスタの一方のソース/ドレイン領域に所定の駆動電圧を印加している状態で書込み処理を行い、以て、駆動トランジスタの他方のソース/ドレイン領域の電位を変化させる請求項1に記載の表示装置の駆動方法。
- 駆動回路は、駆動トランジスタの他方のソース/ドレイン領域に接続された一方の電極と、駆動トランジスタのゲート電極に接続された他方の電極とを有する容量部を更に備えており、
発光部は、駆動トランジスタの他方のソース/ドレイン領域に接続されており、
各書込み処理の後、駆動トランジスタのゲート電極への映像信号の印加が停止されることによって、容量部に保持された電圧の値に応じた電流が駆動トランジスタのソース/ドレイン領域を介して発光部に流れる請求項4に記載の表示装置の駆動方法。 - 表示装置は、更に、行方向に延びる複数の給電線を備えており、
駆動トランジスタの一方のソース/ドレイン領域は給電線に接続されており、給電線から所定の駆動電圧を駆動トランジスタの一方のソース/ドレイン領域に印加する請求項1乃至請求項5のいずれか1項に記載の表示装置の駆動方法。 - 発光部は有機エレクトロルミネッセンス発光部から成る請求項1に記載の表示装置の駆動方法。
- 駆動回路及び電流駆動型の発光部を有する表示素子が、行方向と列方向とに2次元マトリクス状に配列されて成り、
駆動回路は、ゲート電極とソース/ドレイン領域とを有する駆動トランジスタを少なくとも備えており、駆動トランジスタのソース/ドレイン領域を介して発光部に電流が流れ、
表示素子の行数をMとし、各行を構成する表示素子の数をNとし、第1行から第M行までの表示素子を行毎に走査する全時間をMで除した時間を単位時間t0としたとき、
M行の表示素子を複数の表示素子行群に分け、各表示素子行群を構成する複数の表示素子行の数Qと単位時間t0との積によって表される期間TQにおいて、
表示素子行群を構成するQ×N個の表示素子に対して、所定の基準電圧を駆動トランジスタのゲート電極に印加すると共に一方のソース/ドレイン領域に所定の駆動電圧を印加し、以て、他方のソース/ドレイン領域の電位を基準電圧から駆動トランジスタの閾値電圧を減じた電位に向かって変化させる閾値電圧キャンセル処理が、表示素子行単位で行われ、次いで、
表示素子行を構成するN個の表示素子に対して映像信号を駆動トランジスタのゲート電極に印加する書込み処理が、Q回、順次行われる表示装置であって、
期間TQの半分を超えない期間内に書込み処理が、Q回、順次行われると共に、表示素子行群を構成する各表示素子行における閾値電圧キャンセル処理の終了から書込み処理の開始までの期間の長さが一定となるように、閾値電圧キャンセル処理が行われる表示装置。
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