JP2010205803A - Method of manufacturing wiring board - Google Patents
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Abstract
Description
本発明は、半導体素子等の電子部品を搭載するために用いられる配線基板の製造方法に
関するものである。
The present invention relates to a method for manufacturing a wiring board used for mounting electronic components such as semiconductor elements.
近年、半導体素子等の電子部品を搭載するために用いられる配線基板は、その小型化、
薄型化がますます求められており、そのため配線基板における配線パターンも微細かつ高
密度なものが要求されている。このような微細で高密度の配線パターンを実現する方法と
してフルアディティブ法やセミアディティブ法と呼ばれる方法がある。フルアディティブ
法は、表面にめっき触媒核が付与された絶縁層上に配線パターンに対応する開口を有する
めっきレジスト層を形成し、このめっきレジスト層の開口内の絶縁層上に無電解めっき法
により配線パターン用のめっき金属層を析出させた後、めっきレジスト層を剥離すること
によりめっき金属層から成る配線パターンを形成する方法である。また、セミアディティ
ブ法は、絶縁層の表面に無電解めっき層や金属箔等から成る薄い下地金属層を設け、その
下地金属層上に配線パターンに対応する開口を有するめっきレジスト層を形成し、このめ
っきレジスト層の開口内の下地金属層上に電解めっき法により配線パターン用のめっき金
属層を析出させた後、めっきレジスト層を剥離し、その後、配線パターン部以外の露出す
る下地金属層をエッチング除去することにより下地金属層およびめっき金属層から成る配
線パターンを形成する方法である。
In recent years, wiring boards used for mounting electronic components such as semiconductor elements have been downsized.
Thinning is increasingly required, and therefore, a wiring pattern on a wiring board is required to be fine and high density. As a method for realizing such a fine and high-density wiring pattern, there are methods called a full additive method and a semi-additive method. In the full additive method, a plating resist layer having an opening corresponding to a wiring pattern is formed on an insulating layer provided with a plating catalyst nucleus on the surface, and an electroless plating method is formed on the insulating layer in the opening of the plating resist layer. In this method, after depositing a plating metal layer for a wiring pattern, the plating resist layer is peeled off to form a wiring pattern composed of the plating metal layer. In addition, the semi-additive method provides a thin base metal layer made of an electroless plating layer or a metal foil on the surface of the insulating layer, and forms a plating resist layer having an opening corresponding to the wiring pattern on the base metal layer, After depositing a plating metal layer for a wiring pattern on the underlying metal layer in the opening of the plating resist layer by electrolytic plating, the plating resist layer is peeled off, and then an exposed underlying metal layer other than the wiring pattern portion is removed. This is a method of forming a wiring pattern comprising a base metal layer and a plated metal layer by etching away.
ところで、このようなアディティブ法に用いられるめっきレジスト層は、配線パターン
の微細化および高密度化に伴い、めっきレジスト層を形成する際やめっき金属層を析出さ
せる際等に不要な剥離が発生しないように、絶縁層や下地金属層との密着性が高められて
きている。さらに、配線パターン間の隙間が狭いものとなってきているために、一般的に
使用されているアルカリ性水溶液等から成る剥離液を使用してめっきレジスト層を膨潤さ
せることにより剥離しても、配線パターン間の狭い隙間に挟まっためっきレジスト層は容
易に剥離できない。
By the way, the plating resist layer used in such an additive method does not cause unnecessary peeling when forming a plating resist layer or depositing a plating metal layer with the miniaturization and high density of a wiring pattern. Thus, the adhesion to the insulating layer and the base metal layer has been improved. Furthermore, since the gaps between the wiring patterns are becoming narrower, even if the plating resist layer is peeled off by swelling with a commonly used stripping solution made of an alkaline aqueous solution, the wiring A plating resist layer sandwiched between narrow gaps between patterns cannot be easily removed.
そこで、例えば特許文献1には、めっきレジスト層をアルカリ性水溶液により膨潤させ
て剥離した後、残っためっきレジスト層の残渣を酸化樹脂エッチング剤や有機溶剤から成
る薬液にて処理することにより除去する方法が提案されている。
Thus, for example,
しかしながら、めっきレジスト層の残渣を酸化樹脂エッチング剤や有機溶剤から成る薬
液にて処理すると、これらの薬液が配線基板を構成する絶縁層を侵し、配線基板における
配線パターン間の電気的な絶縁信頼性の劣化等をもたらしてしまう危険がある。さらに酸
化樹脂エッチング剤や有機溶剤等の薬液を用いることにより、環境への負荷が大きくなっ
てしまうという問題点も有している。
However, if the residue of the plating resist layer is treated with a chemical solution consisting of an oxide resin etchant or an organic solvent, these chemical solutions will invade the insulating layer constituting the wiring board, and the electrical insulation reliability between the wiring patterns on the wiring board There is a risk of deteriorating the product. Furthermore, there is a problem that the load on the environment is increased by using a chemical solution such as an oxidized resin etching agent or an organic solvent.
本発明は、かかる従来の問題点に鑑み案出されたものであり、その課題は配線基板を構
成する絶縁層に悪影響を与えたり、環境への負荷を増大させたりすることなくめっきレジ
スト層を良好に剥離することができ、それにより微細で高密度配線を有する絶縁信頼性の
高い配線基板を簡単な方法で製造することが可能な配線基板の製造方法を提供することで
ある。
The present invention has been devised in view of such conventional problems, and the problem is that the plating resist layer can be formed without adversely affecting the insulating layer constituting the wiring board or increasing the environmental load. It is an object of the present invention to provide a method of manufacturing a wiring board that can be peeled well and thereby can manufacture a wiring board having fine and high density wiring and having high insulation reliability by a simple method.
本発明の配線基板の製造方法は、絶縁層上または金属層上に配線パターンに対応する開
口を有するめっきレジスト層を形成するレジスト形成工程と、前記開口内の前記絶縁層上
または前記金属層上にめっき金属層を析出させるめっき工程と、前記絶縁層上または前記
金属層上から前記めっきレジスト層を剥離するレジスト剥離工程とを含む配線基板の製造
方法であって、前記めっき工程の後でかつ前記レジスト剥離工程の前に、前記めっき金属
層の表面をエッチングするエッチング工程を行なうことを特徴とするものである。
The method for manufacturing a wiring board according to the present invention includes a resist forming step of forming a plating resist layer having an opening corresponding to a wiring pattern on an insulating layer or a metal layer, and on the insulating layer or the metal layer in the opening. A wiring board manufacturing method comprising: a plating step for depositing a plating metal layer on the substrate; and a resist stripping step for stripping the plating resist layer from the insulating layer or the metal layer, after the plating step and Before the resist stripping step, an etching step for etching the surface of the plated metal layer is performed.
本発明の配線基板の製造方法によれば、めっきレジスト層の開口内の絶縁層上または金
属層上にめっき金属層を析出させた後、該めっき金属層の表面を一旦エッチングし、次に
めっきレジスト層を剥離することから、前記エッチングによりめっきレジスト層とめっき
金属層との間に隙間が形成され、該隙間を介してめっきレジスト層とめっき金属層との間
に剥離液が浸透し、その結果、めっきレジスト層を良好に剥離することができ、それによ
り微細で高密度配線を有する絶縁信頼性の高い配線基板を簡単な方法で製造することがで
きる。
According to the method for manufacturing a wiring board of the present invention, after depositing a plating metal layer on an insulating layer or a metal layer in the opening of the plating resist layer, the surface of the plating metal layer is once etched and then plated. Since the resist layer is peeled off, a gap is formed between the plating resist layer and the plating metal layer by the etching, and the peeling solution penetrates between the plating resist layer and the plating metal layer through the gap. As a result, the plating resist layer can be satisfactorily peeled, whereby a wiring substrate having fine and high density wiring and high insulation reliability can be manufactured by a simple method.
以下、本発明にかかる配線基板の製造方法をセミアディティブ法に適用した場合の一実
施形態例について、図1(a)〜(e)および図2(f)〜(g)を参照して詳細に説明
する。なお、これらの図は、本実施形態を説明するための工程毎の断面模式図であり、図
中、1は絶縁層、2は下地金属層、3はめっきレジスト層、4はめっき金属層である。
Hereinafter, one embodiment when the method for manufacturing a wiring board according to the present invention is applied to a semi-additive method will be described in detail with reference to FIGS. 1 (a) to (e) and FIGS. 2 (f) to (g). Explained. In addition, these figures are cross-sectional schematic diagrams for each step for explaining the present embodiment, in which 1 is an insulating layer, 2 is a base metal layer, 3 is a plating resist layer, and 4 is a plating metal layer. is there.
まず、図1(a)に示すように、配線基板を構成する絶縁層1上に下地金属層2を被着
する。絶縁層1は配線基板用の絶縁層として必要な特性を備えていれば如何なる材料から
形成されていてもよいが、好適には例えばエポキシ樹脂やビスマレイミドトリアジン樹脂、
アリル変性ポリフェニレンエーテル樹脂、ポリイミド樹脂等の熱硬化性樹脂を含有する電
気絶縁材料から成る。また、下地金属層2は、電解めっきのための下地金属層として必要
な特性を備えていれば如何なる材料から形成されていてもよいが、好適には例えば銅箔や
無電解銅めっき層、銅スパッタ膜等の厚みが0.1〜1μm程度の薄い銅から成る。
First, as shown in FIG. 1A, a
It consists of an electrically insulating material containing a thermosetting resin such as an allyl-modified polyphenylene ether resin or a polyimide resin. In addition, the
次に、図1(b)に示すように、下地金属層2の上に配線パターンに対応する開口3a
を有するめっきレジスト層3を形成する。めっきレジスト層3は市販のアルカリ現像型の
ドライフィルムレジストを下地金属層2の上に貼着した後、開口3aを有するように露光
および現像すればよい。なお、めっきレジスト層3の厚みは15〜30μm程度であり、
開口3aの最小幅は10〜25μm程度である。
Next, as shown in FIG. 1B, an opening 3a corresponding to the wiring pattern is formed on the
A plating
The minimum width of the
次に、図1(c)に示すように、開口3a内に露出した下地金属層2上に電解銅めっき
層から成るめっき金属層4を10〜25μmの厚みに析出させる。めっき金属層4の析出
は、周知の電解銅めっき法を採用して下地金属層2から電荷を供給しながら行なえばよい。
Next, as shown in FIG.1 (c), the
次に、図1(d)に示すように、析出しためっき金属層4の表面を0.5〜2.0μm
程度の厚みだけエッチングする。このとき、このエッチングにより、めっきレジスト層3
の開口3aの側面とめっき金属層4との間に僅かな隙間が形成される。なお、めっき金属
層3の表面をエッチングする厚みが0.5μm未満では、めっきレジスト層3の開口3a
の側面とめっき金属層4との間に隙間を形成することが殆どできず、また、2.0μmを
超えると、めっき金属層4により所望の形状および幅の配線パターンを形成することが困
難となる。したがって、めっき金属層4の表面をエッチングする厚みは0.5〜2.0μ
mの範囲であることが好ましい。エッチングには過酸化水素水および硫酸を含有するエッ
チング液を用いればよい。エッチングに用いられる過酸化水素水および硫酸は、環境に対
して大きな負荷を与えることはない。
Next, as shown in FIG. 1 (d), the surface of the deposited
Etch by a certain thickness. At this time, the plating
A slight gap is formed between the side surface of the
It is almost impossible to form a gap between the side surface of the metal and the
A range of m is preferable. For the etching, an etchant containing hydrogen peroxide and sulfuric acid may be used. The hydrogen peroxide solution and sulfuric acid used for etching do not give a large load to the environment.
次に、図1(e)に示すように、アルカリ性水溶液等から成る剥離液を使用してめっき
レジスト層4を膨潤させる。このとき、めっきレジスト層3の開口3aの側面とめっき金
属層4との間には前記エッチングにより僅かな隙間が形成されているので、この隙間を介
して剥離液がめっきレジスト層3とめっき金属層4との間に浸透し、めっきレジスト層3
が良好に膨潤する。また、めっきレジスト層3の開口3aの側面とめっき金属層4との間
には隙間が形成されているので、後述する流水洗浄またはシャワー洗浄を行なうことによ
り、めっきレジスト層3とめっき層4との間がめっきレジスト層3の残渣を残すことなく
良好に剥離される。剥離液に用いられるアルカリ性水溶液としては、例えば1〜5%濃度
の水酸化ナトリウム水溶液や1〜5%濃度の水酸化カリウム等が好適に用いられる。アル
カリ性水溶液の温度は20〜70℃の範囲であることが好ましい。また、めっきレジスト
層3をアルカリ性水溶液中に浸漬する時間またはめっきレジスト層3にアルカリ性水溶液
を浴びせる時間は、0.5〜7分間が好ましい。
Next, as shown in FIG. 1E, the plating
Swells well. In addition, since a gap is formed between the side surface of the opening 3a of the plating
次に、図2(f)に示すように、下地金属層2およびめっき金属層4から剥離しためっ
きレジスト層3を流水洗浄またはシャワー水洗浄により除去した後、図2(g)に示すよ
うに、配線パターン以外の部分の露出する下地金属層2をエッチング除去することにより、
絶縁層1上に残った下地金属層2とその上のめっき金属層4から成る配線パターン5を有
する微細かつ高密度配線の配線基板を得ることができる。したがって、本発明の配線基板
の製造方法によれば、微細で高密度配線を有する絶縁信頼性の高い配線基板を製造するこ
とができる。
Next, as shown in FIG. 2 (f), after removing the
A fine and high-density wiring board having a wiring pattern 5 consisting of the
なお、本発明は上述の実施形態例に限定されるものではなく、本発明の要旨を逸脱しな
い範囲であれば、種々の変更は可能であり、例えば上述の実施形態例では、本発明をセミ
アディティブ法に適用した場合を例にとって説明したが、本発明の配線基板の製造方法は
セミアディティブ法に限らず、フルアディティブ法により配線基板を製造する場合にも適
用可能である。
It should be noted that the present invention is not limited to the above-described embodiment, and various modifications can be made without departing from the gist of the present invention. For example, in the above-described embodiment, the present invention is semi-finished. Although the case where the present invention is applied to the additive method has been described as an example, the method for manufacturing a wiring board according to the present invention is not limited to the semi-additive method, and can also be applied to the case where the wiring board is manufactured by the full additive method.
1 絶縁層
2 下地金属層
3 めっきレジスト層
3a めっきレジスト層の開口
4 めっき金属層
DESCRIPTION OF
Claims (1)
成するレジスト形成工程と、前記開口内の前記絶縁層上または前記金属層上にめっき金属
層を析出させるめっき工程と、前記絶縁層上または前記金属層上から前記めっきレジスト
層を剥離するレジスト剥離工程とを含む配線基板の製造方法であって、前記めっき工程の
後でかつ前記レジスト剥離工程の前に、前記めっき金属層の表面をエッチングするエッチ
ング工程を行なうことを特徴とする配線基板の製造方法。
A resist forming step of forming a plating resist layer having an opening corresponding to the wiring pattern on the insulating layer or the metal layer; and a plating step of depositing a plating metal layer on the insulating layer or the metal layer in the opening; A method of manufacturing a wiring board including a resist stripping process for stripping the plating resist layer from the insulating layer or the metal layer, wherein the plating is performed after the plating process and before the resist stripping process. A method for manufacturing a wiring board, comprising performing an etching process for etching a surface of a metal layer.
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Application Number | Priority Date | Filing Date | Title |
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JP2009047332A JP2010205803A (en) | 2009-02-27 | 2009-02-27 | Method of manufacturing wiring board |
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Cited By (1)
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---|---|---|---|---|
US10147612B2 (en) | 2017-03-22 | 2018-12-04 | Kabushiki Kaisha Toshiba | Metal pattern forming method |
-
2009
- 2009-02-27 JP JP2009047332A patent/JP2010205803A/en active Pending
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US10147612B2 (en) | 2017-03-22 | 2018-12-04 | Kabushiki Kaisha Toshiba | Metal pattern forming method |
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