JP2010160682A - 基準電圧生成回路 - Google Patents
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Abstract
【解決手段】本発明は、出力端子と接地電圧端子との間に接続された負荷回路と、前記出力端子と電源電圧端子との間に接続された出力トランジスタと、前記出力端子と前記電源電圧端子との間に接続された第1の定電流源と、前記出力端子に対し前記出力トランジスタもしくは前記第1の定電流源を選択的に接続する第1の切替回路と、前記負荷回路に供給するバンドギャップ電流を制御する制御回路とを有し、第1の状態では前記第1の切替回路が、前記出力端子と前記出力トランジスタを接続し、且つ、前記制御回路が、前記出力トランジスタの活性状態を制御し、第2の状態では前記第1の切替回路が、前記出力端子と前記第1の定電流源を接続し、且つ、前記制御回路が、前記第1の定電流源からの引き抜き電流量を制御する基準電圧生成回路である。
【選択図】図1
Description
R1〜R3、R30 抵抗素子
D1、D2、D30 ダイオード
SW1〜SW3、SW31、SW32 スイッチ
NAMP アンプ
CC1、CC2 定電流源
CV1 可変型定電流源
STBY 制御信号
VDD 電源電圧端子
GND 接地電圧端子
Vref リファレンス電圧出力端子
TP1、TP10〜TP12、TP30〜TP32 PMOSトランジスタ
TN10〜TN12、TN31、TN32 NMOSトランジスタ
Claims (10)
- 出力端子と、
前記出力端子と、接地電圧端子との間に接続された負荷回路と、
前記出力端子と、電源電圧端子との間に接続された出力トランジスタと、
前記出力端子と、前記電源電圧端子との間に接続された第1の定電流源と、
前記出力端子に対し、前記出力トランジスタもしくは前記第1の定電流源を選択的に接続する第1の切替回路と、
前記負荷回路に供給するバンドギャップ電流を制御する制御回路と、
を有し、
第1の状態では、
前記第1の切替回路が、前記出力端子と前記出力トランジスタを接続し、且つ、前記制御回路が、前記出力トランジスタの活性状態を制御し、
第2の状態では、
前記第1の切替回路が、前記出力端子と前記第1の定電流源を接続し、且つ、前記制御回路が、前記第1の定電流源からの引き抜き電流量を制御する
基準電圧生成回路。 - 当該基準電圧生成回路は、表示装置の表示駆動回路の基準電圧を生成し、
前記第1の状態は、前記表示駆動回路がスタンバイ動作を行う場合であり、
前記第2の状態は、前記表示駆動回路が通常動作を行う場合である
請求項1に記載の基準電圧生成回路。 - 前記負荷回路は、
第1のノードと前記接地電圧端子間に接続される第1のPN接合素子と、
第2のノードと前記接地電圧端子間に直列接続される第1の抵抗素子と第2のPN接合素子と、
を備える第1の負荷部と、
前記電源電圧端子と前記第1のノード間に接続される第2の抵抗素子と、
前記電源電圧端子と前記第2のノード間に接続される第3の抵抗素子と、
を備える第2の負荷部と、を有する
請求項1または請求項2に記載の基準電圧生成回路。 - (実施の形態1、2)
前記制御回路は、
前記バンドギャップ電流に基づいた前記第1のノードと前記第2のノードの電位に応じて、前記出力トランジスタの活性状態、又は、前記第1の定電流源からの引き抜き電流量を制御し、前記負荷回路に供給するバンドギャップ電流を制御する
請求項3に記載の基準電圧生成回路。 - 前記制御回路は、
当該制御回路の出力端である第3のノードと前記接地電圧端子間に接続されるプルダウントランジスタを有し、
前記第1のノードと前記第2のノードの電位に応じて、前記プルダウントランジスタの活性化状態を制御する
請求項3または請求項4に記載の基準電圧生成回路。 - 前記第3のノードに対し、前記出力トランジスタの制御端子、もしくは、前記第1の定電流源を選択的に接続する第2の切替回路と、
前記出力トランジスタの制御端子に接続される第2の定電流源と、を有し、
前記第2の切替回路は、前記第1の状態では前記第3のノードと前記出力トランジスタの制御端子を接続し、前記第2の状態では前記第3のノードと前記第1の定電流源を接続する
請求項5に記載の基準電圧生成回路。 - 前記第3のノードに対し、前記出力トランジスタの制御端子、及び、前記第1の定電流源が接続されており、
前記第1の定電流源は、前記第1の状態では第1の定電流、第2の状態では前記第1の定電流よりも大きい値の第2の定電流を供給する
請求項5に記載の基準電圧生成回路。 - 前記負荷回路は、
第1のノードと前記接地電圧端子間に接続される第1のPN接合素子と、第2のノードと前記接地電圧端子間に直列接続される第1の抵抗素子と第2のPN接合素子と、を有する第1の負荷部と、
前記第1の定電流源と前記第1のノード間に接続される第2の抵抗素子と、前記第1の定電流源と前記第2のノード間に接続される第3の抵抗素子と、を有する第2の負荷部と、
前記出力トランジスタと接地電圧端子間に直列接続される第4の抵抗素子と、第3のPN接合素子と、を有する第3の負荷部と、
前記第2の状態では、前記第1のノード及び第2のノードと、それぞれ前記第2の抵抗素子及び前記第3の抵抗素子を接続し、前記第1の状態では、前記第1のノード及び第2のノードと前記制御回路を接続する第3の切替回路とを備える
請求項1または請求項2に記載の基準電圧生成回路。 - )
前記制御回路は、
前記第2の状態では、前記第1のノードと前記第2のノードの電位に応じて、前記第1の定電流源からの引き抜き電流量を制御し、
前記第1の状態では、前記第1のノード及び前記第2のノードに流れる電流に応じて前記出力トランジスタの活性状態を制御する
請求項8に記載の基準電圧生成回路。 - 前記制御回路は、
当該制御回路の出力端である第3のノードと前記接地電圧端子間に接続されるプルダウントランジスタを有し、
前記第1のノードと前記第2のノードの電位に応じて、前記プルダウントランジスタの活性化状態を制御し、
前記第3のノードは前記第1の定電流源と接続される
請求項9に記載の基準電圧生成回路。
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