JP2007510337A - 移動通信システムのビタビ/ターボ統合デコーダ - Google Patents
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Abstract
【解決手段】ビタビとターボ統合デコーダは、音声、データストリームをデコードする。デコーダの実施形態は同一の制御回路によりビタビ/ターボデコーダのパスメトリックを処理、計算し、ハードウェアコストを抑制する効果を達成する。制御回路は数個のプロセッサとメモリバンクを有し、ビタビ、或いは、ターボ符号語をデコードし、プロセッサは固定ルーティングルールに従って、メモリバンクからパスメトリック情報を読み取り/書き込みする。
【選択図】図4
Description
図4は本発明の具体例によるビタビ/ターボ統合デコーダの実施形態を示す。ビタビ/ターボ統合デコーダ4は受信データのエンコード方法に基づいて、畳み込み、或いは、ターボデコードを実行することができる。ビタビ/ターボ統合デコーダ4は入力端子40から得られるノイズを含むwビットの符号をデコードする。統合デコーダ4は入力バッファ43、ブランチメトリック計算(BMC)ユニット41、制御回路42、インタリーバ/逆インタリーババッファ45、インタリーバ/逆インタリーバ44、残存パス更新ユニット46、トレースバックユニット47、後入れ先出し(LIFO)バッファ48を有する。
図9は第2実施形態によるパスメトリックのメモリバンクアクセス規則を示す図で、エンコーダの制約長さは6(n=5)で、これにより、ビタビデコードは32個の状態 (25 )を有する。つまり、第2実施形態中、4個のACSP(2m ,m≦4, m=2を選択)、及び、8組のメモリバンク(2m+1 )を有する。各メモリバンク中、4個のメモリ素子があり、各ACSPは1つの周期内で、1つのメモリバンクにだけアクセスするので、各ACSPは第1ブロック中の2つの対応するメモリバンクから部分的パスメトリックを4回読み取り、各メモリ素子は全て読み取られなければならず、同様に、新しい部分的パスメトリックは第2ブロック中の2つの対応するメモリバンクに4回書き込まれる。メモリバンクの読み/書きのルーティングルールは第1実施形態と同様である。
図10aと図10bは第3実施形態中、256状態のビタビデコードのパスメトリックメモリバンクに対応する構成とデータ構造を示す図である。第3実施形態中、エンコーダの制約長さは9で、4個のACSPと8組のメモリバンクを使用する。各パスメトリックメモリバンクはどれも2つのブロックを有し(ブロックAとブロックB)、ブロックAとブロックBのブロック索引はそれぞれ0と1である。4個のACSPは1周期間で8個の状態を処理し、これにより、256状態のビタビ符号語をデコードするのに、ACSPは32個の周期(256/8=32)が必要で、メモリバンク中から、1ノードの部分的パスメトリックを読み取り、或いは、書き込みする。
Claims (12)
- ビタビ或いはターボ符号語をデコードするビタビ/ターボ統合デコーダであって、
複数の符号を受信すると共に、前記符号語の各ノードに関連するブランチメトリックを決定するブランチメトリック計算(BMC)ユニットと、
前記BMCユニットから受け取った対応するブランチメトリック及び第1メモリブロックに記憶されている前のノードの部分的パスメトリックに基づいて各ノードの部分的パスメトリックを計算し、得られた前記部分的パスメトリックを第2メモリブロックに記憶し、なおその際の前記メモリブロックに対する前記部分的パスメトリックの読み出し及び書き込みの順序とアドレスは並列処理のための固定ルーティングルールに従い、さらに前記符号語のタイプに基づいて選択或いは最大事後確率(MAP)計算の何れかを実行して各ノードの残存パスを特定する制御回路と、
前記制御回路に接続され、前記制御回路により示される前記残存パスを追随することにより、ビタビ符号語のためのデコード出力を生成するトレースバックユニットと、
前記制御回路に接続され、決定論的方式により入力の順序を変更或いは回復し、ターボ符号語のためのデコード出力を生成するインタリーバ/逆インタリーバと、
入力符号と前記インタリーバ/逆インタリーバの出力を受け取り、前記BMCユニットと前記インタリーバ/逆インタリーバに記憶領域を提供するターボバッファと
を有することを特徴とするビタビ/ターボ統合デコーダ。 - 前記制御回路は、
前記対応するブランチメトリックに従って各ノードの前記部分的パスメトリックを計算するJ個の加法比較選択プロセッサ(ACSP)を有し、各ACSPは前記部分的パスメトリックを並列処理する2つの加法比較選択ユニット(ACSU)を有し、前記J=2m (mは整数)であるところの加法比較選択プロセッサ(ACSP)アレイと、
各々現在のノードと前のノードの前記部分的パスメトリックを記憶する前記第1及び第2のメモリブロックを有し、各メモリブロックはI個のメモリバンクを有し、前記I=2m+1であるところのパスメトリック計算ユニットと、
前記ACSPアレイと前記パスメトリック計算ユニットとに接続され、各ACSPと、2つは前記第1メモリブロックに属しもう2つは前記第2メモリブロックに属する4個のメモリバンクとの間の固定連接線を、前記固定ルーティングルールに従って構築する固定ルーティング回路と、
選択或いはMAP計算の何れかを実行して、各ノードの前記残存パスを特定する選択/MAP計算ユニットと
を有することを特徴とする請求項1に記載のビタビ/ターボ統合デコーダ。 - 前記m+1は、エンコーダの制約長さ以下でなければならないことを特徴とする請求項2に記載のビタビ/ターボ統合デコーダ。
- 前記第1、第2メモリブロックはサイズが等しく、各メモリバンクは前記パスメトリックを記憶するメモリ素子を同数有することを特徴とする請求項2に記載のビタビ/ターボ統合デコーダ。
- 前記選択/MAP計算ユニットが、前記BMCユニットから得られる前記ブランチメトリックと前記パスメトリック計算手段により得られる前記部分的パスメトリックに従って、前記ターボ符号語の対数尤度比(LLR)を計算することを特徴とする請求項2に記載のビタビ/ターボ統合デコーダ。
- 前記パスメトリック計算ユニットは、ターボ符号語の各状態の前方パスメトリックα及びK個後方パスメトリックβを記憶し、前記Kはターボデコードのウィンドウサイズであることを特徴とする請求項2に記載のビタビ/ターボ統合デコーダ。
- 前記m=2、K=32で、前記デコーダは256状態のビタビと8状態のターボ符号語をデコードすることができることを特徴とする請求項7に記載のビタビ/ターボ統合デコーダ。
- 各ノードに関連する前記ブランチメトリックは、前記ノードにおける前記受信符号と前記デコード出力との間の平方距離であることを特徴とする請求項1に記載のビタビ/ターボ統合デコーダ。
- 前記トレースバックユニットに接続されて前記デコードビタビ出力を出力するLIFOバッファをさらに有することを特徴とする請求項1に記載のビタビ/ターボ統合デコーダ。
- さらに、前記制御回路と前記トレースバックユニットに接続される残存パス更新ユニットを有し、最新の計算で得られる残存パスを記憶することを特徴とする請求項1に記載のビタビ/ターボ統合デコーダ。
- 前記ターボバッファは入力バッファとインタリーバ/逆インタリーババッファからなり、前記入力バッファは前記受信符号を記憶し、前記インタリーバ/逆インタリーババッファは前記インタリーバ/逆インタリーバの出力を記憶することを特徴とする請求項1に記載のビタビ/ターボ統合デコーダ。
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US7725798B2 (en) * | 2004-02-27 | 2010-05-25 | Joanneum Research Forschungsgesellschaft Mbh | Method for recovering information from channel-coded data streams |
KR100630168B1 (ko) * | 2004-08-09 | 2006-09-29 | 삼성전자주식회사 | 이동통신 시스템에서 비터비 디코더의 공유 방법 및 장치 |
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TWI255622B (en) * | 2004-10-21 | 2006-05-21 | Mediatek Inc | Method of computing path metrics in a high-speed Viterbi detector and related apparatus thereof |
JP4432781B2 (ja) * | 2005-01-17 | 2010-03-17 | 株式会社日立製作所 | 誤り訂正復号器 |
KR100675389B1 (ko) * | 2005-01-27 | 2007-01-29 | 삼성전자주식회사 | 역추적 작업을 병렬적으로 수행하는 비터비 디코더 및 그디코딩 방법 |
US7450668B2 (en) * | 2005-02-02 | 2008-11-11 | At&T Intellectual Property I, L.P. | Soft bit viterbi equalizer using partially collapsed metrics |
US7877674B2 (en) | 2006-07-25 | 2011-01-25 | Broadcom Corporation | Method and system for redundancy-based decoding of voice content in a wireless LAN system |
US7917834B2 (en) * | 2005-12-08 | 2011-03-29 | Electronics And Telecommunications Research Institute | Apparatus and method for computing LLR |
US8127214B2 (en) * | 2007-06-14 | 2012-02-28 | Intel Corporation | Unified decoder for convolutional, turbo, and LDPC codes |
CN101312531B (zh) * | 2007-11-02 | 2010-11-17 | 北京创毅视讯科技有限公司 | 一种广播***中的流媒体业务传输方法及流媒体帧封装器 |
TWI339956B (en) * | 2007-12-31 | 2011-04-01 | Ind Tech Res Inst | Method and apparatus for convolutional turbo decoding |
US8327058B2 (en) * | 2008-07-25 | 2012-12-04 | Broadcom Corporation | Method and system for routing data in a parallel turbo decoder |
US8332735B1 (en) * | 2009-03-09 | 2012-12-11 | Xilinx, Inc. | Generating a log-likelihood ratio for signal processing |
TWI383596B (zh) * | 2009-04-28 | 2013-01-21 | Via Tech Inc | 維特比解碼器 |
CN102064839B (zh) * | 2009-11-11 | 2013-11-20 | 中国科学院微电子研究所 | 一种高速低功耗多码率的Viterbi译码器 |
US8402342B2 (en) * | 2010-02-26 | 2013-03-19 | Research In Motion Limited | Method and system for cyclic redundancy check |
US8433004B2 (en) | 2010-02-26 | 2013-04-30 | Research In Motion Limited | Low-latency viterbi survivor memory architecture and method using register exchange, trace-back, and trace-forward |
WO2012032371A1 (en) * | 2010-09-08 | 2012-03-15 | Agence Spatiale Europeenne | Flexible channel decoder. |
JP6155959B2 (ja) * | 2013-08-19 | 2017-07-05 | 富士通株式会社 | 復号化装置、及び、復号化方法 |
KR20150061253A (ko) * | 2013-11-27 | 2015-06-04 | 한국전자통신연구원 | 하프 파이프라인 방식의 터보 디코더 및 그의 제어 방법 |
Family Cites Families (10)
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---|---|---|---|---|
KR930004862B1 (ko) * | 1990-12-17 | 1993-06-09 | 삼성전자 주식회사 | 상태 평가량 기억장치 |
JPH09182067A (ja) * | 1995-10-27 | 1997-07-11 | Toshiba Corp | 画像符号化/復号化装置 |
JP3239870B2 (ja) * | 1998-12-28 | 2001-12-17 | 日本電気株式会社 | データ誤り訂正システム |
US7127664B2 (en) * | 2000-09-18 | 2006-10-24 | Lucent Technologies Inc. | Reconfigurable architecture for decoding telecommunications signals |
JP3823731B2 (ja) | 2001-01-17 | 2006-09-20 | 株式会社日立製作所 | 誤り訂正復号器 |
KR100415116B1 (ko) | 2001-02-19 | 2004-01-13 | 삼성전자주식회사 | 비터비 디코더와 터보 디코더의 통합 디코더 및 통합디코딩 방법 |
US6823489B2 (en) * | 2001-04-23 | 2004-11-23 | Koninklijke Philips Electronics N.V. | Generation of decision feedback equalizer data using trellis decoder traceback output in an ATSC HDTV receiver |
KR100438537B1 (ko) | 2001-07-19 | 2004-07-03 | 엘지전자 주식회사 | 이동 통신 단말기에서의 복호 장치 및 그 제어 방법 |
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KR100436434B1 (ko) * | 2001-11-19 | 2004-06-16 | 한국전자통신연구원 | 상태 메트릭을 갖는 터보 복호기 및 그를 이용한 계산 방법 |
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