JP2007328255A - アクティブマトリクス型表示素子 - Google Patents
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Abstract
【解決手段】ガラス基板と、ガラス基板に形成されたコントロール回路部と表示回路部が一体に形成されている表示パネル部と、コントロール回路部に設けられたデータ入力端子、クロック端子、データラッチ端子と、を備え、コントロール回路部には、テスト信号が入力されるテスト端子と、該テスト信号が入力されると表示回路部に書き込まれたデータを呼び出し、該データを出力するデータ出力端子とを更に備える。
【選択図】図1
Description
このような蛍光表示管の1つに、蛍光体を塗布した複数のアノードをマトリクス状に配列した発光表示部と、発光表示部の発光を制御する駆動回路とが一体に形成された半導体チップを絶縁基板上に配列して得られる発光表示面を備えたアクティブマトリクス型蛍光表示管がある。特許文献1に記載のアクティブマトリクス型蛍光表示管は、シリコン単結晶基板にMOSスイッチングアレイを集積し、これに蛍光体を塗布してアノード基板としたものである。
アクティブマトリクス型蛍光表示管は、自発光型の素子であるため、鮮明で見やすく、高輝度が得られること、信頼性に優れていること等から、車両内の運転手等に情報表示する表示手段として、ヘッドアップディスプレイ用表示装置として使用される用途が急増している。そのため、アクティブマトリクス型蛍光表示管は、より低コストで、表示面積の大型化、画素の高密度化を図るような研究開発が行なわれている。
CPU140からコントロール部131へ出力されるデータ信号は、シリアル出力され、コントロール部131から表示パネル部のIC130へのデータ信号の出力はパラレル出力されている。そのため、コントロールIC131と表示部パネルのICとのワイヤボンディング用細線135による接続は、列配線と行配線数分の工程を必要とするため、低コストで表示面積の大型化、画素の高密度化の大きな妨げになっていた。
つまり、表示パネル部への入力信号は、コントロール部からの信号をパラレルに入力する形式であるため、コントロール部の出力は、表示パネル部にパラレルに接続される方式である。コントロール部からの行信号出力及び列信号出力を、表示パネル部の行配線及び列配線にワイヤーボンディングによって接続しているため、コントロール部の出力ラインが、表示部の入力ラインとなっていた。そのため、表示パネル部に書き込まれたラッチデータの出力を、コントロール部が読出すことができないため、表示パネル部に書き込まれたラッチデータの出力を、コントロール部が読出すことによる検査ができなかった。
前記表示パネル部は、テスト信号が入力されるテスト端子と、該テスト信号が入力されると前記表示回路部に書き込まれたデータを出力するデータ出力端子とを更に備えている。
さらに、前記表示パネル部には、書込み制御信号を受ける書き込み端子と、表示部の輝度調整を行なう表示部ブランク端子とを備える。
さらに、従来のシリアルインパラレルアウトドライバの機能を表示パネル部のパネルドライバに内蔵させることができるため、コストの減少のみならず、テストが可能となる。
AMVFDは、ガラス基板10を底部とする密閉容器であるガラス容器39と、ガラス容器39内のガラス基板10上に形成されているICチップであるアクティブマトリクスIC30、フィラメント38とから構成されている。前記AMVFDは、不図示のリードを介して、CPU40、及び電源Vct、フィラメント電源35とが接続されている。
アクティブマトリクスIC30は、表示素子と表示素子を駆動する表示回路が形成されている表示部32と、非表示部33とにより構成され、非表示部33にはコントロール部31が形成されている。
非表示部33は、図2(a)に示すように、フィラメント38の接続部近傍であるためフィラメントの温度が低く、表示部としては使えない領域を示し、表示領域としては使えない領域であるため、周辺回路等が搭載され、本実施例では、コントロール部31がIC化されて搭載されている。
CPU40から出力されるデータ信号は、SI端子からコントロール部31にシリアルに出力され、コントロール部31は、データ信号をCLK信号、LAT信号により、シリアル/パラレル変換し、WE信号及びBKD信号により(LAT信号を介してもよい。)表示部32に出力する。
前記の列アドレス選択信号と表示データ信号によりマトリクス状に配置された各画素への表示データが、選択された列の保持部13に保持される。これが1列分のデータであり、列アドレス信号は順次インクリメントさせ、全列にデータが書き込まれるまで繰り返し行われる。
保持データとブランク信号との積により出力されたデータが駆動回路部18、19を経由して表示画素部21の最終段のドライバ出力回路20に入力されて、表示データとなる。
最終段の駆動回路20がPチャネルMOSトランジスタで構成し、アノード電極駆動に際して、フィラメントセンタータップ電圧に重畳した信号レベル電圧がアノード電極に印加される構成となり、駆動回路より出力される信号レベルは低電圧でよいことになる。従って、最終段のトランジスタを除けば高耐圧を必要とするトランジスタは不要である。
以上の点より、デザインルールの大きい高耐圧トランジスタは各画素に1つ有すればよいため、消費電流は小さく抑えることができる。また、画素サイズも電源ラインが低電圧とGNDの2本のみでよいために小さくすることができ、ドライバ出力部の画素を構成するアノード電極の下に保持回路及び駆動回路、ドライバ回路をレイアウトすることができる。また、画素を狭ピッチ化することができ、高精細な表示を可能にできる。
CPU40からのCLK信号に同期してシリアルデータ(SI)を入力する。LATは表示部にデータの引き渡しを行なう信号である。
WE信号及びBKD信号は直接表示部32に入力されている。WE信号はデータ書込み制御信号であり、BKD信号は表示部の輝度調整を行なう信号である。
図2(b)には、図4に示される従来のAMVFDの断面図が示されている。ガラス基板110上に、表示部132、非表示部133からなるアクティブマトリクスIC130、表示パネル130との接続部であるワイヤボンディング用細線135,アルミ配線136と接続されたコントロール部131、図示しないCPU140と接続されるワイヤボンディング用細線137とから構成される。
CPU40からの信号により、TEST端子が’H’となると、テストモードとなり、SI端子から入力された列アドレス選択信号により、選択された列の表示部に書き込まれたラッチデータがSO端子から出力され、アクティブマトリクスIC30の検査ができることとなる。
SO端子を用いた検査により、アクティブマトリクスICの検査を実行でき、AMVFDの製品検査を容易に実行することができ、精度を向上させることができる。
SO端子は、通常時、データのカスケード接続を可とし、テスト時は各画素に書き込まれたラッチされたデータの読み出しを可とするもので、通常時は、データカスケード用に使用することができる。
コントロール部 31、表示部 32、CPU 40、
シリアル出力端子 SO、シリアルデータ入力端子 SI、
ラッチ入力端子 LAT、シフトレジスタクロック端子 CLK、
テスト端子 TEST、書込み端子 WE、ブランク端子 BKD
Claims (4)
- ガラス基板と、
前記ガラス基板に形成されたコントロール回路部と表示回路部が一体に形成されている表示パネル部と、
前記表示パネル部に設けられたデータ入力端子、クロック端子、データラッチ端子と、
を備え、
前記表示パネル部は、テスト信号が入力されるテスト端子と、該テスト信号が入力されると前記表示回路部に書き込まれたデータを出力するデータ出力端子とを更に備えていること
を特徴とするアクティブマトリクス型表示素子。 - 前記表示パネル部には、さらに、書込み制御信号を受ける書き込み端子と、表示部の輝度調整を行なう表示部ブランク端子とを備えたことを特徴とする請求項1に記載のアクティブマトリクス型表示素子。
- 前記表示パネル部はアクティブマトリクス型蛍光表示管であることを特徴とする請求項2に記載のアクティブマトリクス型表示素子。
- CPUと、
ガラス基板と、
前記ガラス基板に形成されたコントロール回路部と表示回路部が一体に形成されている表示パネル部と、
前記表示パネル部に設けられた、前記CPUと接続されるデータ入力端子、クロック端子、データラッチ端子と、
を備え、
前記表示パネル部は、前記CPUからのテスト信号が入力されるテスト端子と、該テスト信号が入力されると前記表示回路部に書き込まれたデータを出力するデータ出力端子とを更に備えていること
を特徴とするアクティブマトリクス型表示装置。
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