JP2002359979A - 高電圧パルス発生回路 - Google Patents
高電圧パルス発生回路Info
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Abstract
ことなく、極めて幅が狭い高電圧パルスを発生できる簡
単で、安価な高電圧パルス発生回路を提供する。 【解決手段】低電圧の直流電源の正出力端子を、低耐圧
の第1のスイッチ、磁気エネルギー蓄積用のインダクタ
および高耐圧の第2のスイッチより成る直列回路を経て
負出力端子に接続し、前記第1のスイッチとインダクタ
との接続点と前記直流電源の負出力端子との間にフリー
ホィールダイオードを含む分岐配線を接続する。前記第
1および第2のスイッチをオンとして前記インダクタに
磁気エネルギーを蓄えた後に、第1および第2のスイッ
チをターンオフして、前記インダクタに蓄えたエネルギ
ーを、前記第2のスイッチの両端に接続された容量性負
荷へ転流し、これを急速に充電させて急峻で幅の狭い高
電圧パルスを発生できる。
Description
て極めて幅が狭い高電圧・大電流のパルスを発生させる
高電圧パルス発生回路に関するものである。
峻に立上がり、かつ、数kVから数十kVの高電圧で極め
て幅が狭い(50ナノ秒までの要求がある)パルスを生成
して負荷である反応器と称する放電ギャップで放電させ
る必要がある。
的な概念を示す図で、出力すべき高電圧パルスの波高値
に等しい高電圧を有する直流電源1は、充電抵抗2を介
して、パルス・エネルギーを供給するキャパシタ3に接
続されており、このキャパシタ3は、スイッチ4を経て
負荷(放電部分)5に接続されている。キャパシタ3が
充電された後、スイッチ4がオンとなると、キャパシタ
3から負荷へエネルギーが移行されるように構成されて
いる。
流れる放電電流の径路に存在するインダクタンスはイン
ダクタ6としてまとめて示してある。負荷5は放電ギャ
ップよりなるが、一般的に容量性(キャパシティブ)で
あり、便宜的に放電ギャップとは別に、このキャパシテ
ィブ要素をキャパシタ7として放電ギャップと並列に接
続して表す。スイッチ4のオンによりこのキャパシタ7
を充電する電流が流れるが、この電流が大きく、かつ、
急峻に立上がるほど出力電圧であるこのキャパシタ7の
電圧の立上りも急峻となり、好ましいパルスの発生が行
なわれる。しかし、実際の回路においてはスイッチ4に
はスイッチング時間があり、理想的に瞬時に導通状態と
ならないこと、および回路に少なからず存在するインダ
クタンス6により、出力電圧の立上りが遅くなり、急
峻、かつ幅の狭いパルスの発生には限界がある。
いる一例として可飽和鉄心を用いた磁気圧縮回路があ
り、これを図2に示す。図2に示す素子において、図1
に示す素子と同様の役割をするものには、図1で用いた
のと同一記号で示し、その説明は省略する。スイッチ4
と負荷5との間に可飽和リアクトル8-1、8-2および8-3
を直列に接続し、これら可飽和リアクトルの接続点と直
流電源1の負端子との間にキャパシタ3-2および3-3を接
続し、さらに負荷5と並列に可飽和リアクトル8を接続
したものである。
ダクタンスが非常に大きく、電圧時間積が所定の値に達
すると使用している鉄心が飽和し、急激に低インダクタ
ンスとなるものである。詳細な説明は省略するが、飽和
時のインダクタンスを可飽和リアクトル8-1、8-2、8-
3、8の順で小さくなるようにし、また、キャパシタ3-
1、3-2、3-3の容量を同じとする。スイッチ4を閉じた
後、時刻t0において可飽和リアクトル8-1が飽和した
後にキャパシタ3-2、3-3および7間に現れる電圧パルス
v 1、v 2、v 3は、図3に示すように時間軸上で順次に
圧縮される。すなわち、キャパシタ3-2間に現れる電圧
パルスv 1は時刻t0 から上昇し始め、時間T1 が経過
したときにピークとなり、この時に可飽和リアクトル8-
2が飽和するようにセットしておけばキャパシタ3-3間に
現れる電圧パルスv 2が上昇し始め、時間T1 よりも短い
時間T2 後にピークに達し、この時に可飽和リアクトル8
-3が飽和するようにセットしておけばキャパシタ7間に
現れる電圧パルスv3が上昇し始め、時間T2 よりも短い
時間T3 後にピークに達する。このようにして、負荷5
間に所望の急峻で幅の狭い高電圧パルスv 3を得ること
ができる。
クトルを用いた従来の高電圧パルス発生回路は複雑で、
かつ、使用する全部品に高電圧が印加されるために、特
殊な部品を必要としたり、絶縁距離を大きく取る必要が
あり、また、直流電源1は高電圧を出力するものが必要
とされる等のこともあり装置が大型化および高コスト化
する不具合があった。
あるサイラトロンが使用されてきたが、スイッチング速
度が非常に速く、高電圧で使用できるため1個のスイッ
チで良く、したがってスイッチ自身のインダクタンスが
小さい利点を有するものの、次に述べるような問題があ
る。 (1) 高い繰返し周波数での動作ができない。 (2) 自己ターンオフが不可能であるため回路構成
に制約がある。 (3) 寿命が短く、メンテナンスが面倒であり、コ
ストが嵩む。 (4) ヒータ回路やガスコントロールが必要であ
り、構成が複雑である。 (5) ジッタやミス点弧による動作不良がある。
トロニクスとともに発展してきており、高電圧・大電流
で高速のターンオン・ターンオフ・スイッチングが可能
なものが出現しつつある。しかしながら、サイラトロン
に直接置換えるには耐電圧が大きく不足しているので、
多数の半導体スイッチを直列に接続して1つのスイッチ
とし、各スイッチに回路電圧を分担するようにせざるを
得ない。しかし、直列接続された多数の半導体スイッチ
を精度良く同時にターンオンさせるためには、特別に配
慮されたゲート駆動回路を必要とし、かつ、ゲート駆動
回路相互間にも高電圧が印加されるため、ゲート電源お
よびゲート制御信号も互いに絶縁されたものを用意しな
ければならず、従来のサイラトロンを使用していた回路
で単にサイラトロンを多数の半導体スイッチの直列回路
に置換えただけでは余り利点が無い場合が多い。
路においては、高電圧の直流電源を必要とし、回路部品
の全てに高電圧が印加されると共に、スイッチ素子のス
イッチング速度や回路のインダクタンスにより幅の狭い
パルスを直接出力できないため磁気圧縮回路を必要とす
るので、装置が大型となり、コストも高くなっていた。
路では弊害となっていたインダクタンスを有効に利用し
て、急峻で幅の狭い高電圧パルスを、磁気圧縮回路など
を用いずに直接出力できる簡単な構成で低コストの高電
圧パルス発生回路を提供しようとするものである。
て、かなりの低電圧でも許容できる直流電源で動作し、
ターンオフ可能な半導体スイッチを用いて、急峻で幅の
狭い高電圧パルスを出力できる高電圧パルス発生回路を
提供しようとするものである。
圧パルス発生回路は、第1および第2の出力端子を有す
る直流電源と、一端がこの直流電源の第1の出力端子に
接続された第1のスイッチ、この第1のスイッチの他端
に一端が接続されたインダクタおよび一端がこのインダ
クタの他端に接続され、他端が前記直流電源の第2の出
力端子に接続された第2のスイッチより成る直列回路
と、前記第1のスイッチの他端と前記インダクタの一端
との接続点と前記直流電源の第2の出力端子との間に接
続された、フリーホィールダイオードを含む分岐配線と
を具え、前記第1および第2のスイッチをオンとして前
記インダクタに磁気エネルギーを蓄えた後に、第1およ
び第2のスイッチをターンオフして、前記インダクタに
蓄えたエネルギーを、前記第2のスイッチの両端に接続
された負荷へ転流するように構成したものである。
回路においては、前記第1および第2のスイッチを半導
体スイッチで構成することができるが、この場合には第
1および第2の半導体スイッチを介して低電圧の直流電
源電圧をインダクタに印加し、電流を立上げてインダク
タに所要の磁気エネルギーを蓄えた後に、第1および第
2の半導体スイッチをターンオフさせることにより、こ
の磁気エネルギーを低インダクタンス回路の負荷キャパ
シタに転流し、これを急速に充電させることで急峻で高
電圧の幅狭のパルスを発生させることができる。
な実施例においては、前記第1のスイッチを低耐電圧の
半導体スイッチで構成し、前記第2のスイッチを出力パ
ルス電圧の大きさに応じて決められる個数の高耐電圧の
半導体スイッチを直列接続した半導体スイッチ直列回路
で構成し、この半導体スイッチ直列回路の半導体スイッ
チの個数に等しい鉄心を設け、これらの鉄心を貫通する
1次巻線を前記フリーホィールダイオードを含む分岐配
線に設け、前記半導体スイッチ直列回路の各半導体スイ
ッチのゲートおよびカソード端子に接続された2次巻線
を前記鉄心にそれぞれ通す。この場合、前記第2のスイ
ッチを構成する半導体スイッチ直列回路の各半導体スイ
ッチを静電誘導サイリスタで構成するのが特に好適であ
るが、絶縁ゲートバイポーラトランジスタ(IGBT)
などのターンオフ可能な他の半導体スイッチで構成する
こともできる。
おいては、前記第2のスイッチをターンオフし、負荷へ
エネルギーを開放した後に第2のスイッチを再度、極短
時間ターンオンさせるように構成するのが好適である。
また、前記第1および第2のスイッチをほぼ同時にター
ンオフするように構成したり、前後にターンオフするよ
うに構成したりすることができる。
ス発生回路の第1の実施例を示すものであるが、これは
本発明の基本的な構成を示すものである。発生すべき出
力高電圧パルスの電圧波高値に全く関係無く選択するこ
とができる低圧の直流電源11の正出力端子を、オン・オ
フ可能な低耐電圧の第1のスイッチ12、磁気エネルギー
蓄積用インダクタ16およびオン・オフ可能な高耐電圧の
第2のスイッチ14の直列回路を経て直流電源11の負
出力端子に接続する。オン・オフ可能な第1のスイッチ
12は、インダクタ16に対して磁気エネルギーの供給およ
び停止を行うものであり、一般に低耐電圧のもので構成
することができる。一方、オン・オフ可能な第2のスイ
ッチ12は、インダクタ16に対して磁気エネルギーの供給
および開放を行うものであり、出力高電圧パルスの波高
電圧が印加されるため、高耐電圧スイッチで構成する。
タ16との接続点と、前記直流電源11の負出力端子との間
には、フリーホィールダイオード13を含む分岐配線を接
続する。このフリーホィールダイオード13には、出力高
電圧パルスの波高電圧が印加されないので低耐電圧のも
ので良い。第2のスイッチ14と並列に負荷15、例えばプ
ラズマ発生用の反応器に設けられた放電ギャップを接続
する。図4においても、この容量性負荷15のキャパシタ
ンスを表すキャパシタ17を負荷と並列に接続して示す。
ルス発生回路の動作を図5を参照して説明する。図5に
おいて、Aは第1のスイッチ12のオン・オフ動作、Bは
第2のスイッチ14のオン・オフ動作、Cは第1のスイッ
チ12を流れる電流iSW1、 Dはインダクタ16を流れる電
流iL 、Eは第2のスイッチ14を流れる電流iSW2、 Fは
フリーホィールダイオード13を流れる電流ID 、Gはキ
ャパシタ17を流れる共振電流 iC 、 Hはキャパシタ17
間の電圧、すなわち出力高電圧パルスvcをそれぞれ示す
ものである。
2および14をターンオンさせるものとするが、第2のス
イッチ14はこれ以前より導通状態であっても良い。 こ
れにより磁気エネルギー蓄積用インダクタ16(インダク
タンスをL とする)には低圧の直流電源11の電圧E が印
加され、磁気エネルギー蓄積用インダクタ16の電流iL
はE /L の勾配で直線的に増加して行く(図5C)。つ
まり、磁気エネルギー蓄積用インダクタ16に磁気エネル
ギーが蓄積されて行く。図5Hに示す第1のモードIで
は、この電流iL はスイッチ12の電流iSW1 およびスイッ
チ14の電流iSW2 と同じである。
る電流iL が所定の電流値I pに達した時刻t1 において
第1および第2のスイッチ12および14をターンオフさせ
る(図5A,B)。この時、両スイッチのターンオフは
必ずしも同時である必要はなく、どちらかが前後しても
差し支えないが、ここでは説明の便宜上同時にターンオ
フしたものとして説明する。第1および第2のスイッチ
12および14のターンオフにより開始される第2のモード
IIでは、磁気エネルギー蓄積用インダクタ16の電流はフ
リーホィールダイオード13を含む分岐回路および負荷15
(キャパシタ17)へそれぞれ転流する。すなわち、第1
のモードIの間に磁気エネルギー蓄積用インダクタ16に
蓄えられた磁気エネルギー(LIp2/2)によりインダク
タ16→キャパシタ17→フリーホィールダイオード13の
ループで共振動作を開始する。
て要求されるものである。つまり負荷15に印加される出
力電圧v cのピーク値VP (これが放電開始電圧となるの
が望ましい)および時刻t1 からピークまで達する時間T
1 (第2の動作モードIIの期間)は与えられ、キャパシ
タ17のキャパシタンスC も負荷15で決まるものである。
また、直流電源11の出力電圧E も自由に選べるのでシス
テムに合った電圧E として決めることができる。
より L およびIP はそれぞれ次式(4)、式(5)で求
められる。
流すためには第1および第2のスイッチ12および14が同
時に導通している時間T0 を、
を出力できることが分かる。つまり、第1および第2の
スイッチ12および14が同時に導通する時間T0 を制御す
ることにより、出力電圧パルスの立ち上がり部分の幅T1
を変化させずに出力パルスの波高値を自由に変えるこ
とができる。
15で放電が開始されてモードIIIとするのが1番効率の良
い動作となるが、放電は温度、湿度および気体の条件に
より非常に複雑な現象となり、定量的な説明が困難なた
め詳細な説明は省略する。しかし、放電による出力電圧
v 3の電圧降下が緩慢であると放電物理現象的に不都合
な場合が多く、時刻t3 で第2のスイッチ14をターンオ
ンして出力電圧v 3を強制的にゼロとするモードIVを設
ける必要がある。
回路ではターンオフ機能の無いサイラトロンに換えてタ
ーンオフ機能のある半導体スイッチを有効に使用し、極
めて簡単な回路構成で、低価格で小型の低電圧直流電源
から極めて幅の狭い高電圧パルスを発生させることがで
きる。また、第2のスイッチ14を含む回路部分のインダ
クタンス成分は原理的に出力パルス発生に影響を与えな
いことも本発明の回路の特徴である。
路の第2の実施例の詳細な構成を示すものである。図6
において、図4と同符号のものは同じ動作をするもので
ある。直流電源21に、インダクタ22およびキャパシタ23
より成る直流平滑回路を接続し、直流電源の高周波イン
ピーダンスを充分に低くし、パルス電流を円滑に供給で
きるようにする。図4の第1のスイッチ12として、本例
ではパワーMOSFET24を設ける。このパワーMOSFET24は、
前述のように低耐電圧のもので良く、これに流れる電流
のピーク値IP の大きさに応じて複数のパワーMOSFETを
並列接続したもので構成しても良い。図4の第2のスイ
ッチ14として、直列接続した複数の静電誘導サイリスタ
25-1〜25-4を設ける。これら複数の静電誘導サイリスタ
25-1〜25-4の全体を符号25で示す。直列した複数の静電
誘導サイリスタ25-1〜25-4の個数は、出力パルスの波高
値VP と各静電誘導サイリスタの耐電圧に応じて決り、
本例では4個の静電誘導サイリスタ25-1〜25-4を設けて
いる。
ッチ、本例では4個の静電誘導サイリスタ25-1〜25-4を
直列接続した場合、各半導体スイッチにそれぞれ独立し
たゲート駆動回路を必要とし、各ゲート駆動回路間には
高電圧(最大でVP)が印加されるためゲート駆動回路に
与える電源電圧および制御信号ともに相互間で高耐圧絶
縁を必要とし、装置の大型化、高コスト化および信頼性
の低下を招くことになる。また、各半導体スイッチに均
等に電圧が分圧されるようにするため、急峻に各半導体
スイッチをターンオンおよびターンオフさせる必要があ
り、各半導体スイッチに加えるゲート信号を非常に精度
良く同時に加えねばならず高度な技術が要求される。
に、個々に動作するゲート駆動回路を設けない方法を取
り入れている。すなわち、本実施例では静電誘導サイリ
スタ25-1〜25-4の個数に等しい個数の鉄心26-1〜26-4を
設け、フリーホィールダイオード13を含む分岐配線より
成る1次巻線27を鉄心26-1〜26-4に貫通させると共に、
各静電誘導サイリスタ25-1〜25-4のゲート−カソード間
に接続された2次巻線28-1〜28-4をそれぞれ鉄心26-1〜
26-4に貫通させる。このようにして1ターンの1次巻線
27を共通に設けると共に1ターンの2次巻線28-1〜28-4
を個別に設ける。
参照して説明する。時刻t0 でパワーMOSFET24がターン
オンすると、直流平滑回路のキャパシタ23から、パワー
MOSFET24および鉄心26-1〜26-4を経てキャパシタ29およ
び抵抗30の並列回路に電流が流れる。ここでキャパシタ
29はスピードアップキャパシタの役割をし、パワーMOSF
ET24のターンオン直後に大きな電流が流れるように作用
し、抵抗30は継続的な電流を流すように作用する。1対1
に結合された各鉄心26-1〜26-4の2次巻線28-1〜28-4に
は1次巻線27を流れる電流による磁束を打消すように同
じ量の電流が流れ、これが静電誘導サイリスタ25-1〜25
-4の各々のオンゲート電流となり、これらの静電誘導サ
イリスタを同時にターンオンさせることができる。この
ようにしてパワーMOSFET24と静電誘導サイリスタ25(25-
1〜25-4をまとめたもの)が導通し、磁気エネルギー蓄
積用インダクタ16に電流が流れ始める。その後の回路の
動作は第1の実施例の場合と全く同じとなる。ここで、
磁気エネルギー蓄積用インダクタ16の電流の立上がりは
早くないので静電誘導サイリスタ25-1〜25-4のターンオ
ンを急速に行う必要が無いため、必ずしもキャパシタ29
を必要とせず、抵抗30のみを設けても良い。
成する静電誘導サイリスタ25のターンオフの動作は、第
1の実施例とは以下説明するように異なっている。磁気
エネルギー蓄積用インダクタ16を流れる電流がIP に達
した時刻t1 で第1の半導体スイッチを構成するパワーM
OSFET24をターンオフすると、磁気エネルギー蓄積用イ
ンダクタ16に流れていた電流はフリーホィールダイオー
ド13を含む分岐回路に転流する。この電流は鉄心26-1〜
26-4を貫通する1次巻線27に流れ、これによる磁束を打
消すように2次巻線28-1〜28-4側には同じ電流が流れる
が、この電流が各々の静電誘導サイリスタ25-1〜25-4の
ゲートターンオフ電流となり、これらの静電誘導サイリ
スタ25-1〜25-4を同時にターンオフさせる。ここで、第
2の半導体スイッチとして使用する静電誘導サイリスタ
25-1〜25-4は比較的高電圧耐量があり、かつ高速でター
ンオンおよびターンオフが可能なスイッチデバイスであ
る。特に、IGBTのような電圧駆動デバイスではな
く、電流駆動デバイスであり、ターンオン、ターンオフ
ゲート電流が大きいほどターンオン、ターンオフ速度が
速くなり、パルスパワー応用のように高速度が要求され
る回路に使用するのに最適であり、さらにターンオフ利
得(=ターンオフすべきアノード電流/ゲートターンオ
フ電流)が小さいほど、半導体スイッチのターンオフ時
のストーレージ時間を短縮し、フォール時間も短縮でき
るため、第2の実施例のようにアノード電流がゲートタ
ーンオフ電流と等しく、ターンオフ利得が1となるよう
な場合には特に最適である。
ッチを構成する直列接続された複数の静電誘導サイリス
タ25-1〜25-4の各々のゲートターンオンおよびターンオ
フ電流ともに全く同一のものが流れ、かつ、大きな電流
を流すことが可能であるため、各静電誘導サイリスタ25
-1〜25-4を時間のバラツキのない同時高速ターンオン、
ターンオフを信頼性良く行うことをゲート駆動用電源お
よび独立したゲート信号を必要とせずに実現できる。
電を開始した後の適切な時刻t3 において再度第2の半
導体スイッチ14;25をターンオンさせ、キャパシタ17を
急放電させることもできる。これは負荷15の放電現象等
によりキャパシタ17が放電するが、放電インピーダンス
が高く放電によるキャパシタ17の電圧の低下が緩慢にな
り、放電の物理的現象に好ましくない影響を与えるよう
な場合には有効な手段となる。このように第2の半導体
スイッチ14;25を再度ターンオンさせる方法の一つとし
て、図5Bにおいて破線で示すように第2の半導体スイ
ッチを短時間の間だけターンオンさせることが可能であ
るが、このように構成すると、出力パルス電圧vC を図
5Hにおいて破線で示すように直ちに零電圧とすること
ができる。
してパワー MOSFET24を用い、第2の半導体スイ
ッチとして静電誘導サイリスタ25-1〜25-4を用いたが、
これに限定されるものではなく、他の形式のトランジス
タやIGBT(第2の半導体スイッチとして使用する場
合には、電圧駆動素子でかつゲート−エミッタ間電圧に
制限があるためこれに対する考慮が必要となる)などの
半導体スイッチを用いることもできる。また、第2の実
施例では第2の半導体スイッチを4個の静電誘導サイリ
スタ25-1〜25-4の直列接続回路で構成したが、この個数
は出力パルスの波高値によって決るものであり、必要に
応じて変るものであることおよび負荷について容量性の
放電回路にて説明したがはこれに限定されるものではな
いことは言うまでもない。さらに、第2のスイッチおよ
び磁気エネルギー蓄積用インダクタ16について電源の正
側に接続した場合で説明したが、何れか一方あるいは双
方とも電源の負側に配置しても同様の作用をすることも
言うまでもない。
示す回路図である
回路の構成を示す回路図である。
を説明する波形図である。
構成を有する第1の実施例を示す回路図である
回路の動作を説明するための波形図である。
施例を示す回路図である。
の半導体スイッチ)、13 フリーホィールダイオード、
14 高耐圧半導体スイッチ(第2の半導体スイッ
チ)、 16 磁気エネルギー蓄積用インダクタ、 17
キャパシタ、 21低圧直流電源、 22 直流平滑用イン
ダクタ、 23 直流平滑用キャパシタ、 24 パワー M
OSFET(第1の半導体スイッチ)、 25:25-1〜25-
4 静電誘導サイリスタ(第2の半導体スイッチ)、 2
6-1〜26-4 鉄心、 27 1次巻線、 28-1〜28-4 2
次巻線、 29 スピードアップキャパシタ、 30 抵抗
Claims (12)
- 【請求項1】第1および第2の出力端子を有する直流電
源と、 一端がこの直流電源の第1の出力端子に接続された第1
のスイッチ、この第1のスイッチの他端に一端が接続さ
れたインダクタおよび一端がこのインダクタの他端に接
続され、他端が前記直流電源の第2の出力端子に接続さ
れた第2のスイッチより成る直列回路と、 前記第1のスイッチの他端と前記インダクタの一端との
接続点と、前記直流電源の第2の出力端子との間に接続
された、フリーホィールダイオードを含む分岐配線とを
具え、 前記第1および第2のスイッチをオンとして前記インダ
クタに磁気エネルギーを蓄えた後に、第1および第2の
スイッチをターンオフして、前記インダクタに蓄えたエ
ネルギーを、前記第2のスイッチの両端に接続された負
荷へ転流するように構成した高電圧パルス発生回路。 - 【請求項2】前記第1および第2のスイッチを少なくと
もターンオフ可能な半導体スイッチで構成した請求項1
に記載の高電圧パルス発生回路。 - 【請求項3】前記第1および第2のスイッチをターンオ
ンおよびターンオフ可能な半導体スイッチで構成した請
求項2に記載の高電圧パルス発生回路。 - 【請求項4】前記第1のスイッチを低耐電圧の半導体ス
イッチで構成し、前記第2のスイッチを出力パルス電圧
の大きさに応じて決められる個数の高耐電圧の半導体ス
イッチを直列接続した半導体スイッチ直列回路で構成
し、この半導体スイッチ直列回路の半導体スイッチの個
数に等しい鉄心を設け、これらの鉄心を貫通する1次巻
線を前記フリーホィールダイオードを含む分岐配線に設
け、前記半導体スイッチ直列回路の各半導体スイッチの
ゲートおよびカソード端子に接続された2次巻線を前記
鉄心にそれぞれ通した請求項3に記載の高電圧パルス発
生回路。 - 【請求項5】前記第2のスイッチを構成する半導体スイ
ッチ直列回路の各半導体スイッチを静電誘導サイリスタ
で構成した請求項4に記載の高電圧パルス発生回路。 - 【請求項6】前記1次巻線および2次巻線を、前記鉄心
にそれぞれ1ターンだけ巻回した請求項5に記載の高電
圧パルス発生回路。 - 【請求項7】前記第1のスイッチを構成する低耐電圧の
半導体スイッチをパワーMOSFETで構成した請求項
5に記載の高電圧パルス発生回路。 - 【請求項8】前記第2のスイッチをターンオフし、負荷
へエネルギーを開放した後に第2のスイッチを再度ター
ンオンさせるように構成した請求項1に記載の高電圧パ
ルス発生回路。 - 【請求項9】前記第2のスイッチをターンオフし、負荷
へエネルギーを開放した後に第2のスイッチを再度短時
間ターンオンさせるように構成した請求項8に記載の高
電圧パルス発生回路。 - 【請求項10】前記第1および第2のスイッチをほぼ同
時にターンオフするように構成した請求項1に記載の高
電圧パルス発生回路。 - 【請求項11】前記第1のスイッチをターンオフした直
後に、前記第2のスイッチをターンオフするように構成
した請求項1に記載の高電圧パルス発生回路。 - 【請求項12】前記フリーホィールダイオードと並列
に、キャパシタおよび抵抗の並列回路あるいは抵抗のみ
を接続した請求項1に記載の高電圧パルス発生回路。
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