JP2002246512A - Bgaパッケージの構造及び実装基板の構造 - Google Patents

Bgaパッケージの構造及び実装基板の構造

Info

Publication number
JP2002246512A
JP2002246512A JP2001040676A JP2001040676A JP2002246512A JP 2002246512 A JP2002246512 A JP 2002246512A JP 2001040676 A JP2001040676 A JP 2001040676A JP 2001040676 A JP2001040676 A JP 2001040676A JP 2002246512 A JP2002246512 A JP 2002246512A
Authority
JP
Japan
Prior art keywords
bga
package
bga package
projection
mounting board
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2001040676A
Other languages
English (en)
Inventor
Masumi Sugai
万寿美 菅井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP2001040676A priority Critical patent/JP2002246512A/ja
Publication of JP2002246512A publication Critical patent/JP2002246512A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/17Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
  • Structure Of Printed Boards (AREA)
  • Wire Bonding (AREA)

Abstract

(57)【要約】 【課題】BGAパッケージとプリント基板との間隔を一
定距離に固定しにくく、プリント基板に仮固定する際に
BGAパッケージの位置がずれる場合がある。 【解決手段】BGAパッケージ2と、BGAパッケージ
2の一面側に設けられる複数のBGA端子21と、複数
のBGA端子21に形成されるはんだボール4と、BG
A端子21と同一面側に設けられ中央部付近に突起段差
部32を有し、先端部にかけて突起円すい部31を有す
る複数のBGA突起部3と、を備えるBGAパッケージ
の構造。プリント基板1と、プリント基板1の一面側に
設けられて、BGAパッケージ2の複数のはんだボール
4が接触する複数のBGA接続用端子11と、BGA接
続用端子11と同一面側に設けられて、BGAパッケー
ジ2の突起段差部32を有するBGA突起部3が挿入さ
れるBGA突起部用穴5と、を備えるプリント基板の構
造。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、プリント基板の表
面に実装する電子部品の実装構造に関し、特にはんだ付
け状態が外観によって確認できないBGA(Ball
Grid Array、ボールグリッドアレイ)パッケ
ージの構造及び実装基板の構造に関する。
【0002】
【従来の技術】表面実装型多端子LSIパッケージは、
ピン数の増大や狭ピッチ化のため、実装上の歩留まりを
向上させうるBGAパッケージが多く利用されている。
BGAパッケージは、LSIチップを搭載したパッケー
ジの一面側に二次元でアレイ状に配置されたBGA端子
に球状のはんだ(はんだボール)を塗布したものであ
る。
【0003】このようなBGAパッケージをプリント基
板にはんだ付け実装する場合は、プリント基板のBGA
接続用端子にはんだを塗布し、BGAパッケージのBG
A端子とプリント基板のBGA接続用端子とを自動機ま
たは人手で位置を合わせをして仮実装したあと、BGA
端子に予め塗布したはんだ(はんだボール)を熱で溶か
してBGA端子とBGA接続用端子とを溶着している。
【0004】上記した従来の技術として、プリント基板
上に、マウンタ認識マークを設け、目視によりBGAパ
ッケージとプリント基板とのずれを確認することが特開
平9−83093号公報に開示されている。
【0005】
【発明が解決しようとする課題】しかし、このBGAパ
ッケージの従来構造には、次のような問題点があった。
【0006】第1の問題点は、BGAパッケージをプリ
ント基板にはんだ付け実装する場合にBGAパッケージ
とプリント基板との間隔を一定距離に保ちづらく、距離
が短か過ぎる箇所ははんだが隣接端子部にはみ出して誤
接続を生じたり、また距離が長い場合はBGAパッケー
ジのBGA端子とプリント基板のBGA接続端子との間
に十分はんだが届かないため未接続を生じたりする場合
があることである。その理由は、BGAパッケージをプ
リント基板に仮固定する場合、BGA端子に塗布したは
んだボールとBGA接続用端子に塗布したはんだのみで
固定しているため、BGAパッケージがずれたり傾いた
りする場合があり、BGAパッケージとプリント基板の
間隔を均一にするのが難しいためである。。
【0007】第2の問題点は、BGAパッケージをプリ
ント基板に仮固定する場合にBGAパッケージの位置が
ずれる場合があり、はんだボールを熱で溶かしてBGA
パッケージのBGA端子とプリント基板のBGA接続用
端子を溶着する際にBGA端子とBGA接続用端子がず
れることにより、未接続や隣接端子部との誤接続などの
接続不良が発生することである。その理由は、BGA端
子とBGA接続用端子の距離が近いためわずかな位置ず
れでもはんだの未接続や隣接端子との誤接続が発生する
ためである。
【0008】
【課題を解決するための手段】上記の課題を解決するた
めに、本発明の請求項1に係わる発明は、BGAパッケ
ージと、前記BGAパッケージの一面側に設けられる複
数のBGA端子と、前記複数のBGA端子に形成される
はんだボールと、前記BGA端子と同一面側に設けら
れ、柱状部と段差部とテーパ部とを有する複数の突起部
と、を備えることを特徴とする。
【0009】また、本発明の請求項2に係わる発明は、
前記請求項1記載の前記突起部が、中央部付近に前記段
差部を有し、前記段差部から前記BGAパッケージにか
けて前記柱状部を有し、前記段差部から先端部にかけて
前記テーパ部を有することを特徴とする。
【0010】さらに、本発明の請求項3に係わる発明
は、前記請求項1、2記載の前記テーパ部が、円すいま
たは角すいであることを特徴とする。
【0011】さらに、本発明の請求項4に係わる発明
は、前記請求項1記載の前記複数の突起部の中心軸が、
前記BGAパッケージが実装される実装基板に設けられ
た複数のBGA突起部用穴の中心軸とそれぞれ一致して
いることを特徴とする。
【0012】さらに、本発明の請求項5に係わる発明
は、前記請求項1記載の前記複数の突起部が、前記BG
Aパッケージの複数の隅部にそれぞれ装着されているこ
とを特徴とする。
【0013】さらに、本発明の請求項6に係わる発明
は、前記請求項1記載の前記突起部の前記柱状部の高さ
が、前記BGA端子の高さと、前記はんだボールの高さ
と、前記BGAパッケージが実装される実装基板に設け
られ前記BGA端子とはんだ溶着されるBGA接続用端
子の高さと、の合計値より低いことを特徴とする。
【0014】さらに、本発明の請求項7に係わる発明
は、前記請求項1記載の前記突起部が、フランジの形状
をなしていることを特徴とする。
【0015】さらに、本発明の請求項8に係わる発明
は、BGAパッケージが実装される実装基板と、前記実
装基板の一面側に設けられて、前記BGAパッケージに
設けられた複数のはんだボールが接触する複数のBGA
接続用端子と、前記BGA接続用端子と同一面側に設け
られて、前記BGAパッケージに設けられた段差部を有
する突起部が挿入されるBGA突起部用穴と、を備える
ことを特徴とする。
【0016】さらに、本発明の請求項9に係わる発明
は、前記請求項8記載の前記BGA突起部用穴が、前記
突起部と対になって設けられていることを特徴とする。
【0017】さらに、本発明の請求項10に係わる発明
は、前記請求項8記載の前記BGA突起部用穴が、前記
突起部に設けられ前記BGA突起部用穴に挿入されるテ
ーパ部と嵌め合うようなテーパ状であることを特徴とす
る。
【0018】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して詳細に説明する。
【0019】(実施の形態の構成)図1は、本発明のB
GAパッケージの構造におけるBGAパッケージの斜視
図である。図2は、本発明のBGAパッケージの構造に
おけるBGAパッケージの断面図である。図3は、本発
明のBGAパッケージの構造及び実装基板の構造におい
て、BGAパッケージが実装基板に取り付けられ、はん
だで溶着される前の断面図である。図4は、本発明のB
GAパッケージの構造及び実装基板の構造において、B
GAパッケージが実装基板に取り付けられ、はんだで溶
着された後の断面図である。
【0020】図1を参照すると、BGAパッケージ2の
一面側であるBGA端子面の4隅(4つの隅部)に、B
GA突起部3を有する。BGA突起部3の数は、4個に
限られるものではなく、BGAパッケージ2の位置を固
定できる数、例えば対角線上の隅部に配置された2個で
もよい。また、BGA突起部3は、BGAパッケージ2
の隅部や周辺部に限って配置されなくてもよいし、一カ
所にかたまらずに互いに一定の間隔をもって配置されて
もよい。
【0021】図1及び図2を参照すると、BGA突起部
3が、BGAパッケージ2のBGA端子面に対して直角
方向に突出しており、BGA突起部3の途中に突起段差
部32があり、突起段差部32から先端部にかけて細く
なりテーパ状となって、円すい状の突起円すい部31を
形成している。突起円すい部31は、角すい形状であっ
てもかまわない。
【0022】BGAパッケージ2のBGA端子面には、
アレイ状二次元に配置されたBGA端子21と、BGA
端子21に形成されたはんだボール4とが備えられてい
る。
【0023】BGA突起部3を、突起円すい部31から
プリント基板1(実装基板)に設けたBGA突起部用穴
5に挿入した場合、途中の突起段差部32がプリント基
板1のBGA突起部用穴5より大きいため停止して固定
される。従って、プリント基板1とBGAパッケージ2
との間隔は、突起柱状部33の高さに固定される。な
お、BGA突起部3の材料については、金属材料でもモ
ールド材料でも良い。
【0024】図3及び図4を参照すると、プリント基板
1には、はんだボール4と接触するBGA端子21と、
BGA突起部3の突起円すい部31が挿入されるBGA
突起部用穴5とが設けられている。
【0025】(実施の形態の動作)図3は、BGAパッ
ケージ2をプリント基板1にはんだ付け実装する場合に
おいて、BGAパッケージ2をプリント基板1に仮実装
しBGAパッケージ2のBGA端子21に形成したはん
だボール4でプリント基板1のBGA接続用端子11と
はんだボール4による溶着前の状態を示している。突起
円すい部31の一部が、BGA突起部用穴5に挿入され
ている状態である。
【0026】また、図4はBGAパッケージ2のBGA
端子21とプリント基板1のBGA接続用端子11とは
んだボール4により溶着した後の状態を示しており、B
GA突起部用穴5より大きい突起段差部32は、BGA
突起部用穴5の中に挿入されることはない。
【0027】図3によると、BGAパッケージ2をプリ
ント基板1に仮実装する際、プリント基板1に設けたB
GA突起部用穴5にBGAパッケージ2のBGA突起部
3の突起円すい部31の先端部が挿入される。
【0028】BGAパッケージ2のBGA突起部3の突
起円すい部31は先端部にかけて細くなっているため、
プリント基板1に設けた突起部用穴5に容易に挿入出来
る。
【0029】図4によると、BGAパッケージ2をプリ
ント基板1に仮実装した後、BGA端子21に形成した
はんだボール4によってプリント基板1に設けたBGA
接続用端子11とBGA端子21とがはんだで溶着され
る。
【0030】この溶着において、BGAパッケージ2の
端子部21に形成したはんだボール4が溶解することに
より、BGAパッケージ2は自重で沈み込む際、BGA
パッケージ2に具備したBGA突起部3の途中にある突
起円すい部31はプリント基板1に設けたBGA突起部
用穴5に沿って沈み込み、BGA突起部3の途中にある
突起段差部32で沈み込みが停止し、BGAパッケージ
2とプリント基板1との間隔が一定(突起柱状部3の高
さ)に保持される。つまり、BGA突起柱状部33の直
径は、BGA突起部用穴5の直径より大きくなるように
形成されている。また、突起段差部32をフランジにし
ても同様に沈み込みを停止させることが可能である。
【0031】BGA端子21とBGA接続用端子11と
のずれをさらに防止するためには、BGA突起部用穴5
が、突起円すい部31と嵌め合うような円すい状であれ
ばさらによい。また、複数のBGA突起部3の中心軸
と、複数のBGA突起部用穴5の中心軸とがそれぞれ一
致していることも効果的である。
【0032】以上の説明では、本発明をBGAパッケー
ジについて適用したが、CSPパッケージ(チップサイ
ズパッケージ)についても適用することが可能である。
【0033】
【発明の効果】第1の効果は、BGAパッケージとプリ
ント基板との間隔を一定に保持できることである。その
理由は、BGAパッケージに具備したBGA突起部の途
中に設けた突起段差部がプリント基板に設けたBGA突
起部用穴で固定され、BGAパッケージとプリント基板
とが一定の距離を保つことが出来るためである。
【0034】第2の効果は、BGAパッケージとプリン
ト基板との位置合わせが容易でかつ位置ずれが小さいこ
とである。その理由は、BGAパッケージに具備したB
GA突起部がプリント基板に設けたBGA突起部用穴に
沿って挿入されるためである。
【図面の簡単な説明】
【図1】本発明のBGAパッケージの構造におけるBG
Aパッケージの斜視図である。
【図2】本発明のBGAパッケージの構造におけるBG
Aパッケージの断面図である。
【図3】本発明のBGAパッケージの構造及び実装基板
の構造において、BGAパッケージが実装基板に取り付
けられ、はんだで溶着される前の断面図である。
【図4】本発明のBGAパッケージの構造及び実装基板
の構造において、BGAパッケージが実装基板に取り付
けられ、はんだで溶着された後の断面図である。
【符号の説明】
1 プリント基板 11 BGA接続用端子 2 BGAパッケージ 21 BGA端子 3 BGA突起部 31 突起円すい部 32 突起段差部 33 突起柱状部 4 はんだボール 5 BGA突起部用穴

Claims (10)

    【特許請求の範囲】
  1. 【請求項1】 BGAパッケージと、前記BGAパッケ
    ージの一面側に設けられる複数のBGA端子と、前記複
    数のBGA端子に形成されるはんだボールと、前記BG
    A端子と同一面側に設けられ、柱状部と段差部とテーパ
    部とを有する複数の突起部と、を備えることを特徴とす
    るBGAパッケージの構造。
  2. 【請求項2】 前記突起部が、中央部付近に前記段差部
    を有し、前記段差部から前記BGAパッケージにかけて
    前記柱状部を有し、前記段差部から先端部にかけて前記
    テーパ部を有することを特徴とする請求項1記載のBG
    Aパッケージの構造。
  3. 【請求項3】 前記テーパ部が、円すいまたは角すいで
    あることを特徴とする請求項1、2記載のBGAパッケ
    ージの構造。
  4. 【請求項4】 前記複数の突起部の中心軸が、前記BG
    Aパッケージが実装される実装基板に設けられた複数の
    BGA突起部用穴の中心軸とそれぞれ一致していること
    を特徴とする請求項1記載のBGAパッケージの構造。
  5. 【請求項5】 前記複数の突起部が、前記BGAパッケ
    ージの複数の隅部にそれぞれ装着されていることを特徴
    とする請求項1記載のBGAパッケージの構造。
  6. 【請求項6】 前記突起部の前記柱状部の高さが、前記
    BGA端子の高さと、前記はんだボールの高さと、前記
    BGAパッケージが実装される実装基板に設けられ前記
    BGA端子とはんだ溶着されるBGA接続用端子の高さ
    と、の合計値より低いことを特徴とする請求項1記載の
    BGAパッケージの構造。
  7. 【請求項7】 前記突起部が、フランジの形状をなして
    いることを特徴とする請求項1記載のBGAパッケージ
    の構造。
  8. 【請求項8】 BGAパッケージが実装される実装基板
    と、前記実装基板の一面側に設けられて、前記BGAパ
    ッケージに設けられた複数のはんだボールが接触する複
    数のBGA接続用端子と、前記BGA接続用端子と同一
    面側に設けられて、前記BGAパッケージに設けられた
    段差部を有する突起部が挿入されるBGA突起部用穴
    と、を備えることを特徴とする実装基板の構造。
  9. 【請求項9】 前記BGA突起部用穴が、前記突起部と
    対になって設けられていることを特徴とする請求項8記
    載の実装基板の構造。
  10. 【請求項10】 前記BGA突起部用穴が、前記突起部
    に設けられ前記BGA突起部用穴に挿入されるテーパ部
    と嵌め合うようなテーパ状であることを特徴とする請求
    項8記載の実装基板の構造。
JP2001040676A 2001-02-16 2001-02-16 Bgaパッケージの構造及び実装基板の構造 Pending JP2002246512A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2001040676A JP2002246512A (ja) 2001-02-16 2001-02-16 Bgaパッケージの構造及び実装基板の構造

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2001040676A JP2002246512A (ja) 2001-02-16 2001-02-16 Bgaパッケージの構造及び実装基板の構造

Publications (1)

Publication Number Publication Date
JP2002246512A true JP2002246512A (ja) 2002-08-30

Family

ID=18903240

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2001040676A Pending JP2002246512A (ja) 2001-02-16 2001-02-16 Bgaパッケージの構造及び実装基板の構造

Country Status (1)

Country Link
JP (1) JP2002246512A (ja)

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7224072B2 (en) 2003-01-23 2007-05-29 Funai Electric Co., Ltd. Mounting structure for ball grid array type IC
JP2008147317A (ja) * 2006-12-08 2008-06-26 Matsushita Electric Ind Co Ltd 電子部品の実装方法
WO2008139563A1 (ja) * 2007-05-07 2008-11-20 Fujitsu Limited 電子装置及びその製造方法、当該電子装置を有する電子機器
JP2011216558A (ja) * 2010-03-31 2011-10-27 Nec Corp 電子部品実装装置及び電子部品並びに基板
JP2013183104A (ja) * 2012-03-02 2013-09-12 Toyota Industries Corp 半導体装置
US10331161B2 (en) 2014-12-24 2019-06-25 Fujitsu Limited Power supply board
JP7023339B1 (ja) 2020-11-04 2022-02-21 三菱電機株式会社 半導体装置

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7224072B2 (en) 2003-01-23 2007-05-29 Funai Electric Co., Ltd. Mounting structure for ball grid array type IC
JP2008147317A (ja) * 2006-12-08 2008-06-26 Matsushita Electric Ind Co Ltd 電子部品の実装方法
WO2008139563A1 (ja) * 2007-05-07 2008-11-20 Fujitsu Limited 電子装置及びその製造方法、当該電子装置を有する電子機器
JP2011216558A (ja) * 2010-03-31 2011-10-27 Nec Corp 電子部品実装装置及び電子部品並びに基板
JP2013183104A (ja) * 2012-03-02 2013-09-12 Toyota Industries Corp 半導体装置
US10331161B2 (en) 2014-12-24 2019-06-25 Fujitsu Limited Power supply board
JP7023339B1 (ja) 2020-11-04 2022-02-21 三菱電機株式会社 半導体装置
JP2022074234A (ja) * 2020-11-04 2022-05-18 三菱電機株式会社 半導体装置

Similar Documents

Publication Publication Date Title
EP1764833B1 (en) Lead pin for mounting semiconductor and printed wiring board
US5926731A (en) Method for controlling solder bump shape and stand-off height
US20080245554A1 (en) Fabrication method and structure of pcb assembly, and tool for assembly thereof
KR100381111B1 (ko) Bga패키지를 이용한 반도체장치 및 그 제조방법
JP2002246512A (ja) Bgaパッケージの構造及び実装基板の構造
JPH11111771A (ja) 配線基板の接続方法、キャリア基板および配線基板
JP2000012732A (ja) Bga型半導体装置の構造
JP2007027576A (ja) 半導体装置
US5849609A (en) Semiconductor package and a method of manufacturing thereof
JPH11145600A (ja) プリント配線基板上のパッドの構造及び電子ユニット
JPH10335795A (ja) プリント基板
JP2006165485A (ja) 表面実装部品の実装構造
JPH11345826A (ja) 半導体装置、半導体装置の製造方法及び半導体装置の実装方法
KR100810349B1 (ko) 인터포저와 그를 이용한 반도체 패키지
US6441477B2 (en) Substrate mounting an integrated circuit package with a deformed lead
JPH06252326A (ja) 多端子部品、配線基板、多端子部品の実装構造
JP3498458B2 (ja) 混成集積回路装置
CN218677122U (zh) 封装体
JP2005197406A (ja) Bga型icパッケージの取付構造
JPH11251727A (ja) グリッドアレイ型半導体パッケージの実装方法
JP3434775B2 (ja) 裏面電極型電気部品の実装方法および統合ランド
JP2751897B2 (ja) ボールグリッドアレイ実装構造及び実装方法
KR101141587B1 (ko) 솔더볼용 블록형 핀
JPH11251726A (ja) グリッドアレイ型半導体パッケージの実装方法
JP2001085832A (ja) 電子部品実装構造とその実装方法

Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20030826