JP2000011525A - Disk reproducing device and disk motor control circuit - Google Patents
Disk reproducing device and disk motor control circuitInfo
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Abstract
Description
【0001】[0001]
【発明の属する技術分野】本発明は、CDやDVD等の
光学的ディスク再生装置に関わり、とくにディスクモー
タ制御で重要となるディスクモータ制御回路に関するも
のである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an apparatus for reproducing an optical disk such as a CD or a DVD, and more particularly to a disk motor control circuit which is important for controlling a disk motor.
【0002】[0002]
【従来の技術】オーディオ記録媒体として始まったCD
(コンパクトディスク)は、光ディスクの持つ大容量記
録、高速アクセスの特徴を生かしてコンピュータの分野
の記録媒体(CD−ROM)としても使われるようにな
り、さらに広く普及するようになった。ディスクからデ
ータを再生するディスク再生装置は、ディスクをディス
クモータ制御回路及びディスクモータによって回転させ
る。半導体レーザや光電変換素子などを内蔵した光学式
ピックアップ素子(PU)は、ディスクモータで回転さ
れているディスクの内周側から外周側に向かってリニア
トラッキングすることによりディスクに記録されたデー
タを読み取る。読み取られたデータ(電流信号)は、R
Fアンプに供給される。RFアンプは、電流信号を電圧
信号としての広帯域の信号、即ちRF信号に変換してこ
れをデータスライス回路に供給する。2. Description of the Related Art CD started as an audio recording medium
The (compact disc) has been used as a recording medium (CD-ROM) in the field of computers, taking advantage of the features of large capacity recording and high-speed access possessed by the optical disc, and has become more widely used. A disk reproducing apparatus for reproducing data from a disk rotates the disk by a disk motor control circuit and a disk motor. An optical pickup element (PU) incorporating a semiconductor laser, a photoelectric conversion element, and the like reads data recorded on a disk by performing linear tracking from the inner circumference to the outer circumference of a disk rotated by a disk motor. . The read data (current signal) is R
It is supplied to the F amplifier. The RF amplifier converts a current signal into a broadband signal as a voltage signal, that is, an RF signal, and supplies this to a data slice circuit.
【0003】データスライス回路は、ディスクからの再
生信号を2値化し、例えば、CDである場合ではEFM
(Eight to Fourteen Modulation)信号として、PLL(P
haseLocked Loop) 回路及び信号処理回路に供給する。
信号処理回路は、EFM信号から同期信号を分離した後
EFM復調し、1フレーム当たりサブコードデータ1シ
ンボルとバリティを含む32シンボルのデータとを得
て、サブコードの復調及びデータの訂正を行い、これを
オーディオデータもしくはコンピュータ用データとして
出力させている。ディスクの再生速度又はディスクの強
制加速及び強制減速といった設定は、システムコントロ
ーラによって制御することが出来る。最近のCD−RO
Mドライブの動向としては高倍速競争が続き、オーディ
オCDの再生速度を1倍速として、32倍速再生が可能
なものまで実現しているのが現状である。現状では信号
処理能力の向上を図ると共に、線速度一定(CLV:Co
nstant Linear Velocity)方式で信号が記録されている
ディスクを内周部では回転速度一定(CAV:Constant
Angular Velocity )方式で再生し、外周部ではCLV
方式により再生することによって、ディスクモータの負
担及び振動問題の軽減を図り、32倍速という高速再生
が実現されている。A data slice circuit binarizes a reproduction signal from a disk, and for example, in the case of a CD, an EFM
(Eight to Fourteen Modulation) signal as PLL (P
haseLocked Loop) circuit and signal processing circuit.
The signal processing circuit separates the synchronization signal from the EFM signal and then performs EFM demodulation, obtains one symbol of subcode data per frame and data of 32 symbols including a parity, demodulates the subcode and corrects the data, This is output as audio data or computer data. Settings such as the playback speed of the disc or the forced acceleration and deceleration of the disc can be controlled by a system controller. Recent CD-RO
As for the trend of the M drive, high-speed competition continues, and at present, the reproduction speed of an audio CD has been realized to be 1x speed and to be capable of 32x speed reproduction. At present, while improving the signal processing capacity, the linear velocity (CLV: Co
A disk on which a signal is recorded by the nstant linear velocity (VST) method has a constant rotation speed (CAV: Constant) at the inner periphery.
Angular Velocity) method, and CLV on the outer periphery
By performing the reproduction by the method, the load on the disk motor and the problem of vibration are reduced, and a high-speed reproduction of 32 times speed is realized.
【0004】図11に従来のディスク再生装置における
ディスクモータのサーボループを示し、ディスクモータ
制御について述べる。ディスクモータ2により回転され
ているディスク1からピックアップ(PU)3によって
読み出された電気信号は、RFアンプ4に入力される。
RFアンプ4は、前記電気信号に基づいてRF信号を生
成し、スライス・PLL回路5に入力される。そしてス
ライス・PLL回路5を構成するデータスライス回路で
2値化されてEFM信号が生成される。EFM信号は、
スライス・PLL回路5を構成するPLL回路に送ら
れ、そこでEFM信号に同期したPLLクロックPLC
Kが生成される。EFM信号とPLCKは、信号処理回
路6に送られ、EFM復調、訂正、データ出力等が行わ
れる。信号処理回路6ではシステムコントローラ10か
らの制御信号を受けて再生速度等の設定変更を行うこと
ができる。また信号処理回路6からは再生速度に比例し
た周波数を有するフレーム同期信号PFCKが生成さ
れ、ディスクモータ制御回路8に入力される。ディスク
モータ制御回路8にはモータドライバ11からディスク
1の回転周波数に比例したFGパルスも入力される。デ
ィスクモータ制御回路8ではシステムコントローラ10
によりCLVもしくはCAVの再生方式を設定すること
ができるが、CLV再生の時はPFCKを用い、CAV
再生の時はFGパルスを用いることにより、それに応じ
たディスクモータ制御信号を生成し、モータドライバ1
1に入力している。モータドライバ11は、このディス
クモータ制御信号を受けてモータの電力に変換し、ディ
スクモータ2を駆動している。FIG. 11 shows a servo loop of a disk motor in a conventional disk reproducing apparatus, and the disk motor control will be described. An electric signal read by the pickup (PU) 3 from the disk 1 rotated by the disk motor 2 is input to the RF amplifier 4.
The RF amplifier 4 generates an RF signal based on the electric signal, and is input to the slice / PLL circuit 5. Then, the data is binarized by a data slice circuit constituting the slice / PLL circuit 5 to generate an EFM signal. The EFM signal is
The PLL clock which is sent to the PLL circuit constituting the slice / PLL circuit 5 and is synchronized therewith with the EFM signal
K is generated. The EFM signal and the PLCK are sent to the signal processing circuit 6, where EFM demodulation, correction, data output, and the like are performed. The signal processing circuit 6 can change the setting such as the reproduction speed in response to the control signal from the system controller 10. Further, a frame synchronization signal PFCK having a frequency proportional to the reproduction speed is generated from the signal processing circuit 6 and input to the disk motor control circuit 8. An FG pulse proportional to the rotation frequency of the disk 1 is also input from the motor driver 11 to the disk motor control circuit 8. In the disk motor control circuit 8, the system controller 10
Can set the playback method of CLV or CAV, but at the time of CLV playback, use PFCK and CAV
At the time of reproduction, an FG pulse is used to generate a disk motor control signal corresponding to the FG pulse, and the motor driver 1
1 is input. The motor driver 11 receives the disk motor control signal, converts the signal into motor power, and drives the disk motor 2.
【0005】システムコントローラ10からディスクモ
ータ制御回路8に強制減速制御信号が送られるとこの制
御回路で生成されるディスクモータ制御信号は、ディス
クモータ2が逆方向に回転するようなトルクを発生さ
せ、結果的にディスクの回転を減速させる。ブレーキ回
路7は、スライス・PLL回路5からのEFM信号ある
いはモータドライバ11からのFGパルスの周期を計測
して十分遅くなったことを検出してブレーキ信号(BR
KR信号)を発生する。ブレーキ信号BRKRがディス
クモータ制御回路8に入力されると、この信号BRKR
がディスクモータ制御信号をオフにしてディスク1を停
止させる。When a forced deceleration control signal is sent from the system controller 10 to the disk motor control circuit 8, the disk motor control signal generated by this control circuit generates a torque that causes the disk motor 2 to rotate in the reverse direction. As a result, the rotation of the disk is reduced. The brake circuit 7 measures the EFM signal from the slice / PLL circuit 5 or the period of the FG pulse from the motor driver 11 and detects that it has become sufficiently slow, and detects the brake signal (BR
KR signal). When the brake signal BRKR is input to the disk motor control circuit 8, this signal BRKR
Turns off the disk motor control signal and stops the disk 1.
【0006】図12に従来のディスクモータ制御回路を
示し、ディスクモータ制御信号の生成方法について、さ
らに詳しく述べる。ディスクモータ制御回路8は、AF
C(Automatic Frequency Control) 回路81とAPC(A
utomatic Phase Control) 回路82の大きく分けて2つ
のブロックからなる。AFC回路81は、CLV動作時
には図11の信号処理回路で生成される再生速度に比例
したフレーム同期信号PFCKを受け、クロック発生回
路9で生成される水晶発振器X’talで生成されたク
ロック信号を分周したクロックCKでそのフレーム同期
信号PFCKを計測することによりフレーム周波数の誤
差を検出する。一方、CAV動作時には図11のモータ
ドライバ11で生成されるFGパルスをクロックCKで
計測することにより、FGパルスの周波数の誤差を検出
できる。またAPC回路82は、CLV動作時のみに働
くもので、最近のディスク再生装置で主流になっている
可変速再生時(CAV動作時も含む)にはAPCデータ
(位相誤差信号)を“0”としている。APC回路82
は、クロックCKに対する位相誤差を検出して、CLV
動作時のディスクモータのジッタを吸収することによ
り、CLV動作をより正確にするために機能する。FIG. 12 shows a conventional disk motor control circuit, and a method of generating a disk motor control signal will be described in more detail. The disk motor control circuit 8 includes an AF
C (Automatic Frequency Control) circuit 81 and APC (A
utomatic Phase Control) The circuit 82 is roughly divided into two blocks. The AFC circuit 81 receives the frame synchronization signal PFCK proportional to the reproduction speed generated by the signal processing circuit of FIG. 11 at the time of the CLV operation, and outputs the clock signal generated by the crystal oscillator X′tal generated by the clock generation circuit 9. An error of the frame frequency is detected by measuring the frame synchronization signal PFCK with the divided clock CK. On the other hand, during the CAV operation, an error in the frequency of the FG pulse can be detected by measuring the FG pulse generated by the motor driver 11 in FIG. 11 with the clock CK. The APC circuit 82 operates only at the time of CLV operation. At the time of variable speed reproduction (including CAV operation), which is the mainstream in recent disk reproducing devices, APC data (phase error signal) is set to "0". And APC circuit 82
Detects the phase error with respect to the clock CK and
It functions to make the CLV operation more accurate by absorbing the jitter of the disk motor during operation.
【0007】ディスクモータ制御信号は、AFCデータ
とAPCデータが足し込まれたものになる。セレクタ8
3は、図13のセレクタの対応表にあるように、正常に
CLV、CAV動作が行われているノーマル再生の場合
はAFC回路で検出した周波数誤差信号を選択(A0)
し、システムコントローラ10から入力される強制加速
制御信号が入力された場合は所定の値に設定された正の
値、例えば、正の最大値を選択(A1)し、強制減速制
御信号が入力された場合は所定の値に設定された負の
値、例えば、負の最大値を選択(A2)し、そして強制
減速制御信号が入力されBRKR信号を検出した場合は
“0”を選択(A3)してAFCデータとするように構
成されている。以上のようにディスクモータ制御回路8
で生成されるディスクモータ制御信号により、正確なC
LV・CAV動作又はシステムコントローラ10の制御
信号によるディスク1の強制加減速動作及びディスクモ
ータ2の停止が可能となる。The disk motor control signal is obtained by adding AFC data and APC data. Selector 8
3 selects a frequency error signal detected by the AFC circuit in the case of normal reproduction in which CLV and CAV operations are normally performed, as shown in the selector correspondence table of FIG. 13 (A0).
When a forced acceleration control signal input from the system controller 10 is input, a positive value set to a predetermined value, for example, a positive maximum value is selected (A1), and a forced deceleration control signal is input. In this case, a negative value set to a predetermined value, for example, a negative maximum value is selected (A2), and when a forced deceleration control signal is input and a BRKR signal is detected, "0" is selected (A3). And AFC data. As described above, the disk motor control circuit 8
By the disk motor control signal generated by
The forced acceleration / deceleration operation of the disk 1 and the stop of the disk motor 2 by the LV / CAV operation or the control signal of the system controller 10 can be performed.
【0008】[0008]
【発明が解決しようとする課題】ディスクモータ2の停
止時に重要となるのは、ブレーキ回路7によりブレーキ
信号(BRKR信号)を検出することである。例えば、
スライス・PLL回路6から生成されるEFM信号の周
期を計測して、この周期が十分に遅くなったことを検知
した時にBRKR信号を生成するようなブレーキ回路7
を考える。ディスク1を32倍速で再生中にディスク1
を停止させるためにシステムコントローラ10から強制
減速制御信号をディスクモータ制御回路8に送った直後
にディスク再生装置に衝撃が加わりピックアップ3のフ
ォーカスが外れてしまった場合にはもはやピックアップ
3は、ディスク1に刻まれた信号を読み取ることができ
なくなってしまう。したがってEFM信号を計測信号と
するようなブレーキ回路7では、ピックアップ3のフォ
ーカスが外れてしまった場合、BRKR信号を検出する
ことは不可能になってしまう。そのためEFM信号が読
み取れなくなってBRKR信号の検出が不可能になる。
その結果AFCデータを“0”にリセットできずにずっ
と負の最大値をディスクモータ制御信号としてしまうこ
とになるので、減速したディスク1を停止させずに逆方
向に回転させるトルクを与え続けるため逆方向に暴走し
てしまうという結果を招いてしまう。What is important when the disk motor 2 is stopped is that the brake circuit 7 detects a brake signal (BRKR signal). For example,
A brake circuit 7 that measures the cycle of the EFM signal generated from the slice / PLL circuit 6 and generates a BRKR signal when detecting that the cycle is sufficiently slow.
think of. While playing disc 1 at 32x speed,
Immediately after the system controller 10 sends a forced deceleration control signal from the system controller 10 to the disk motor control circuit 8 to stop the disk drive, if the impact is applied to the disk reproducing apparatus and the pickup 3 is out of focus, the pickup 3 It becomes impossible to read the signal engraved on the device. Therefore, in the brake circuit 7 that uses the EFM signal as the measurement signal, it becomes impossible to detect the BRKR signal when the pickup 3 is out of focus. As a result, the EFM signal cannot be read and the BRKR signal cannot be detected.
As a result, the AFC data cannot be reset to "0", and the negative maximum value is used as the disk motor control signal. Therefore, the torque for rotating the decelerated disk 1 in the reverse direction without stopping is provided. The result is a runaway in the direction.
【0009】この問題を避けるために実際はピックアッ
プ3のフォーカスが落ちてしまった場合には図11のデ
ィスクモータのサーボループは解除するようになってい
て、ディスクモータ制御信号として“0”をモータドラ
イバに送り、自然にディスク1が減速して止まるのを待
つ以外に方法がないという問題があった。一方、FGパ
ルスを計測信号とするようなブレーキ回路7の場合は、
ピックアップ3のフォーカスが落ちたとしても、問題な
くFGパルスの周期が十分に遅くなることを検知するこ
とが可能でBRKR信号を発生させ得る。しかし、ディ
スク再生装置の何らかの誤動作により、ディスク1が逆
回転方向に暴走している場合には、システムコントロー
ラ10より強制減速制御信号をディスクモータ制御回路
8に送っても減速させられないという状況に陥ってしま
うことがあった。これは、EFM信号を計測信号とする
ようなブレーキ回路7でも起こり得る問題であった。本
発明は、この様な事情によりなされたものであり、ディ
スクモータが逆方向に回転していることを検出でき、通
常の強制減速制御信号のみでディスクモータの回転を停
止させることができるディスク再生装置及びディスクモ
ータ制御回路を提供する。In order to avoid this problem, when the focus of the pickup 3 actually drops, the servo loop of the disk motor shown in FIG. 11 is released, and "0" is set as the disk motor control signal to the motor driver. And wait for the disk 1 to naturally decelerate and stop, there is no other way. On the other hand, in the case of the brake circuit 7 in which the FG pulse is used as the measurement signal,
Even if the focus of the pickup 3 drops, it is possible to detect that the period of the FG pulse is sufficiently delayed without any problem, and it is possible to generate the BRKR signal. However, if the disk 1 runs out of control in the reverse rotation direction due to some malfunction of the disk reproducing apparatus, the system controller 10 may not send the forced deceleration control signal to the disk motor control circuit 8 to decelerate. There was a fall. This is a problem that can occur in the brake circuit 7 that uses the EFM signal as a measurement signal. The present invention has been made in view of such circumstances, and it is possible to detect that the disk motor is rotating in the reverse direction, and to stop the rotation of the disk motor only by a normal forced deceleration control signal. An apparatus and a disk motor control circuit are provided.
【0010】[0010]
【課題を解決するための手段】ディスク再生装置及びデ
ィスクモータ制御回路において、モータドライバから出
力されるディスクの回転周期に比例したFGパルスの周
期を計測し、その計測値によりディスクが逆回転に暴走
していることを検出してディスクの回転を停止させるこ
とを特徴としている。ディスクの回転を停止させる制御
信号をシステムコントローラから送ることによりディス
クの回転状況のあらゆる場合において停止制御が可能と
なる。In the disk reproducing apparatus and the disk motor control circuit, the period of the FG pulse output from the motor driver is measured in proportion to the rotation period of the disk, and the measured value causes the disk to run out of reverse rotation. The rotation of the disk is stopped by detecting that the disk is rotating. By sending a control signal for stopping the rotation of the disk from the system controller, the stop control can be performed in all cases of the rotation state of the disk.
【0011】すなわち本発明のディスク再生装置は、デ
ィスクに線速度一定で記録されたデータを光学的に読み
出し、電気信号に変換する光電変換手段及びレンズを制
御するアクチュエータを備えた光学式ピックアップと、
前記電気信号に変換された前記データを2値化する手段
と、前記2値化された前記データを復調し再生データを
生成する手段と、データが線速度一定で記録されたディ
スクからフレーム同期信号(PFCK)を検出する手段
と、ディスクモータの回転周波数に比例したFGパルス
信号を生成する手段と、前記フレーム同期信号(PFC
K)もしくは前記FGパルス信号と周波数を比較するた
めのクロック信号(CK)を生成する手段と、前記フレ
ーム同期信号(PFCK)もしくは前記FGパルス信号
と前記クロック(CK)との周波数を検出する手段と、
前記ディスクモータの回転が十分に遅くなったことを検
出してブレーキ信号(BRKR信号)を生成する手段
と、前記フレーム同期信号(PFCK)もしくは前記F
Gパルス信号と前記クロック信号(CK)の周波数を比
較して生成された周波数誤差もしくは所定の正の値又は
所定の負の値もしくは“0”を選択してディスクモータ
制御信号を生成し、このディスクモータ制御信号に基づ
いて前記ディスクモータを駆動する手段と、システムコ
ントローラからの強制減速制御信号により前記ディスク
モータが逆回転していることを検出する逆回転検出信号
(BKERR信号)を生成する手段とを具備し、前記デ
ィスクが逆方向に回転した場合において前記逆回転検出
信号(BKERR信号)に基づいて前記ディスクモータ
制御信号を反転することによりディスクモータの回転を
停止することを特徴としている。That is, a disk reproducing apparatus according to the present invention comprises: an optical pickup provided with photoelectric conversion means for optically reading data recorded on a disk at a constant linear velocity, converting the data into an electric signal, and an actuator for controlling a lens;
Means for binarizing the data converted to the electric signal, means for demodulating the binarized data to generate reproduced data, and a frame synchronization signal from a disk on which the data is recorded at a constant linear velocity. Means for detecting (PFCK), means for generating an FG pulse signal proportional to the rotation frequency of the disk motor, and means for detecting the frame synchronization signal (PFC).
K) or means for generating a clock signal (CK) for comparing the frequency with the FG pulse signal, and means for detecting the frequency between the frame synchronization signal (PFCK) or the FG pulse signal and the clock (CK) When,
Means for detecting that the rotation of the disk motor has become sufficiently slow to generate a brake signal (BRKR signal); and a means for generating the frame synchronization signal (PFCK) or the F signal.
A disc motor control signal is generated by selecting a frequency error generated by comparing the frequency of the G pulse signal and the frequency of the clock signal (CK) or a predetermined positive value or a predetermined negative value or “0”. Means for driving the disk motor based on a disk motor control signal, and means for generating a reverse rotation detection signal (BKERR signal) for detecting that the disk motor is rotating in reverse according to a forced deceleration control signal from a system controller Wherein the rotation of the disk motor is stopped by inverting the disk motor control signal based on the reverse rotation detection signal (BKERR signal) when the disk rotates in the reverse direction.
【0012】また、本発明のディスクモータ制御回路
は、情報が線速度一定で記録されたディスクからフレー
ム同期信号(PFCK)を検出する回路と、ディスクモ
ータの回転周波数に比例したFGパルス信号を生成する
回路と、前記フレーム同期信号(PFCK)もしくは前
記FGパルス信号と周波数を比較するためのクロック信
号(CK)を生成する回路と、前記フレーム同期信号
(PFCK)もしくは前記FGパルス信号と前記クロッ
ク(CK)との周波数を検出する回路と、ディスクモー
タの回転が十分に遅くなったことを検出してブレーキ信
号(BRKR信号)を生成する回路と、前記フレーム同
期信号(PFCK)もしくは前記FGパルス信号と前記
クロック信号(CK)の周波数を比較して生成された周
波数誤差もしくは所定の正の値又は所定の負の値もしく
は“0”を選択してディスクモータ制御信号を生成し、
このディスクモータ制御信号に基づいて前記ディスクモ
ータを駆動する回路と、システムコントローラからの強
制減速制御信号により前記ディスクモータが逆回転して
いることを検出する逆回転検出信号(BKERR信号)
を生成する回路とを具備し、ディスクが逆方向に回転し
た場合において、前記逆回転検出信号(BKERR信
号)に基づいて前記ディスクモータ制御信号を反転する
ことによりディスクモータの回転を停止することを特徴
としている。Further, the disk motor control circuit of the present invention generates a frame synchronization signal (PFCK) from a disk on which information is recorded at a constant linear velocity, and generates an FG pulse signal proportional to the rotation frequency of the disk motor. A circuit that generates a clock signal (CK) for comparing the frequency with the frame synchronization signal (PFCK) or the FG pulse signal; and a circuit that generates the clock signal (PFCK) or the FG pulse signal and the clock (CK). CK), a circuit for detecting that the rotation of the disk motor has become sufficiently slow and generating a brake signal (BRKR signal), the frame synchronization signal (PFCK) or the FG pulse signal. And a frequency error generated by comparing the frequency of the clock signal (CK) or a predetermined value. It generates a disc motor control signal by selecting a positive value or a predetermined negative value or "0",
A circuit for driving the disk motor based on the disk motor control signal, and a reverse rotation detection signal (BKERR signal) for detecting that the disk motor is rotating in reverse according to a forced deceleration control signal from a system controller.
And stopping the rotation of the disk motor by inverting the disk motor control signal based on the reverse rotation detection signal (BKERR signal) when the disk rotates in the reverse direction. Features.
【0013】前記逆回転検出信号(BKERR信号)に
基づいて前記ディスクモータ制御信号を反転する動作を
前記FGパルスの周波数が所定の値まで低下した後は止
めることによりディスクモータの回転を停止するように
しても良い。システムコントローラからの非反転制御信
号により、前記逆回転検出信号(BKERR)を検出し
た場合に前記ディスクモータ制御信号を“0”としてデ
ィスクモータサーボループを解除するようにしても良
い。請求項2乃至請求項4に記載のディスクモータ制御
回路は、半導体基板に形成され、この半導体基板には、
前記ディスクモータの回転周波数に比例したFGパルス
信号を入力する端子(T1)と、前記ディスクモータを
駆動するディスクモータ制御信号を出力する端子(T
2)と、前記ディスクモータ制御信号を反転させること
によりディスクモータの回転を停止させる前記逆転検出
信号が入出力する端子(T3)と、前記ディスクモータ
の回転が十分に遅くなったことを検出したときに生成さ
れるブレーキ信号(BRKR信号)を入出力する端子
(T4)とを備えているようにしても良い。The rotation of the disk motor is stopped by stopping the operation of inverting the disk motor control signal based on the reverse rotation detection signal (BKERR signal) after the frequency of the FG pulse drops to a predetermined value. You may do it. When the reverse rotation detection signal (BKERR) is detected by a non-inversion control signal from the system controller, the disk motor control signal may be set to "0" to release the disk motor servo loop. The disk motor control circuit according to any one of claims 2 to 4 is formed on a semiconductor substrate.
A terminal (T1) for inputting an FG pulse signal proportional to the rotation frequency of the disk motor, and a terminal (T1) for outputting a disk motor control signal for driving the disk motor.
2) and a terminal (T3) for inputting and outputting the reverse rotation detection signal for stopping the rotation of the disk motor by inverting the disk motor control signal, and detecting that the rotation of the disk motor has become sufficiently slow. And a terminal (T4) for inputting and outputting a brake signal (BRKR signal) generated at that time.
【0014】[0014]
【発明の実施の形態】以下、図面を参照して発明の実施
の形態を説明する。図1は、ディスク再生装置のディス
クモータサーボループを示すブロック図である。図1に
示す実施例において、ディスク1は、ディスクモータ2
により回転駆動され、光学式ピックアップ(PU)3に
よりディスク1に記録されたデータが電流信号として読
み取られる。読み取られたデータは、RFアンプ4に供
給される。RFアンプ4は、ピックアップ3で読み取ら
れた再生信号である電流信号(データ)を電圧信号、す
なわちRF信号に変換し、これをスライス・PLL回路
5に供給する。スライス・PLL回路5を構成するスラ
イス回路では入力した再生信号を2値化して、例えば、
ディスク1がCDであればEFM信号としてスライス・
PLL回路5を構成するPLL回路及び信号処理回路6
に供給する。このPLL回路は、EFM信号に同期した
PLLクロックPLCKを生成する。信号処理回路6
は、EFM信号とPLCK信号とを受けてフレーム同期
信号PFCKを生成し、これをディスクモータ制御回路
8に入力させる。ディスクモータ制御回路8にはモータ
ドライバ11からディスク1の回転に比例した周期のF
Gパルスも入力されている。Embodiments of the present invention will be described below with reference to the drawings. FIG. 1 is a block diagram showing a disk motor servo loop of the disk reproducing apparatus. In the embodiment shown in FIG.
The optical pickup (PU) 3 reads the data recorded on the disk 1 as a current signal. The read data is supplied to the RF amplifier 4. The RF amplifier 4 converts a current signal (data), which is a reproduction signal read by the pickup 3, into a voltage signal, that is, an RF signal, and supplies this to the slice / PLL circuit 5. In the slice circuit constituting the slice / PLL circuit 5, the input reproduced signal is binarized, and for example,
If the disc 1 is a CD, the slice
PLL circuit and signal processing circuit 6 constituting PLL circuit 5
To supply. This PLL circuit generates a PLL clock PLCK synchronized with the EFM signal. Signal processing circuit 6
Receives the EFM signal and the PLCK signal, generates a frame synchronization signal PFCK, and inputs the frame synchronization signal PFCK to the disk motor control circuit 8. The disk motor control circuit 8 supplies the motor driver 11 with a period F proportional to the rotation of the disk 1.
The G pulse is also input.
【0015】また、水晶発振器X’talなどを用いた
クロック発生回路9からシステムコントローラ10によ
り制御されて基準周波数のクロック(以下、基準クロッ
クという)CKが生成され、これもディスクモータ制御
回路8に入力される。ディスクモータ制御回路8におい
ては、フレーム同期信号PFCK又はFGパルスを基準
クロックCKを用いて計測することにより、それらの周
波数誤差又は位相誤差を検出する。ただし、位相誤差を
検出するのはCLV動作時のみである。それらの誤差信
号の和をディスクモータ制御信号としてモータドライバ
11に入力することによりディスクモータ2にトルクを
与え、CLV及びCAV動作が可能になる。A clock CK having a reference frequency (hereinafter referred to as a reference clock) CK is generated from a clock generation circuit 9 using a crystal oscillator X'tal or the like under the control of a system controller 10. Is entered. The disk motor control circuit 8 detects the frequency error or the phase error by measuring the frame synchronization signal PFCK or the FG pulse using the reference clock CK. However, the phase error is detected only during the CLV operation. By inputting the sum of these error signals to the motor driver 11 as a disk motor control signal, a torque is applied to the disk motor 2 and CLV and CAV operations become possible.
【0016】一方、システムコントローラ10から強制
減速(停止)制御信号が送られると、ディスクモータ制
御回路8からは所定の値の負値、例えば、この実施例で
は負の最大値をディスクモータ制御信号として出力し、
ディスクモータ2が回転している方向とは逆方向にトル
クを加えることにより、ディスク1の回転速度を減速さ
せる。ブレーキ回路7は、その回転速度が十分に遅くな
ったことを検知してブレーキ信号(BRKR信号)を出
力し、これをディスクモータ制御回路8に入力させる。
ディスクモータ制御回路8ではBRKR信号により、デ
ィスクモータ制御信号を“0”としてディスクモータ2
にトルクを与えないようになり、ディスク1は完全に停
止する。またブレーキ回路7は、逆回転検出信号(BK
ERR信号)を出力するような構造を具備している。On the other hand, when a forced deceleration (stop) control signal is sent from the system controller 10, a predetermined negative value, for example, a maximum negative value in this embodiment is transmitted from the disk motor control circuit 8 to the disk motor control signal. Output as
The rotational speed of the disk 1 is reduced by applying a torque in a direction opposite to the direction in which the disk motor 2 rotates. The brake circuit 7 detects that the rotation speed has become sufficiently low, outputs a brake signal (BRKR signal), and inputs this to the disk motor control circuit 8.
The disk motor control circuit 8 sets the disk motor control signal to “0” by the BRKR signal and sets the disk motor 2
, And the disk 1 stops completely. Further, the brake circuit 7 outputs a reverse rotation detection signal (BK
(ERR signal).
【0017】図2にディスクモータの停止動作のフロー
チャートを示し、更に詳しく停止動作の説明をする。ま
ずディスク再生中において、システムコントローラから
強制減速制御信号が出力される、すなわちディスク回転
に対する停止命令が出力される(ステップ101)と、
ディスクモータ制御回路では所定の負の値、例えば、負
の最大値をディスクモータ制御信号として出力し、ブレ
ーキ回路では、計測信号として、例えば、FGパルスの
周期の計測(ステップ102)を開始する。ステップ1
03ではFGパルスの周期が十分に長くなって目標速度
に達したか否かのチェックを行い、目標速度に達してい
た場合(Yes)にはBRKR=“H”として(ステッ
プ105)、ディスクモータ制御信号を“0”にしてデ
ィスクを停止させる。FIG. 2 shows a flowchart of the stop operation of the disk motor, and the stop operation will be described in more detail. First, during disc playback, when a forced deceleration control signal is output from the system controller, that is, a stop command for the disc rotation is output (step 101).
The disk motor control circuit outputs a predetermined negative value, for example, a negative maximum value, as a disk motor control signal, and the brake circuit starts measurement of, for example, the period of an FG pulse as a measurement signal (step 102). Step 1
At 03, it is checked whether or not the period of the FG pulse has become sufficiently long to reach the target speed. If the target speed has been reached (Yes), BRKR is set to "H" (step 105), and the disk motor The control signal is set to "0" to stop the disk.
【0018】目標速度に達していない場合(No)に
は、FGパルスの周期の異常を検出させる(ステップ1
04)。検出方法は、FGパルスの周期を毎回計測し、
前回の計測結果と最新の計測結果の大小比較を行う。そ
れによりFGパルスの周期が長くなっているのか、短く
なっているのかが分かり、ディスクモータ制御信号を負
の最大値にしたことにより、ディスクが減速しているの
か、逆方向に加速しているのかが判断できる。正常時は
ディスクが減速し、再度ステップ102以降を繰り返
す。もし、何らかの異常モードに入り込み逆方向に加速
していると判断した場合には逆回転検出信号(BKER
R信号)をセットする(ステップ106)。BKERR
信号=“H”の時は、ディスクが逆回転に加速してしま
っていることになるので、ディスクを停止させるために
はディスクモータ制御信号としては正の最大値をモータ
ドライバに入力すれば良い。ディジタル信号における正
負の符号を反転するには単純に全ビット反転するだけで
良く、ハード的に非常に簡単に実現できる。停止動作中
はAPCデータ(位相誤差信号)は必要ないので、BK
ERR信号を検出した時にはAFCデータのみを反転す
ることでディスクモータ制御信号の反転となる(ステッ
プ107)。If the target speed has not been reached (No), an abnormality in the period of the FG pulse is detected (step 1).
04). The detection method measures the cycle of the FG pulse every time,
Compare the previous measurement result with the latest measurement result. As a result, it is known whether the period of the FG pulse is long or short, and by setting the disk motor control signal to the negative maximum value, the disk is decelerating or accelerating in the opposite direction. Can be determined. In a normal state, the disk is decelerated, and Step 102 and the subsequent steps are repeated again. If it is determined that the vehicle has entered an abnormal mode and is accelerating in the reverse direction, the reverse rotation detection signal (BKER
R signal) is set (step 106). BKERR
When the signal is "H", the disk has accelerated in the reverse rotation, so that the disk can be stopped by inputting a positive maximum value to the motor driver as a disk motor control signal. . To invert the sign of the digital signal, it is only necessary to simply invert all the bits, and it is very easy to realize in terms of hardware. Since APC data (phase error signal) is not required during the stop operation, BK
When the ERR signal is detected, the disc motor control signal is inverted by inverting only the AFC data (step 107).
【0019】その後、再びステップ102以降を繰り返
すことにより、正常にディスクの停止が可能となる。シ
ステムコントローラにより非反転制御信号を“H”にし
ている場合(ステップ108)は、逆回転を異常モード
としてとらえ、BKERR信号を検出したらディスクモ
ータ制御信号を“0”として(ステップ109)、ディ
スクモータフォーカスサーボループを解除するようにし
ても良い。Thereafter, by repeating Step 102 and subsequent steps, the disk can be normally stopped. When the non-inversion control signal is set to "H" by the system controller (step 108), the reverse rotation is regarded as an abnormal mode, and when the BKERR signal is detected, the disk motor control signal is set to "0" (step 109). The focus servo loop may be canceled.
【0020】図3にブレーキ回路のブロック図を示して
その説明をする。システムコントローラ10より強制減
速制御信号(停止命令)が送られて、ブレーキ回路がア
クティブになる構造となっている。計測クロックとして
は、例えば、EFM信号又はFGパルスを用い、非計測
クロックは、クロック発生回路9より供給されるクロッ
ク信号CKを用いる。クロック信号CKは、計測クロッ
クの周期に応じて分周器71で分周し、これをカウンタ
74のクロックとする。EFM信号もしくはFGパルス
にはチャタリングが生じるのでノイズ除去回路72で波
形整形してからタイミング生成回路73へ送られる。タ
イミング生成回路73では計測信号の上がりエッジでカ
ウンタ74のクリア信号を生成する。BRKR検出回路
75は、カウンタの値が十分に大きくなった時にBRK
R信号をセットする構成になっている。BKERR検出
回路76は、レジスタ1とレジスタ2の2段のシフトレ
ジスタを持ち、タイミング生成回路73で作られるタイ
ミング信号Фでカウンタの値をレジスタ1(値はA)に
シフトし、レジスタ1の値をレジスタ2(値はB)にシ
フトし、コンパレータなどでAとBの値の大小比較を行
い、Bの値がAの値よりも大きくなったときにBKER
R信号をセットする構成になっている。FIG. 3 shows a block diagram of the brake circuit, which will be described. A forced deceleration control signal (stop command) is sent from the system controller 10 to activate the brake circuit. For example, an EFM signal or an FG pulse is used as a measurement clock, and a clock signal CK supplied from the clock generation circuit 9 is used as a non-measurement clock. The clock signal CK is frequency-divided by the frequency divider 71 in accordance with the cycle of the measurement clock, and is used as the clock of the counter 74. Since chattering occurs in the EFM signal or the FG pulse, the waveform is shaped by the noise removing circuit 72 and then sent to the timing generating circuit 73. The timing generation circuit 73 generates a clear signal of the counter 74 at the rising edge of the measurement signal. When the value of the counter becomes sufficiently large, the BRKR detection circuit 75
The R signal is set. The BKERR detection circuit 76 has a two-stage shift register of a register 1 and a register 2. The BKERR detection circuit 76 shifts the value of the counter to the register 1 (the value is A) by the timing signal 作 generated by the timing generation circuit 73, and Is shifted to the register 2 (the value is B), and the values of A and B are compared with each other by a comparator or the like. When the value of B becomes larger than the value of A, BKER
The R signal is set.
【0021】図4にディスクモータ制御回路の詳細なブ
ロック図を示す。図1に示されているディスクモータ制
御回路8は、AFC回路81とAPC回路82の大きく
分けて2つのブロックからなる。AFC回路81は、C
LV動作時には図1の信号処理回路で生成される再生速
度に比例したフレーム同期信号PFCKを受け、クロッ
ク発生回路9で生成される水晶発振器X’talで生成
されたクロック信号を分周したクロックCKでそのフレ
ーム同期信号PFCKを計測することによりフレーム周
波数の誤差を検出する。一方、CAV動作時には図1の
モータドライバ11で生成されるFGパルスをクロック
CKで計測することにより、FGパルスの周波数の誤差
を検出できる。また、APC回路82は、CLV動作時
のみに働くもので、最近のディスク再生装置で主流にな
っている可変速再生時(CAV動作時も含む)にはAP
Cデータ(位相誤差信号)を“0”としている。APC
回路82は、クロックCKに対する位相誤差を検出し
て、CLV動作時のディスクモータのジッタを吸収する
ことにより、CLV動作をより正確にするために機能す
る。ディスクモータ制御信号は、AFCデータとAPC
データが足し込まれたものになる。FIG. 4 is a detailed block diagram of the disk motor control circuit. The disk motor control circuit 8 shown in FIG. 1 is roughly composed of two blocks of an AFC circuit 81 and an APC circuit 82. The AFC circuit 81
During the LV operation, a clock CK obtained by receiving a frame synchronization signal PFCK proportional to the reproduction speed generated by the signal processing circuit of FIG. 1 and dividing the clock signal generated by the crystal oscillator X′tal generated by the clock generation circuit 9 is obtained. Then, an error of the frame frequency is detected by measuring the frame synchronization signal PFCK. On the other hand, during the CAV operation, an error in the frequency of the FG pulse can be detected by measuring the FG pulse generated by the motor driver 11 in FIG. 1 with the clock CK. The APC circuit 82 operates only at the time of CLV operation. At the time of variable speed reproduction (including CAV operation), which is the mainstream in recent disk reproducing apparatuses, the APC circuit 82 operates at the same time.
The C data (phase error signal) is set to “0”. APC
The circuit 82 functions to detect the phase error with respect to the clock CK and absorb the jitter of the disk motor during the CLV operation, thereby making the CLV operation more accurate. The disk motor control signal consists of AFC data and APC
The data will be added.
【0022】セレクタ83は、図13のセレクタの対応
表にあるように、正常にCLV、CAV動作が行われて
いるノーマル再生の場合はAFC回路で検出した周波数
誤差信号を選択(A0)し、システムコントローラ10
から入力される強制加速制御信号が入力された場合は所
定の値に設定された正の値、例えば、正の最大値を選択
(A1)し、強制減速制御信号が入力された場合は所定
の値に設定された負の値、例えば、負の最大値を選択
(A2)し、強制減速制御信号が入力されBRKR信号
を検出した場合は“0”を選択(A3)してAFCデー
タとするように構成されている。また本発明のディスク
モータ制御回路には強制加速制御信号、強制減速制御信
号、ブレーキ信号(BRKR)の制御信号の他に非反転
制御信号及び逆回転検出信号(BKERR)が入力され
る。そして逆回転検出信号と負の最大値を入力とし、出
力が負の最大値を選択する端子(A2)に接続されたe
xNOR回路(EXCLUSIVE NOR)が追加さ
れている。システムコントローラより強制減速制御信号
が入力されていて非反転制御信号が“L”の場合は、B
KERR=“H”で負の最大値は反転され、正の最大値
がディスクモータ制御信号となる。つまり逆回転してい
るときは、正の最大値が強制的にその回転を阻止される
ことになる。また、セレクタ83は、図5のセレクタの
対応表に示すように、非反転制御信号が“H”の時は、
“0”をAFCデータとして出力するような構成として
いる。As shown in the selector correspondence table of FIG. 13, the selector 83 selects (A0) the frequency error signal detected by the AFC circuit during normal reproduction in which the CLV and CAV operations are performed normally, System controller 10
When a forced acceleration control signal input from the controller is input, a positive value set to a predetermined value, for example, a positive maximum value is selected (A1), and when a forced deceleration control signal is input, a predetermined value is selected. A negative value set as the value, for example, a negative maximum value is selected (A2). When a forced deceleration control signal is input and a BRKR signal is detected, "0" is selected (A3) to be AFC data. It is configured as follows. Further, in addition to the forced acceleration control signal, the forced deceleration control signal, and the control signal of the brake signal (BRKR), the non-inversion control signal and the reverse rotation detection signal (BKERR) are input to the disk motor control circuit of the present invention. The reverse rotation detection signal and the negative maximum value are input, and the output is connected to the terminal (A2) for selecting the negative maximum value.
An xNOR circuit (EXCLUSIVE NOR) is added. If the forced deceleration control signal is input from the system controller and the non-inversion control signal is "L", B
When KERR = “H”, the negative maximum value is inverted, and the positive maximum value becomes the disk motor control signal. That is, when the motor rotates in the reverse direction, the positive maximum value is forcibly prevented from rotating. Further, as shown in the selector correspondence table of FIG. 5, when the non-inversion control signal is “H”, the selector 83
It is configured to output “0” as AFC data.
【0023】図6に正常に停止する場合のタイミングチ
ャートを示す。強制減速制御信号(停止命令)により、
ディスクモータは、逆回転方向のトルクを受けてFGパ
ルス(計測信号)の周期が長くなってくる。FG周期毎
にカウントするカウンタの値は次第に大きくなり、N回
目のカウント値が十分大きくなり目標速度に達してBR
KR信号を生成している。BRKR信号の検出で強制減
速制御信号(停止命令)はリセットされ、ディスクモー
タの回転は止まる。また、何等かの原因によりディスク
が逆回転している異常状態の場合において、強制減速制
御信号(停止命令)を受けた時のタイミングチャートを
図7及び図8に示す。FIG. 6 shows a timing chart in the case of normal stop. With the forced deceleration control signal (stop command),
The disk motor receives the torque in the reverse rotation direction and the period of the FG pulse (measurement signal) becomes longer. The value of the counter that counts every FG cycle gradually increases, and the N-th count value becomes sufficiently large to reach the target speed.
KR signal is generated. Upon detection of the BRKR signal, the forced deceleration control signal (stop command) is reset, and the rotation of the disk motor stops. FIGS. 7 and 8 show timing charts when a forced deceleration control signal (stop command) is received in an abnormal state where the disk is rotating in the reverse direction for some reason.
【0024】図7は、システムコントローラにより、非
反転制御信号を“H”にした場合、図8は、“L”にし
た場合である。図7では非反転制御信号が“H”のた
め、Bの値の方がAより大きいことを検出し、BKER
R信号を発生してAFCデータを“0”としてディスク
モータサーボループを解除し、強制減速制御信号もリセ
ットする。図8では、BKERR信号を検出して、AF
Cデータを正の最大値に切り替える。これにより、逆回
転方向に回転していたディスクモータには、順回転方向
へのトルクが加わり、回転速度を減速させることがで
き、以降は図6と同様の停止動作を可能とする。以上、
前述した実施例のディスクモータ制御回路のセレクタに
入力される正の最大値、負の最大値は、一例であって、
本発明で必要としているのは所定の値に設定した正の
値、負の値である。FIG. 7 shows the case where the non-inversion control signal is set to "H" by the system controller, and FIG. 8 shows the case where it is set to "L". In FIG. 7, since the non-inversion control signal is “H”, it is detected that the value of B is larger than A, and BKER
An R signal is generated to set the AFC data to "0" to release the disk motor servo loop and reset the forced deceleration control signal. In FIG. 8, the BKERR signal is detected and AF
Switch C data to positive maximum. As a result, a torque in the forward rotation direction is applied to the disk motor that has been rotating in the reverse rotation direction, so that the rotation speed can be reduced, and thereafter the same stop operation as in FIG. 6 can be performed. that's all,
The positive maximum value and the negative maximum value input to the selector of the disk motor control circuit of the above-described embodiment are examples,
The present invention requires a positive value and a negative value set to predetermined values.
【0025】次に、図9を参照してFGパルスの周波数
変化に対応して変化するディスクモータ制御信号を説明
する。ここで説明するディスクの動作は、図2に示すフ
ローチャートに従う。非反転制御信号“L”の場合にお
いて、逆回転するディスクを停止させる動作を行う。逆
回転検出信号(BKERR)が“H”の時がブレーキ回
路の動作する時点(BRAKE)である。この時点を、
例えば、600Hzとし、この時点でディスクが逆回転
に加速してしまっていることになるので、ディスクを停
止させるためにディスクモータ制御信号としては正の最
大値をモータドライバに入力する。停止動作中はAPC
データ(位相誤差信号)は必要ないので、BKERR信
号を検出した時にはAFCデータのみを反転することで
ディスクモータ制御信号の反転となる。AFCデータの
この状態を与え続けると点線Eに示すように下がり続け
て負の領域に入ってしまう(つまり、正回転に変わ
る)。逆回転を停止させるためにはこの状態は好ましく
ないので、計測信号(FGパルス)が所定の値(例え
ば、A、B、C、D点のいずれかの値)まで下がったら
ディスクモータ制御信号を“0”に変更すると、正回転
に至らずにディスクを停止させることができる。この図
では、A点及びB点(実線A及び実線B)で変更させた
場合のFGパルスの変化を示す。Next, a description will be given of a disk motor control signal which changes in response to a change in the frequency of the FG pulse with reference to FIG. The operation of the disk described here follows the flowchart shown in FIG. In the case of the non-inversion control signal “L”, an operation of stopping the disk rotating in the reverse direction is performed. The time when the reverse rotation detection signal (BKERR) is “H” is the time (BRAKE) at which the brake circuit operates. At this point,
For example, the frequency is set to 600 Hz. At this point, the disk has accelerated in the reverse rotation, so a positive maximum value is input to the motor driver as a disk motor control signal to stop the disk. APC during stop operation
Since no data (phase error signal) is required, when the BKERR signal is detected, only the AFC data is inverted to invert the disk motor control signal. If this state of the AFC data continues to be given, it continues to fall and enters a negative region as shown by a dotted line E (that is, changes to positive rotation). Since this state is not preferable for stopping reverse rotation, when the measurement signal (FG pulse) falls to a predetermined value (for example, any of the points A, B, C, and D), the disk motor control signal is output. By changing to "0", the disk can be stopped without reaching normal rotation. This figure shows a change in the FG pulse when the change is made at points A and B (solid line A and solid line B).
【0026】非反転制御信号“H”の場合において、逆
回転するディスクを停止させる動作を行う。システムコ
ントローラにより非反転制御信号を“H”にしている場
合は、逆回転を異常モードとしてとらえるので、BKE
RR信号を検出したらディスクモータ制御信号を“0”
としてディスクモータのフォーカスサーボループを解除
するようにする。この場合は、長い停止時間を必要とす
る。通常FGパルスの周期は、ディスクの回転数の6n
倍に等しくなるように設定されている。以上説明した実
施例において、ディスク再生装置のディスクモータ制御
回路は、図10に示すように、半導体基板に形成されて
いる。この半導体基板には、ディスクモータの回転周波
数に比例したFGパルス信号を入力する端子(T1)
と、ディスクモータを駆動するディスクモータ制御信号
を出力する端子(T2)と、ディスクモータ制御信号を
反転させることによりディスクモータの回転を停止させ
る逆転検出信号が入出力する端子(T3)と、ディスク
モータの回転が十分に遅くなったことを検出したときに
生成されるブレーキ信号(BRKR信号)を入出力する
端子(T4)などを備えている。In the case of the non-inversion control signal "H", an operation for stopping the disk rotating in the reverse direction is performed. When the non-inversion control signal is set to “H” by the system controller, the reverse rotation is regarded as an abnormal mode.
When the RR signal is detected, the disk motor control signal is set to "0"
To release the focus servo loop of the disk motor. In this case, a long stopping time is required. Normally, the period of the FG pulse is 6n of the disk rotation speed.
It is set to be equal to twice. In the embodiment described above, the disk motor control circuit of the disk reproducing apparatus is formed on a semiconductor substrate as shown in FIG. This semiconductor substrate has a terminal (T1) for inputting an FG pulse signal proportional to the rotation frequency of the disk motor.
A terminal (T2) for outputting a disk motor control signal for driving the disk motor, a terminal (T3) for inputting / outputting a reverse rotation detection signal for stopping the rotation of the disk motor by inverting the disk motor control signal, A terminal (T4) for inputting and outputting a brake signal (BRKR signal) generated when it is detected that the rotation of the motor has become sufficiently slow is provided.
【0027】[0027]
【発明の効果】本発明は、以上の構成により、システム
コントローラから停止信号である強制減速制御信号を送
ることにより、ディスクモータが逆方向に回転している
ことを検出でき、通常の停止制御信号のみでディスクモ
ータの回転を停止させることができる。またシステムコ
ントローラから停止制御信号を送ることにより、ディス
クモータが逆方向に回転していることを検出したらディ
スクモータサーボループを解除することにより、ディス
クモータの暴走を防ぐことができ、ディスクモータを効
率的に停止させることができる。According to the present invention, by transmitting a forced deceleration control signal as a stop signal from the system controller, the present invention can detect that the disk motor is rotating in the reverse direction. Only with this, the rotation of the disk motor can be stopped. Also, by sending a stop control signal from the system controller, the disk motor servo loop is released when it detects that the disk motor is rotating in the reverse direction, preventing runaway of the disk motor and improving the efficiency of the disk motor. Can be stopped temporarily.
【図1】本発明のディスク再生装置におけるディスクモ
ータのサーボループを示すブロック図。FIG. 1 is a block diagram showing a servo loop of a disk motor in a disk reproducing apparatus of the present invention.
【図2】ディスクモータの停止動作のフローチャート。FIG. 2 is a flowchart of a stop operation of a disk motor.
【図3】本発明のブレーキ回路のブロック図。FIG. 3 is a block diagram of a brake circuit according to the present invention.
【図4】本発明のディスクモータ制御回路のブロック
図。FIG. 4 is a block diagram of a disk motor control circuit according to the present invention.
【図5】本発明のセレクタの対応表を示す図。FIG. 5 is a diagram showing a correspondence table of selectors according to the present invention.
【図6】正常動作時のディスクモータ停止時のタイミン
グチャート。FIG. 6 is a timing chart when the disk motor stops during normal operation.
【図7】逆回転している時のディスクモータ停止時のタ
イミングチャート(非反転信号“H”)。FIG. 7 is a timing chart (non-inverted signal “H”) when the disk motor is stopped during reverse rotation.
【図8】逆回転している時のディスクモータ停止時のタ
イミングチャート(非反転信号“L”)。FIG. 8 is a timing chart (non-inverted signal “L”) when the disk motor is stopped during reverse rotation.
【図9】FGパルスの周波数変化に対応する停止動作の
時間的変化を示す図。FIG. 9 is a diagram showing a temporal change in a stop operation corresponding to a frequency change of an FG pulse.
【図10】本発明のディスク再生装置における半導体基
板を示すブロック図。FIG. 10 is a block diagram showing a semiconductor substrate in the disk reproducing apparatus of the present invention.
【図11】従来のディスク再生装置におけるディスクモ
ータのサーボループを示すブロック図。FIG. 11 is a block diagram showing a servo loop of a disk motor in a conventional disk reproducing apparatus.
【図12】従来のディスクモータ制御回路のブロック
図。FIG. 12 is a block diagram of a conventional disk motor control circuit.
【図13】従来のセレクタ対応表を示す図。FIG. 13 is a diagram showing a conventional selector correspondence table.
1・・・ディスク、 2・・・ディスクモータ、
3・・・ピックアップ(PU)、 4・・・RFアン
プ、 5・・・スライス・PLL回路、6・・・信号
処理回路、フレーム同期検出回路、 7・・・ブレー
キ回路、8・・・ディスクモータ制御回路、 9・・
・クロック発生回路、10・・・システムコントロー
ラ、 11・・・モータドライバ、71・・・分周
器、 72・・・ノイズ除去回路、 73・・・タ
イミング生成回路、 74・・・カウンタ、 75
・・・BRKR検出回路、76・・・BKERR検出回
路、 81・・・AFC回路、82・・・APC回
路、 83・・・セレクタ。1 ... disk, 2 ... disk motor,
3: pickup (PU), 4: RF amplifier, 5: slice / PLL circuit, 6: signal processing circuit, frame synchronization detection circuit, 7: brake circuit, 8: disk Motor control circuit, 9 ...
・ Clock generation circuit, 10 ・ ・ ・ System controller, 11 ・ ・ ・ Motor driver, 71 ・ ・ ・ Divider, 72 ・ ・ ・ Noise removal circuit, 73 ・ ・ ・ Timing generation circuit, 74 ・ ・ ・ Counter, 75
... BRKR detection circuit, 76 ... BKERR detection circuit, 81 ... AFC circuit, 82 ... APC circuit, 83 ... selector.
Claims (5)
タを光学的に読み出し、電気信号に変換する光電変換手
段及びレンズを制御するアクチュエータを備えた光学式
ピックアップと、 前記電気信号に変換された前記データを2値化する手段
と、 前記2値化された前記データを復調し、再生データを生
成する手段と、 データが線速度一定で記録されたディスクからフレーム
同期信号を検出する手段と、 ディスクモータの回転周波数に比例したFGパルス信号
を生成する手段と、 前記フレーム同期信号もしくは前記FGパルス信号と周
波数を比較するためのクロック信号を生成する手段と、 前記フレーム同期信号もしくは前記FGパルス信号と前
記クロックとの周波数を検出する手段と、 前記ディスクモータの回転が十分に遅くなったことを検
出してブレーキ信号を生成する手段と、前記フレーム同
期信号もしくは前記FGパルス信号と前記クロック信号
の周波数を比較して生成された周波数誤差もしくは所定
の正の値又は所定の負の値もしくは“0”を選択してデ
ィスクモータ制御信号を生成し、このディスクモータ制
御信号に基づいて前記ディスクモータを駆動する手段
と、 システムコントローラからの強制減速制御信号により前
記ディスクモータが逆回転していることを検出する逆回
転検出信号を生成する手段とを具備し、 前記ディスクが逆方向に回転した場合において、前記逆
回転検出信号に基づいて前記ディスクモータ制御信号を
反転することによりディスクモータの回転を停止するこ
とを特徴とするディスク再生装置。1. An optical pickup comprising: a photoelectric conversion unit for optically reading data recorded on a disk at a constant linear velocity and converting the data to an electric signal; and an actuator for controlling a lens, and an optical pickup converted to the electric signal. Means for binarizing the data, means for demodulating the binarized data to generate reproduced data, and means for detecting a frame synchronization signal from a disk on which data is recorded at a constant linear velocity; Means for generating an FG pulse signal proportional to the rotation frequency of the disk motor; means for generating a clock signal for comparing the frequency with the frame synchronization signal or the FG pulse signal; and the frame synchronization signal or the FG pulse signal Means for detecting the frequency of the clock and the clock, and the rotation of the disk motor has become sufficiently slow. Means for detecting and generating a brake signal; and comparing a frequency error of the frame synchronization signal or the FG pulse signal with the frequency of the clock signal or a predetermined positive value or a predetermined negative value or "0". "To generate a disk motor control signal, and a means for driving the disk motor based on the disk motor control signal, and that the disk motor is rotating in reverse by a forced deceleration control signal from a system controller. Means for generating a reverse rotation detection signal for detecting, when the disk rotates in the reverse direction, the rotation of the disk motor is stopped by inverting the disk motor control signal based on the reverse rotation detection signal. A disc reproducing apparatus characterized in that:
からフレーム同期信号を検出する回路と、 ディスクモータの回転周波数に比例したFGパルス信号
を生成する回路と、 前記フレーム同期信号もしくは前記FGパルス信号と周
波数を比較するためのクロック信号を生成する回路と、 前記フレーム同期信号もしくは前記FGパルス信号と前
記クロックとの周波数を検出する回路と、 ディスクモータの回転が十分に遅くなったことを検出し
てブレーキ信号を生成する回路と、前記フレーム同期信
号もしくは前記FGパルス信号と前記クロック信号の周
波数を比較して生成された周波数誤差もしくは所定の正
の値又は所定の負の値もしくは“0”を選択してディス
クモータ制御信号を生成し、このディスクモータ制御信
号に基づいて前記ディスクモータを駆動する回路と、 システムコントローラからの強制減速制御信号により前
記ディスクモータが逆回転していることを検出する逆回
転検出信号を生成する回路とを具備し、 ディスクが逆方向に回転した場合において、前記逆回転
検出信号に基づいて前記ディスクモータ制御信号を反転
することによりディスクモータの回転を停止することを
特徴とするディスクモータ制御回路。2. A circuit for detecting a frame synchronization signal from a disk on which information is recorded at a constant linear velocity, a circuit for generating an FG pulse signal proportional to a rotation frequency of a disk motor, the frame synchronization signal or the FG pulse A circuit for generating a clock signal for comparing a signal with a frequency; a circuit for detecting the frequency of the frame synchronization signal or the FG pulse signal and the clock; and detecting that the rotation of the disk motor has become sufficiently slow. A frequency error generated by comparing the frequency of the frame synchronization signal or the FG pulse signal with the frequency of the clock signal, or a predetermined positive value or a predetermined negative value or “0” To generate a disk motor control signal, and based on the disk motor control signal, A circuit for driving a motor, and a circuit for generating a reverse rotation detection signal for detecting that the disk motor is rotating in reverse by a forced deceleration control signal from a system controller. 2. The disk motor control circuit according to claim 1, wherein the rotation of the disk motor is stopped by inverting the disk motor control signal based on the reverse rotation detection signal.
スクモータ制御信号を反転する動作を前記FGパルスの
周波数が所定の値まで低下した後は止めることによりデ
ィスクモータの回転を停止することを特徴とする請求項
2に記載のディスクモータ制御回路。3. The disk motor rotation is stopped by stopping the operation of inverting the disk motor control signal based on the reverse rotation detection signal after the frequency of the FG pulse has decreased to a predetermined value. 3. The disk motor control circuit according to claim 2, wherein
信号により、前記逆回転検出信号を検出した場合に前記
ディスクモータ制御信号を“0”としてディスクモータ
サーボループを解除することを特徴とするディスクモー
タ制御回路。4. The disk motor control according to claim 1, wherein when said reverse rotation detection signal is detected by a non-inversion control signal from a system controller, said disk motor control signal is set to "0" to release a disk motor servo loop. circuit.
モータ制御回路は、半導体基板に形成され、この半導体
基板には、前記ディスクモータの回転周波数に比例した
FGパルス信号を入力する端子と、前記ディスクモータ
を駆動するディスクモータ制御信号を出力する端子と、
前記ディスクモータ制御信号を反転させることによりデ
ィスクモータの回転を停止させる前記逆転検出信号が入
出力する端子と、前記ディスクモータの回転が十分に遅
くなったことを検出したときに生成されるブレーキ信号
を入出力する端子とを備えていることを特徴とするディ
スクモータ制御回路。5. A disk motor control circuit according to claim 2, wherein said disk motor control circuit is formed on a semiconductor substrate, and said semiconductor substrate has a terminal for inputting an FG pulse signal proportional to a rotation frequency of said disk motor. A terminal for outputting a disk motor control signal for driving the disk motor;
A terminal for inputting and outputting the reverse rotation detection signal for stopping the rotation of the disk motor by inverting the disk motor control signal; and a brake signal generated when the rotation of the disk motor is detected to be sufficiently slow. A disk motor control circuit, comprising: a terminal for inputting and outputting data.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10183396A JP2000011525A (en) | 1998-06-15 | 1998-06-15 | Disk reproducing device and disk motor control circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10183396A JP2000011525A (en) | 1998-06-15 | 1998-06-15 | Disk reproducing device and disk motor control circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2000011525A true JP2000011525A (en) | 2000-01-14 |
Family
ID=16135055
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10183396A Pending JP2000011525A (en) | 1998-06-15 | 1998-06-15 | Disk reproducing device and disk motor control circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2000011525A (en) |
-
1998
- 1998-06-15 JP JP10183396A patent/JP2000011525A/en active Pending
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