ES2659734T3 - Método para el control de la emisión de luz de un dispositivo emisor de luz y un sistema excitador que implementa el método - Google Patents

Método para el control de la emisión de luz de un dispositivo emisor de luz y un sistema excitador que implementa el método Download PDF

Info

Publication number
ES2659734T3
ES2659734T3 ES14184814.3T ES14184814T ES2659734T3 ES 2659734 T3 ES2659734 T3 ES 2659734T3 ES 14184814 T ES14184814 T ES 14184814T ES 2659734 T3 ES2659734 T3 ES 2659734T3
Authority
ES
Spain
Prior art keywords
unit
logical data
retention
excitation
bits
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
ES14184814.3T
Other languages
English (en)
Inventor
Shun-Yuan Hsu
Shun-Ching Hsieh
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Macroblock Inc
Original Assignee
Macroblock Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Macroblock Inc filed Critical Macroblock Inc
Application granted granted Critical
Publication of ES2659734T3 publication Critical patent/ES2659734T3/es
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05B—ELECTRIC HEATING; ELECTRIC LIGHT SOURCES NOT OTHERWISE PROVIDED FOR; CIRCUIT ARRANGEMENTS FOR ELECTRIC LIGHT SOURCES, IN GENERAL
    • H05B47/00—Circuit arrangements for operating light sources in general, i.e. where the type of light source is not relevant
    • H05B47/10—Controlling the light source
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
    • G09G3/30—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels
    • G09G3/32—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED]
    • G09G3/3208—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED]
    • G09G3/3225—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix
    • G09G3/3233—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix with pixel circuitry controlling the current through the light-emitting element
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05B—ELECTRIC HEATING; ELECTRIC LIGHT SOURCES NOT OTHERWISE PROVIDED FOR; CIRCUIT ARRANGEMENTS FOR ELECTRIC LIGHT SOURCES, IN GENERAL
    • H05B45/00—Circuit arrangements for operating light-emitting diodes [LED]
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05B—ELECTRIC HEATING; ELECTRIC LIGHT SOURCES NOT OTHERWISE PROVIDED FOR; CIRCUIT ARRANGEMENTS FOR ELECTRIC LIGHT SOURCES, IN GENERAL
    • H05B45/00—Circuit arrangements for operating light-emitting diodes [LED]
    • H05B45/10—Controlling the intensity of the light
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05B—ELECTRIC HEATING; ELECTRIC LIGHT SOURCES NOT OTHERWISE PROVIDED FOR; CIRCUIT ARRANGEMENTS FOR ELECTRIC LIGHT SOURCES, IN GENERAL
    • H05B47/00—Circuit arrangements for operating light sources in general, i.e. where the type of light source is not relevant
    • H05B47/10—Controlling the light source
    • H05B47/16—Controlling the light source by timing means

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Control Of El Displays (AREA)
  • Led Devices (AREA)

Abstract

Un método para controlar la emisión de luz de un dispositivo emisor de luz, dicho método para ser aplicado por un sistema de excitación que incluye una unidad de registro de desplazamiento (3) que recibe una señal de reloj, una unidad de retención de datos (5) acoplada a la unidad de registro de desplazamiento (3), una unidad de multiplexación (6) acoplada a la unidad de registro de desplazamiento (3) y la unidad de retención de datos (5), y una unidad de excitación (7) acoplada a la unidad de multiplexación (6) y al dispositivo de emisión de luz, incluyendo dicho método: (a) la recepción y el almacenamiento, por la unidad de registro de desplazamiento (3), de primeros datos lógicos en ella de acuerdo con la señal de reloj; y (b) la retención y almacenamiento, por la unidad de retención de datos (5), de primeros datos lógicos almacenados en la etapa (a) en ella; estando dicho método caracterizado por: (c) después de la etapa (b), la recepción y el almacenamiento, por la unidad de registro de desplazamiento (3), de segundos datos lógicos en ella, (d) de forma selectiva entregar a la unidad de excitación (7), por la unidad de multiplexación (6), uno de los primeros datos lógicos que están almacenados en la unidad de retención de datos (5) y los segundos datos lógicos que están almacenados en la unidad de registro de desplazamiento (3); y (e) la conversión, por la unidad de excitación (7), de dicho uno de los primeros datos lógicos y los segundos datos lógicos recibidos, en una salida de excitación que se proporciona al dispositivo de emisión de luz.

Description

5
10
15
20
25
30
35
40
45
50
55
60
65
DESCRIPCION
Método para el control de la emisión de luz de un dispositivo emisor de luz y un sistema excitador que implementa el método
La invención se refiere a un método de control y un sistema excitador, y más particularmente a un método de control y un sistema excitador adaptado para un dispositivo de emisión de luz.
El brillo de la luz emitida por un dispositivo LED (diodo emisor de luz) se controla por medio de un sistema excitador de LED que proporciona una corriente constante al dispositivo LED durante diferentes períodos de tiempo, en el que la corriente constante se refiere a un valor constante de corriente dentro de un período de tiempo unidad.
Con referencia a las figuras 1 y 3, un sistema excitador de LED convencional tiene 16 canales de control para excitar el dispositivo LED (no se muestra), y recibe 16 conjuntos de datos lógicos fuente que corresponden respectivamente a los 16 canales de excitación. Cada conjunto de datos lógicos fuente se compone de 6 bits de brillo para indicar uno de 26 niveles de brillo. Los bits de brillo tienen diferentes órdenes de bits definidos de 0 a 5, y se llaman en este documento 0° a 5° bit de brillo. El sistema de excitación de LED divide los datos lógicos fuente en 6 conjuntos de datos lógicos, cada uno de los cuales tiene 16 valores lógicos respectivamente para los 16 canales de excitación y corresponde a cada uno de los bits de brillo. El sistema excitador de LED incluye una unidad de control 10, una unidad de registro de desplazamiento 11, una unidad de retención de datos 12 y una unidad de excitación 13.
La unidad de control 10 recibe los datos lógicos fuente y está configurada para generar los datos lógicos después de la división, una señal de reloj, una señal de retención y una señal de activación de salida.
La unidad de registro de desplazamiento 11 incluye 16 registros, recibe la señal de reloj y los datos lógicos y secuencialmente y respectivamente almacena los valores lógicos en los registros en respuesta a un flanco positivo de la señal de reloj.
Con referencia adicional a la figura 2, la unidad de control 10 permite a la unidad de registro de desplazamiento 11 almacenar los 6 conjuntos de datos lógicos correspondientes a los bits de brillo con los bits comprendiendo órdenes de bits de 0 a 5 (en referencia a los números que aparecen en los datos lógicos de la figura 2) en la secuencia dada. Una duración de tiempo requerida por la unidad de registro de desplazamiento 11 para almacenar cada conjunto de datos lógicos es T1.
La unidad de retención de datos 12 incluye 16 retenedores, recibe la señal de retención, y respectivamente almacena en los retenedores los valores lógicos almacenados en la unidad de registro de desplazamiento 11 en respuesta a un flanco positivo de la señal de retención.
La unidad de excitación 13 recibe la señal de activación de salida y los valores lógicos almacenados en la unidad de retención de datos 12, y entrega, a cada uno de los canales de excitación, una señal de corriente constante para cada uno de los seis períodos de tiempo predeterminados. Con referencia adicional a la figura 2, cada uno de los períodos de tiempo predeterminado tiene una longitud de 2k T2 en función de la señal de activación de salida y los datos lógicos, donde k representa el orden de bit del bit de brillo correspondiente a los datos lógicos recibidos de esta manera, y T2 es una duración del período de tiempo preestablecido correspondiente al bit de brillo que tiene el orden de bit 0. En un ejemplo, cuando tanto la señal de activación de salida y el valor lógico correspondiente tienen niveles lógicos altos, el canal correspondiente entrega una primera corriente constante al LED correspondiente, y cuando la señal de activación de salida tiene el nivel lógico alto y el correspondiente valor lógico tiene un nivel lógico bajo, el canal correspondiente entrega una segunda corriente constante (por ejemplo, con una magnitud de 0 A) al LED correspondiente.
En esta configuración, cuando 2k T2 < T1, hay un período de tiempo toff en el que el dispositivo LED está en un estado de inactividad, limitando así una tasa de utilización y un brillo máximo del dispositivo LED. Cuando 2k T2 > T1, hay un período de tiempo Doff en el que la unidad de control 10 es incapaz de entregar el siguiente conjunto de datos lógicos que se corresponde con el bit de brillo que tenga el orden de bit (k+1), limitando así una tasa de refresco del dispositivo LED.
Por lo tanto, un objetivo de la presente invención es proporcionar un método para controlar la emisión de luz de un dispositivo de emisión de luz. El método puede ocasionar que el dispositivo emisor de luz tenga una tasa de utilización y tasa de refresco relativamente mayores.
De acuerdo con un aspecto de la presente invención, se proporciona un método para controlar la emisión de luz de un dispositivo emisor de luz, y debe ser ejecutado por un sistema de excitación que incluye una unidad de registro de datos, una unidad de retención acoplada a la unidad de registro, una unidad de multiplexación acoplada a la unidad de registro y a la unidad de retención de datos, y una unidad de excitación acoplada a la unidad de multiplexación y el dispositivo emisor de luz. El método comprende:
5
10
15
20
25
30
35
40
45
50
55
60
65
(a) la recepción y el almacenamiento, por la unidad de registro, de los primeros datos lógicos, en sí misma;
(b) la retención y almacenamiento, por la unidad de retención de datos de los primeros datos lógicos almacenados en la etapa (a), en sí misma;
(c) después de la etapa (b), la recepción y el almacenamiento, por la unidad de registro, de los segundos datos lógicos, en sí misma;
(d) la entrega selectiva a la unidad de excitación, por la unidad de multiplexación, de uno de los primeros datos lógicos que están almacenados en la unidad de retención de datos, y los segundos datos lógicos que están almacenados en la unidad de registro; y
(e) la conversión, por la unidad de excitación, de dicho uno de los primeros datos lógicos y los segundos datos lógicos recibidos en una entrega de excitación que se proporciona al dispositivo de emisión de luz.
Otro objetivo de la presente invención es proporcionar un sistema de excitación para un dispositivo de emisión de luz. El sistema de excitación puede provocar que el dispositivo emisor de luz tenga una tasa de utilización y tasa de refresco relativamente mayores.
De acuerdo con otro aspecto de la presente invención, se proporciona un sistema de excitación para un dispositivo de emisión de luz, que incluye:
una unidad de registro dispuesta para recibir y almacenar los datos lógicos en ella;
una unidad de retención de datos acoplada a la unidad de registro para recibir los datos lógicos almacenados en la unidad de registro y operable para de forma selectiva retener y almacenar en ella los datos lógicos recibidos de la unidad de registro;
una unidad de multiplexación acoplada a la unidad de retención de datos para la recepción de los datos lógicos almacenados en ella para servir como primeros datos lógicos, acoplada a la unidad de registro para recibir los datos lógicos en ella almacenados para servir como segundos datos lógicos, y operable para entregar como salida de forma selectiva uno de los primeros datos lógicos y segundos datos lógicos; y
una unidad de excitación acoplada a la unidad de multiplexación para recibir de ella el uno de los primeros datos lógicos y los segundos datos lógicos, configurada para convertir el uno de los primeros datos lógicos y los segundos datos lógicos recibidos así en una entrega de excitación, y operable para proporcionar la salida de excitación al dispositivo emisor de luz.
Otras características y ventajas de la presente invención se pondrán de manifiesto en la siguiente descripción detallada de las realizaciones preferidas con referencia a los dibujos adjuntos, de los cuales:
la figura 1 es un diagrama de bloques que ilustra un sistema de excitación convencional de LED;
la figura 2 es un diagrama de tiempos que ilustra el sistema de excitación convencional de LED controlando la
emisión de luz de un dispositivo de emisión de luz;
la figura 3 es un diagrama esquemático que ilustra la división de datos lógicos fuente en varios conjuntos de datos lógicos;
la figura 4 es un diagrama de bloques que ilustra una primera realización preferida de un sistema de excitación para un dispositivo de emisión de luz de acuerdo con la presente invención;
la figura 5 es un diagrama de flujo de una realización preferida de un método de control para controlar la emisión de luz del dispositivo emisor de luz de acuerdo con la presente invención.
la figura 6 es un diagrama de tiempos que ilustra el sistema de excitación de la presente invención controlando la emisión de luz del dispositivo emisor de luz;
la figura 7 es un diagrama de tiempos que ilustra la temporización detallada de las señales de la primera realización preferida durante un período de tiempo tex en la figura 6;
la figura 8 es un diagrama de bloques que ilustra una segunda realización preferida de un sistema de excitación para un dispositivo de emisión de luz de acuerdo con la presente invención;
la figura 9 es un diagrama de tiempos que ilustra la temporización detallada de las señales de la segunda realización preferida durante el período de tiempo tex en la figura 6;
la figura 10 es un diagrama de bloques que ilustra una tercera realización preferida de un sistema de excitación para un dispositivo de emisión de luz de acuerdo con la presente invención;
la figura 11 es un diagrama de tiempos que ilustra la temporización detallada de las señales de la tercera realización preferida durante el período de tiempo tex en la figura 6;
la figura 12 es un diagrama de bloques que ilustra una cuarta realización preferida de un sistema de excitación para un dispositivo de emisión de luz de acuerdo con la presente invención; y
la figura 13 es un diagrama de tiempos que ilustra la temporización detallada de las señales de la cuarta realización preferida durante el período de tiempo tex en la figura 6.
Con referencia a las figuras 3 y 4, una primera realización preferida de un sistema de excitación para un dispositivo de emisión de luz (por ejemplo, un dispositivo con diodo emisor de luz (LED), que no se muestra) de acuerdo con la presente invención tiene un número N de canales de excitación para excitar, por ejemplo, LED del dispositivo de emisión de luz, donde N es un número entero y N ^ 1. El sistema de excitación incluye un bloque de control 1, una unidad de registro de desplazamiento 3, una unidad de retención de datos 5, una unidad de multiplexación 6 y una unidad de excitación 7. El bloque de control 1 incluye una unidad de control 2 y una unidad de conmutación 4. En la
5
10
15
20
25
30
35
40
45
50
55
60
práctica, la unidad de conmutación 4 puede estar integrada con la unidad de control 2, puede estar integrada con la unidad de retención de datos 5 y la unidad de multiplexación 6, o puede ser un módulo independiente, y la presente invención no debe considerarse limitada a este respecto. La unidad de control 2 recibe N conjuntos de datos lógicos fuente, cada uno de los cuales está compuesto de un número M de bits de brillo para indicar uno de los 2M niveles de brillo, donde M es un entero y M ^ 2. Los bits de brillo tienen diferentes órdenes de bits definidos respectivamente como 0 a M-1. En lo sucesivo, el bit de brillo que tiene el bit de orden k se llama bit de brillo k-ésimo. La unidad de control 2 divide los datos lógicos fuente en M conjuntos de datos lógicos, cada uno de los cuales corresponde a cada uno de los bits de brillo y tiene N valores lógicos respectivamente correspondientes a los canales de excitación. La unidad de control 2, entonces entrega a la unidad de registro de desplazamiento 3 los datos lógicos después de la división. En esta realización, N = 16 y M = 6, pero la presente invención no está limitada a ellos. Además, la unidad de control 2 genera y entrega una señal de reloj, una señal de retención y una señal de activación de salida para controlar las operaciones de la unidad de registro de desplazamiento 3, la unidad de conmutación 4, la unidad de retención de datos 5, la unidad de multiplexación 6 y la unidad de excitación 7, directa o indirectamente.
Con referencia a las figuras 4 y 7, en esta realización, la unidad de registro de desplazamiento 3 incluye N registros 31 y recibe y almacena en los registros 31 los datos lógicos transmitidos por la unidad de control 2 en respuesta a un flanco positivo de la señal de reloj. Durante la operación de almacenamiento de la unidad de registro de desplazamiento 3 (es decir, durante la salida de los datos lógicos mediante la unidad de control 2), la señal de reloj transmitida por la unidad de control 2 tiene un número de ciclos de reloj típicamentedos a N.
En esta realización, la unidad de conmutación 4 recibe la señal de reloj y la señal de retención, y emite una señal de activación de retención que tiene un nivel lógico ajustado para ser opuesto al de la señal de retención en respuesta a un flanco positivo de la señal de reloj. La unidad de conmutación 4 es además sensible a un flanco negativo de la señal de retención para: producir la señal de selección que tiene un nivel lógico alto cuando la señal de activación de retención tiene el nivel lógico alto, e invertir el nivel lógico de la señal de selección cuando la señal de activación de retención tiene el nivel lógico bajo.
En esta realización, la unidad de retención de datos incluye N retenedores 51, está acoplada a la unidad de registro de desplazamiento 3 para la recepción de los datos lógicos almacenados en la unidad de registro 3, y responde a un flanco negativo de la señal de retención para retener y almacenar los datos lógicos recibidos desde la unidad de registro de desplazamiento 3 en los retenedores 51 cuando la señal de activación de retención tiene el nivel lógico alto.
En esta realización, la unidad de multiplexación 6 está acoplada a la unidad de retención de datos 5 para recibir los datos lógicos almacenados en ella, está acoplada a la unidad de registro de desplazamiento 3 para la recepción de los datos lógicos almacenados en ella, y está configurada para entregar los datos lógicos almacenados en la unidad de retención de datos 5 cuando la señal de selección tiene el nivel lógico alto, y entregar los datos lógicos almacenados en la unidad de registro de desplazamiento 3 cuando la señal de selección tiene el nivel lógico bajo.
En esta realización, la unidad de excitación 7 está acoplada a la unidad de multiplexación 6 para recibir los datos lógicos producidos por la unidad de multiplexación 6, convierte los datos lógicos recibidos así en una salida de excitación, y proporciona una salida de excitación constante al dispositivo emisor de luz cuando la señal de activación de salida tiene el nivel lógico bajo. En este documento, la producción de excitación constante se refiere a una corriente constante dentro de un periodo de tiempo unidad.
Los bits de brillo se clasifican en un primer grupo de bits y un segundo grupo de bits. El orden de bit de cada uno de los bits de brillo clasificados en el primer grupo de bits es mayor que el de cada uno de los bits de brillo clasificados en el segundo grupo de bits. En una realización, la clasificación se consigue definiendo el orden de bits más bajo j entre los órdenes de bits de los bits de brillo que están clasificados en el primer grupo de bits para ser el orden de bits más alto entre los órdenes de bits 0 a M-1 que satisface:
imagen1
Es decir, cada uno de los bits de brillo con el bit de orden superior o igual a j se clasifica en el primer grupo de bits, y cada uno de los bits de brillo con el bit de orden menor que j queda clasificado en el segundo grupo de bits. En esta realización, desde M = 6, el bit de orden 4 es el bit de más alto orden que cumple la mencionada relación ((4-1) = 3
< ün=o(2n — 1) = 0 + 1 + 3= 4), es decir, j = 4. Por lo tanto, el 4o y 5o bits de brillo quedan clasificados en el primer grupo de bits, y el 0° al tercer bit de brillo quedan clasificados en el segundo grupo de bits.
En referencia adicional a la figura 6, la realización cumple:
2k1T2 > 2T1 y 2k2T2 < 2T1
5
10
15
20
25
30
35
40
45
50
55
60
65
donde Ti representa un periodo de tiempo (por ejemplo, N ciclos de reloj de la señal de reloj) requeridos por la unidad de registro de desplazamiento 3 para recibir y almacenar los datos lógicos entregados por la unidad de control 2, T2 representa un periodo de tiempo durante el que se proporciona excitación al dispositivo emisor de luz cuando la salida de excitación se convierte a partir del conjunto de datos lógicos cuyo bit de brillo correspondiente tiene el orden de bit 0, k1 representa el orden de bit de uno cualquiera de los bits de brillo clasificados en el primer grupo de bits, y k2 representa el orden de bit de uno cualquiera de los bits de brillo clasificados en el segundo grupo de bits. En esta realización, 21 2 3 T2 = 8 * T2 = T1, donde 23 T2 es un periodo de tiempo durante el que se proporciona salida de excitación al dispositivo emisor de luz cuando la salida de excitación se convierte a partir del conjunto de datos lógicos correspondiente al tercer bit de brillo, que es el orden de bit más alto entre los órdenes de bits de brillo clasificados en el segundo grupo de bits.
Con referencia a las figuras 5 y 6, con el fin de promover la tasa de utilización y la tasa de refresco del dispositivo de emisión de luz, el bloque de control 1 controla la unidad de registro de desplazamiento 3, la unidad de retención de datos 5, la unidad de multiplexación 6 y la unidad de excitación 7 para operar de acuerdo con las siguientes etapas:
Etapa 50: la unidad de control 2 produce primeros datos lógicos para la unidad de registro de desplazamiento 3 y la unidad de registro de desplazamiento 3 recibe y almacena los primeros datos lógicos en sí misma. Los primeros datos lógicos son uno de los M conjuntos de datos lógicos cuyo bit de brillo correspondiente se clasifica en el primer grupo de bits (por ejemplo, los datos lógicos con un número 4 o 5 en la figura 6). Cabe señalar que, en las figuras 6, 7, 9, 11 y 13, un número que se muestra en cada conjunto de datos lógicos representa el orden de bits del bit de brillo correspondiente a ese conjunto de datos lógicos.
Etapa 52: la unidad de retención de datos 5 retiene y almacena en ella los primeros datos lógicos almacenados en la unidad de registro de desplazamiento 3.
Etapa 54: después de la etapa 52, la unidad de control 2 entrega los segundos datos lógicos a la unidad de registro de desplazamiento 3 y la unidad de registro de desplazamiento 3 recibe y almacena los segundos datos lógicos en sí misma. Los segundos datos lógicos son uno de los M conjuntos de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits (por ejemplo, los datos lógicos con un número 0, 1, 2 o 3 en la figura 6).
Etapa 56: la unidad de multiplexación 6 entrega selectivamente a la unidad de excitación 7 uno de los primeros datos lógicos que están almacenados en la unidad de retención de datos 5 (con referencia a la señal de selección marcada con "L" en la figura 6), y los segundos datos lógicos que están almacenados en la unidad de registro de desplazamiento 3 (con referencia a la señal de selección marcada con una "R" en la figura 6).
Etapa 58: la unidad de excitación 7 convierte dicho uno de los primeros datos lógicos y los segundos datos lógicos recibidos por ella en una salida de excitación que se proporciona al dispositivo de emisión de luz (refiriéndose a la señal de activación de salida en la figura 6). En detalle, un período de tiempo en el cual la unidad de control 2 envía la señal de activación de salida para permitir la etapa 58 para el conjunto de datos lógicos que corresponden al bit de brillo k-ésimo es 2kT2.
Con el fin de minimizar Toff en el que el dispositivo de emisión de luz se encuentra en un estado de reposo y Doff en el que la unidad de control 2 es incapaz de entregar el siguiente conjunto de datos lógicos, una secuencia de salida de los M conjuntos de datos lógicos, la señal de retención y la señal de activación de salida están bien organizadas por la unidad de control 2 para conseguir las siguientes prestaciones:
(1) La unidad de multiplexación 6 entrega los primeros datos lógicos, los segundos datos lógicos y los primeros datos lógicos respectivamente en el primer, segundo y tercer períodos de tiempo en la secuencia indicada. Téngase en cuenta que los primeros datos lógicos producidos en el primer y tercer períodos de tiempo son los mismos primeros datos lógicos (en referencia a la señal de selección y los datos lógicos almacenados en la unidad de retención de datos 5 que corresponden a 32 * T2 (1), 2 * T2 y 32 x T2 (2) en la figura 6).
(2) Durante el primer período de tiempo, la unidad de excitación 7 convierte los primeros datos lógicos en una primera salida de excitación constante que se proporciona al dispositivo emisor de luz durante un primer período de tiempo predeterminado (por ejemplo, 32 * T2 (1) en la Figura 6); durante el segundo período de tiempo, la unidad de excitación 7 convierte los segundos datos lógicos en una segunda salida de excitación constante que se proporciona al dispositivo emisor de luz durante un segundo período de tiempo predeterminado (por ejemplo, 2 x T2 en Figura 6); y durante el tercer período de tiempo, la unidad de excitación 7 convierte los primeros datos lógicos en la primera salida de excitación constante que se proporciona al dispositivo emisor de luz durante un tercer período de tiempo predeterminado (por ejemplo, 32 * T2 (2) en la figura 6). En otras palabras, un periodo largo de tiempo durante el que se proporciona la primera salida de excitación constante al dispositivo emisor de luz se divide en varios períodos de tiempo más cortos separados. Por ejemplo, en esta realización, un período de 32 * T2 para el conjunto de datos lógicos correspondiente al 5° bit de brillo se divide en cuatro períodos más cortos: 32 * T2 (1), 32 * T2 (2), 32 * T2 (3) y 32 * T2 (4), cada uno de los cuales tiene una duración de tiempo igual a 8 * T2. Igualmente, un período de 16 * T2 para el conjunto de datos lógicos correspondiente al 4° bit de brillo se divide en dos períodos más cortos: 16 * T2 (1) y 16 * T2 (2), cada uno de las cuales tiene una duración de tiempo igual a 8 * T2.
(3) Al menos un conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits se dispone entre dos conjuntos de datos lógicos cuyos bits de brillo correspondientes están clasificados en el primer grupo de bits. Por ejemplo, en la figura 6, la entrega del conjunto de datos lógicos correspondiente al
5
10
15
20
25
30
35
40
45
50
55
60
65
bit de brillo 0° se dispone entre entregas de los conjuntos de datos lógicos correspondientes a los bits de brillo 4° y 5°. En esta realización, un número R del citado al menos un conjunto de datos lógicos satisface R = 2 K1f-j+1 - 1, donde kf representa el orden de bits correspondiente al primero de los citados dos conjuntos de datos lógicos. Por ejemplo, cuando el primer conjunto de los citados dos conjuntos de datos lógicos corresponde al 4° bit de brillo, R = 2 4-4+1 -1 = 1. Con referencia a la figura 6, solo el conjunto de datos lógicos correspondiente al 0° bit de brillo está dispuesto para seguir al conjunto de datos lógicos correspondiente al 4° bit de brillo. Cuando el primer conjunto de los citados dos conjuntos de datos lógicos corresponde al 5° bit de brillo, R = 25-4+1 -1 = 3. Con referencia a la figura 6, los tres conjuntos de datos lógicos correspondientes al 1° al 3° bit de brillo están dispuestos para seguir al conjunto de datos lógicos correspondiente al 5° bit de brillo. En otras realizaciones, el primer conjunto de los citados dos conjuntos de datos lógicos puede estar dispuesto antes del conjunto R de datos lógicos y después de otro conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits y tiene el orden de bit de t, donde 2t T2 = T1.
En virtud de esta disposición, la entrega de los segundos datos lógicos por la unidad de control 2 y la producción de la salida de excitación que se convierte desde los primeros datos lógicos puede producirse al mismo tiempo, con el fin de reducir tanto Toff como Doff, promoviendo así la tasa de utilización, brillo máximo y la tasa de refresco del dispositivo emisor de luz.
Con referencia a la figura 6, en esta realización, la unidad de control 2 primero entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 4° bit de brillo. La unidad de retención de datos 5 después retiene y almacena en ella el conjunto de datos lógicos correspondiente al 4° bit de brillo que se almacena en la unidad de registro de desplazamiento 3.
A continuación, la unidad de control 2 entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 0° bit de brillo. Al mismo tiempo, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 4° bit de brillo (que se almacena en la unidad de retención de datos 5) en una salida de excitación constante que se proporciona al dispositivo de emisión de luz durante una duración (es decir, 8 x T2) del período de tiempo 16 x T2 (1).
A continuación, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 0° bit de brillo (que está almacenado en la unidad de registro de desplazamiento 3) en una salida de excitación constante que se proporciona al dispositivo emisor de luz durante un período de tiempo de 1 x T2.
A continuación, la unidad de control 2 entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 5° bit de brillo. Al mismo tiempo, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 4° bit de brillo (que está almacenado en la unidad de retención de datos 5) en una salida de excitación constante que se proporciona al dispositivo de emisión de luz durante una duración (es decir, 8 x T2) del período de tiempo 16 x T2 (2). La unidad de retención de datos 5 entonces retiene y almacena en ella el conjunto de datos lógicos correspondiente al 5° bit de brillo que está almacenado en la unidad de registro de desplazamiento 3.
A continuación, la unidad de control 2 entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 1er bit de brillo. Al mismo tiempo, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 5° bit de brillo (que está almacenado en la unidad de retención de datos 5) en una salida de excitación constante que se proporciona al dispositivo de emisión de luz durante una duración (es decir, 8 x T2) del período de tiempo 32 x T2 (1).
A continuación, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente 1er bit de brillo (que está almacenado en la unidad de registro de desplazamiento 3) en una salida de excitación constante que se proporciona al dispositivo emisor de luz durante un período de tiempo de 2 x t2.
A continuación, la unidad de control 2 entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 2° bit de brillo. Al mismo tiempo, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 5° bit de brillo (que está almacenado en la unidad de retención de datos 5) en una salida de excitación constante que se proporciona al dispositivo de emisión de luz durante una duración (es decir, 8 x T2) del período de tiempo 32 x T2 (2).
A continuación, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 2° bit de brillo (que está almacenado en la unidad de registro de desplazamiento 3) en una salida de excitación constante que se proporciona al dispositivo emisor de luz durante un período de tiempo de 4 x t2.
A continuación, la unidad de control 2 entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 3er bit de brillo. Al mismo tiempo, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 5° bit de brillo (que está almacenado en la unidad de retención de datos 5) en una salida de excitación constante que se proporciona al dispositivo de emisión de luz durante una duración (es decir, 8 x T2) del período de tiempo 32 x T2 (3).
5
10
15
20
25
30
35
40
45
A continuación, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 3er bit de brillo (que está almacenado en la unidad de registro de desplazamiento 3) en una salida de excitación constante que se proporciona al dispositivo emisor de luz durante un período de tiempo de 8 x T2.
A continuación, la unidad de control 2 entrega a la unidad de registro de desplazamiento 3 el conjunto de datos lógicos correspondiente al 4° bit de brillo y asociado a los siguientes datos lógicos fuente. Al mismo tiempo, la unidad de control 2 activa la unidad de excitación 7 para convertir el conjunto de datos lógicos correspondiente al 5° bit de brillo (que está almacenado en la unidad de retención de datos 5) en una salida de excitación constante que se proporciona al dispositivo de emisión de luz de durante una duración (es decir, 8 x T2) del período de tiempo 32 x T2
(4).
En la primera realización preferida, la unidad de registro de desplazamiento 3 es un registro de desplazamiento que incluye N registros. Sin embargo, en una variación de la primera realización preferida, la unidad de registro de desplazamiento 3 puede incluir una pluralidad de registros de desplazamiento acoplados en serie, de tal forma que la suma de los números de registros de los registros de desplazamiento es igual a N, y la unidad de retención de datos 5 incluye una pluralidad de subunidades de retención de datos respectivamente correspondientes a los registros de desplazamiento. En una variación específica, la unidad de registro de desplazamiento 3 incluye un número X de registros de desplazamiento, cada uno de los cuales incluye un número n de registros, y X x n = N.
Con referencia a las figuras 8 y 9, una segunda realización preferida de un sistema de excitación de acuerdo con la presente invención es similar a la primera realización preferida, y difiere en que: la unidad de conmutación 4 recibe la señal de retención y la señal de activación de salida, entrega la señal de activación de retención que es la misma que la señal de activación de salida, y responde a un flanco negativo de la señal de activación de salida para entregar la señal de selección que tiene el nivel lógico alto cuando la señal de retención tiene el nivel lógico bajo, y entregar la señal de selección que tiene el nivel lógico bajo cuando la señal de retención tiene el nivel lógico alto.
Con referencia a las figuras 10 y 11, una tercera realización preferida de un sistema de excitación de acuerdo con la presente invención es similar a la primera realización preferida, y difiere en que: la unidad de conmutación 4 genera una señal intermedia que tiene un nivel lógico ajustado para ser opuesto al de la señal de retención en respuesta a un flanco positivo de la señal de reloj, y entrega, en respuesta a un flanco negativo de la señal de retención, un pulso para servir como señal de activación de retención cuando la señal intermedia tiene un nivel lógico alto. Más aún, la unidad de conmutación 4 responde a un flanco negativo de la señal de retención para entregar la señal de selección que tiene un nivel lógico alto cuando la señal intermedia tiene el nivel lógico alto, e invertir el nivel lógico de la señal de selección cuando la señal intermedia tiene un nivel lógico bajo. La unidad de retención de datos 5 retiene y almacena los datos lógicos almacenados en la unidad de registro de desplazamiento 3 de acuerdo con la señal de activación de retención (por ejemplo, cuando la señal de activación de retención tiene el nivel lógico alto).
Con referencia a las figuras 12 y 13, una cuarta realización preferida de un sistema de excitación de acuerdo con la presente invención es similar a la segunda realización preferida, y difiere en que: la unidad de conmutación 4 entrega, en respuesta a un flanco negativo de la señal de retención, un pulso que sirve como señal de activación de retención cuando la señal de activación de salida tiene el nivel lógico alto. La unidad de retención de datos 5 retiene y almacena los datos lógicos almacenados en la unidad de registro de desplazamiento 3 de acuerdo con la señal de activación de retención (por ejemplo, cuando la señal de activación de retención tiene el nivel lógico alto).
Como resumen, de acuerdo con la presente invención, las operaciones de la unidad de registro de desplazamiento 3, la unidad de retención de datos 4 y la unidad de excitación 5 están bien controladas usando el bloque de control 1 para promover la tasa de utilización y la tasa de refresco del dispositivo emisor de luz.

Claims (15)

  1. 5
    10
    15
    20
    25
    30
    35
    40
    45
    50
    55
    60
    65
    REIVINDICACIONES
    1. Un método para controlar la emisión de luz de un dispositivo emisor de luz, dicho método para ser aplicado por un sistema de excitación que incluye una unidad de registro de desplazamiento (3) que recibe una señal de reloj, una unidad de retención de datos (5) acoplada a la unidad de registro de desplazamiento (3), una unidad de multiplexación (6) acoplada a la unidad de registro de desplazamiento (3) y la unidad de retención de datos (5), y una unidad de excitación (7) acoplada a la unidad de multiplexación (6) y al dispositivo de emisión de luz, incluyendo dicho método:
    (a) la recepción y el almacenamiento, por la unidad de registro de desplazamiento (3), de primeros datos lógicos en ella de acuerdo con la señal de reloj; y
    (b) la retención y almacenamiento, por la unidad de retención de datos (5), de primeros datos lógicos almacenados en la etapa (a) en ella;
    estando dicho método caracterizado por:
    (c) después de la etapa (b), la recepción y el almacenamiento, por la unidad de registro de desplazamiento (3), de segundos datos lógicos en ella,
    (d) de forma selectiva entregar a la unidad de excitación (7), por la unidad de multiplexación (6), uno de los primeros datos lógicos que están almacenados en la unidad de retención de datos (5) y los segundos datos lógicos que están almacenados en la unidad de registro de desplazamiento (3); y
    (e) la conversión, por la unidad de excitación (7), de dicho uno de los primeros datos lógicos y los segundos datos lógicos recibidos, en una salida de excitación que se proporciona al dispositivo de emisión de luz.
  2. 2. El método de acuerdo con la reivindicación 1, caracterizado por que la etapa (d) incluye:
    (d1) entregar a la unidad de excitación (7), por la unidad de multiplexación (6), los primeros datos lógicos almacenados en la unidad de retención de datos (5);
    (d2) después de la sub-etapa (d1), entregar a la unidad de excitación (7), por la unidad de multiplexación (6), los segundos datos lógicos almacenados en la unidad de registro de desplazamiento (3); y (d3) después de la sub-etapa (d2), entregar a la unidad de excitación (7), por la unidad de multiplexación (6), los primeros datos lógicos almacenados en la unidad de retención de datos (5); y
    en donde los primeros datos lógicos enviados en la sub-etapa (d3) y la sub-etapa (d1) son los mismos primeros datos lógicos que se almacenan en la unidad de retención de datos (5) en la misma etapa (b).
  3. 3. El método de acuerdo con la reivindicación 2, caracterizado además por que:
    la etapa (e) incluye:
    (e1) durante la sub-etapa (d1), la conversión, por la unidad de excitación (7), de los primeros datos lógicos en una primera salida de excitación constante que se proporciona al dispositivo emisor de luz durante un primer periodo de tiempo predeterminado;
    (e2) durante la sub-etapa (d2), la conversión, por la unidad de excitación (7), de los segundos datos lógicos en una segunda salida de excitación constante que se proporciona al dispositivo emisor de luz durante un segundo período de tiempo predeterminado; y
    (e3) durante la sub-etapa (d3), la conversión, por la unidad de excitación (7), de los primeros datos lógicos en la primera salida de excitación constante que se proporciona al dispositivo emisor de luz durante un tercer período de tiempo predeterminado; y
    en donde el segundo período de tiempo predeterminado es más corto que la suma del primer período de tiempo predeterminado y el tercer período de tiempo predeterminado.
  4. 4. El método de acuerdo con una cualquiera de las reivindicaciones 1 a 3, en el que el sistema de excitación incluye además un bloque de control (1) que controla las operaciones de la unidad de registro de desplazamiento (3), la unidad de retención de datos (5), la unidad de multiplexación (6) y la unidad de excitación (7), dicho método caracterizado además por:
    recibir, por el bloque de control (1), los datos lógicos fuente compuestos por un número M de bits de brillo, los datos lógicos fuente indicando uno de 2M niveles de brillo, donde M es un número entero y M ^ 2, teniendo los bits de brillo diferente orden de bits y estando clasificados en un primer y un segundo grupo de bits, siendo el orden de bit de cada uno de los bits de brillo del primer grupo de bits siendo mayor que el de cada uno de los bits de brillo del segundo grupo de bits;
    dividir, por el bloque de control (1), los datos lógicos fuente en M conjuntos de datos lógicos, cada uno de ellos correspondiente a cada uno de los bits de brillo; y
    entregar, por el bloque de control (1), los M conjuntos de datos lógicos tras la división en una secuencia de salida
    5
    10
    15
    20
    25
    30
    35
    40
    45
    50
    55
    60
    65
    tal que cada conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el primer grupo de bits sirve como los primeros datos lógicos, y cada conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits sirve como los segundos datos lógicos.
  5. 5. El método de acuerdo con la reivindicación 4, caracterizado por que M ^ 3, y en la secuencia de entrega, al menos un conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits se dispone entre dos conjuntos de datos lógicos cuyos bits de brillo correspondientes están clasificados en el primer grupo de bits.
  6. 6. El método de acuerdo con la reivindicación 5, en el que los órdenes de bits de los bits de brillo se definen como números enteros que van desde 0 a M-1, dicho método se caracteriza además por satisfacer:
    2k1T2 > 2Ti y 2k2T2 < 2Ti
    en donde T1 representa una duración de tiempo requerido para recibir y almacenar uno de los primeros datos lógicos en la etapa (a) y los segundos datos lógicos en la etapa (c), T2 representa una duración de tiempo durante el que se proporciona salida de excitación al dispositivo emisor de luz cuando la salida de excitación se convierte a partir de los segundos datos lógicos que corresponden al conjunto de datos lógicos cuyo bit de brillo correspondiente tiene el orden de bit de 0, k1 representa el orden de bit de uno cualquiera de los bits de brillo clasificados en el primer grupo de bits, y k2 representa el orden de bit de uno cualquiera de los bits de brillo clasificados en el segundo grupo de bits;
    y k
    en donde la duración total de tiempo de salida de excitación proporcionada al dispositivo emisor de luz es 2k T2 cuando la salida de excitación se convierte a partir del conjunto de datos lógicos cuyo bit de brillo correspondiente tiene el orden de bit de k.
  7. 7. El método de acuerdo con la reivindicación 6, caracterizado además por satisfacer R = zk1f-j+1 -1, donde R representa un número de dicho al menos un conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits, k1f representa el orden de bits correspondiente al primero de uno de dichos dos conjuntos de datos lógicos cuyos bits de brillo correspondientes están clasificados en el primer grupo de bits y j representa el orden de bits más bajo entre los órdenes de bits de los bits de brillo clasificados en el primer grupo de bits.
  8. 8. El método de acuerdo con la reivindicación 7, caracterizado por que M ^ 4, y en la secuencia de entrega dicho primer conjunto de dichos dos conjuntos de datos lógicos está dispuesto antes de dicho al menos un conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits y después de otro conjunto de datos lógicos cuyo bit de brillo correspondiente está clasificado en el segundo grupo de bits y tiene el orden de bit de t, satisfaciendo además dicho método: 2t T2 = T1.
  9. 9. Un sistema de excitación para un dispositivo de emisión de luz, que incluye:
    una unidad de registro de desplazamiento (3) dispuesta para recibir una señal de reloj y datos lógicos y configurada para almacenar los datos lógicos en ella de acuerdo con la señal de reloj;
    una unidad de retención de datos (5) acoplada a dicha unidad de registro de desplazamiento (3) para la recepción de los datos lógicos almacenados en dicha unidad de registro de desplazamiento (3), y operable para retener de forma selectiva y almacenar en ella los datos lógicos recibidos de dicha unidad de registro de desplazamiento (3);
    una unidad de multiplexación (6) acoplada a dicha unidad de retención de datos (5) para la recepción de los datos lógicos almacenados en ella, acoplada a dicha unidad de registro de desplazamiento (3) para la recepción de los datos lógicos almacenados en ella y operable para entregar de forma selectiva uno de los datos lógicos almacenados en dicha unidad de retención (5) y los datos lógicos almacenados en dicha unidad de registro de desplazamiento (3); y
    una unidad de excitación (7) acoplada a dicha unidad de multiplexación (6) para recibir los datos lógicos entregados por dicha unidad de multiplexación (6), configurada para convertir los datos lógicos recibidos por ella, en una salida de excitación, y operable para proporcionar la salida de excitación al dispositivo emisor de luz; estando dicho sistema de excitación caracterizado por que: dicha unidad de registro de desplazamiento (3) está configurada para recibir y almacenar los primeros datos lógicos en ella, dicha unidad de retención de datos (5) está configurada para retener y almacenar los primeros datos lógicos almacenados en dicha unidad de registro de desplazamiento (3) y dicha unidad de registro de desplazamiento (3) está configurada para recibir y almacenar los segundos datos lógicos en ella después de que dicha unidad de retención de datos (5) retenga y almacene los primeros datos lógicos.
  10. 10. El sistema de excitación de acuerdo con la reivindicación 9, además caracterizado por:
    un bloque de control (1) acoplado a dicha unidad de registro de desplazamiento (3), dicha unidad de retención de datos (5), dicha unidad de multiplexación (6) y dicha unidad de excitación (7), en donde dicho bloque de control (1) está configurado para controlar dicha unidad de registro de desplazamiento (3) para recibir y almacenar los
    5
    10
    15
    20
    25
    30
    35
    40
    45
    50
    55
    60
    25 primeros datos lógicos en ella, para controlar dicha unidad de retención de datos (5) para retener y almacenar los primeros datos lógicos almacenados en dicha unidad de registro de desplazamiento (3) y para controlar dicha unidad de registro de desplazamiento (3) para recibir y almacenar los segundos datos lógicos en ella después de que dicha unidad de retención de datos (5) retenga y almacene los primeros datos lógicos.
  11. 11. El sistema de excitación de acuerdo con la reivindicación 10, caracterizado por que:
    dicho bloque de control (1) está configurado para entregar la señal de reloj a dicha unidad de registro de desplazamiento (3);
    dicho bloque control (1) está configurado para entregar una señal de activación de retención para dicha unidad de retención de datos (5) y dicha unidad de retención de datos (5) está configurada para retener y almacenar en ella los primeros datos lógicos de acuerdo con la señal de activación de retención;
    dicho bloque de control (1) está configurado para entregar una señal de selección para dicha unidad de multiplexación (6) y dicha unidad de multiplexación (6) está configurada para entregar a dicha unidad de excitación (7) uno de los primeros datos lógicos y los segundos datos lógicos de acuerdo con la señal de selección; y
    dicho bloque de control (1) está configurado para entregar una señal de activación de salida para dicha unidad de excitación (7) y dicha unidad de excitación (7) está configurada para proporcionar la salida de excitación al dispositivo emisor de luz de acuerdo con la señal de activación de salida.
  12. 12. El sistema de excitación de acuerdo con la reivindicación 11, caracterizado además por que dicho bloque de control (1) incluye:
    una unidad de control (2) configurada para generar la señal de reloj, la señal de activación de salida y una señal de retención, y generar los primeros datos lógicos y los segundos datos lógicos cada uno teniendo al menos un valor lógico, la señal de reloj siendo entregada durante la entrega de uno de los primeros datos lógicos y los segundos datos lógicos y teniendo un número de ciclos de reloj asociados a un número de valores lógicos de dichos uno de los primeros datos lógicos y los segundos datos lógicos; y
    una unidad de conmutación (4) acoplada a dicha unidad de control (2) para recibir la señal de retención y una de la señal de reloj y la señal de activación de salida, configurada para entregar la señal de activación de retención y configurada para entregar la señal de selección según la señal de retención en respuesta a un desencadenante por dicha una de la señal de reloj y la señal de activación de salida.
  13. 13. El sistema de excitación de acuerdo con la reivindicación 12, caracterizado además por que dicha unidad de retención de datos (5) está configurada para recibir además la señal de retención y para almacenar los primeros datos lógicos de acuerdo con la señal de activación de retención y la señal de retención.
  14. 14. El sistema de excitación de acuerdo con la reivindicación 13, además caracterizado por que:
    dicha unidad de conmutación (4) está configurada para recibir la señal de reloj y la señal de retención, y está configurada para entregar la señal de activación de retención que tiene un nivel lógico ajustado para ser opuesto al de la señal de retención en respuesta a un flanco positivo de la señal de reloj; y
    dicha unidad de conmutación (4) está configurada para responder a un flanco negativo de la señal de retención para:
    entregar la señal de selección que permite a la unidad de multiplexación (6) entregar los primeros datos lógicos cuando la señal de activación de retención tiene uno de entre un nivel lógico alto y un nivel lógico bajo; e
    invertir un nivel lógico de la señal de selección cuando la señal de activación de retención tiene el otro del nivel lógico alto y el nivel lógico bajo.
  15. 15. El sistema de excitación de acuerdo con la reivindicación 13, además caracterizado por que:
    dicha unidad de conmutación (4) está configurada para recibir la señal de retención y la señal de activación de salida y está configurada para entregar la señal de activación de retención, que es la misma que la señal de activación de salida; y
    dicha unidad de conmutación (4) está configurada para responder a un flanco negativo de la señal de activación de salida para:
    entregar la señal de selección que activa la unidad de multiplexación (6) para la entrega de los primeros datos lógicos cuando la señal de retención tiene uno entre un nivel lógico alto y un nivel lógico bajo; y entregar la señal de selección que activa la unidad de multiplexación (6) para entregar los segundos datos lógicos cuando la señal de retención tiene el otro del nivel lógico alto y un nivel lógico bajo.
ES14184814.3T 2013-09-18 2014-09-15 Método para el control de la emisión de luz de un dispositivo emisor de luz y un sistema excitador que implementa el método Active ES2659734T3 (es)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
TW102133904A TWI489909B (zh) 2013-09-18 2013-09-18 Light emitting diode drive system and control method
TW102133904 2013-09-18

Publications (1)

Publication Number Publication Date
ES2659734T3 true ES2659734T3 (es) 2018-03-19

Family

ID=51570276

Family Applications (1)

Application Number Title Priority Date Filing Date
ES14184814.3T Active ES2659734T3 (es) 2013-09-18 2014-09-15 Método para el control de la emisión de luz de un dispositivo emisor de luz y un sistema excitador que implementa el método

Country Status (7)

Country Link
US (1) US9226358B2 (es)
EP (1) EP2852255B1 (es)
JP (1) JP5935192B2 (es)
KR (1) KR101790023B1 (es)
CN (1) CN104464613B (es)
ES (1) ES2659734T3 (es)
TW (1) TWI489909B (es)

Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI564858B (zh) * 2015-06-24 2017-01-01 Macroblock Inc Light - emitting diode control method
CN106448603B (zh) * 2016-11-10 2019-07-09 京东方科技集团股份有限公司 控制电路、控制装置、栅极驱动器、显示装置及驱动方法
TWI622976B (zh) * 2017-03-15 2018-05-01 明陽半導體股份有限公司 灰階產生電路與使用其之驅動電路
CN107545864B (zh) * 2017-08-07 2023-11-24 杭州视芯科技股份有限公司 Led显示装置及其驱动电路和驱动方法
JP6787446B2 (ja) * 2019-05-28 2020-11-18 カシオ計算機株式会社 造形物の製造方法
CN112820237B (zh) * 2019-10-31 2022-08-26 京东方科技集团股份有限公司 电子基板及其驱动方法、显示装置

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63185271A (ja) * 1987-01-28 1988-07-30 Nec Corp Ｌｅｄアレイ装置
US5812534A (en) * 1993-01-08 1998-09-22 Multi-Tech Systems, Inc. Voice over data conferencing for a computer-based personal communications system
US6175346B1 (en) * 1996-10-24 2001-01-16 Motorola, Inc. Display driver and method thereof
JP2009093188A (ja) * 1997-10-01 2009-04-30 Semiconductor Energy Lab Co Ltd 半導体表示装置
TWI224300B (en) * 2003-03-07 2004-11-21 Au Optronics Corp Data driver and related method used in a display device for saving space
JP4526279B2 (ja) * 2003-05-27 2010-08-18 三菱電機株式会社 画像表示装置および画像表示方法
EP1757171A1 (en) * 2004-04-19 2007-02-28 Tir Systems Ltd. Parallel pulse code modulation system and method
JP2007333913A (ja) * 2006-06-14 2007-12-27 Sony Corp 表示装置
US7569997B2 (en) * 2007-05-06 2009-08-04 Ascend Visual System, Inc. Self-calibrated integration method of light intensity control in LED backlighting
JP4523016B2 (ja) * 2007-05-22 2010-08-11 株式会社沖データ 駆動回路、ｌｅｄヘッドおよび画像形成装置
TWM368163U (en) * 2009-07-03 2009-11-01 Numen Technology Inc Control circuit of LED display with adjustment function
TWI425481B (zh) * 2009-12-29 2014-02-01 My Semi Inc 發光二極體的驅動裝置
CN102044216B (zh) * 2010-09-14 2013-03-20 杭州士兰微电子股份有限公司 一种led显示***和led驱动电路
TWM452576U (zh) * 2012-07-27 2013-05-01 My Semi Inc 發光二極體驅動電路與驅動系統
TWI491304B (zh) * 2012-11-09 2015-07-01 My Semi Inc 發光二極體驅動電路與驅動系統

Also Published As

Publication number Publication date
JP5935192B2 (ja) 2016-06-15
EP2852255A3 (en) 2015-09-30
US9226358B2 (en) 2015-12-29
EP2852255B1 (en) 2017-11-22
CN104464613B (zh) 2018-01-30
JP2015060221A (ja) 2015-03-30
EP2852255A2 (en) 2015-03-25
CN104464613A (zh) 2015-03-25
KR101790023B1 (ko) 2017-10-25
KR20150032489A (ko) 2015-03-26
TW201513722A (zh) 2015-04-01
TWI489909B (zh) 2015-06-21
US20150077008A1 (en) 2015-03-19

Similar Documents

Publication Publication Date Title
ES2659734T3 (es) Método para el control de la emisión de luz de un dispositivo emisor de luz y un sistema excitador que implementa el método
KR102328594B1 (ko) 발광 다이오드를 구비한 디스플레이 장치
US10297190B2 (en) Pixel selection method for a light-source matrix driver
KR101278250B1 (ko) Ｌｅｄ 구동 장치 및 이의 구동 시스템
US10140927B2 (en) Gray scale generator and driving circuit using the same
TWI430710B (zh) 發光二極體之驅動電路及其方法
JP5643268B2 (ja) 発光ダイオード駆動回路、発光ダイオード駆動装置および駆動方法
CN102157130A (zh) Led驱动集成电路的脉冲宽度调制方法
JP2015045779A5 (es)
US9215771B2 (en) Light emitting diode driver
TW200518464A (en) Timing generator, solid-state imaging device and camera system
TWI478621B (zh) 驅動電路與驅動方法
CN213073168U (zh) Led驱动装置
JP2015026341A5 (es)
US7317294B2 (en) Pulse generator and method thereof
US20110109665A1 (en) Display driving circuit and display driving system
JP7490672B2 (ja) Ｐｗｍ信号を生成するための方法、およびｐｗｍ信号を生成するための回路
KR101103252B1 (ko) 2개의 신호선을 사용하는 데이터 전송 장치
JP2012100887A5 (es)
CN105490963B (zh) 一种网络节点多业务数据的发送调度方法及***
TW201411588A (zh) 發光二極體驅動電路與具有其之驅動系統
JP2010011713A (ja) パルス出力回路
TW201918028A (zh) 暫存器配置電路
TWM460406U (zh) 發光二極體驅動電路與驅動系統
JP2013066083A (ja) 列変換回路、および、列変換方法