EP0197809A1 - Circuit de commande d'un panneau à plasma de type alternatif - Google Patents

Circuit de commande d'un panneau à plasma de type alternatif Download PDF

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EP0197809A1
EP0197809A1 EP86400450A EP86400450A EP0197809A1 EP 0197809 A1 EP0197809 A1 EP 0197809A1 EP 86400450 A EP86400450 A EP 86400450A EP 86400450 A EP86400450 A EP 86400450A EP 0197809 A1 EP0197809 A1 EP 0197809A1
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EP
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circuit
electrodes
signals
signal
circuits
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EP86400450A
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Louis Delgrange
Michel Specty
Françoise Vialettes
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Thales SA
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Thomson CSF SA
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Publication date
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Definitions

  • the present invention relates to a control circuit for an alternating type plasma panel.
  • Plasma panels of the alternative type are well known in the prior art.
  • the present invention provides an integrated circuit designed to operate with the two arrays of electrodes of the panel, without complication of the commands, and which therefore does not have the drawbacks of the Texas SN 75501 N circuit.
  • the present invention relates to a circuit for controlling an alternating type plasma panel, ensuring the generation of the maintenance signals, and of the selective signals, for writing and erasing the panel, these signals being applied between two electrodes.
  • this control circuit comprising integrated circuits provided in particular with a logic circuit defining the signal to be executed, its duration and the electrodes on which this signal will be active;
  • FIG. 1 the maintenance inscription and erasure signals which are applied to the cells of the panel are shown.
  • Each cell is constituted by the gas space located at the intersection of two electrodes belonging to the two networks of orthogonal electrodes of the panel.
  • Each cell is found setting control signals V x -Vy, shown in Figure 1, and constituted by the difference of the voltages V x and Vy applied to the two electrodes between which it is located.
  • the dotted lines represent the signals V x -Vy which must be applied to write or delete a cell and the signals are represented by asterisks.
  • V x -Vy to be applied to cells which must not be registered or deleted.
  • FIGS. 2 to 5 these two modes of representation have also been used for the selective signals.
  • FIGS. 2 and 3 show the signals V x and Vy which are applied to each of the electrode arrays to obtain the signals V x -Vy of FIG. 1.
  • the signals V x participate in the preparation of the selective recording and erasing signals and transmit the reference voltage of the maintenance signals, that is to say from 0 V on the figure 2.
  • Maintenance signals are not produced by integrated circuits but by amplifiers external to integrated circuits.
  • the integrated circuits only transmit the maintenance signals.
  • the integrated circuits according to the invention are produced so as to be able to withstand a voltage of 100 volts.
  • Vy which evolves between -100 V and + 100 V
  • V, f which follows the maintenance signals which also evolve between -100 V and + 100 V.
  • This floating reference voltage V is shown in FIG. 4. It can be seen, with respect to the voltage Vy in FIG. 3, that V r. f follows the maintenance signals and when developing selective signals, the voltage V rf follows the lowest potential that it is possible to apply to the electrodes.
  • Vy - V rf which varies between 0 and 100 V.
  • control circuit of a plasma panel comprises integrated circuits associated with amplifiers for the development of maintenance signals and each integrated circuit notably comprises a logic circuit defining the signal to be executed, its duration and the electrodes on which this signal will be active.
  • FIG. 2 of French patent 2,547,091 the structure of a logic circuit is shown which is part of an integrated circuit.
  • Each logic circuit essentially consists of shift registers with serial input and parallel outputs and a decoding and validation system. Therefore, the data or logical addresses designating the active and non-active electrodes are entered in series in the shift registers and are found in parallel on the outputs of the registers which correspond respectively to the electrodes of the plasma panel. An order defining the recording or erasing signal to be applied to the active electrodes then validates the parallel outputs of the registers to a low voltage / high voltage interface circuit.
  • logic circuits are produced which satisfy the following logic table:
  • the "Strobe” signal is an input of the logic circuit which by convention when it is at "1 indicates that an integrated circuit is not selected and when it is at" 0 "indicates that an integrated circuit is selected.
  • the signal "Inv” is the signal discussed above which, by convention, when it is “0” indicates that an integrated circuit is used on one of the electrode networks, the x-electrodes which receive V x in our example and which when it is at "1 indicates that an integrated circuit is used on the other electrode network, the electrodes at y which receive Vy in our example.
  • a bit of the shift register is, by convention, in state 1 if one wishes to activate an electrode and in state 0 if one does not wish to activate an electrode.
  • the shift register with serial input of the data D and with parallel outputs has been designated by the reference 1.
  • This register receives a clock signal H.
  • the acquisition of the data in the register and the application of an order to the electrodes of the panel are dissociated in time.
  • the data D is entered in series in the register at the rate of the data acquisition clock H.
  • a bit of the register is reserved for each controlled electrode.
  • This logic circuit conventionally comprises a decoding and validation circuit 6 which, during the duration of the signal to be executed, validates or not the outputs which go to the low voltage / high voltage, LV / HV interface, reference 5; this interface allows signals of 100 V amplitude to be applied directly to the electrodes
  • Access to the panel is therefore by point segments in rows and columns. Each point of these segments is defined as active or not. by a bit of a shift register.
  • the decoding and validation system 6 comprises inverted AND circuits 2. Each circuit 2 is connected to one of the outputs of register 1 and to the output of an inverter 3 which receives the Strobe signal. This information is common to all the circuits 2 forming part of the same integrated circuit.
  • An inverted exclusive OR circuit 4 receives the output of a circuit 2 and the signal Inv which is generally the same for the same integrated circuit.
  • the outputs of the reverse exclusive OR circuits 4 are connected to the low voltage / high voltage interface 5.
  • the signal Inv can be permanently connected at the high level or at the low level.
  • the plasma panel provided with a control circuit according to the invention can operate in these two modes.
  • FIG 7 there is shown - schematically a plasma panel 7 surrounded by integrated circuits 8 of its control circuit.
  • the amplifiers associated with the integrated circuits are not shown.
  • Each integrated circuit generally controls 32 electrodes.
  • the integrated circuits controlling one of the networks of electrodes have their pin Inv connected at the low level, that is to say to the ground of the device and the integrated circuits controlling the other network of electrodes have their Inv pin connected at the high level, to a voltage V cc1 .
  • the strobe signal is specific to each integrated circuit.
  • the signals St1y, St2y ... Stny and the St1x, St2x ... Stnx are shown.
  • the data Dx and Dy and the clock signals H x and H y use the same connection for the integrated circuits of the same network.
  • the panel shown in Figure 7 operates in overprint mode.
  • FIG 8 there is shown - schematically a plasma panel 7 surrounded by integrated circuits 8 in the case where it is desired to operate in the image replacement mode by complete lines.
  • the inputs Inv are connected at the high level to V cc1 .
  • the "Strobe" inputs St 1 y, St 2 y ... St n y are specific to each integrated circuit, and the data Dy, the clock signals Hy are sent over a single connection for all the integrated circuits.
  • a small number of signals can be used to control the panel.
  • the data signal D ix for the circuits controlling the columns and the Strobe signal for the circuits controlling the lines.

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Abstract

Le circuit de commande selon l'invention comporte des circuits intégrés (8) qui sont utilisés pour le premier et le second réseaux d'électrodes du panneau. Sur le premier réseau, les circuits intégrés participent à l'élaboration des signaux sélectifs et transmettent la tension de référence des signaux d'entretien ; - Sur le second réseau, les circuits intégrés participent à l'élaboration des signaux sélectifs, transmettent la tension en créneaux des signaux d'entretien et leur tension de référence est flottante, c'est-à-dire qu'elle suit les signaux d'entretien et que; lors de l'élaboration des signaux sélectifs, elle suit le potentiel le plus bas qu'il soit possible d'appliquer aux électrodes. Les circuits intégrés sont munis de circuits logiques qui reçoivent un signal (Inv) indiquant si le circuit intégré (8) est utilisé sur le premier ou sur le second réseaux d'électrodes, de façon à ce que dans le cas d'une utilisation sur le premier réseau, les électrodes actives soient portées au niveau haut par rapport aux électrodes non-actives soient portées au niveau haut par rapport aux électrodes non-actives et dans le cas d'une utilisation sur le second réseau, les électrodes non-actives soient portées au niveau haut par rapport aux électrodes actives.

Description

  • La présente invention concerne un circuit de commande d'un panneau à plasma de type alternatif.
  • Les panneaux à plasma de type alternatif sont bien connus de l'art antérieur.
  • Par les demandes de brevet n° 81.19941 et n° 83.09289, publiées sous les numéros 2.515.402 et 2.547.091, au nom de THOMSON-CSF, on connait des circuits de commande de panneaux à plasma de type alternatif. Ces circuits de commande utilisent des circuits intégrés qui sont différents pour chacun des deux réseaux d'électrodes du panneau. Ainsi sur la figure 1 du premier brevet cité, on a désigné par la référence X les circuits intégrés reliés aux électrodes x, à Xn du panneau et par la référence Y les circuits intégrés reliés aux électrodes y, à yn.
  • De même, on connait, par exemple par l'article de la revue "Electronique et Applications Industrielles" n° 276, du 15 Novembre 1979, pages 26 à 28, qui est intitulé " Les circuits de commande d'afficheurs à panneau à plasma", des circuits intégrés de commande de panneaux à plasma, fabriqués par Texas Instruments. Il s'agit des circuits SN 75500 N et SN 75501 N. Le circuit SN 75500 N est destiné à commander les colonnes du panneau et le circuit SN 75501 N est destiné à commander les lignes du panneau. Il est bien connu des spécialistes que le circuit SN 75501 N peut être utilisé pour commander les lignes et les colonnes. Mais comme ce circuit n'est pas prévu pour cet usage, cela pose des problèmes, de signaux de commande notamment.
  • La présente invention propose un circuit intégré conçu pour fonctionner avec les deux réseaux d'électrodes du panneau, sans complication des commandes, et qui ne présente donc pas les inconvénients du circuit Texas SN 75501 N.
  • La présente invention concerne un circuit de commande d'un panneau à plasma de type alternatif, assurant l'élaboration des signaux d'entretien, et des signaux sélectifs, d'inscription et d'effacement du panneau, ces signaux étant appliqués entre deux électrodes appartenant à un premier et un second réseaux d'électrodes orthogonaux, ce circuit de commande comportant des circuits intégrés munis notamment d'un circuit logique définissant le signal à exécuter, sa durée et les électrodes sur lesquelles ce signal sera actif ;
  • caractérisé en ce que :
    • -les mêmes circuits intégrés sont utilisés pour le premier et le second réseau d'électrodes ;
    • - sur le premier réseau, les circuits intégrés participent à l'élaboration des signaux sélectifs et transmettent la tension de référence des signaux d'entretien
    • -sur le second réseau, les circuits intégrés participent à l'élaboration des signaux sélectifs, transmettent la tension en créneaux des signaux d'entretien et leur tension de référence est flottante, c'est-à-dire qu'elle suit les signaux d'entretien et que, lors de l'élaboration des signaux sélectifs, elle suit le potentiel le plus bas qu'il soit possible d'appliquer aux électrodes ;
    • -les circuits logiques reçoivent un signal indiquant si le circuit intégré est utilisé sur le premier ou sur le second réseaux d'électrodes, de façon à ce que dans le cas d'une utilisation sur le premier réseau, les électrodes actives soient portées au niveau haut par rapport aux électrodes non-actives, et dans le cas d'une utilisation sur le second réseau, les électrodes non-actives soient portées au niveau haut par rapport aux électrodes actives.
  • D'autre objets, caractéristiques et résultats de l'invention ressortiront de la description suivante,. donnée à titre d'exemple non limitatif et illustrée par les figures annexées qui représentent :
    • -les figures 1 à 5, des signaux de commande du panneau ;
    • -la figure 6, le schéma d'un mode de réalisation d'un circuit logique selon l'invention.
    • -les figures 7 à 8, deux modes de réalisation de l'organisation d'un panneau à plasma et des circuits associés.
  • Sur les différentes figures, les mêmes repères désignent les mêmes éléments, mais, pour des raisons de clarté, les cotes et proportions des divers éléments ne sont pas respectées.
  • Sur la figure 1, on a représenté les signaux d'entretien d'inscription et d'effacement qui sont appliqués aux cellules du panneau.
  • - Les panneaux à plasma comportent un grand nombre de cellules disposées sous forme matricielle. Chaque cellule est constituée par l'espace gazeux situé à l'intersection de deux électrodes appartenant aux deux réseaux d'électrodes orthogonaux du panneau. Chaque cellule se trouve soumise à des signaux de commande Vx -Vy, représentés sur la figure 1, et constitués par la différence des tensions Vx et Vyappliquées aux deux électrodes entre lesquelles elle se trouve.
  • En ce qui concerne les signaux d'inscription et d'effacement, sur la figure 1, on a représenté en pointillés les signaux Vx -Vy qu'il faut appliquer pour inscrire ou effacer une cellule et on a représenté par des astérisques les signaux Vx -Vy à appliquer aux cellules qui ne doivent pas être inscrites, ni effacées. Sur les figures 2 à 5, on a également utilisé ces deux modes de représentation pour les signaux sélectifs.
  • Sur les figures 2 et 3, on a représenté les signaux Vx et Vy qui sont appliqués à chacun des réseaux d'électrodes pour obtenir les signaux Vx -Vy de la figure 1.
  • Sur la figure 2, on voit que les signaux Vx participent à l'élaboration des signaux sélectifs d'inscription et d'effacement et transmettent la tension de référence des signaux d'entretien c'est-à-dire du 0 V sur la figure 2.
  • Sur la figure 3, on voit que les signaux Vy participent à l'élaboration des signaux sélectifs d'inscription et d'effacement et transmettent la tension en créneaux des signaux d'entretien.
  • On pourrait intervertir les signaux Vx et Vy.
  • Les signaux d'entretien ne sont pas produits par les circuits intégrés mais par des amplificateurs externes aux circuits intégrés. Les circuits intégrés ne font que transmettre les signaux d'entretien.
  • Dans le cas des signaux Vx et Vy qui sont représentés sur les figures 2 et 3, on constate que les circuits intégrés associés à l'un des réseaux d'électrodes, ce sont les électrodes en y, transmettent la totalité des signaux d'entretien alors que les circuits intégrés associés à l'autre réseau d'électrodes, ce sont les électrodes en x, transmettent uniquement la tension de référence des signaux d'entretien.
  • Les circuits intégrés selon l'invention sont réalisés de façon à pouvoir supporter une tension de 100 Volts. On est donc conduit pour obtenir le signal Vy qui évolue entre -100 V et + 100 V à utiliser une tension de référence flottante V, f qui suit les signaux d'entretien qui évoluent également entre -100 V et + 100 V.
  • Cette tension de référence flottante V, est représentée sur la figure 4. On constate, par rapport à la tension Vy de la figure 3, que Vr . f suit les signaux d'entretien et que lors de l'élaboration des signaux sélectifs, la tension V r f suit le potentiel le plus bas qu'il soit possible d'appliquer aux électrodes.
  • Sur la figure 5, on a représenté là tension Vy - Vr fqui évolue entre 0 et 100 V.
  • La comparaison des figures 2 et 5 montre que
    • -pour le signal Vx, les électrodes actives, c'est-à-dire qui doivent être inscrites ou effacées, sont portées à +100 V au-dessus du niveau des électrodes qui ne sont pas modifiées ;
    • -alors que pour le signal (Vy - V, t), ce sont les électrodes non modifiées qui sont portées à + 100 V au-dessus des électrodes actives.
  • Dans les deux brevets THOMSON-CSF cités, le circuit de commande d'un panneau plasma comporte des circuits intégrés associés à des amplificateurs pour l'élaboration des signaux d'entretien et chaque circuit intégré comporte notamment un circuit logique définissant le signal à exécuter, sa durée et les électrodes sur lesquelles ce signal sera actif.
  • Sur les figures 2 et 3 du brevet THOMSON-CSF 2.515.402 on a représenté la structure générale des circuits intégrés utilisés.
  • Sur la figure 2 du brevet français 2.547.091, on a représenté la structure d'un circuit logique faisant partie d'un circuit intégré.
  • Chaque circuit logique se compose essentiellement de registres à décalages à entrée série et sorties parallèles et d'un système de décodage et de validation. De ce fait, les données ou adresses logiques désignant les électrodes actives et non-actives sont entrées en série dans les registres à décalages et se retrouvent en parallèle sur les sorties des registres qui correspondent respectivement aux électrodes du panneau à plasma. Un ordre définissant le signal d'inscription ou d'effacement à appliquer aux électrodes actives valide alors les sorties parallèles des registres vers un circuit d'interface basse tension/haute tension.
  • Selon l'invention, on prévoit d'appliquer à chaque circuit logique un signal indiquant sur quel réseau d'électrodes est utilisé le circuit intégré dont il fait partie, de façon à ce que :
    • -dans le cas d'une utilisation sur l'un des réseaux, les électrodes actives soient portées au niveau haut par rapport aux électrodes non-actives ;
    • -dans le cas d'une utilisation sur l'autre réseau, les électrodes non-actives soient portées au niveau haut par rapport aux électrodes actives.
  • Selon l'invention, on réalise des circuits logiques qui satisfont à la table logique suivante :
    Figure imgb0001
  • Le signal "Strobe" est une entrée du circuit logique qui par convention lorsqu'elle est à "1 indique qu'un circuit intégré n'est pas sélectionné et lorsqu'elle est à "0" indique qu'un circuit intégré est sélectionné.
  • Le signal "Inv" est le signal dont il a été question précédemment qui, par convention, lorsqu'il est à "0" indique qu'un circuit intégré est utilisé sur l'un des réseaux d'électrodes, les électrodes en x qui reçoivent Vx dans notre exemple et qui lorsqu'il est à "1 indique qu'un circuit intégré est utilisé sur l'autre réseau d'électrodes, les électrodes en y qui reçoivent Vy dans notre exemple.
  • Un bit du registre à décalage est, par convention, à l'état 1 si l'on désire activer une électrode et à l'état 0 si l'on ne désire pas activer une électrode.
  • Sur la figure 6, on a représenté un exemple de réalisation d'un circuit logique selon l'invention.
  • On a désigné par la référence 1 le registre à décalage à entrée série des données D et à sorties parallèles. Ce registre reçoit un signal d'horloge H. L'acquisition des données dans le registre et l'application d'un ordre aux électrodes du panneau sont dissociés dans le temps. Les données D sont entrées en série dans le registre au rythme de l'horloge d'acquisition des données H. Un bit du registre est réservé à chaque électrode commandée.
  • Ce circuit logique comporte de façon classique un circuit de décodage et de validation 6 qui, pendant la durée du signal à exécuter, valide ou non les sorties qui vont vers l'interface basse tension/haute tension, BT/HT, référence 5 ; cet interface permet d'appliquer directement aux électrodes des signaux d'amplitude 100 V.
  • L'accès au panneau se fait donc par segments de points en lignes et en colonnes. Chaque point de ces segments est défini comme actif ou non. par un bit d'un registre à décalage.
  • Dans le mode de réalisation de la figure 6, le système de décodage et de validation 6 comporte des circuits ET inversés 2. Chaque circuit 2 est relié à l'une des sorties du registre 1 et à la sortie' d'un inverseur 3 qui reçoit le signal Strobe. Cette information est commune à tous les circuits 2 faisant partie du même circuit intégré. Un circuit OU exclusif inversé 4 reçoit la sortie d'un circuit 2 et le signal Inv qui est généralement le même pour un même circuit intégré.
  • Les sorties des circuits OU exclusif inversé 4 sont reliés à l'interface basse tension/haute tension 5.
  • Selon que le circuit intégré est destiné à produire un signal Vx ou Vy, on peut relier en permanence le signal Inv au niveau haut ou au niveau bas.
  • Il est aussi possible si l'on ne désire pas utiliser une broche de chaque circuit intégré pour rentrer l'information Inv de réaliser deux types de. circuits intégrés, pour l'un des types l'entrée Inv sera connectée de façon interne au niveau haut et pour l'autre type, la broche Inv sera connectée de façon interne au niveau bas. Lors de la réalisation des circuits intégrés; c'est seulement lors de la réalisation du dernier niveau de masques, qui est le niveau d'interconnexions, qu'existera une différence.
  • Il est également possible de rentrer le signal Inv en série avec les données D. Il faut alors une mémoire pour maintenir ce signal sur l'entrée des circuits 2.
  • On peut bien sûr envisager diverses variantes du schéma de la figure 6 qui satisfont à la table logique établie précédemment.
  • Dans le brevet 2.547.091 déjà cité, il est expliqué comment faire fonctionner un panneau à plasma en mode surimpression ou/et en mode remplacement.
  • Le panneau à plasma muni d'un circuit de commande selon l'invention peut fonctionner selon ces deux modes.
  • Sur la figure 7, on a représenté de façon - schématique un panneau à plasma 7 entouré des circuits intégrés 8 de son circuit de commande. Les amplificateurs associés -aux circuits intégrés ne sont pas représentés.
  • Chaque circuit intégré permet de commander généralement 32 électrodes.
  • Sur la figure 7, les circuits intégrés commandant l'un des réseaux d'électrodes ont leur broche Inv reliée au niveau bas, c'est-à-dire à la masse du dispositif et les circuits intégrés commandant l'autre réseau d'électrodes ont leur broche Inv reliée au niveau haut, à une tension Vcc1.
  • Le signal "strobe" est propre à chaque circuit intégré. Sur la figure 7, on a représenté les signaux St1y, St2y... Stny et les St1x, St2x...Stnx.
  • Les données Dx et Dy et les signaux d'horloge Hx et H yutilisent une même connexion pour les circuits intégrés d'un même réseau.
  • Le panneau représenté sur la figure 7 fonctionne en mode surimpression.
  • Sur la figure 8, on a représenté de façon - schématique un panneau à plasma 7 entouré de circuits intégrés 8 dans le cas où l'on désire fonctionner dans le mode remplacement d'images par lignes complètes.
  • En ce qui concerne les circuits intégrés disposés verticalement qui commandent les lignes du panneau, on retrouve les mêmes connexions que dans le cas de la figure 7. Les entrées Inv sont reliées au niveau haut à Vcc1. Les entrées "Strobe" St1y , St2y...Stny sont propres à chaque circuit intégré, et les données Dy, les signaux d'horloge Hy sont envoyées sur une seule connexion pour tous les circuits intégrés.
  • En ce qui concerne les circuits intégrés disposés horizontalement qui commandent les colonnes du panneau, on constate les modifications suivantes :
    • -le signal Inv n'est pas en permanence au niveau haut ou au niveau bas. Le signal Inv est un signal logique commandé ;
    • -chaque circuit intégré reçoit séparément ses données Dlx, D2x...Dnx, par contre le signal d'horloge H x reste commun aux circuits intégrés reliés à un même réseau d'électrodes ;
    • -les broches Strobe de tous les circuits intégrés reçoivent le même signal Stx.
  • Pour effectuer un remplacement d'image comme cela a été expliqué dans le brevet 2.547.091 déjà cité, on procède de la façon suivante :
    • -on' charge les registres à décalages des circuits intégrés commandant les colonnes avec la nouvelle image à afficher ;
    • -simultanément ou non, on charge le registre d'un circuit commandant les lignes avec l'adresse d'une ligne ;
    • . -on efface les points complémentaires des points à inscrire en appliquant un signal Inv au niveau haut aux circuits commandant les colonnes en même temps qu'on applique un signal Strobe à 0 ;
    • -on rend simultanément active la ligne sélectionnée en mettant le signal Strobe à 0 ;
    • -immédiatement après, on inscrit la nouvelle image en mettant à 0 les signaux Inv et Strobe des circuits commandant les colonnes en même temps que la ligne sélectionnée est activée.
  • On réalise ainsi de façon simple un remplacement d'image de. tous les points d'une ligne du panneau.
  • Ceci est particulièrement intéressant pour réaliser une gestion de l'image de type vidéo.
  • Un petit nombre de signaux permet de réaliser la commande du panneau.
  • Un seul signal individuel est nécessaire par circuit intégré : le signal données Dix pour les circuit commandant les colonnes et le signal Strobe pour les circuits commandant les lignes.
  • Comme cela avait été exposé dans le. brevet cité, on peut réaliser ainsi des effacements et des inscriptions rapprochées.

Claims (6)

1. Circuit de commande d'un panneau à plasma de type alternatif, assurant l'élaboration des signaux d'entretien, et des signaux sélectifs, d'inscription et d'effacement du panneau, ces signaux étant appliqués entre deux électrodes appartenant à un premier et un second réseaux d'électrodes orthogonaux, ce circuit de commande comportant des circuits intégrés munis notamment d'un circuit logique définissant le signal à exécuter, sa durée et les électrodes sur lesquelles ce signal sera actif ; caractérisé en ce que :
-les mêmes circuits intégrés (8) sont utilisés pour le premier et le second réseaux d'électrodes ;
-sur le premier réseau, les circuits intégrés participent à l'élaboration des signaux sélectifs et transmettent la tension de référence (O V) des signaux d'entretien ;
-sur le second réseau, les circuits intégrés, participent à l'élaboration des signaux sélectifs, transmettent la tension en créneaux des signaux d'entretien et leur tension de référence est flottante, c'est-à-dire qu'elle suit les signaux d'entretien et que, lors de l'élaboration des signaux sélectifs, elle suit le potentiel de plus bas qu'il soit possible d'appliquer aux électrodes ;
-les circuits logiques (6) reçoivent une signal (Inv) indiquant si le circuit intégré (8) est utilisé sur le premier ou sur le second réseaux d'électrodes, de façon à ce que dans le cas d'une utilisation sur le premier réseau, les électrodes actives soient portées au niveau haut par rapport aux électrodes non-actives et dans le cas d'une utilisation sur le second réseau, les électrodes non-actives soient portées au niveau haut par rapport aux électrodes actives.
2. Circuit selon là revendication 1, caractérisé en ce que le niveau haut égale + 100 Volts.
3. Circuit selon l'une des revendications 1 ou 2, caractérisé en ce que les circuits logiques (6) satisfont à la table logique suivante où :
-le signal "Strobe" est une entrée du circuit logique qui par convention lorsqu'elle est à "1 indique que le circuit intégré n'est pas sélectionné et lorsqu'elle est à "0" indique que le circuit intégré est sélectionné ;
-le signal "Inv" est le signal reçu par le circuit logique qui par convention à "0" indique que le circuit intégré est utilisé sur le premier réseau d'électrodes et à "1 " indique que le circuit intégré est utilisé sur le secbnd réseau d'électrodes ;
-un bit du registre à décalages (1) faisant partie du circuit logique est, par convention, à l'état 1 si l'on désire activer une électrode et à l'état 0 si l'on ne désire pas activer une électrode.
Figure imgb0002
4. Circuit selon l'une des revendications 1 à 3, caractérisé en ce qu'il comporte deux types de circuits intégrés dans lesquels ledit signal (Inv) appliqué aux circuits logiques est appliqué de façon interne.
5. Circuit selon l'une des revendications 1 à 3, caractérisé en ce que ledit signal (Inv) est appliqué aux circuits logiques, multiplexé avec les données qui sont entrées dans le registre.
6. Circuit selon l'une des revendications 3 à 5, caractérisé en ce que chaque circuit logique comporte un circuit de décodage et de validation (6) avec :
-un circuit ET inversé (2), relié à l'une des sorties du registre et à la sortie d'un inverseur (3) qui reçoit le signal Strobe ;
-un circuit OU exclusif inversé (4) qui reçoit la sortie d'un circuit ET inversé (2) et le signal Inv.
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