DE4026326A1 - Integriertes halbleiterschaltungsplaettchen - Google Patents
Integriertes halbleiterschaltungsplaettchenInfo
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Description
Die Erfindung betrifft ein integriertes Halbleiterschal
tungsplättchen oder IC-Chip, das insbesondere eine Identifi
zierungsschaltung enthält, um Halbleiterplättchen oder Chips
über eine Prüfung zu sortieren oder zu klassifizieren.
In der jüngsten Zeit sind in steigendem Maße elektroni
sche Systematisierungen auf dem Gebiet der Entwicklung der
Halbleitertechnik vorgenommen worden. Folglich ist eine
geeignete Kennzeichnung der elektronischen Systeme erforder
lich, um den Gegebenheiten des jeweiligen Gebietes der
Halbleitertechnik zu genügen. Aus diesem Grunde haben sich
die Halbleiterhersteller bemüht, ihre Produkte zu diversifi
zieren, um den verschiedenen Erfordernissen der Benutzer zu
genügen. Es wurden beispielsweise verschiedene Betriebsarten
zusätzlich zu der Grundbetriebsart in Verbindung mit der
Erhöhung der Speicherkapazität von dynamischen Speichern mit
direktem Zugriff DRAM auf M Bit-Größenordnung entwickelt. Das
heißt, daß bei 1 M Bit oder 4 M Bit DRAM-Speichern die
Betriebsarten in 1 Bit, 4 Bit, 8 Bit usw. entsprechend der
Anzahl an Ausgangsdaten und in den Betrieb der schnellen
schrittweisen Ausgabe von Daten, den Halbbytebetrieb, den
statischen Spaltenbetrieb usw. je nach Eingangssteuersignal
unterteilt sind. Um den Anwendererfordernissen zu genügen,
liefern die Hersteller von DRAM-Speichern verschiedene DRAM-
Speicher zur Ausführung der verschiedenen Betriebsarten je
nach Wahl, indem wunschgemäß bestimmte Betriebsarten neben
der Grundbetriebsart eines DRAM-Speichers während seiner
Herstellung vorgesehen oder eingerichtet werden. Beispiels
weise wird als Grundbetriebsart in einer einzigen DRAM-
Herstellungsstraße die schnelle schrittweise Datenübergabe
gewählt und wird ein DRAM-Speicher mit Halbbytebetrieb oder
statischem Spaltenbetrieb dadurch erzeugt, daß je nach Wunsch
die entsprechende Betriebsart während der Herstellungsschrit
te jeweils vorgesehen wird.
Diese Ausbildung je nach Wunsch erfolgt Halbleiterwafer
um Halbleiterwafer und die hergestellten DRAM-Speicher werden
auf die jeweiligen Betriebsarten aufgeteilt. Nach der
Herstellung der DRAM-Speicher wird während der Baugruppenbil
dung das Wafer in einzelne Plättchen durch Ritzen oder
Anreißen vereinzelt, werden die einzelnen Plättchen über
einen Montagevorgang in einen speziellen Baustein einge
bracht, erfolgt eine Drahtkontaktierung und -formung, d. h.
Verdrahtung und wird der DRAM-Baustein als Endprodukt nach
einer Kennzeichnung der Daten des Produktes, beispielsweise
der Seriennummer, des Herstellungsdatums und der Herstel
lungsstraße der Prüfung des Produktes unterworfen.
Wenn DRAM-Speicher nach dem obigen Verfahren hergestellt
werden, werden die nach den Betriebsarten unterteilten
Plättchen jedoch oftmals mit anderen Arten von Plättchen
vermischt, wenn die Plättchen in einer einzigen Produktions
straße hergestellt werden. In diesem Fall werden Produkte mit
verschiedenen Betriebsarten als fehlerhafte Plättchen während
der anschließenden Prüfung beurteilt und als Gegenstände
geringerer Qualität behandelt, was die Ausbeute, d. h. die
Produktivität herabsetzt.
Es ist eine außerordentlich hohe Sorgfalt erforderlich,
um eine Mischung von Plättchen der gleichen Art mit Plättchen
einer anderen Art zu verhindern, was den Arbeitswirkungsgrad
herabsetzt.
Es wird daher ein Verfahren benötigt, mit dem es möglich
ist, plättchen der gleichen Art während der Prüfung zu
identifizieren, wenn Plättchen mit verschiedenen Betriebsar
ten vor dem Einbau in den Baustein miteinander vermischt
sind.
Ein entsprechendes Identifizierungsverfahren für
Halbleiterplättchen ist in den US-PS 41 50 331 und 45 10 673
beschrieben. Gemäß US-PS 41 50 331 wird jedes Plättchen unter
Verwendung einer programmierbaren Schaltungseinrichtung auf
der Plättchenoberfläche identifiziert oder gekennzeichnet.
Die Schaltungseinrichtung dient dazu, einen Identifizierungs
und Kennzeichnungscode während eines zusätzlichen Tests je
nach dem zu programmieren, ob eine Diode zwischen einem
Diagnosestift oder -anschluß und einem gewählten Eingangs/Aus
gangsstift oder -anschluß ausgebildet ist oder nicht.
Dieses Verfahren hat jedoch den Nachteil, daß die
Bausteingröße aufgrund des zusätzlich vorgesehenen Test- oder
Diagnosestiftes zunimmt, was einen erheblichen Einfluß auf
die Kosten des Halbleiterplättchens hat.
In der US 41 50 673 ist ein Verfahren beschrieben, bei
dem eine bestimmte Identifizierungsmarkierung auf der
Rückfläche des Halbleiterplättchens unter Verwendung einer
Laservorrichtung vorgesehen wird und von Hand aus oder
maschinell die Identifizierungsmarkierung unter Verwendung
einer Laservorrichtung oder einer optischen Vorrichtung
unterschieden werden kann. Dieses Verfahren hat den Nachteil,
daß eine mit hohen Kosten verbundene Laservorrichtung zum
Anbringen der speziellen Identifizierungsmarkierung bei
spielsweise bezüglich der Herstellungsstraße, des Herstel
lungsdatums usw. vorgesehen sein muß.
Durch die Erfindung soll daher ein integriertes
Halbleiterschaltungsplättchen mit einer Identifizierungs
schaltung geschaffen werden, bei dem zusätzliche Prüfungen
sowie ein zusatzlicher Diagnosestift oder -anschluß nicht
benötigt werden und die oben erwähnten Schwierigkeiten bei
den bekannten Verfahren beseitigt sind.
Das erfindungsgemäße integrierte Halbleiterschal
tungsplättchen mit einer Identifizierungsschaltung soll
weiterhin einen einfachen Aufbau haben und die Identifizie
rung des Halbleiterplättchens erleichtern.
Dazu umfaßt das erfindungsgemäße integrierte Halbleiter
schaltungsplättchen zwei Spannungsversorgungsanschlüsse und
mehrere Eingangsanschlüsse sowie eine Identifizierungsschal
tungseinrichtung, die zwischen einen der Spannungsversor
gungsanschlüsse und einen Eingangsanschluß geschaltet ist,
wobei die Identifizierungsschaltungseinrichtung einen Span
nungsbegrenzer mit einem bestimmten Grenzspannungspegel zum
Begrenzen des Eingangspotentialunterschiedes zwischen einem
Spannungsversorgungsanschluß und einem der Eingangsanschlüsse
und eine Optionseinrichtung umfaßt, die in Reihe zum
Spannungsbegrenzer geschaltet ist und die Identifizierungsin
formation des Plättchen danach ermittelt, ob ein Stromweg
während des Herstellungsvorganges des Plättchens gebildet ist
oder nicht.
Durch die Erfindung wird weiterhin ein integriertes
Halbleiterschaltungsplättchen mit zwei Spannungsversorgungs
anschlüssen und wenigstens drei Eingangsanschlüssen sowie
einer Identifizierungsschaltungseinrichtung geschaffen, die
mit einem der Spannungsversorungsanschlüsse und mit drei der
wenigstens drei Eingangsanschlüsse verbunden ist, bei dem
die Identifizierungsschaltungseinrichtung einen Spannungsbe
grenzer mit einem bestimmten Grenzspannungspegel zum
Begrenzen des Eingangspotentialunterschiedes zwischen dem
Spannungsversorgungsanschluß und einem der drei Eingangsan
schlüsse und zum anschließenden Erzeugen einer bestimmten
Steuerspannung durch Teilen des Grenzspannungspegels, eine
Optionseinrichtung, die zwischen die restlichen beiden
Eingangsanschlüsse der drei Eingangsanschlüsse geschaltet
ist, um die Identifizierungsinformation des Plättchens
darüber zu ermitteln, ob während des Herstellungsvorganges
des Plättchens ein Stromweg gebildet ist oder nicht, und eine
Schaltereinrichtung umfaßt, die in Reihe zur Optionseinrich
tung geschaltet ist und durch die Steuerspannung vom
Spannungsbegrenzer angeschaltet wird.
Bei einer derartigen Ausbildung kann eine Identifizie
rungsschaltung des Plättchens ohne zusätzlichen Anschluß
stift, wie beispielsweise einen Test- und Diagnosestift
vorgesehen werden.
Im folgenden werden anhand der zugehörigen Zeichnung
besonders bevorzugte Ausführungsbeispiele der Erfindung näher
beschrieben. Es zeigen
Fig. 1 eine vereinfachte Darstellung eines Ausführungs
beispiels des erfindungsgemäßen integrierten Halbleiterschal
tungsplättchens mit einer Identifizierungsschaltung,
Fig. 2 ein weiteres Ausführungsbeispiel des erfindungs
gemäßen integrierten Halbleiterschaltungsplättchens mit einer
Identifizierungsschaltung,
Fig. 3 das Schaltbild einer Abwandlungsform der
Optionseinrichtung in Fig. 1 und 2 und
Fig. 4 in einer vereinfachten Form noch ein Ausführungs
beispiel des erfindungsgemäßen integrierten Halbleiterschal
tungsplättchens mit einer Identifizierungsschaltung.
Fig. 1 zeigt schematisch ein Ausführungsbeispiel des
erfindungsgemäßen integrierten Halbleiterschaltungsplättchens
mit einer Identifizierungsschaltung. Wie es in Fig. 1
dargestellt ist, schließt das integrierte Schaltungsplättchen
1 eine interne Schaltung 10, Eingangsschutzschaltungen PC1
bis PCn, Ausgangspufferschaltungen B1 bis Bn, Eingangsan
schlüsse IN1 bis INn, Ausgangsanschlüsse OUT1 bis OUTn und
zwei Versorgungsanschlüsse Vdd und Vss ein. Das integrierte
Schaltungsplättchen oder IC-Chip ist mit einer nicht dar
gestellten Energiequelle verbunden, so daß über den Span
nungsversorgungsanschluß Vdd eine Versorgungsspannung von
beispielsweise 5 V anliegt, während der Spannungsversor
gungsanschluß Vss an Masse liegt. Die interne Schaltung 10
empfängt die Betriebsspannung von den Spannungsversor
gungsanschlüssen Vdd und Vss, führt eine gegebene Funktion
aus, wenn sie Eingangssignale an den Eingangsanschlüssen IN1
bis IN3 empfängt, und erzeugt bestimmte Ausgangssignale an
den Ausgangsanschlüssen OUT1 bis OUTn. Die Eingangsanschlüsse
IN1 bis INn sind mit der internen Schaltung 10 über die
jeweiligen Eingangsschutzschaltungen PC1 bis PCn verbunden,
die einen Ausfall der internen Schaltung 10 aufgrund einer
Störspannung, beispielsweise eines Spannungsstoßes oder einer
ähnlichen Spannung an den Eingangsanschlüssen verhindern.
Die Ausgangsanschlüsse OUT1 bis OUTn sind über die
Ausgangspufferschaltungen B1 bis Bn jeweils mit der internen
Schaltung 10 verbunden.
Eine Identifizierungsschaltung 20 ist mit ihrem in der
erfindungsgemäßen Weise ausgebildeten Teil zwischen einen
Anschluß IN1 der Eingangsanschlüsse und den Spannungsversor
gungsanschluß Vss des IC-Chips 1 geschaltet. Diese Identifi
zierungsschaltung umfaßt einen Spannungsbegrenzer 22 und eine
Optionseinrichtung 24. Der Spannungsbegrenzer 22 dient dazu,
den Pegel eines Eingangssignals, das zwischen dem Eingang IN1
und dem Spannungsversorgungsanschluß Vss liegt, auf einen
bestimmten logischen Pegel zu begrenzen, der dann an der
internen Schaltung 10 liegt. Dieser Spannungsbegrenzer 22
besteht aus mehreren in Reihe geschalteten MOS-Transistoren
M1 bis Mn, deren Gates jeweils mit ihren Drains verbunden
sind. Der Spannungsbegrenzer 22 kann den bestimmten logischen
Pegel über die Summe der Schwellenspannungen aller MOS-
Transistoren festlegen.
Der bestimmte logische Pegel wird beispielsweise auf
mehr als etwa 2,5 V bei einem TTL-Pegel am Eingangsanschluß
und auf mehr als annähernd +3 V festgelegt, wenn ein CMOS-
Pegel am Eingangsanschluß liegt.
Obwohl bei dem vorliegenden Ausführungsbeispiel die
Diodenschaltung der MOS-Transistoren verwandt wird, kann als
Spannungsbegrenzer jede einseitige Stromflußeinrichtung mit
einer bestimmten Schwellenspannung, beispielsweise eine Diode
mit PN-Übergang, eine Z-Diode oder ein ähnliches Bauteil
verwandt werden.
Die Optionseinrichtung 24 ist dazu vorgesehen, einen
Stromweg durch den Spannungsbegrenzer 22 während des
Herstellungsvorganges zu bilden, und ist in Reihe zum
Spannungsbegrenzer 22 geschaltet. Die Optionseinrichtung 24
wird über einen einfachen zusätzlichen Arbeitsvorgang
vorgesehen, bei dem die Verbindung oder Trennung, d. h. die
Leitung oder die Nichtleitung einer Sicherung oder eines
Metalldrahtes, die oder der während des Herstellungsvorganges
ausgebildet wird, die Art des Plättchens bestimmt. Bei dem
vorliegenden Ausführungsbeispiel wird nach der Bildung der
Sicherung die Identifizierungsinformation der Plättchen über
einen Optionsarbeitsvorgang eingeschrieben, bei dem die
Sicherung durch ein Laserdurchtrennen zum Durchschmelzen
gebracht wird.
Während des Herstellungsvorganges des Plättchens wird
beispielsweise die Sicherung FU in einem Plättchen für einen
DRAM-Speicher mit schneller schrittweiser Datenübergabe
leitend gehalten, während für einen DRAM-Speicher mit
Halbbytebetrieb die Sicherung FU durchgeschmolzen wird,
wodurch eine Identifizierung der Plättchen möglich wird.
Während der Prüfung beim Plättchenherstellungsvorgang für die
in der oben beschriebenen Weise identifizierten Plättchen
wird der Eingangsanschluß IN1 mit einer Quelle 2 einer
bestimmten Hochspannung, beispielsweise einer Spannungsquelle
mit einer Spannung von annähernd 15 V, verbunden und wird der
Spannungsversorgungsanschluß Vss mit einem Amperemeter 3
verbunden, so daß es dann möglich ist, die Betriebsart des
DRAM-Speichers zu unterscheiden. Wenn ein Strom fließt, dann
wird die Probe als ein DRAM-Speicher für die schnelle
schrittweise Datenübertragung identifiziert, während dann,
wenn kein Strom fließt, die Probe als ein DRAM-Speicher für
den Halbbytebetrieb identifiziert wird, indem der Stromfluß
mittels des Amperemeters 3 überprüft wird.
Beim Halbbytebetrieb ist die Sicherung durchgeschmolzen,
so daß das Eingangssignal auf die interne Schaltung 10
unabhängig vom Vorhandensein der Identifizierungsschaltung 20
während der normalen Arbeit des Plättchens übertragen wird.
Bei einem Betrieb mit einer schnellen schrittweisen Daten
Übergabe hätte jedoch der Eingangsanschluß IN1 immer den
logischen Zustand "0" und zwar über die Sicherung FU, falls
der Spannungsbegrenzer 22 nicht vorhanden wäre. Das kann
durch den Spannungsbegrenzer 22 verhindert werden. Wenn somit
der logische Wert "0" am Eingangsanschluß IN1 liegt, dann
liegt unabhängig von der Schaltung der Identifizierungsschal
tung 20 der logische Wert "0" an der internen Schaltung 10.
Wenn jedoch der logische Wert "1" am Eingangsanschluß IN1
liegt, dann fließt ein Strom durch die Identifizierungsschal
tung 20, so daß ein bestimmter Spannungsunterschied im
Spannungsbegrenzer 22 erzeugt wird, der bewirkt, daß an der
internen Schaltung 10 der logische Wert "1" liegt.
Die Identifizierungsschaltung 20 ist vorzugsweise mit
dem Eingangsanschluß IN1 über die Eingangsschutzschaltung PC1
verbunden, die die Identifizierungsschaltung gegenüber einer
Beschädigung aufgrund eines äußeren Spannungsstoßes oder
einer ähnlichen hohen Spannung schützt.
Fig. 2 zeigt ein weiteres Ausführungsbeispiel des
erfindungsgemäßen integrierten Halbleiterschaltungsplättchen
mit einem Schaltungsaufbau, der mit der Ausnahme gleich dem
des ersten Ausführungsbeispiels ist, daß die Identifizie
rungsschaltung 20 zwischen den Spannungsversorgungsanschluß
Vdd und den Eingangsanschluß IN1 geschaltet ist. Da während
der Identifizierungsprüfung die am Eingangsanschluß liegende
Spannung von +15 V über der Spannung von +5 V liegt, die von
dem Spannungsversorgungsanschluß Vdd kommt, ist das Grundar
beitsprinzip des Plättchens das gleiche wie beim ersten
Ausführungsbeispiel.
Fig. 3 zeigt eine Abwandlungsform der Optionseinrichtung
24 zum Identifizieren von zwei oder mehr Arten von Plättchen.
Wie es in Fig. 3 dargestellt ist, umfaßt die Optionseinrich
tung 24 mehrere MOS-Transistoren MA1 bis MAn, deren Gates mit
ihren Drains verbunden sind, sowie mehrere Sicherungen FU1
bis FUn, die jeweils mit den entsprechenden MOS-Transistoren
verbunden sind. Jede Kombination aus einem MOS-Transistor und
einer Sicherung ist parallel zueinander zwischen den
Spannungsbegrenzer 22 und den Spannungsversorgungsanschluß
Vss oder Vdd geschaltet.
Um die Plättchen durch die Schaltung mit dem oben
beschriebenen Aufbau zu identifizieren, kann eine Identifi
zierungsinformation durch die Werte der Ströme gegeben
werden, die durch die Optionseinrichtung fließen, wie es in
der folgenden Tabelle 1 zusammengefaßt ist.
Fig. 4 zeigt eine Abwandlungsform der Identifizierungs
schaltung zum Identifizieren von zwei oder mehr Arten von
plättchen. In Fig. 4 ist die Identifizierungseinrichtung 30
mit dem Versorgungsanschluß Vss und drei Eingangsanschlüssen
IN1 bis IN3 verbunden. Die Identifizierungseinrichtung 30
umfaßt einen Spannungsbegrenzer 32, eine Optionseinrichtung
34 und eine Schaltereinrichtung 36.
Der Spannungsbegrenzer 32 ist so aufgebaut, daß er den
Eingangsspannungsunterschied zwischen dem Eingangsanschluß
IN3 und dem Versorgungsanschluß Vss auf den logischen Pegel
begrenzt, der von der internen Schaltung 10 empfangen wird,
und anschließend den gegebenen logischen Pegel teilt, um eine
bestimmte Steuerspannung VR zu erzeugen. Der Spannungsbegren
zer 32 umfaßt mehrere MOS-Transistoren MB1 bis MBn, deren
Gates mit ihren Drains verbunden sind, sowie einen Widerstand
R, der mit den MOS-Transistoren verbunden ist, wobei die MOS-
Transistoren und der Widerstand zwischen den Eingangsanschluß
IN3 und den Versorgungsanschluß Vss geschaltet sind. Der
Spannungsunterschied zwischen den beiden Anschlüssen des
Widerstandes R liegt an der Schaltereinrichtung 36 als
Steuerspannung VR. Die Schaltereinrichtung 36 ist in Reihe
zur Optionseinrichtung zwischen die Eingangsanschlüsse IN1
und IN2 geschaltet, um den Stromfluß zu schalten, d. h. den
Stromfluß über die Steuerspannung VR des Spannungsbegrenzers
32 anzuschalten. Die Schaltereinrichtung 36 besteht aus
mehreren MOS-Transistoren MC1 bis MCn, wobei die Drains aller
Transistoren mit dem Eingangsanschluß IN1 verbunden sind, an
ihren Gates die Steuerspannung VR liegt und ihre Sourcen mit
den entsprechenden Sicherungen der Optionseinrichtung 34
verbunden sind, die im folgenden beschrieben wird.
Bei dem vorliegenden Ausführungsbeispiel besteht die
Optionseinrichtung 34 aus mehreren Sicherungen FUA1 bis FUAn,
von denen jede mit dem entsprechenden MOS-Transistor der
Schaltereinrichtung 36 verbunden ist. Jede Kombination aus
einem MOS-Transistor und einer Sicherung ist parallel
zueinander zwischen die Eingangsanschlüsse IN1 und IN2
geschaltet. Das Durchschmelzen der jeweiligen Sicherungen der
Optionseinrichtung erfolgt während des Herstellungsvorganges
des Plättchens, um die erforderliche Identifizierungs
information vorzusehen.
Um die mit dem obigen Ausführungsbeispiel der Identifi
zierungsschaltung versehenen Plättchen zu identifizieren,
wird der Eingangsanschluß IN1 mit einer Energiequelle V einer
bestimmten Spannung von beispielsweise 5 V verbunden, wird der
Eingangsanschluß IN2 mit einem Amperemeter A verbunden und
wird eine Energiequelle mit höherer Spannung von beispiels
weise 15 V zwischen den Eingangsanschluß IN3 und den Versor
gungsanschluß Vss geschaltet. Auf das Anschalten der
Spannungsquellen fließt ein Strom durch den Spannungsbegren
zer 32 und ergibt sich eine Spannungsverteilung im Widerstand
R, so daß eine Steuerspannung VR erzeugt wird, die an der
Schaltereinrichtung 36 liegt. Infolge dieser Steuerspannung
VR schalten die jeweiligen MOS-Transistoren MC1 und MCn der
Schaltereinrichtung 36 durch. Der Stromfluß zwischen den
Eingangsanschlüssen IN1 und IN2 wird dann am Amperemeter A
angezeigt. Dabei werden die folgenden Stromwerte je nachdem
erhalten, ob die Sicherungen FUA1 bis FUAn durchgeschmolzen
sind oder nicht.
Aus der Tabelle 2 ist ersichtlich, daß in die Plättchen
eine Identifizierungsinformation eingeschrieben werden kann,
die vier verschiedene Arten von Plättchen identifizieren
kann.
Wenn sich das Plättchen nicht in der Identifizierungs
prüfung befindet, dann liegt die Massespannung an den Gates
der jeweiligen MOS-Transistoren MC1 bis MCn der Schalterein
richtung 36 und zwar über den Widerstand R, was den normalen
Betrieb des Plättchens sicherstellt.
Wie es oben beschrieben wurde, wird gemäß der Erfindung
die Plättchenidentifizierungsinformation dadurch eingeschrie
ben, daß je nach Wunsch ein einfacher Schaltkreis während des
Waferherstellungsvorgange geschlossen oder geöffnet wird,
wobei die eingeschriebene Identifizierungsinformation bei
einer Prüfung während der üblichen Montage des Plättchens
erfaßt werden kann, so daß Plättchen gleicher Art ermittelt
und separat in den anschließenden Arbeitsvorgängen behandelt
werden können.
Bei dem erfindungsgemäßen Plättchen erfolgt die
Identifizierungsprüfung über bestehende Eingangs- und
Ausgangsanschlüsse und bestehende Versorgungsanschlüsse im
Gegensatz zu dem herkömmlichen Verfahren, so daß die
herkömmliche Art der Herstellung unverändert vollständig
beibehalten werden kann, was außerordentlich wirtschaftlich
und daher wünschenswert ist.
Das erfindungsgemäße Plättchen benötigt weiter keinen
zusätzlichen Prüf- oder Diagnoseanschlußstift oder eine mit
hohen Kosten verbundene Laseranlage oder ähnliches zum
Identifizieren des Plättchens.
Claims (8)
1. Integriertes Halbleiterschaltungsplättchen mit zwei
Spannungsversorgungsanschlüssen und mehreren Eingangsan
schlüssen sowie einer Identifizierungsschaltungseinrichtung,
die zwischen einen Spannungsversorgungsanschluß und einen der
Eingangsanschlüsse geschaltet ist, dadurch gekennzeichnet,
daß die Identifizierungsschaltungseinrichtung (20) einen
Spannungsbegrenzer (22) mit einem bestimmten Grenzspan
nungspegel zum Begrenzen des Eingangspotentialunterschiedes
zwischen einem der Spannungsversorgungsanschlüsse und einem
der Eingangsanschlüsse und eine Optionseinrichtung (24)
umfaßt, die in Reihe zum Spannungsbegrenzer (22) geschaltet
ist und die Identifizierungsinformation des Plättchens daraus
ermittelt, ob während des Herstellungsvorganges des Plätt
chens ein Stromweg gebildet ist oder nicht.
2. Halbleiterschaltungsplättchen nach Anspruch 1,
dadurch gekennzeichnet, daß der Spannungsbegrenzer (22)
mehrere in Reihe geschaltete MOS-Transistoren (M1-Mn) umfaßt,
deren Gates mit ihren Drains verbunden sind, so daß der
bestimmte Grenzspannungspegel auf die Summe der Schwellen
spannungen der MOS-Transistoren (M1-Mn) festgelegt ist.
3. Halbleiterschaltungsplättchen nach Anspruch 1,
dadurch gekennzeichnet, daß die Optionseinrichtung (24) aus
einer Sicherung (FU) besteht, die während des Herstel
lungsvorganges des Plättchens in einen leitenden oder in
einen nicht leitenden Zustand gebracht ist.
4. Halbleiterschaltungsplättchen nach Anspruch 1,
dadurch gekennzeichnet, daß die Optionseinrichtung (24) aus
einem Metalldraht besteht, der zwischen dem Gate und der
Source eines MOS-Transistors angeordnet ist, der mit dem
Spannungsbegrenzer verbunden ist, wobei der Metalldraht
wahrend der Metallisierung zur Bildung der leitenden
Anschlüsse beim Herstellungsvorgang des Plättchens ausgebil
det ist.
5. Halbleiterschaltungsplättchen nach Anspruch 1,
dadurch gekennzeichnet, daß die Optionseinrichtung (24)
mehrere Kombinationen aus einem MOS-Transistor (MA1-MAn),
dessen Gate mit seinem Drain verbunden ist, und aus einer
Sicherung (FU1-FUn) umfaßt, die mit der Source des zugehöri
gen MOS-Transistors (MA1-MAn) verbunden ist, wobei die
Kombinationen parallel zueinander geschaltet sind und die
Identifizierungsinformation des Plättchens daraus abgeleitet
wird, wieviele Sicherungen (FU1-FUn) durchgeschmolzen sind.
6. Integriertes Halbleiterschaltungsplättchen mit zwei
Spannungsversorgungsanschlüssen und wenigstens drei Eingangs
anschlüssen sowie einer Identifizierungsschaltungseinrich
tung, die mit einem der Spannungsversorgungsanschlüsse und
mit drei der wenigstens drei Eingangsanschlüsse verbunden
ist, dadurch gekennzeichnet, daß die Identifizierungsschal
tungseinrichtung (30) einen Spannungsbegrenzer (32) mit einem
bestimmten Grenzspannungspegel zum Begrenzen des Potential
unterschiedes zwischen dem Spannungsversorgungsanschluß und
einem der drei Eingangsanschlüsse und zum anschließenden
Erzeugen einer bestimmten Steuerspannung durch Teilen des
Grenzspannungspegels, eine Optionseinrichtung (34), die
zwischen die verbleibenden beiden Eingangsanschlüsse der drei
Eingangsanschlüsse geschaltet ist und die Identifizierungsin
formation des Plättchens daraus ableitet, ob während des
Herstellungsvorganges des Plättchens ein Stromweg gebildet
ist oder nicht, und eine Schaltereinrichtung (36) umfaßt, die
in Reihe zur Optionseinrichtung (34) geschaltet ist, wobei
die Schaltereinrichtung (36) durch die Steuerspannung vom
Spannungsbegrenzer (32) angeschaltet wird.
7. Halbleiterschaltungsplättchen nach Anspruch 6,
dadurch gekennzeichnet, daß der Spannungsbegrenzer (32)
mehrere in Reihe geschaltete MOS-Transistoren (MB1-MBn),
deren Gates jeweils mit ihren Drains verbunden sind, und
einen Widerstand (R) umfaßt, der mit den MOS-Transistoren
(MB1-MBn) verbunden ist, wobei der Grenzspannungspegel die
Summe aus der Klemmenspannung des Widerstandes (R) und den
Schwellenspannungen der MOS-Transistoren (MB1-MBn) ist und
die Steuerspannung die Klemmenspannung des Widerstandes (R)
ist.
8. Integriertes Halbleiterschaltungsplättchen nach
Anspruch 6, dadurch gekennzeichnet, daß die Optionsein
richtung (34) mehrere Sicherungen (FUA1-FUAn) umfaßt, und die
Schaltereinrichtung (36) mehrere MOS-Transistoren (MC1-MCn)
umfaßt, wobei jede Sicherung (FUA1-FUAn) und jeder MOS-
Transistor (MC1-MCn) in Reihe zueinander geschaltet sind, die
MOS-Transistoren (MC1-MCn) durch die Steuerspannung durchge
schaltet werden, die an ihren Gates liegt, und die Identifi
zierungsinformation des Plättchens aus der Anzahl der
durchgeschmolzenen Sicherungen (FUA1-FUAn) abgeleitet wird.
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