DE4018615A1 - Schaltungsanordnung zur aufbereitung eines oszillatorsignals - Google Patents
Schaltungsanordnung zur aufbereitung eines oszillatorsignalsInfo
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- H03K5/1565—Arrangements in which a continuous pulse train is transformed into a train having a desired pattern the output pulses having a constant duty cycle
-
- H—ELECTRICITY
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- H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
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Landscapes
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- Nonlinear Science (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
Die Erfindung betrifft eine Schaltungsanordnung zur Aufbe
reitung eines Oszillatorsignals.
In der Kommunikationstechnik werden häufig, z.B. zur Modu
lation oder Demodulation von Signalen zur Nachrichtenüber
mittlung, Signale bestimmter Frequenz benötigt. Diese wer
den in Oszillatoren erzeugt und den entsprechenden Bau
gruppen zugeleitet. Die Oszillatorsignale erfüllen aber
insbesondere bei hohen Frequenzen häufig nicht die Anfor
derungen hinsichtlich Verzerrungsfreiheit, die für ein
wandfreien Betrieb der nachfolgenden Baugruppen notwendig
sind.
Aufgabe der vorliegenden Erfindung ist daher, eine vor
teilhafte Schaltungsanordnung zur Aufbereitung eines Os
zillatorsignals, insbesondere zur Erzielung eines Tastver
hältnisses von 0,5 im aufbereiteten Oszillatorsignal an
zugeben.
Die Erfindung ist im Patentanspruch 1 beschrieben. Die Un
teransprüche enthalten vorteilhafte Ausgestaltungen der
Erfindung.
Die Erfindung ist insbesondere auch bei unsymmetrisch zu
geführten Eingangssignal und symmetrisch abgenommenen Aus
gangssignal vorteilhaft einsetzbar.
Die Erfindung ist nachfolgend anhand eines Beispiels unter
Bezugnahme auf die Abbildung noch veranschaulicht.
Das Oszillatorsignal LO ist unsymmetrisch an den Eingang
einer aus mehreren Verstärkerstufen LV1, LV2, LV3, von
denen die letzte (LV3) vorzugsweise in die Begrenzung ge
steuert ist, aufgebauten Verstärkeranordnung LV gelegt.
Das Ausgangssignal der letzten Verstärkerstufe LV3 ist ei
nem Detektor SD zugeführt, der fortlaufend das Tastver
hältnis des begrenzten Ausgangssignals detektiert und bei
von 0,5 abweichendem Tastverhältnis über einen Regelver
stärker HRV ein Regelsignal LR für die erste Verstärker
stufe LV1 erzeugt, das der Unsymmetrie entgegenwirkt, bei
spielsweise durch eine Gleichspannungs-Pegelveschiebung
des Eingangs- oder Ausgangssignals der ersten Verstärker
stufe, wodurch sich der Schaltzeitpunkt des Verstärkers
ändert. Durch den externen Kondensator C1 ist die Regel
zeitkonstante der Regelschleife einstellbar. Das Ausgangs
signal der letzten Verstärkerstufe LV3, für welches durch
die Regelschleife mit SD und HRV Halbwellensymmetrie
(Tastverhältnis 0,5) gewährleistet ist, ist beispielsweise
an den Eingang einer Frequenzverd opplungsschaltung FD ge
legt, die ein Signal doppelter Frequenz abgibt. Bei guter
Halbwellensymmetrie des Signals am Eingang von FD ist die
Grundwelle im Ausgangssignal von FD weitestgehend unter
drückt.
Eine andere, besonders bedeutsame Verwendung des aufgear
beiteten Ausgangssignals ist in der Ansteuerung einer Mi
scheranordnung, z.B. eines Gegentaktmischers zur Fre
quenzumsetzung zu sehen. Die Schaltungsanordnung zur Auf
bereitung des Oszillatorsignals ist vorzugsweise mit ande
ren Baugruppen, insbesondere der von dem aufbereiteten Si
gnal direkt angesteuerten Baugruppe monolithisch inte
griert.
Der Detektor SD kann als einfacher RC-Integrator ausge
führt sein. Zu beachten ist, daß der Detektor nicht unmit
telbar das Ausgangssignal verfälscht, weshalb vorzugsweise
das Regelsignal LR nicht aus dem Ausgangssignal selbst,
sondern aus einem diesem proportionalen Signal abgeleitet
ist.
Die skizzierte Anordnung stellt lediglich eine Ausfüh
rungsform der Erfindung dar, ohne diese darauf einzu
schränken. Insbesondere braucht der Verstärker LV nicht
mehrstufig ausgeführt sein und das Oszillatorsignal kann
je noch Anwendungsfall auch linear verstärkt oder nur
schwach begrenzt werden.
Claims (3)
1. Schaltungsanordnung zur Aufbereitung eines Oszillator
signals, dadurch gekennzeichnet, daß das Oszillatorsignal
an die Eingänge eines Verstärkers gelegt ist, an dessen
Ausgang das aufbereitete oszillatorsignal abnehmbar ist,
daß ein Regeldetektor aus dem aufbereiteten Oszillatorsi
gnal oder einem dazu proportionalen Signal ein Regelsignal
derart ableitet und auf ein Signalweg vor dem Verstärker
ausgang liegende Stellmittel leitet, daß das aufbereitete
Oszillatorsignal ein Tastverhältnis von 0,5 aufweist.
2. Schaltungsanordnung nach Anspruch 1, dadurch gekenn
zeichnet, daß die Stellmittel eine Verschiebung des
Gleichspannungspegels an einen Punkt im Signalweg bewir
ken.
3. Schaltungsanordnung nach Anspruch 1 oder 2, dadurch
gekennzeichnet, daß der Verstärker ein Begrenzerverstärker
ist.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE4018615A DE4018615A1 (de) | 1989-06-09 | 1990-06-11 | Schaltungsanordnung zur aufbereitung eines oszillatorsignals |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
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DE3918829 | 1989-06-09 | ||
DE4018615A DE4018615A1 (de) | 1989-06-09 | 1990-06-11 | Schaltungsanordnung zur aufbereitung eines oszillatorsignals |
Publications (1)
Publication Number | Publication Date |
---|---|
DE4018615A1 true DE4018615A1 (de) | 1990-12-13 |
Family
ID=25881749
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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DE4018615A Ceased DE4018615A1 (de) | 1989-06-09 | 1990-06-11 | Schaltungsanordnung zur aufbereitung eines oszillatorsignals |
Country Status (1)
Country | Link |
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DE (1) | DE4018615A1 (de) |
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